PIC16(L)F145X
PIC16 （ L） F145X内存编程规范
本文件包含的
编程规范
下列设备：
PIC16F1454
PIC16F1455
PIC16F1459
PIC16LF1454
PIC16LF1455
PIC16LF1459
1.1.2
低电压ICSP
程序设计
在低电压ICSP 模式下，这些设备可以是
使用单个V编程
DD
源中的
工作范围。在MCLR / V
PP
销不必
是赞助商不同的电压，但可以改为左
在正常的工作电压。
1.0
概观
1.1.2.1
单电源ICSP编程
该设备就可以利用高编程
电压在线串行编程（ICSP ）
法或低压ICSP方法。
当使用低电压ICSP 编程
（ LVP =
1),
在ICSPDAT / ICSPCLK功能
在RA0 / RA1端口引脚还开启。这
传统的编程功能，提供兼容性
现有PIC18F1XK50的设计支持。对于新
外观设计上采用了ICSPDAT / ICSPCLK功能
在RC0 / RC1端口引脚建议。
对于传统编程支持，请参考
第4.2.1节“传统ICSP引脚编程” 。
配置字2的LVP位使单
供应（低电压） ICSP编程。 LVP位
缺省值为'1' （启用）从工厂。 LVP位
只能通过输入高被编程为“0”
电压ICSP模式，其中MCLR / V
PP
被拉高
到V
IHH
。一旦LVP位被编程为“0” ，只
高电压ICSP模式是可用的，并只在
高电压ICSP模式可以被用来编程
装置。
注1 ：
高电压ICSP模式始终
可用的，而不管状态
LVP位，通过施加V
IHH
到MCLR /
V
PP
引脚。
2:
而在低电压ICSP模式下， MCLR
始终处于启用状态，无论
MCLRE位，以及端口引脚可无
再用作通用
输入。
1.1
1.1.1
硬件要求
高电压ICSP
程序设计
在高电压ICSP 模式，这些设备需要
两个可编程电源：一个是V
DD
和
一个是MCLR / V
PP
引脚。
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1.2
利用针
需要为ICSP 编程五个引脚。这是
推荐使用中列出的销
表1-1 。
为
PIC18F1XK50传统设计参考
第4.2.1节
“传统ICSP引脚编程” 。
表1-1：
引脚名称
在编程过程中推荐的引脚说明
在编程过程中
功能
PIN TYPE
I
I / O
P
(1)
P
P
引脚说明
时钟输入 - 施密特触发器输入
数据输入/输出 - 施密特触发器输入
编程模式选择/编程电源
电源
地
RC1
RC0
MCLR / V
PP
/RA3
V
DD
V
SS
图例：
注1 ：
ICSPCLK
ICSPDAT
编程/校验模式
V
DD
V
SS
I =输入， O =输出， P =电源
在编程高电压由内部产生。要激活编程/校验模式，高电压需要
加到MCLR输入。由于MCLR被用于电平信号源， MCLR不作出任何显著的电流。
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2.0
器件引脚
销图示于
图2-1
通过
图2-4 。
所需要的编程销
列于
表1-1
并示出在粗体字
引脚图。
图2-1：
14引脚PDIP ， SOIC ， TSSOP示意图PIC16 （ L） F1454 / 1455
PDIP ， SOIC ， TSSOP
V
DD
RA5
RA4
MCLR / V
PP
/RA3
RC5
RC4
RC3
1
PIC16(L)F1454/1455
2
3
4
5
6
7
14
13
12
11
10
9
8
V
SS
RA0/D+/ICSPDAT
(1)
RA1/D-/ICSPCLK
(1)
V
USB3V3
RC0/ICSPDAT
RC1/ICSPCLK
RC2
注1 ：
LVP支持PIC18 （ L） F1XK50传统设计。
图2-2：
QFN （ 4×4 ）
16引脚QFN封装示意图PIC16 （ L） F1454 / 1455
V
DD
VSS
NC
16 15 14 13
RA5
RA4
MCLR / V
PP
/RA3
RC5
PIC16(L)F1454/1455
1
2
3
4
12
11
10
9
8
RA0/D+/ICSPDAT
(1)
RA1/D-/ICSPCLK
(1)
V
USB3V3
RC0/ICSPDAT
5
6
RC4
RC3
NC
7
RC2
注1 ：
LVP支持PIC18 （ L） F1XK50传统设计。
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ICSPCLK/RC1
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图2-3：
20引脚PDIP ， SOIC ， SSOP示意图PIC16 （ L） F1459
PDIP ， SOIC ， SSOP
V
DD
RA5
RA4
MCLR / V
PP
/RA3
RC5
RC4
RC3
RC6
RC7
RB7
1
2
PIC16(L)F1459
3
4
5
6
7
8
9
10
20
19
18
17
16
15
14
13
12
11
V
SS
RA0/D+/ICSPDAT
(1)
RA1/D-/ICSPCLK
(1)
V
USB3V3
RC0/ICSPDAT
RC1/ICSPCLK
RC2
RB4
RB5
RB6
注1 ：
LVP支持PIC18 （ L） F1XK50传统设计。
图2-4：
20引脚QFN封装示意图PIC16 （ L） F1459
RA4
RA5
V
DD
VSS
RA0/D+/ICSPDAT
(1)
20 19 18 17 16
1
2
3
4
5
PIC16(L)F1459
MCLR / V
PP
/RA3
RC5
RC4
RC3
RC6
15
14
13
12
11
RA1/D-/ICSPCLK
(1)
V
USB3V3
RC0/ICSPDAT
RC1/ICSPCLK
RC2
6 7 8 9 10
QFN （ 4×4 ）
注1 ：
LVP支持PIC18 （ L） F1XK50传统设计。
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超前信息
RC7
RB7
RB6
RB5
RB4
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3.0
存储器映射
该内存被分为两个部分：计划
存储器和配置存储器。唯一的尺寸
设备之间的程序存储器发生变化，
配置存储器保持不变。
图3-1：
PIC16 （ L） F1454 /一千四百五十九分之一千四百五十五程序存储器映射
8千瓦
0000h
实施
1FFFh
映射到
0-1FFFh
8000h
8001h
8002h
8003h
8004h
8005h
8006h
8007h
8008h
8009h
800Ah
800Bh-81FFh
用户ID的位置
用户ID的位置
用户ID的位置
用户ID的位置
版权所有
修订ID
器件ID
配置字1
配置字2
校准字1
FFFFH
校准字2
版权所有
映射到
8000-81FFh
7FFFh
8000h
8200h
程序存储器
实施
配置存储器
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