【21098765432121098765432109876543210987654321210987】,IC型号PI6C2516,PI6C2516 PDF资料,PI6C2516经销商,ic,电子元器件-51电子网

21098765432121098765432109876543210987654321210987654321098765432109876543212109876543210987654321098765432121098765432109876543210987654321

PI6C2516

锁相环时钟驱动器

16个时钟输出

产品特点

??高性能锁相环时钟分布

同步DRAM ，服务器和网络应用。

??零输入至输出延时：分发一个时钟输入

以四家银行的四路输出，有独立的输出使能

每个银行。

??让时钟输入有扩频调制

降低EMI 。时钟输出跟踪时钟输入

调制。

?? 150 MHz的最大时钟频率。

??低抖动：周期到周期抖动± 100ps的最大

??工作电压为3.3V V

CC

??可用包装：

?? 48引脚TSSOP （薄小外形封装）（ A）

描述

该PI6C2516家庭是一个低偏移，低抖动锁相环

（PLL）的时钟驱动器，分配高频时钟信号，用于

SDRAM ，服务器和网络应用。通过连接

反馈Fb_out分别输出到反馈FB_IN输入时， propa-

gation延迟从CLK输入到任何时钟输出将是近

零。这种零延迟功能使CLK输入时钟是

分布式，提供四路输出4组。

出于测试目的，该PLL可以通过捆扎的AV被绕过

CC

到地面。

该PI6C2516系列具有相同的引脚排列与TI CDC2516 ，与

让扩频时钟输入的附加功能。

引脚说明

VCC

1Y0

1Y1

GND

1Y2

1Y3

VCC

1G

GND

AVCC

CLK

AGND

GND

2G

VCC

2Y0

2Y1

GND

2Y2

2Y3

VCC

1

48

2

47

3

46

4

45

5

44

6

43

7

42

8

41

9

40

10

48-Pin

39

11

A

38

12

37

13

36

14

35

15

34

16

33

17

32

18

31

19

30

20

29

21

28

22

27

23

26

24

25

VCC

4Y0

4Y1

GND

4Y2

4Y3

VCC

4G

GND

AVCC

FB_IN

AGND

Fb_out分别

GND

3G

VCC

3Y0

3Y1

GND

3Y2

3Y3

VCC

框图

1G

2G

3G

4G

4

1Y [0:3]

2Y [0:3]

3Y [0:3]

CLK

PLL

FB_IN

AVCC

4

4Y [0:3]

Fb_out分别

1

PS8440C

07/24/01

21098765432121098765432109876543210987654321210987654321098765432109876543212109876543210987654321098765432121098765432109876543210987654321

PI6C2516

锁相环时钟驱动器

16个时钟输出

引脚功能

引脚名称

CLK

FB_IN

针Numbe

12

37

TYPE

I

电子旗下cription

时钟输入。 CLK允许扩频。

反馈输入。 FB_IN提供反馈信号到内部PLL 。

CLK

↑

和FB_IN

↑

是同步的，以便有正常零相

CLK和FB_IN之间的误差。

银行安输出使能。当1G的LO W，输出1Y [ 0 ： 3 ]是残疾人

逻辑低状态。当1G为高电平时，所有输出端1Y [0：3 ]的启用和

在切换频率相同的CLK 。

银行安输出使能。当2G是LO W，输出2Y [ 0 ： 3 ]是残疾人

逻辑低状态。当2G为高电平时，所有输出端2Y [0：3 ]的启用和

在切换频率相同的CLK 。

银行安输出使能。当3G是LO W，输出3Y [ 0 ： 3 ]是残疾人

逻辑低状态。当3G为高电平时，所有输出3Y [0：3 ]的启用和

在切换频率相同的CLK 。

银行安输出使能。当4G是LO W，输出4Y [ 0 ： 3 ]是残疾人

逻辑低状态。当4G为高电平时，所有输出4Y [0：3 ]的启用和

在切换频率相同的CLK 。

反馈输出。 FB_O UT专用于外部反馈。 FB_O UT有

嵌入式25

串联阻尼值相同的时钟输出的电阻。

时钟输出。这些输出提供低CLK _IN歪斜副本。

每路输出都有一个嵌入式25

串联的阻尼电阻器

相同的值的时钟输出。

时钟输出。这些输出提供低CLK _IN歪斜副本。

每路输出都有一个嵌入式25

串联的阻尼电阻器

相同的值的时钟输出。

时钟输出。这些输出提供低CLK _IN歪斜副本。

每路输出都有一个嵌入式25

串联的阻尼电阻器

相同的值的时钟输出。

时钟输出。这些输出提供低CLK _IN歪斜副本。

每路输出都有一个嵌入式25

串联的阻尼电阻器

相同的值的时钟输出。

模拟电源。 AV

CC

也可以使用以绕过锁相环

测试目的。当AV

C C

绑在地上， PLL被旁路， CLK

直接缓冲到设备的输出。

1G

9

I

2G

16

I

3G

33

I

4G

FB_O UT

1Y[0:3]

40

35

2,3,6,7

I

O

2Y[0:3]

18,19,22,23

O

3Y[0:3]

26,27,30,31

O

4Y[0:3]

42,43,46,47

O

AV

CC

AGND

V

C C

GND

11,38

13,14,36

1,8,17,24,25,32,41,48

4,5,10,15,20,21,28,29,

34,39,44,45

动力

地面模拟地。 AGND为模拟电路的接地参考。

动力

电源

接地接地

2

PS8440C

07/24/01

21098765432121098765432109876543210987654321210987654321098765432109876543212109876543210987654321098765432121098765432109876543210987654321

PI6C2516

锁相环时钟驱动器

16个时钟输出

绝对最大额定值

（在工作自由空气的温度范围内，除非另有说明）

符号

V

CC

V

I

V

O

V

IK

I

O

ΔDC

I

O

ΔDC

动力

T

英镑

电源电压范围

输入电压范围

(1)

电压范围应用于任何输出

(1,2)

输入钳位电流

连续输出电流（V

O

= 0或V

CC

)

通过V连续输出

CC

或接地

在T最大功耗

A

= 55

o

C，静止空气中

(3)

储存温度

65

帕拉梅德

M英寸

0.5

50

±50

±100

0.85

150

W

o

C

M AX 。

4.6

6.5

V

CC

+ 0.5

单位

V

mA

??超出下??绝对最大额定值讲？可能对器件造成永久性损坏。这是一个压力等级

只有与设备，在这些或超出下标明的任何其他条件的功能操作“推荐工作

条件？是不是暗示。暴露在绝对最大额定值条件下长时间可能会影响其可靠性。

注意事项：

1.如果输入和输出钳位电流额定值是所观察到的输入和输出负电压额定值可能被超过。

2.该值被限制在4.6V最大。

3.最大的封装功耗采用150 ° C的结温为750密耳的电路板走线的长度来计算。

推荐工作条件

(4)

符号

V

CC

V

IH

V

IL

V

I

T

A

I

OH

I

OL

电源电压

高电平输入电压

低电平输入电压

输入电压

工作自由空气的温度

高电平输出电流

低电平输出电流

0.0

0

帕拉梅德

M英寸

3.0

2.0

0.8

V

CC

70

12

C

mA

M AX 。

3.6

V

单位

记

4.未使用的输入必须保持高电平或低电平，以防止它们飘浮。

3

PS8440C

07/24/01

21098765432121098765432109876543210987654321210987654321098765432109876543212109876543210987654321098765432121098765432109876543210987654321

PI6C2516

锁相环时钟驱动器

16个时钟输出

功能表

xG

L

H

注意：

x是从1到4

CLK

L

H

L

H

XY [0：3 ]

L

H

Fb_out分别

L

H

L

H

电气特性

（在推荐工作的自由空气的温度范围）

符号

V

IK

，输入钳位电压

V

OH

特S T条件

输入电流？ 18毫安

I

OH

= 100A

I

OH

= -12mA

I

OH

= -6mA

I

OL

= 100A

V

OL

I

，输入电流

模拟电源电流，I

CC

C

I

C

O

I

CC

I

OL

= 12毫安

I

OL

= 6毫安

时钟输入电压= V

CC

或GND

时钟输入电压= V

CC

或GND

输入电压= V

CC

或GND

本安输出电压= V

CC

或GND

NE输入@ V

CC

0.6V,

其他投入@V

CC

或GND

V

CC

3V

分钟。马克斯。

3V

分钟。马克斯。

3V

V

CC

0.2

2.1

2.4

M英寸

典型值。

0.79

2.99

2.66

2.83

0.01

0.3

0.15

0.2

0.8

0.55

±5

12

4.0

6.0

5.0

500

4.0

A

mA

pF

A

V

M AX 。

1.2

单位

3.6V

3.3V

3.3V至3.6V

4

PS8440C

07/24/01

ICC （MA ）

21098765432121098765432109876543210987654321210987654321098765432109876543212109876543210987654321098765432121098765432109876543210987654321

PI6C2516

锁相环时钟驱动器

16个时钟输出

时序要求

（在推荐的电源电压范围和经营自由的空气温度）

符号

F

CLKOP

t

CLKAPP

t

STABLILIZATION

D

CYI

帕拉梅德

perator时钟频率

(1)

应用时钟频率

(2,4)

稳定时间后开机

(3)

输入时钟的占空比

M英寸

25

6

40

M AX 。

150

133

1

60

单位

兆赫

ms

%

注意事项：

1.工作时钟频率指示的范围超过该PLL必须能够锁定的，但其中不

以满足其他时序参数（用于低速系统调试）必需的。

2.应用时钟频率指示范围该PLL必须满足所有的时序参数。

3.以获得其反馈信号的相位锁定到它的基准信号所需的集成PLL电路的时间。对于锁相是

得到的，固定频率，固定相位基准信号必须存在于CLK 。直到获得相位锁定，规格

传播延迟，在开关特性表中给出偏移和抖动的参数是不适用的。

4.频率和负载条件下应不超过0.85瓦特功耗（包限制）。请参阅格拉夫1 。

350

300

250

200

150

100

50

0

50

100

150

负载= 22pF的

LOAD = 10pF的

时钟频率（MHz）

图1.动态电流与时钟频率

(V

CC

= 3.6V ，T

A

= 25°C)

开关特性

帕拉梅德

t

相

错误

t

sk(O)(2)

抖动

（ PK- PK）

占空比

t

r

t

f

（在推荐的电源电压和工作的自由空气温度，C的范围

L

= 22pF的）

(1,3)

从

（输入）

CLKIN

↑

= 100MHz的

任何Y或FBOUT

F（ CLKIN >为66MHz ）

F（ CLKIN

≤

66MHz)

F（ CLKIN >为66MHz ）

CLKIN = 50 150MHz的

从20％到80％

To

（输出）

FBIN

↑

V

CC

= 3.3V ± 0.165V

M英寸

典型值。

M AX 。

V

CC

= 3.3V ± 0.3V

M英寸

150

100

典型值。

M AX 。

+170

200

100

55

2.1

2.5

45

单位

ps

任何Y或FBOUT

1.3

1.7

2.1

2.5

%

ns

0.7

1.2

注意事项：

1.这些参数不是生产测试。

2.经t

SK （ O）

规范仅适用于所有输出的负载相等。

3.规范在此表中的参数仅适用后的任何合适的稳定时间后。

5

PS8440C

07/24/01

21098765432121098765432109876543210987654321210987654321098765432109876543212109876543210987654321098765432121098765432109876543210987654321

PI6C2516

锁相环时钟驱动器

16个时钟输出

产品特点

??高性能锁相环时钟分布

同步DRAM ，服务器和网络应用。

??零输入至输出延时：分发一个时钟输入

以四家银行的四路输出，有独立的输出使能

每个银行。

??让时钟输入有扩频调制

降低EMI 。时钟输出跟踪时钟输入

调制。

?? 150 MHz的最大时钟频率。

??低抖动：周期到周期抖动± 100ps的最大

??工作电压为3.3V V

CC

??可用包装：

?? 48引脚TSSOP （薄小外形封装）（ A）

描述

该PI6C2516家庭是一个低偏移，低抖动锁相环

（PLL）的时钟驱动器，分配高频时钟信号，用于

SDRAM ，服务器和网络应用。通过连接

反馈Fb_out分别输出到反馈FB_IN输入时， propa-

gation延迟从CLK输入到任何时钟输出将是近

零。这种零延迟功能使CLK输入时钟是

分布式，提供四路输出4组。

出于测试目的，该PLL可以通过捆扎的AV被绕过

CC

到地面。

该PI6C2516系列具有相同的引脚排列与TI CDC2516 ，与

让扩频时钟输入的附加功能。

引脚说明

VCC

1Y0

1Y1

GND

1Y2

1Y3

VCC

1G

GND

AVCC

CLK

AGND

GND

2G

VCC

2Y0

2Y1

GND

2Y2

2Y3

VCC

1

48

2

47

3

46

4

45

5

44

6

43

7

42

8

41

9

40

10

48-Pin

39

11

A

38

12

37

13

36

14

35

15

34

16

33

17

32

18

31

19

30

20

29

21

28

22

27

23

26

24

25

VCC

4Y0

4Y1

GND

4Y2

4Y3

VCC

4G

GND

AVCC

FB_IN

AGND

Fb_out分别

GND

3G

VCC

3Y0

3Y1

GND

3Y2

3Y3

VCC

框图

1G

2G

3G

4G

4

1Y [0:3]

2Y [0:3]

3Y [0:3]

CLK

PLL

FB_IN

AVCC

4

4Y [0:3]

Fb_out分别

1

PS8440C

07/24/01

21098765432121098765432109876543210987654321210987654321098765432109876543212109876543210987654321098765432121098765432109876543210987654321

PI6C2516

锁相环时钟驱动器

16个时钟输出

引脚功能

引脚名称

CLK

FB_IN

针Numbe

12

37

TYPE

I

电子旗下cription

时钟输入。 CLK允许扩频。

反馈输入。 FB_IN提供反馈信号到内部PLL 。

CLK

↑

和FB_IN

↑

是同步的，以便有正常零相

CLK和FB_IN之间的误差。

银行安输出使能。当1G的LO W，输出1Y [ 0 ： 3 ]是残疾人

逻辑低状态。当1G为高电平时，所有输出端1Y [0：3 ]的启用和

在切换频率相同的CLK 。

银行安输出使能。当2G是LO W，输出2Y [ 0 ： 3 ]是残疾人

逻辑低状态。当2G为高电平时，所有输出端2Y [0：3 ]的启用和

在切换频率相同的CLK 。

银行安输出使能。当3G是LO W，输出3Y [ 0 ： 3 ]是残疾人

逻辑低状态。当3G为高电平时，所有输出3Y [0：3 ]的启用和

在切换频率相同的CLK 。

银行安输出使能。当4G是LO W，输出4Y [ 0 ： 3 ]是残疾人

逻辑低状态。当4G为高电平时，所有输出4Y [0：3 ]的启用和

在切换频率相同的CLK 。

反馈输出。 FB_O UT专用于外部反馈。 FB_O UT有

嵌入式25

串联阻尼值相同的时钟输出的电阻。

时钟输出。这些输出提供低CLK _IN歪斜副本。

每路输出都有一个嵌入式25

串联的阻尼电阻器

相同的值的时钟输出。

时钟输出。这些输出提供低CLK _IN歪斜副本。

每路输出都有一个嵌入式25

串联的阻尼电阻器

相同的值的时钟输出。

时钟输出。这些输出提供低CLK _IN歪斜副本。

每路输出都有一个嵌入式25

串联的阻尼电阻器

相同的值的时钟输出。

时钟输出。这些输出提供低CLK _IN歪斜副本。

每路输出都有一个嵌入式25

串联的阻尼电阻器

相同的值的时钟输出。

模拟电源。 AV

CC

也可以使用以绕过锁相环

测试目的。当AV

C C

绑在地上， PLL被旁路， CLK

直接缓冲到设备的输出。

1G

9

I

2G

16

I

3G

33

I

4G

FB_O UT

1Y[0:3]

40

35

2,3,6,7

I

O

2Y[0:3]

18,19,22,23

O

3Y[0:3]

26,27,30,31

O

4Y[0:3]

42,43,46,47

O

AV

CC

AGND

V

C C

GND

11,38

13,14,36

1,8,17,24,25,32,41,48

4,5,10,15,20,21,28,29,

34,39,44,45

动力

地面模拟地。 AGND为模拟电路的接地参考。

动力

电源

接地接地

2

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07/24/01

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PI6C2516

锁相环时钟驱动器

16个时钟输出

绝对最大额定值

（在工作自由空气的温度范围内，除非另有说明）

符号

V

CC

V

I

V

O

V

IK

I

O

ΔDC

I

O

ΔDC

动力

T

英镑

电源电压范围

输入电压范围

(1)

电压范围应用于任何输出

(1,2)

输入钳位电流

连续输出电流（V

O

= 0或V

CC

)

通过V连续输出

CC

或接地

在T最大功耗

A

= 55

o

C，静止空气中

(3)

储存温度

65

帕拉梅德

M英寸

0.5

50

±50

±100

0.85

150

W

o

C

M AX 。

4.6

6.5

V

CC

+ 0.5

单位

V

mA

??超出下??绝对最大额定值讲？可能对器件造成永久性损坏。这是一个压力等级

只有与设备，在这些或超出下标明的任何其他条件的功能操作“推荐工作

条件？是不是暗示。暴露在绝对最大额定值条件下长时间可能会影响其可靠性。

注意事项：

1.如果输入和输出钳位电流额定值是所观察到的输入和输出负电压额定值可能被超过。

2.该值被限制在4.6V最大。

3.最大的封装功耗采用150 ° C的结温为750密耳的电路板走线的长度来计算。

推荐工作条件

(4)

符号

V

CC

V

IH

V

IL

V

I

T

A

I

OH

I

OL

电源电压

高电平输入电压

低电平输入电压

输入电压

工作自由空气的温度

高电平输出电流

低电平输出电流

0.0

0

帕拉梅德

M英寸

3.0

2.0

0.8

V

CC

70

12

C

mA

M AX 。

3.6

V

单位

记

4.未使用的输入必须保持高电平或低电平，以防止它们飘浮。

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PS8440C

07/24/01

21098765432121098765432109876543210987654321210987654321098765432109876543212109876543210987654321098765432121098765432109876543210987654321

PI6C2516

锁相环时钟驱动器

16个时钟输出

功能表

xG

L

H

注意：

x是从1到4

CLK

L

H

L

H

XY [0：3 ]

L

H

Fb_out分别

L

H

L

H

电气特性

（在推荐工作的自由空气的温度范围）

符号

V

IK

，输入钳位电压

V

OH

特S T条件

输入电流？ 18毫安

I

OH

= 100A

I

OH

= -12mA

I

OH

= -6mA

I

OL

= 100A

V

OL

I

，输入电流

模拟电源电流，I

CC

C

I

C

O

I

CC

I

OL

= 12毫安

I

OL

= 6毫安

时钟输入电压= V

CC

或GND

时钟输入电压= V

CC

或GND

输入电压= V

CC

或GND

本安输出电压= V

CC

或GND

NE输入@ V

CC

0.6V,

其他投入@V

CC

或GND

V

CC

3V

分钟。马克斯。

3V

分钟。马克斯。

3V

V

CC

0.2

2.1

2.4

M英寸

典型值。

0.79

2.99

2.66

2.83

0.01

0.3

0.15

0.2

0.8

0.55

±5

12

4.0

6.0

5.0

500

4.0

A

mA

pF

A

V

M AX 。

1.2

单位

3.6V

3.3V

3.3V至3.6V

4

PS8440C

07/24/01

ICC （MA ）

21098765432121098765432109876543210987654321210987654321098765432109876543212109876543210987654321098765432121098765432109876543210987654321

PI6C2516

锁相环时钟驱动器

16个时钟输出

时序要求

（在推荐的电源电压范围和经营自由的空气温度）

符号

F

CLKOP

t

CLKAPP

t

STABLILIZATION

D

CYI

帕拉梅德

perator时钟频率

(1)

应用时钟频率

(2,4)

稳定时间后开机

(3)

输入时钟的占空比

M英寸

25

6

40

M AX 。

150

133

1

60

单位

兆赫

ms

%

注意事项：

1.工作时钟频率指示的范围超过该PLL必须能够锁定的，但其中不

以满足其他时序参数（用于低速系统调试）必需的。

2.应用时钟频率指示范围该PLL必须满足所有的时序参数。

3.以获得其反馈信号的相位锁定到它的基准信号所需的集成PLL电路的时间。对于锁相是

得到的，固定频率，固定相位基准信号必须存在于CLK 。直到获得相位锁定，规格

传播延迟，在开关特性表中给出偏移和抖动的参数是不适用的。

4.频率和负载条件下应不超过0.85瓦特功耗（包限制）。请参阅格拉夫1 。

350

300

250

200

150

100

50

0

50

100

150

负载= 22pF的

LOAD = 10pF的

时钟频率（MHz）

图1.动态电流与时钟频率

(V

CC

= 3.6V ，T

A

= 25°C)

开关特性

帕拉梅德

t

相

错误

t

sk(O)(2)

抖动

（ PK- PK）

占空比

t

r

t

f

（在推荐的电源电压和工作的自由空气温度，C的范围

L

= 22pF的）

(1,3)

从

（输入）

CLKIN

↑

= 100MHz的

任何Y或FBOUT

F（ CLKIN >为66MHz ）

F（ CLKIN

≤

66MHz)

F（ CLKIN >为66MHz ）

CLKIN = 50 150MHz的

从20％到80％

To

（输出）

FBIN

↑

V

CC

= 3.3V ± 0.165V

M英寸

典型值。

M AX 。

V

CC

= 3.3V ± 0.3V

M英寸

150

100

典型值。

M AX 。

+170

200

100

55

2.1

2.5

45

单位

ps

任何Y或FBOUT

1.3

1.7

2.1

2.5

%

ns

0.7

1.2

注意事项：

1.这些参数不是生产测试。

2.经t

SK （ O）

规范仅适用于所有输出的负载相等。

3.规范在此表中的参数仅适用后的任何合适的稳定时间后。

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