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集成电路
PCK2509SA
50-150兆赫1 : 9 SDRAM时钟驱动器
产品speci fi cation
ICL03 - 电脑主板芯片;逻辑产品事业群
2000 12月1日
飞利浦
半导体
飞利浦半导体
产品speci fi cation
50-150兆赫1 : 9 SDRAM时钟驱动器
PCK2509SA
特点
锁相环时钟分配为
PC100 / PC133 SDRAM的应用
JEDEC兼容的操作PLL reamins锁定时输出
被禁用。
调节到50% ,而与占空比的CLK 。每
产出银行可以启用或经由单独禁用
控制( 1G和2G )的投入。当对G输入为高电平时,输出
切换在相位和频率上与CLK ;当对G输入为低时,
输出被禁止在逻辑低状态。
含锁相环与许多产品, PCK2509SA不
需要外部RC网络。对于PLL的环路滤波器是包含
片上,最大限度地减少了元件数量,电路板空间和成本。
因为它是基于锁相环电路,所述PCK2509SA需要
稳定时间以实现反馈信号提供给相位锁
参考信号。此稳定时间是必需的,以下通电
和应用一个固定频率,在CLK的定相的信号,并
下面的任何更改PLL参考或反馈信号。该
PLL可以通过捆扎AV绕过用于测试目的
CC
到地面。
该PCK2509SA的特点是操作从0 ° C至+ 70°C 。
低功耗版本,请参阅PCK2509SL哪里PLL进入
待机时输出被禁止..
扩频时钟兼容
工作频率为50 150MHz的
(t
相位误差
- 抖动) 100 to133兆赫=
±50
ps
抖动(峰 - 峰值)在100至133兆赫=
±
80 PS
抖动(周期循环)在100至133兆赫= 65 PS
引脚到引脚歪斜
& LT ;
200 PS
可在塑料24引脚TSSOP
分配一个时钟输入至五个输出中的一个银行,
四个输出一个银行
引脚配置
AGND
V
CC
1Y0
1Y1
1Y2
GND
GND
1Y3
1Y4
1
2
3
4
5
6
7
8
9
24 CLK
23 AV
CC
22 V
CC
21 2Y0
20 2Y1
19 GND
18 GND
17 2Y2
16 2Y3
15 V
CC
14 2G
13 FBIN
外部反馈( FBIN )端子用于同步的
输出到时钟输入
片系列阻尼电阻器
无需外部RC网络所需
工作在3.3 V
输入, 2.5 V和3.3 V范围内兼容
见特性曲线第7页
描述
该PCK2509SA是一款高性能,低偏移,低抖动,
锁相环(PLL)的时钟驱动器。它使用一个锁相环来精确
对齐,在频率和相位,所述反馈( FBOUT )输出到
的时钟(CLK)的输入信号。它是专为使用而设计的
同步DRAM 。该PCK2509SA工作在3.3 V V
CC
输入与两个2.5 V和3.3 V输入电压范围兼容。它
还提供了集成的串联阻尼电阻,使其理想
用于驱动点对点荷载。
五个输出四路输出一家银行一家银行,并提供9
低偏移, CLK低抖动的副本。输出信号的占空比为
V
CC
10
1G 11
FBOUT 12
SW00389
订购信息
套餐
24引脚塑料TSSOP
温度范围
0
°C
+70
°C
订货编号
PCK2509SADH
图号
SOT355-1
2000 12月1日
2
853–2228 25137
飞利浦半导体
产品speci fi cation
50-150兆赫1 : 9 SDRAM时钟驱动器
PCK2509SA
引脚说明
引脚数
1
2, 10, 15, 22
3, 4, 5, 8, 9
6, 7, 18, 19
11
符号
AGND
V
CC
1Y (0–4)
GND
1G
TYPE
GND
PWR
OUT
GND
IN
电源
时钟输出。
这些输出提供CLK的低偏移的副本。输出银行1Y ( 0-4 )启用
通过the1G输入。这些输出可以去断言1G控制被禁用逻辑低状态
输入。每个输出有一个集成的25
串联阻尼电阻。
输出组启用。
1G是输出使能输出端1Y (0-4) 。 1G时为低电平,输出
1Y ( 0-4)被禁用,以逻辑低状态。 1G时为高电平,所有输出1Y ( 0-4)被启用,
开关以相同的频率为时钟。
反馈输出。
FBOUT专用于外部反馈。它的开关频率为相同的频率
CLK 。当从外部连接到FBIN , FBOUT完成PLL的反馈环路。 FBOUT有
综合25
串联阻尼电阻。
反馈输入。
FBIN提供反馈信号到内部PLL 。 FBIN必须是硬线连接的
以FBOUT完成PLL 。该集成的PLL同步的CLK和FBIN使得存在
CLK和FBIN间名义上的零相位误差。
输出组启用。
2G是输出使能输出端2Y (0-3) 。当2G为低电平时,输出
2Y ( 0-3)被禁用,以逻辑低状态。 2G时为高电平,所有输出2Y ( 0-3)被启用,
开关以相同的频率为时钟。
时钟输出。
这些输出提供CLK的低偏移的副本。输出银行2Y ( 0-3)启用
通过2G输入。这些输出可以通过去断言2G被禁用,以一个逻辑低状态
控制输入。每个输出有一个集成的25
串联阻尼电阻。
模拟电源。
AV
CC
提供了用于模拟电路的功率参考。此外,
AV
CC
可用于绕过锁相环用于测试目的。当AV
CC
绑在地上, PLL是
旁路和CLK直接缓冲到该设备输出。
时钟输入。
CLK提供时钟信号,以通过所述PCK2509SA时钟驱动器进行分配。 CLK
被用来提供基准信号给所述集成PLL,它产生时钟输出
信号。 CLK必须具有固定频率和固定相位的锁相环,以获得相位锁定。一旦
该电路被加电和有效的CLK信号被施加,则所需的稳定化时间
PLL的相位锁定反馈信号到它的参考信号。
名称,功能和方向
模拟地。
AGND为模拟电路的接地参考。
12
FBOUT
OUT
13
FBIN
IN
14
2G
IN
16, 17, 20, 21
2Y (0–3)
OUT
23
AV
CC
PWR
24
CLK
IN
功能表
输入
1G
X
L
L
H
H
2G
X
L
H
L
H
CLK
L
H
H
H
H
1Y (0–4)
L
L
L
H
H
输出
2Y (0–3)
L
L
H
L
H
FBOUT
L
H
H
H
H
2000 12月1日
3
飞利浦半导体
产品speci fi cation
50-150兆赫1 : 9 SDRAM时钟驱动器
PCK2509SA
功能框图
1G
11
3
1Y0
4
1Y1
5
1Y2
8
9
1Y3
1Y4
2G
14
21
2Y0
20
CLK
FBIN
24
13
PLL
17
16
2Y1
2Y2
2Y3
AV
CC
23
12
FBOUT
SW00388
SDRAM
SDRAM
SDRAM
SDRAM
SDRAM
SDRAM
SDRAM
SDRAM
正面
A [ L] VC
A [ L] VC
A [ L] VC
PCK2509SA
PLL时钟分配器件和A [L] VC注册的司机减少
该存储器控制器上的信号的负载和防止定时延迟和
波形失真会导致不可靠的操作
2000 12月1日
4
SDRAM
SW00431
飞利浦半导体
产品speci fi cation
50-150兆赫1 : 9 SDRAM时钟驱动器
PCK2509SA
绝对最大额定值
1
按照绝对最大额定值系统( IEC 134 )
符号
AV
CC
V
CC
I
IK
V
I
I
OK
V
O
I
O
T
英镑
参数
电源电压范围
电源电压范围
输入钳位电流
输入电压范围
输出钳位电流
输出电压范围
DC输出源或灌电流
存储温度范围
V
I
& LT ; 0
注3
V
O
& GT ; V
CC
或V
O
& LT ; 0
注3 ,第4
V
O
= 0至V
CC
–65
–0.5
–0.5
条件
注2
–0.5
范围
最大
& LT ; V
CC
+ 0.7
+4.6
–50
6.5
±50
V
CC
+ 0.5
±50
+150
单位
V
V
mA
V
mA
V
mA
°C
P
合计
每个封装功耗
700
mW
注意事项:
1.强调超越那些可能会对设备造成永久性损坏。这些压力额定值只和功能操作
器件在这些或超出下标明的任何其他条件, “推荐工作条件”是不是暗示。接触
绝对最大额定条件下长时间可能会影响器件的可靠性。
2. AV
CC
一定不能超过V
CC
3.如果输入和输出电流额定值是所观察到的输入和输出电压额定值可能被超过。
4.该值被限制在4.6V的最大。
推荐工作条件
1
符号
V
CC
, AV
CC
V
IH
V
IL
V
I
T
AMB
参数
电源电压
高电平输入电压
低电平输入电压
输入电压
工作环境温度范围在自由空气
0
0
条件
范围
3
2
0.8
V
CC
+70
最大
3.6
单位
V
V
V
V
°C
注意:
1.未使用的输入必须保持高电平或低电平,以防止它们飘浮。
电气特性
在推荐工作的自由空气的温度范围内(除非另有说明)
符号
V
IK
V
OH
参数
输入钳位电压
高电平输出电压
测试条件
AV
CC
, V
CC
(V)
3
MIN到MAX
3
3
MIN到MAX
V
OL
I
I
I
CC 1
I
CC
C
I
C
O
低电平输出电压
输入电流
静态电源电流
每个额外的电源电流
输入引脚
输入电容
输出电容
3
3
3.6
3.6
3.3到3.6
3.3
3.3
其他
I
I
= -18mA
I
OH
= – 100A
I
OH
= - 12毫安
I
OH
= - 6毫安
I
OL
= 100A
I
OL
= 12毫安
I
OL
= 6毫安
V
I
= V
CC
或GND
V
I
= V
CC
或GND ;
I
O
= 0 ,输出:低或高
一个输入在V
CC
– 0.6V;
其他输入在V
CC
或GND
V
I
= V
CC
或GND
V
O
= V
CC
或GND
2.8
5.4
V
CC
– 0.2
2.1
2.4
0.2
0.8
0.55
±5
10
500
A
A
A
pF
pF
V
V
范围
典型值
最大
–1.2
单位
V
注意:
1.对于我
CCA
CC
与频率的关系,参见图1和图2 。
2000 12月1日
5
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