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集成电路
PCK2023
CK408 ( 66/100/133/200兆赫)
扩频差分系统
时钟发生器
产品数据
在集成电路文件 - ICL03
2001年9月07
飞利浦
半导体
飞利浦半导体
产品数据
CK408 ( 66/100/133/200兆赫)扩频
差分系统时钟发生器
PCK2023
特点
3.3 V工作电压
三个差分CPU时钟对
十个PCI时钟的3.3 V
六66 MHz的时钟在3.3 V
两个48 MHz的时钟在3.3 V
一个14.318 MHz的参考时钟
66100 , 133或200 MHz的操作
电源管理控制引脚
CPU时钟偏斜小于200ps的周期到周期
CPU时钟偏斜小于150 ps的引脚对引脚
1.5 ns至3.5 ns的延迟对PCI引脚
扩频功能
描述
该PCK2023是一个时钟合成器/驱动器的奔腾IV和
其他类似的处理器。
该PCK2023有三个差分对CPU的电流源
输出。还有在33 MHz和2运行10 PCI时钟输出
48 MHz的时钟。有六个3V66输出。最后,还有一
3.3 V参考时钟14.318兆赫。所有的时钟输出,符合Intel的
驱动强度,上升/下降时间,抖动,准确性和歪斜
要求。
该器件具有一个专用的掉电输入引脚电源
管理控制。此输入在片同步和
保证无干扰的输出转换。
引脚配置
V
DD
1
XTAL_IN
XTAL_OUT
V
SS
PCIF0
PCIF1
PCIF2
V
DD
V
SS
2
3
4
5
6
7
8
9
56 REF_0
55 S0
54 CPU3
53 CPU3
52 CPU0
51 CPU0
50 V
DD
49 CPU1
48 CPU1
47 V
SS
46 V
DD
45 CPU2
44 CPU2
43 MULT0
42 IREF
41 V
SS
IREF
40 S2
39 USB 48 MHz的
38 DOT 48兆赫
37 V
DD
48兆赫
36 V
SS
48兆赫
35 3V66_1 / VCH
34 PCI_Stop
33 3V66_0
32 V
DD
31 V
SS
30 SCLK
29 SDATA
PCI0 10
PCI1 11
PCI2 12
PCI3 13
V
DD
14
V
SS
15
PCI4 16
PCI5 17
PCI6 18
V
DD
19
V
SS
20
66Buff0 / 3V66_2 21
66Buff1 / 3V66_3 22
66Buff2 / 3V66_4 23
66IN / 3V66_5 24
25 PWRDWN
V
DD
A 26
V
SS
A 27
VTT_PWRGD 28
SW00695
订购信息
套餐
56引脚塑封SSOP
56引脚塑料TSSOP
温度范围
0至+70
°C
0至+70
°C
订货编号
PCK2023DL
PCK2023DGG
图号
SOT371-1
SOT364-1
Intel和Pentium是Intel Corporation的注册商标。
2001年9月07
2
853-2278 27052
飞利浦半导体
产品数据
CK408 ( 66/100/133/200 MHz)的传播
频谱差分系统时钟发生器
PCK2023
引脚说明
引脚数
56
2
3
44, 45, 48, 49, 51, 52
33
35
24
21, 22, 23
5, 6, 7
10, 11, 12, 13, 16, 17,
18
39
38
40
54, 55
42
43
25
34
53
28
29
30
1, 8, 14, 19, 32, 37, 46,
50
26
4, 9, 15, 20, 31, 36, 41,
47
27
符号
REF
XTAL_IN
XTAL_OUT
CPU & CPU
[2:0]
3V66_0
3V66_1/VCH
66In/3V66_5
66Buff [2:0 ] / 3V66 [4: 2]
PCIF
[2:0]
PCI
[6:0]
USB
DOT
S2
S1, S0
I
REF
Mult0
PWRDWN
PCI_STOP
CPU_STOP
VTT_PWRGD
SDATA
SCLOCK
V
DD
V
DD
A
V
SS
V
SS
A
3.3 V 14.318 MHz的时钟输出。
14.318 MHz的晶振输入。
14.318 MHz的晶振输出。
微分CPU时钟输出。
3.3 V 66 MHz的时钟输出。
3.3 V至我选择
2
C至为66 MHz或48 MHz的
66 MHz的输入缓冲66Buff和PCI或内部VCO 66 MHz的时钟。
66 MHz的缓冲来自66输入或内部VCO 66 MHz的时钟输出。
33 MHz的时钟从66输入分频或3V66分频。
PCI时钟输出66输入分频或3V66分频。
固定的48 MHz的时钟输出。
固定的48 MHz的时钟输出。
特殊的3.3 V 3级输入模式选择。
3.3 V LVTTL输入, CPU的频率选择。
精密电阻器被连接到该引脚被连接到内部电流
参考。
3.3伏的LVTTL输入,用于选择当前乘法器,用于在CPU的输出。
3.3 V LVTTL输入的PowerDown低电平有效。
3.3 V LVTTL输入PCI_Stop低电平有效。
3.3 V LVTTL输入CPU_Stop低电平有效。
3.3伏的LVTTL输入是用来确定一个电平敏感的选通时, S [ 2:0]和Mult0
输入是有效的,并确定进行采样(低电平有效) 。
I
2
C兼容型SDATA 。
I
2
C兼容型SCLOCK 。
3.3 V电源的输出。
3.3 V电源的PLL 。
地用于输出。
地面PLL 。
功能
2001年9月07
3
飞利浦半导体
产品数据
CK408 ( 66/100/133/200 MHz)的传播
频谱差分系统时钟发生器
PCK2023
框图
PWRDWN
X
文献[ 0 ] ( 14.318兆赫)
辛X
14.318
兆赫
OSC
USBPLL
PWRDWN
X
DOT / USB 48 MHz的
XOUT X
PWRDWN
SYSPLL
PWRDWN
IREF X
PWRDWN
IBIAS
X 3V66_1 / VCH ( 66,49兆赫)
X
CPU [ 0-2] ( 100/133兆赫)
X CPU [ 0-2] ( 100/133兆赫)
PWRDWN
X
3V66 [2-4] ( 66兆赫)
CPU STOP X
PCI STOP X
PWRDWN X
S2 X
S1 X
S0 X
MULT0 X
V
tt
PWRGD X
SDA X
SCL X
X
PCIF [ 0-2] ( 33兆赫)
PWRDWN
X
PCI [ 0-6 ] ( 33兆赫)
逻辑
PWRDWN
X
3V66_0 ( 66兆赫)
PWRDWN
X
66ln / 3V66_5 ( 66兆赫)
SW00861
2001年9月07
4
飞利浦半导体
产品数据
CK408 ( 66/100/133/200 MHz)的传播
频谱差分系统时钟发生器
PCK2023
频率选择/功能表
S2
1
1
1
1
0
0
0
0
MID
MID
S1
0
0
1
1
0
0
1
1
0
0
S0
0
1
0
1
0
1
0
1
0
1
中央处理器
66兆赫
100兆赫
200兆赫
133兆赫
66兆赫
100兆赫
200兆赫
133兆赫
Tclk/2
3V66
66兆赫
66兆赫
66兆赫
66兆赫
66兆赫
66兆赫
66兆赫
66兆赫
Tclk/4
66BUFF/
3V66
66
66
66
66
66兆赫
66兆赫
66兆赫
66兆赫
Tclk/4
66In/
3V66_5
66输入
66输入
66输入
66输入
66兆赫
66兆赫
66兆赫
66兆赫
Tclk/4
PCIF / PCI
66 / 2
66 / 2
66 / 2
66 / 2
33兆赫
33兆赫
33兆赫
33兆赫
Tclk/8
REF 0
14.318兆赫
14.318兆赫
14.318兆赫
14.318兆赫
14.318兆赫
14.318兆赫
14.318兆赫
14.318兆赫
TCLK
USB / DOT
48兆赫
48兆赫
48兆赫
48兆赫
48兆赫
48兆赫
48兆赫
48兆赫
Tclk/2
3V66_1/
VCH
四十八分之六十六兆赫
四十八分之六十六兆赫
四十八分之六十六兆赫
四十八分之六十六兆赫
四十八分之六十六兆赫
四十八分之六十六兆赫
四十八分之六十六兆赫
四十八分之六十六兆赫
高阻
Tclk/4
注意:
1.端被定义为1.0 V和1.8伏之间的电压电平为第3级的输入功能。低低于0.8 V.高超过2.0 V.
2. 3V66_1 / VCH输出频率由本人设定
2
C.
的48 MHz的输出频率3.必须是167 ppm的匹配USB默认值。
4. Rref的输出分= 14.316兆赫,标称= 14.31818 ,上限= 14.32兆赫。
5. TCLK是一个测试时钟测试模式在驱动上XTAL_In输入。
掉电模式
PWRDWN
1
0
中央处理器
正常
I
REF
*2
中央处理器
正常
FL燕麦
3V66
正常
66BUFF/
3V66
正常
66In/
3V66_5
正常
PCIF / PCI
正常
REF 0
正常
USB / DOT
正常
3V66_1/
VCH
正常
HOST SWING选择功能 - CK408
MULT 0
0
1
阻抗
50
50
I
REF
R
REF
= 221.1%
I
REF
= 5.00毫安
R
REF
= 475.1%
I
REF
= 2.32毫安
负载
额定试验载荷为给定的配置
额定试验载荷为给定的配置
I
OH
I
OH
= 4*I
REF
I
OH
= 6*I
REF
V
OH
@ 50 W
1.0 V
0.7 V
条件
I
OUT
I
OUT
V
DD
= 3.3 V
V
DD
= 3.3 V
±5%
CON组fi guration
所有组合,
见上表
所有组合,
见上表
分钟。
-7 %的我
OH
见上表
我-12 %
OH
见上表
马克斯。
我+ 7 %
OH
见上表
我+ 12 %
OH
见上表
2001年9月07
5
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