PCF8574
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...............................................................................................................................................................
SCPS068G - 2001年7月 - 修订2008年5月
远程8位I / O扩展器我
2
C总线
1
特点
低待机电流的消耗
10
A
最大
I
2
C到并行端口扩展器
漏极开路中断输出
与大多数微控制器
锁存输出，大电流驱动
能力可直接驱动LED
闭锁性能超过100mA的每
JESD 78 ， II类
RGY包装
（ TOP VIEW ）
DW或N包装
（ TOP VIEW ）
RGT包装
（ TOP VIEW ）
16
SDA
15
SCL
14
INT
13
P7
INT
1
20
19
P6
18
NC
17
P5
16
P4
15
GND
14
P3
13
NC
12
P2
P7
DGV或PW包装
（ TOP VIEW ）
P0
5
P2
7
P3
8
P1
6
A0
A1
A2
P0
P1
P2
P3
GND
1
2
3
4
5
6
7
8
16
15
14
13
12
11
10
9
V
CC
SDA
SCL
INT
P7
P6
P5
P4
V
CC
1
A0
2
A1
3
A2
4
12
P6
11
P5
10
P4
9
GND
SCL
NC
SDA
V
CC
A0
A1
NC
A2
2
3
4
5
6
7
8
9
10
11
INT
SCL
NC
SDA
V
CC
A0
A1
NC
A2
P0
1
2
3
4
5
6
7
8
9
10
20
19
18
17
16
15
14
13
12
11
P7
P6
NC
P5
P4
GND
P3
NC
P2
P1
P0
P1
NC - 无内部连接
NC - 无内部连接
描述/订购信息
这8位输入/输出（ I / O）扩展为两线双向总线（我
2
C）是专为2.5 V至6 V V
CC
操作。
在PCF8574提供通用的远程I / O扩展通过我大多数微控制器系列
2
C
接口[串行时钟（ SCL ） ，串行数据（ SDA ）。
该器件具有一个8位准双向I / O口（ P0 - P7 ） ，包括高电流驱动输出锁存
能力可直接驱动LED 。每个准双向I / O可以被用作不使用的输入或输出
数据的方向的控制信号。在上电时，I / O的高。在这种模式下，只有一个电流源到V
CC
is
活跃的。另外一个强上拉至V
CC
可以边快速上升到重仓输出。该器件圈
上时的输出被写入高，并且由SCL的下降沿断开。在I / O的要高
之前被用作输入。
1
请注意，一个重要的通知有关可用性，标准保修，并且在关键的应用程序中使用
德州仪器公司的半导体产品和免责条款及其出现在此数据表的末尾。
PRODUCTION数据信息为出版日期。
产品符合占德州条款规范
仪器标准保修。生产加工过程中不
不一定包括所有参数进行测试。
版权所有2001-2008 ，德州仪器
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描述/订购信息（续）
的PCF8574提供一个漏极开路输出（INT ），其可以连接到一个中断输入
微控制器。一个中断是通过在输入模式中的端口输入的任何上升沿或下降沿产生。后
时间t
iv
， INT是有效的。复位和重新激活该中断电路时在该端口上的数据被改变，实现
到初始设定或从中读取数据，或写入时，产生中断的端口。发生在重置
在读方式应答位后的SCL信号的上升沿，或者在写入模式
在SCL信号的高电平至低电平转换后的应答位。在确认发生的中断
时钟脉冲可以被丢失（或很短）由于中断此脉冲期间的复位。每个变化
在I / O的复位后检测，之后的下一个时钟上升沿，传输为INT 。从阅读，或
写入，另一个设备没有影响中断电路。
通过该线路上发送一个中断信号时，远程I / O可以通知微控制器是否有接收的数据
它的端口，而无需经由I通信
2
C总线。因此， PCF8574可保持简单的从属
装置。
订购信息
T
A
PDIP - N
QFN - RGT
QFN - RGY
包
(1) (2)
25管
3000卷
1000卷
40管
-40 ° C至85°C
SOIC - DW
2000年卷
70管
TSSOP - PW
2000年卷
TVSOP - DGV
(1)
(2)
2000年卷
订购型号
PCF8574N
PCF8574NE4
PCF8574RGTR
PCF8574RGYR
PCF8574RGYRG4
PCF8574DW
PCF8574DWE4
PCF8574DWR
PCF8574DWRE4
PCF8574PW
PCF8574PWE4
PCF8574PWR
PCF8574PWRE4
PCF8574DGVR
PCF8574DGVRE4
PF574
PF574
PCF8574
顶部端标记
PCF8574N
ZWJ
PF574
包装图纸，热数据和符号可在
www.ti.com/packaging 。
对于最新的封装和订购信息，请参阅封装选项附录本文档的末尾，或见TI
网站：
www.ti.com 。
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逻辑图（正逻辑）
PCF8574
INT
13
打断
逻辑
LP滤波器
A0
A1
A2
SCL
SDA
1
2
3
4
5
6
P0
P1
P2
P3
P4
P5
P6
P7
14
15
输入
滤波器
I
2
C总线
控制
移
注册
8位
I / O
PORT
7
9
10
11
12
写脉冲
V
CC
GND
16
8
POWER- ON
RESET
读脉冲
显示引脚数都为DW和N包。
每个P -PORT输入/输出简化示意图
写脉冲
100
A
DATA FROM
移位寄存器
D
FF
C
I
S
POWER- ON
RESET
P0P7
Q
V
CC
D
FF
Q
GND
读脉冲
C
I
S
中断
逻辑
DATA TO
移位寄存器
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I
2
C接口
I
2
这种装置C的通信是由一个主，从高至低跳变对发送启动条件启动
在SDA I / O ，而SCL输入为高。启动条件之后，器件地址字节发送，
最显著位（MSB）首先，包括数据方向位（ R / W） 。该器件不一般的回应
呼叫地址。接收的有效地址字节后，该设备响应一个应答，低的SDA
我/在应答时钟脉冲为高电平O操作。从设备的地址输入（ A0 -A2 ）必须
不被启动和停止状态之间改变。
该数据字节如下地址确认。如果R / W位为高电平时，从该设备中的数据是数值
从P端口读取。如果R / W位为低时，数据是从主站，将被输出到P端口。的数据字节
其次是在确认从该设备发送的。如果其他数据字节从主站发送，继
承认，他们是由该设备被忽略。数据输出只有在收到完整的字节，
承认。输出数据将是有效的，在时间t
pv
，在SCL和低到高的转变后，
时钟周期的确认。
停止条件，这是对我SDA从低到高的跳变/ O ，而SCL输入为高电平，由发送
高手。
接口定义
字节
I
2
I2C从地址
I / O数据总线
位
图7（ MSB）中
L
P7
6
H
P6
5
L
P5
4
L
P4
3
A2
P3
2
A1
P2
1
A0
P1
0（ LSB）的
读/写
P0
4
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图1
和
图2
显示的地址和时序图的写入和读出模式，分别。
两个字节的整数倍
SCL
1
2
3
4
5
6
7
8
1
2
3
4
5
6
7
8
1
2
3
4
5
6
7
8
开始
条件
从机地址
SDA
S
0
1
0
0
A2 A1 A0
确认
从机
读/写
数据
0
A
P7
P6
1
确认
从机
数据
P0
一P7
P0
确认
从机
A
写
PORT
P5
数据输出
电压
数据A0
和B0
有效
t
pv
P5输出
电压
P5上拉
产量
当前
I
OH
I
OHT
INT
t
ir
图1.写模式（输出）
SCL
1
2
3
4
5
6
7
8
1
2
3
4
5
6
7
8
1
2
3
4
5
6
7
8
读/写
确认
从机
确认
从主
确认
从主
SDA S
0
1
0
0 A2
A1
A0 1
A
P7 P6 P5 P4 P3 P2 P1
P0
一P7
P6 P5 P4
P3 P2
P1 P0
一P7 P6
从阅读
PORT
数据导入
PORT
P7至P0
t
h
P7至P0
t
su
INT
t
iv
t
ir
t
ir
SDA由低到高的转变，而SCL为高电平被定义为停止条件（ P） 。数据的传输可以停止在任何时刻由
一个停止条件。当这种情况发生时，数据存在于最新的ACK阶段是有效的（输出模式）。输入的数据将丢失。
图2.阅读模式（输入）
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远程8位I / O扩展器我
2
C总线
1
特点
低待机电流的消耗
10
A
最大
I
2
C到并行端口扩展器
漏极开路中断输出
与大多数微控制器
锁存输出，大电流驱动
能力可直接驱动LED
闭锁性能超过100mA的每
JESD 78 ， II类
RGY包装
（ TOP VIEW ）
DW或N包装
（ TOP VIEW ）
RGT包装
（ TOP VIEW ）
16
SDA
15
SCL
14
INT
13
P7
INT
1
20
19
P6
18
NC
17
P5
16
P4
15
GND
14
P3
13
NC
12
P2
P7
DGV或PW包装
（ TOP VIEW ）
P0
5
P2
7
P3
8
P1
6
A0
A1
A2
P0
P1
P2
P3
GND
1
2
3
4
5
6
7
8
16
15
14
13
12
11
10
9
V
CC
SDA
SCL
INT
P7
P6
P5
P4
V
CC
1
A0
2
A1
3
A2
4
12
P6
11
P5
10
P4
9
GND
SCL
NC
SDA
V
CC
A0
A1
NC
A2
2
3
4
5
6
7
8
9
10
11
INT
SCL
NC
SDA
V
CC
A0
A1
NC
A2
P0
1
2
3
4
5
6
7
8
9
10
20
19
18
17
16
15
14
13
12
11
P7
P6
NC
P5
P4
GND
P3
NC
P2
P1
P0
P1
NC - 无内部连接
NC - 无内部连接
描述/订购信息
这8位输入/输出（ I / O）扩展为两线双向总线（我
2
C）是专为2.5 V至6 V V
CC
操作。
在PCF8574提供通用的远程I / O扩展通过我大多数微控制器系列
2
C
接口[串行时钟（ SCL ） ，串行数据（ SDA ）。
该器件具有一个8位准双向I / O口（ P0 - P7 ） ，包括高电流驱动输出锁存
能力可直接驱动LED 。每个准双向I / O可以被用作不使用的输入或输出
数据的方向的控制信号。在上电时，I / O的高。在这种模式下，只有一个电流源到V
CC
is
活跃的。另外一个强上拉至V
CC
可以边快速上升到重仓输出。该器件圈
上时的输出被写入高，并且由SCL的下降沿断开。在I / O的要高
之前被用作输入。
1
请注意，一个重要的通知有关可用性，标准保修，并且在关键的应用程序中使用
德州仪器公司的半导体产品和免责条款及其出现在此数据表的末尾。
PRODUCTION数据信息为出版日期。
产品符合占德州条款规范
仪器标准保修。生产加工过程中不
不一定包括所有参数进行测试。
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描述/订购信息（续）
的PCF8574提供一个漏极开路输出（INT ），其可以连接到一个中断输入
微控制器。一个中断是通过在输入模式中的端口输入的任何上升沿或下降沿产生。后
时间t
iv
， INT是有效的。复位和重新激活该中断电路时在该端口上的数据被改变，实现
到初始设定或从中读取数据，或写入时，产生中断的端口。发生在重置
在读方式应答位后的SCL信号的上升沿，或者在写入模式
在SCL信号的高电平至低电平转换后的应答位。在确认发生的中断
时钟脉冲可以被丢失（或很短）由于中断此脉冲期间的复位。每个变化
在I / O的复位后检测，之后的下一个时钟上升沿，传输为INT 。从阅读，或
写入，另一个设备没有影响中断电路。
通过该线路上发送一个中断信号时，远程I / O可以通知微控制器是否有接收的数据
它的端口，而无需经由I通信
2
C总线。因此， PCF8574可保持简单的从属
装置。
订购信息
T
A
PDIP - N
QFN - RGT
QFN - RGY
包
(1) (2)
25管
3000卷
1000卷
40管
-40 ° C至85°C
SOIC - DW
2000年卷
70管
TSSOP - PW
2000年卷
TVSOP - DGV
(1)
(2)
2000年卷
订购型号
PCF8574N
PCF8574NE4
PCF8574RGTR
PCF8574RGYR
PCF8574RGYRG4
PCF8574DW
PCF8574DWE4
PCF8574DWR
PCF8574DWRE4
PCF8574PW
PCF8574PWE4
PCF8574PWR
PCF8574PWRE4
PCF8574DGVR
PCF8574DGVRE4
PF574
PF574
PCF8574
顶部端标记
PCF8574N
ZWJ
PF574
包装图纸，热数据和符号可在
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对于最新的封装和订购信息，请参阅封装选项附录本文档的末尾，或见TI
网站：
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逻辑图（正逻辑）
PCF8574
INT
13
打断
逻辑
LP滤波器
A0
A1
A2
SCL
SDA
1
2
3
4
5
6
P0
P1
P2
P3
P4
P5
P6
P7
14
15
输入
滤波器
I
2
C总线
控制
移
注册
8位
I / O
PORT
7
9
10
11
12
写脉冲
V
CC
GND
16
8
POWER- ON
RESET
读脉冲
显示引脚数都为DW和N包。
每个P -PORT输入/输出简化示意图
写脉冲
100
A
DATA FROM
移位寄存器
D
FF
C
I
S
POWER- ON
RESET
P0P7
Q
V
CC
D
FF
Q
GND
读脉冲
C
I
S
中断
逻辑
DATA TO
移位寄存器
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I
2
C接口
I
2
这种装置C的通信是由一个主，从高至低跳变对发送启动条件启动
在SDA I / O ，而SCL输入为高。启动条件之后，器件地址字节发送，
最显著位（MSB）首先，包括数据方向位（ R / W） 。该器件不一般的回应
呼叫地址。接收的有效地址字节后，该设备响应一个应答，低的SDA
我/在应答时钟脉冲为高电平O操作。从设备的地址输入（ A0 -A2 ）必须
不被启动和停止状态之间改变。
该数据字节如下地址确认。如果R / W位为高电平时，从该设备中的数据是数值
从P端口读取。如果R / W位为低时，数据是从主站，将被输出到P端口。的数据字节
其次是在确认从该设备发送的。如果其他数据字节从主站发送，继
承认，他们是由该设备被忽略。数据输出只有在收到完整的字节，
承认。输出数据将是有效的，在时间t
pv
，在SCL和低到高的转变后，
时钟周期的确认。
停止条件，这是对我SDA从低到高的跳变/ O ，而SCL输入为高电平，由发送
高手。
接口定义
字节
I
2
I2C从地址
I / O数据总线
位
图7（ MSB）中
L
P7
6
H
P6
5
L
P5
4
L
P4
3
A2
P3
2
A1
P2
1
A0
P1
0（ LSB）的
读/写
P0
4
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图1
和
图2
显示的地址和时序图的写入和读出模式，分别。
两个字节的整数倍
SCL
1
2
3
4
5
6
7
8
1
2
3
4
5
6
7
8
1
2
3
4
5
6
7
8
开始
条件
从机地址
SDA
S
0
1
0
0
A2 A1 A0
确认
从机
读/写
数据
0
A
P7
P6
1
确认
从机
数据
P0
一P7
P0
确认
从机
A
写
PORT
P5
数据输出
电压
数据A0
和B0
有效
t
pv
P5输出
电压
P5上拉
产量
当前
I
OH
I
OHT
INT
t
ir
图1.写模式（输出）
SCL
1
2
3
4
5
6
7
8
1
2
3
4
5
6
7
8
1
2
3
4
5
6
7
8
读/写
确认
从机
确认
从主
确认
从主
SDA S
0
1
0
0 A2
A1
A0 1
A
P7 P6 P5 P4 P3 P2 P1
P0
一P7
P6 P5 P4
P3 P2
P1 P0
一P7 P6
从阅读
PORT
数据导入
PORT
P7至P0
t
h
P7至P0
t
su
INT
t
iv
t
ir
t
ir
SDA由低到高的转变，而SCL为高电平被定义为停止条件（ P） 。数据的传输可以停止在任何时刻由
一个停止条件。当这种情况发生时，数据存在于最新的ACK阶段是有效的（输出模式）。输入的数据将丢失。
图2.阅读模式（输入）
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