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集成电路
数据表
PCD5092
DECT基带控制器
客观的特定网络阳离子
取代1996年的数据10月30日
在集成电路, IC17文件
1997年07月21日
飞利浦半导体
客观的特定网络阳离子
DECT基带控制器
目录
1
1.1
2
3
4
5
5.1
5.2
6
7
8
8.1
8.2
8.3
8.4
9
10
11
特点
DSP的软件功能
概述
订购信息
框图
管脚信息
钉扎
引脚说明
功能说明
包装外形
焊接
介绍
再溢流焊接
波峰焊
修复焊接接头
释义
生命支持应用
购买飞利浦的我
2
C组分
PCD5092
1997年07月21日
2
飞利浦半导体
客观的特定网络阳离子
DECT基带控制器
1
特点
PCD5092
简单的接口与无线电电路,在其他操作系统
电源电压( RF电源引脚电平转换器的RF
信号)
片上比较器,用作数据限幅器
低功耗振荡器,频率综合
调整
QFP100封装
上电复位
可编程的关断模式
低电源电压(2.7 3.6 V )
CMOS技术。
1.1
DSP的软件功能
80C51端口P0 , P1,P2和P3的可用于连接
以显示,键盘,我
2
C总线,中断源和/或
外部存储器。集成的64 KB的ROM , 3字节
数据存储器和1 KB的SDR -RAM 。外部程序
存储器是可寻址多达128千字节
+2.7到+ 5V端口( P0到P3 )接口
TDMA帧( DE)复用。变速器或
前台可以编程为任何插槽。
加密,加扰, CRC校验/产生和
保护B-领域
六个手机的语音和数据缓冲空间
环回本地通话和B场
两个中断线BML和DSP中断80C51
片上,三个通道的时间复用的8位
模拟数字转换器( ADC )的RSSI
测量中, 1为电池电压的测量
并且可用于其他目的之一信道
片上8位数字到模拟转换器( DAC )的
电子电位计功能
相位误差测量与相位误差校正由
五金
DAC和ADC的动态耳机和动态或
驻极体传声器
片内基准电压
芯片供应驻极体传声器
非常低电阻蜂鸣器输出
串行接口与外部ADPCM CODEC ( PCD5032 )
或8 kHz的U型规律的样本
语音交换机的数字电话接听
机( DTAM )连接到SPI接口
IOM- 2接口(西门子注册商标)
串行接口来合成频率
程序设计
可编程极性和无线电控制的时机
信号的
GMSK脉冲整形
3
订购信息
TYPE
PCD5092H
ADPCM编码和解码用的G.721符合
U- law编码和解码符合G.711
回声消除和网络回声抑制器
语音过滤器
在语音通道可编程增益
侧音及软静音
林格和音频(DTMF )发生器
自动增益控制
电话应答机( TAM)开关。
对于每一个DSP软件版本单独手册
可用的,其中详细信息提供有关如何
参数必须设置。欲了解更多信息,请
联系飞利浦半导体。
2
概述
该PCD5092是专为GAP标准的单一A / B
线基站与应答机开关。它有一个
嵌入式80C51单片机的两倍
经典的建筑表现, 64千字节
PROM的程序存储器和数据存储器的3字节
片上。另外有1千字节的片上数据的
这是带有片上突发模式逻辑共享内存
( BML )和DSP ,系统数据RAM ( SDR ) 。
名字
QFP100
描述
塑料四方扁平的封装; 100引脚(引脚长度1.95毫米) ;
身体14
×
20
×
2.8 mm
VERSION
SOT317-2
1997年07月21日
3
4
客观的特定网络阳离子
PCD5092
图1框图。
手册,全页宽
1997年07月21日
PORT 1.0
PORT 1.7
VDD_RF
5
×
VSS
VSSA
VDDA
2
×
VDD3V
3
×
VDD5V
8
8
8
PORT 2.0
2.7端口
PORT 3.0
3.7端口
8
端口1
端口3
IB总线
端口2
数字引脚
模拟引脚
PORT 0.0
0.7端口
VDD
端口0
飞利浦半导体
框图
PCD5092
PSE
EA
ALE
VDD
80CL51-核心
A16
只读存储器
( 64字节)
I
2
C总线
测试控制块
( TCB)中
TST1
TST2
AUX -RAM
( 3千字节)
微控制器的RAM
(256字节)
AB微控制器
INTERFACE ( ABCIF )
语音接口
IOM / ADPCM
( SPI)的
微控制器
DECT基带控制器
VDD_RF
VDD
蜂鸣器BUFFER
(ABB)
VDD
VDDA
VDD
VDD
DO
DI
FS1
DCK
CLK3
BZP
BZM
水平
4fs
1位ADC
ARD
ARF
数字
信号
处理器
(DSP)的
4fs
ATS
108fs
Σ
1位ADC
数字
噪音
整形
(DNS)的
108fs
EARP
EARM
ARA
LIFP
LIFM
MICP
MICM
AMP
VMIC
CDC-上
4
系统
数据
内存
( SDR)的
( 1字节)
数字
富力
滤波器
( DDF )
SLICE_CTR
R_PWR
R_ENABLE
REF_CLK
SYNTH_LOCK
S_ENABLE
S_CLK
S-DATA
VCO_BND_SW
S_PWR
ANT_SW0
ANT_SW1
T_ENABLE
T_PWR_RMP
T_DATA
R_DATAP
R_DATAM
BURST
模式
逻辑
( BML )
R_SLICED
VDDA
T_GMSK
AGM
编解码器
VREF
DPLL_DATA
VDDA
辅助ADC ( AAD )
模拟电压
参考
( AVR )
VREF
类似物
电压
来源
( AVS )
MUX
3:1
VADC
峰值保持
VANLI
RSSI_AN
VBAT
VREF
ISB BUS
调节器
( IBC )
数字
控制
OF
类似物
( DCA )
上电复位
(POR)
GP_CLK7
VDD
时钟
发电机
( CLG )
定时控制
( TICB )
XTAL1
XTAL2
XTAL
振荡器
( XOSC )
看门狗
定时器
( WDT )
RESET
发电机
( RGE )
CLK100
VDDO
RESET_OUT
M_RESET
VSSO
MBH946
EN_WATCHDOG
VBGP
VANLO
飞利浦半导体
客观的特定网络阳离子
DECT基带控制器
5
5.1
管脚信息
钉扎
PCD5092
100 RESET_OUT
99 M_RESET
90 VDD5V_3
89 VSS5
88 EA
98 P0.0
97 P0.1
96 P0.2
95 P0.3
94 P0.4
93 P0.5
92 P0.6
91 P0.7
85 P2.7
84 P2.6
83 P2.5
82 P2.4
手册,全页宽
ANT_SW1
ANT_SW0
CLK100
T_ENABLE
T_PWR_RMP
T_DATA
T_GMSK
VCO_BND_SW
SYNTH_LOCK
1
2
3
4
5
6
7
8
9
81 P2.3
80
79
78
77
76
75
74
73
72
71
70
69
68
67
86 PSE
87 ALE
TST2
TST1
VSS4
VDD5V_2
A16
P2.2
P2.1
P2.0
P3.7
P3.6
P3.5
P3.4
P3.3
P3.2
P3.1
P3.0
VSS3
VSS2
BZP
BZM
VDD3V_2
P1.7
P1.6
P1.5
P1.4
P1.3
VDD5V_1
R_SLICED
DPLL_DATA
GP_CLK7
S_ENABLE 10
S-DATA 11
S_CLK 12
S_PWR 13
REF_CLK 14
VSS1 15
VDD_RF 16
VDD3V_1 17
SLICE_CTR 18
R_PWR 19
R_DATAP
R_DATAM
R_ENABLE
RSSI_AN
VANLI
VBAT
CLK3
DCK
DI
FS1
DO
20
21
22
23
24
25
26
27
28
29
30
XTAL2 31
XTAL1 32
VANLO 33
VSSO 34
VDDO 35
LIFM 36
LIFP 37
VSSA 38
MICM 39
MICP 40
VMIC 41
VREF 42
VBGP 43
VDDA 44
EARM 45
EARP 46
EN_WATCHDOG 47
P1.0 48
P1.1 49
P1.2 50
PCD5092
66
65
64
63
62
61
60
59
58
57
56
55
54
53
52
51
MGD799
图2引脚配置( QFP100 ) 。
1997年07月21日
5
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