最终科幻
COM'L ： -10
IND ： -20
PALLV16V8-10和PALLV16V8Z -20
低电压，零功耗的20引脚EE CMOS
通用可编程阵列逻辑
特色鲜明
x
低电压运行， 3.3 V兼容JEDEC
x
x
x
x
x
x
x
x
x
x
x
x
— V
CC
= + 3.0V至+ 3.6V
引脚和功能与所有20引脚兼容PAL
器件
电可擦除的CMOS技术提供侦察网络可配置逻辑和充分的可测试性
直插式替代PAL16R8系列
设计采用两个3.3 V和5 V逻辑接口
作为注册的可编程输出或组合任意组合
可编程输出极性
可编程的启用/禁用控制
预加载输出寄存器可测性
上电自动复位寄存器
高性价比的20引脚塑料DIP ， PLCC和SOIC封装
丰富的第三方软件和编程器支持
经过全面测试的100 ％的编程和功能的产量和高可靠性
概述
该PALLV16V8是内置有低电压，高速，电可擦除一个先进的PAL设备
CMOS技术。它与所有的20针GAL器件在功能上兼容。宏蜂窝
提供了一个通用的器件结构。该PALLV16V8将直接更换PAL16R8 ，与
除了PAL16C1的。
该PALLV16V8Z提供了待机零功耗和高速。在30-
A最大待机
电流， PALLV16V8Z允许电池供电的操作延长的时间。
该PALLV16V8利用加总产品（AND / OR）熟悉的架构，允许用户
轻松实现复杂的逻辑功能和EF网络ciently 。组合逻辑的多级可
总是沦为加总产品的形式，采取了非常宽的输入门的优点
可在PAL器件。该公式是通过浮动栅极单元编程到器件
中的与逻辑阵列可电擦除。
在网络连接固定的或阵列允许每个输出八个数据产品方面的逻辑功能。总和
这些产品的饲料输出宏单元。每个宏单元可以为注册进行编程或
组合具有高电平有效或低电平有效输出。输出CON组fi guration由下式确定
两个全局位和1位当地控制四个多路复用器在每个宏单元。
出版＃
17713
Amendment/0
启：
E
发行日期：
1998年11月
框图
I
1
- I
8
CLK /
I0
8
可编程和阵列
32 x 64
万家乐
MC0
万家乐
MC1
万家乐
MC2
万家乐
MC3
万家乐
MC4
万家乐
MC5
万家乐
MC6
万家乐
MC7
OE
/I
9
I / O
0
I / O
1
I / O
2
I / O
3
I / O
4
I / O
5
I / O
6
I / O
7
17713D-1
功能说明
该PALLV16V8是一个低电压， EE的CMOS版PALCE16V8的。
该PALLV16V8Z是一个低电压， EE的CMOS版PALCE16V8的。此外，该
PALLV16V8Z具有零待机功耗和未使用的乘积项禁用特性，可降低
功耗。
该PALLV16V8是一个普遍的PAL器件。它有八个独立CON连接可配置宏
（ MC
0
-MC
7
） 。每个宏单元可以CON组fi gured挂号输出组合输出，
组合I / O或专用输入。编程矩阵实现了一个可编程与
逻辑阵列，它驱动一个固定或逻辑阵列。缓存用于设备投入具有互补
输出，以提供用户可编程的输入信号的极性。引脚1和11成为无论是作为数组
输入或作为时钟（CLK）和输出使能（OE ） ，分别用于所有佛罗里达州的ip-佛罗里达州欢声笑语。
未使用的输入引脚应直接连接到V
CC
或GND 。产品方面与所有位
编程（断开）假设的逻辑高电平状态和产品方面与双方真实
任何输入信号连接的补充假设的逻辑低状态。
在PALLV16V8可编程功能自动CON网络从用户的gured
设计规范网络阳离子。该设计规范网络阳离子由开发软件处理，以验证
设计和创建一个程序文件中。这音响文件，一旦下载到一个程序员，网络骗子居雷什的
根据用户期望的功能的设备。
2
PALLV16V8-10和PALLV16V8Z -20家庭
该用户被赋予了与PALLV16V8 2的设计方案。首先，它可以被编程为
从PAL16R8和PAL10H8系列标准的PAL器件。在PAL程序员制造商
将供应设备的代码的标准的PAL器件结构，以用于与PALLV16V8 。
程序员编程将在相应的架构PALLV16V8 。这允许
用户可以使用现有标准的PAL器件JEDEC科幻莱未做任何更改它们。
可选地，该设备可以被编程为一个PALLV16V8 。这里，用户必须使用
PALLV16V8设备代码。此选项允许宏蜂窝的充分利用。
11
10
00
01
To
邻
MACROCELL
11
0X
10
OE
V
CC
SL0
X
SG1
11
0X
D
SL1
X
CLK
Q
Q
10
11
0X
*SG1
*在宏单元MC0和MC7
,
SG1被替换SG0的反馈多路复用器。
SL0X
10
I / O
X
从
邻
针
17713D-004
图1. PALLV16V8宏单元
CON组fi guration选项
每个宏单元可以CON组fi gured作为执行下列操作之一：注册输出组合输出，
组合I / O ，或专用输入。在已注册的输出CON连接配置中，输出缓冲器
通过OE引脚使能。在组合CON组fi配置中，缓冲器或者由一个控制
产品长期或始终处于启用状态。在专用输入CON连接配置中，它总是被禁用。同
除了MC的
0
而MC
7
，宏蜂窝CON连接gured作为一个专用的输入导出输入信号
来自相邻的I / O 。 MC
0
从11脚（ OE）和MC得到输入
7
从1脚（ CLK ） 。
宏蜂窝CON连接gurations由CON组fi guration控制字进行控制。它包含了全球2
位（ SG0和SG1 ）和16位本地（ SL0
0
通过SL0
7
和SL1
0
通过SL1
7
） 。 SG0决定
寄存器是否将被允许。 SG1决定PALLV16V8是否会效仿PAL16R8
家庭。在每个宏单元， SL0
x
在与SG1相结合，选择的的CON组fi guration
宏和SL1
x
设置为任一活性低或高电平有效的个体宏蜂窝的输出。
该CON组fi guration位工作由作为控制输入用于宏蜂窝的多路复用器。那里
四个多路复用器：一个乘积项的输入，使能选择，输出选择和反馈
选择多路复用器。 SG1和SL0
x
对于所有四个多路复用器的控制信号。在MC
0
而MC
7
,
PALLV16V8-10和PALLV16V8Z -20家庭
3
SG0取代的反馈多路SG1 。这个可容纳CLK作为相邻引脚
MC
7
和OE相邻引脚MC
0
.
注册输出CON组fi guration
控制位设置为SG0 = 0 ， SG1 = 1和SL0
x
= 0 。有注册的只有一个
CON组fi guration 。所有8个乘积项可作为输入或门。数据极性
通过SL1确定
x
.
在IP- FL佛罗里达州运装在CLK的低到高的转变。反馈
路径是从寄存器Q 。的输出缓冲器由OE激活。
组合刀豆网络gurations
该PALLV16V8有三种组合输出CON连接gurations ：专用输出在非
注册设备，I / O中的一个注册装置未注册装置和I / O 。
专用输出在非注册设备
控制位设置SG0 = 1 ， SG1 = 0， SL0
x
= 0 。这八个方面的产品提供给
或门。虽然宏单元是一个专用的输出，反馈的情况下，除
MC的
3
而MC
4
。 MC
3
而MC
4
不使用反馈在此模式。由于CLK和OE不
在一个非注册装置中使用，销1和11是作为输入信号。引脚1将使用
MC的反馈路径
7
和销11将使用MC的反馈路径
0
.
组合I / O在非注册设备
该控制位的设置是SG 0 = 1， SG 1 = 1，并且SL0
x
= 1 。只有七个方面的产品可用
到或门。第八乘积项，用来使能输出缓冲器中。在I / O信号
针经由反馈多路复用器反馈到与门阵列。这使引脚用作
一个输入端。
由于CLK和
OE
未在非注册装置中使用，销1和11都可以用作输入。
引脚1将使用MC的反馈路径
7
和销11将使用MC的反馈路径
0
.
组合I / O在已登录的设备
控制位设置为SG0 = 0 ， SG1 = 1和SL0
x
= 1 。只有七个方面的产品可用
到或门。第八乘积项作为输出使能。该反馈信号是
相应的I / O信号。
专用输入CON组fi guration
控制位设置SG0 = 1 ， SG1 = 0， SL0
x
= 1 。输出缓冲器被禁止。以外
MC
0
而MC
7
中，反馈信号是相邻的I / O 。对于MC
0
而MC
7
中，反馈信号是
引脚1和11.这些CON组fi gurations总结在表1和图2所示。
4
PALLV16V8-10和PALLV16V8Z -20家庭
表1.宏单元CON组fi guration
SG0
SG1
SL0X
CELL
CON组fi guration
器件
模拟
SG0
SG1
SL0X
CELL
CON组fi guration
器件
模拟
设备使用寄存器
0
1
0
注册
产量
组合
I / O
PAL16R8 ， 16R6 ，
16R4
PAL16R6 ， 16R4
1
0
设备采用无寄存器
0
组合
产量
输入
组合
I / O
PAL10H8 ， 12H6 ，
14H4 ， 16H2 ， 10L8 ， 12L6 ，
14L4, 16L2
PAL12H6 ， 14H4 ， 16H2 ， 12L6 ，
14L4, 16L2
PAL16L8
0
1
1
1
1
0
1
1
1
可编程输出极性
每个宏单元的极性可以是高电平或低电平有效，要么匹配输出信号
需要或者降低产品条款。可编程极性允许写入布尔表达式
在其最紧凑的形式（真或反转） ，并且输出仍然可以在所需的极性。
它还可以保存“ DeMorganizing ”的努力。
选择是通过一个可编程的位SL1
x
其控制的异或门的输出
的和/或逻辑。输出为高电平有效，如果SL1
x
是1和活性低，如果SL1
x
是0 。
PALLV16V8-10和PALLV16V8Z -20家庭
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