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PA7572 PEEL阵列

可编程电可擦除逻辑阵列

多才多艺的逻辑阵列架构

- 24个I / O ， 14个输入， 60寄存器/锁存器

- 高达72逻辑单元输出功能

- 解放军的结构与真正的乘积项共享

- 逻辑功能和寄存器可以将I / O埋

高速商用和工业版本

- 尽可能快13ns / 20ns的（ tpdi / tpdx ）， 66.6MHz频率范围内（F

最大

)

工业级可用于4.5 5.5V V

和-40

至+85°C的温度

理想的组合，同步和

异步逻辑应用

- 多PLD和随机逻辑的整合

- 地埋柜，复杂的状态机

- 比较器，解码器，等宽门功能

CMOS电可擦除技术

可重复编程的40引脚DIP ， 44引脚PLCC和

TQFP封装

灵活的逻辑单元

- 最多3个输出功能每个逻辑单元

- D， T和JK具有特殊功能寄存器

- 独立或全局时钟，复位，预置位，

时钟极性和输出使能

- 加总的产品逻辑输出使能

开发和编程支持

- 信息和通信技术PLACE开发软件

- 钳工的ABEL ，中国政法大学和其他软件

- 编程流行的第三方支持

编程器

概述

该PA7572是可编程电的一员

可擦除逻辑（ PEEL ）的基础上阵列系列易亨电子的

CMOS EEPROM技术。 PEEL 阵列免费

设计师们从普通的可编程逻辑器件的限制

提供所需的架构的灵活性和速度

今天的可编程逻辑设计。该PA7572提供

通用的逻辑阵列架构， 24个I / O引脚， 14个输入

销和60的寄存器/锁存器（ 24埋逻辑单元， 12输入

寄存器/锁存器， 24埋I / O寄存器/锁存器）。它的逻辑

阵列实现了加总的产品100的逻辑功能

分为每两组服12个逻辑单元。每

的120产品方面的现有集团股权的一半（ 60 ）。

该PA7572的逻辑和I / O单元（低成本航空公司，国际石油公司）是

非常灵活的，每个单元最多三个输出功能

（总共72对所有24个逻辑单元）。细胞可被配置为

D，T ， JK和注册具有独立或全局时钟，

复位，预置，时钟极性等特点，使得

在PA7572适合各种组合的，

同步和异步逻辑应用。该

PA7572支持的速度一样快13ns / 20ns的（ tpdi / tpdx ）

和66.6MHz频率范围内（F

最大

）在中等功率消耗

140毫安（ 100毫安典型值）。包装包括40引脚DIP

和44引脚PLCC （见图1）。易亨电子和流行

第三方开发工具制造商提供

为PA7572开发和编程支持。

图1.引脚配置

DIP （ 600密耳）

I/CLK1

I / O

摹ND

VCC

I / O

I/CLK2

I / O

摹ND

I / O

I/CLK1

VCC

I / O

图2.框图

2输入/

摹叶形时钟引脚

摹ND

I / O

6 5 4 3 2 1 44 43 42 41 40

18 19 20 21 22 23 24 25 26 27 28

PLCC

I / O

摹ND

摹叶形

CE LLS

12输入引脚

输入

细胞

（ INC）

124 (62X2)

ARRAY INPUTS

真实

COM PLEM耳鼻喉科

隐藏

逻辑

FUNC TIONS

到I / O单元

I / O

细胞

（ IO C）

24个I / O引脚

I / CLK

I / O

全局C ELLS

VCC

I / O单元

I / O

I / CLK 2

LO GIC

一个rray

I / O

I/CLK1

VCC

I / O

摹ND

I/CLK2

I / O

输入单元格

逻辑

控制

细胞

（ LCC）的

Q FP

44 43 42 41 40 39 38 37 36 35 34

12 13 14 15 16 17 18 19 20 21 22

I / O

摹ND

I/CLK2

I / O

摹ND

I / O

4总和相S

5产品相S

对于G叶形细胞

96总和相S

（每LCC 4 ）

24逻辑控制细胞

每单元最多3个输出函数

（ 72总输出功能

可能的话）

C逻辑ONTROL细胞

08-15-001A

GND

PA7572

08-15-002A

该数据表包含的新产品信息。易亨电子公司保留权利修改产品规格，恕不另行通知。无责任承担由于使用本产品造成的。无权利

任何专利陪出售的产品。

1.0版2004年12月16日

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内的逻辑阵列

皮尔阵列架构的心脏是基于

同样，由PLA （可编程逻辑阵列结构

与可编程或）。逻辑阵列实现所有

逻辑功能，并提供互连和控制

的细胞。在PA7572 PEEL 阵列，62个输入是

可成从I / O单元，输入单元阵列和

输入/全局时钟引脚。

所有的输入同时提供真正的和补充的信号，这

可被编程到阵列中的任何一个乘积项。该

PA7572 PEEL 阵列包含124项产品。所有

乘积项（除了中的某些供给到

全球小区）可以可编程地连接到任何的

加总计算的逻辑控制单元（ 4相加，计算每

逻辑控制单元）。产品条款及金额，条款还

路由到全局细胞用于控制目的。图3

示出了逻辑阵列结构的详细视图。

可用于提供给逻辑单元制品的功能

时钟，复位，预置和输出使能，而不是仅仅

简单的产品长期控制。

皮尔逻辑阵列也可以实现逻辑功能

与在一个单一层次的延迟许多产品条款。为

例如一个16位比较器需要32共享乘积项

实施16异或功能。皮尔逻辑

阵列轻松处理这一个级别的延迟。其他

的PLD / CPLD的任意用完产品的条款或规定

膨胀器或附加的逻辑电平，通常慢

性能和时间偏移。

逻辑控制单元（ LCC ）

逻辑控制单元格（ LCC）的用于分配和控制

逻辑阵列中创建的逻辑功能。每个LCC有四个

主要输入和三个输出。输入到每个LCC的是

积求和的完整逻辑从阵列，其中功能

可用于实现组合和时序逻辑

的功能，并控制LCC的寄存器和I / O单元输出

启用。

给G叶形细胞

从

IO细胞

（ IO C， INC。，

I / CLK ）

62阵列输入

系统时钟

预设

REGT YPE复位

开/关

M UX

D，T ，J

ARRAY

从

逻辑

控制

细胞

（ LCC）的

M UX

REG

从

ARRAY

摹叶形

细胞

125产品

相S

M UX

I / O

CELL

逻辑控制

细胞

（ LCC）的

08-15-004A

图4.逻辑控制单元结构图

如图4所示， LCC是由三个信号的

路由多路复用器和一个多功能寄存器同步

或异步D，T或JK寄存器（主频-SR寄存器

这是JK的一个子集，也是可能的）。见图5 。

EEPROM存储器单元用于编程

所需的配置。积求和的四个逻辑功能

（SUM条件的A，B ， C和D）被送入从每个LCC

逻辑阵列。每个SUM术语可以选择性地用于

多种功能，列出如下。

08-15-003A

PA7572逻辑阵列

100心相S

图3. PA7572逻辑阵列

真正的乘积项共享

皮尔逻辑阵列提供了几个优势

常见的PLD逻辑阵列。首先，它允许为真产品 -

长期共享，而不是简单的产品长期指导，为的COM

monly其他CPLD的发现。产品长期分担能力可确保

该产物的术语用于需要它们的地方和

没有离开未使用或复制。其次，求和OF-

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总和-A = D，T ，J或总和-A

总和-B =预置， K或心-B

总和-C =复位，时钟，SUM -C

总和-D =时钟，输出使能，森-D

D型寄存器

经过超频Q = D

最适合的存储， SIM PLE专柜，

转换器和状态M achines瓦特第i个

少保持（循环）的条件。

森A， B或C的组合路径。因此，一个LCC的输出

可以登记， 1组合和所述第三，一个输出

启用或额外埋入的逻辑功能。多

功能PEEL 阵列逻辑单元等效于两个或

3宏小区其它可编程逻辑器件，其具有每一个输出

细胞。它们还允许寄存器被埋没真正从I / O引脚

没有这些限制到仅输入（参见图8 &图9）。

给G叶形细胞

输入单元格的时钟

牛逼注册

Q切换瓦特母鸡T = 1

Q持有瓦特母鸡T = 0

最好的瓦特IDE二进制计数器（节省

产品长期S）和状态M achines

瓦特第i M任何保留（环路）的条件。

LATCH

JK注册

Q切换瓦特母鸡J / K = 1/1

Q持有瓦特母鸡J / K = 0/0

Q= 1

瓦特母鸡J / K = 1/0

Q= 0

瓦特母鸡J / K = 0/1

COM bines两个D和T的功能

寄存器。

08-15-005A

输入

M UX

输入

ARRAY

输入单元（ INC ）

给G叶形细胞

输入单元格的时钟

图5. LCC注册类型

SUM- A可以作为D，T或寄存器了J输入或

组合路径。 SUM -B可以作为K个输入，或

预置到寄存器，或者一个组合路径。 SUM - C可

是时钟，复位到寄存器，或者一个组合

路径。 SUM- D可以在时钟的寄存器的输出

启用该连接的I / O单元，或内部反馈

节点。需要注意的是该款项的控制时钟，复位，预置

和输出使能积和功能齐全，

不仅仅是产品方面，与大多数其它可编程逻辑器件。这也

意味着任何输入或I / O引脚可以用作一个时钟或

其他的控制功能。

主要是提供从全局小区几个信号

同步（全球）寄存器控制。全局小区

信号被发送到所有的低成本航空公司。这些信号包括一个

的正极性或负极性的高速时钟，全球

预设和复位，以及一个特殊的寄存器型控制该

有选择地允许寄存器类型的动态切换。这

最后一个功能是对节能产品而言特别有用

实施可装载计数器和状态机时，

由从D型动态切换寄存器加载和

T型寄存器的计数（参见图9）。

RE G /

LATCH

ARRAY

输入

M UX

从

逻辑

控制

CELL

A， B，C

M UX

I / O引脚

M UX

1 0

I / O单元（ IO C）

08-15-006A

图6.输入和I / O单元框图

IOC / INC注册

后时钟的上升沿Q = D

持有，直到下一个上升沿

多路输出每逻辑单元

逻辑控制单元的一个重要特点是它的能力

让每单元多路输出功能，每个操作系统

独立。如示于图4中， 2的三

输出可以选择从寄存器或输出Q

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IOC / INC锁存

Q = L瓦特母鸡时钟为高

持有值W母鸡时钟低

08-15-007A

图7. IOC / INC。注册的配置

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输入单元（ INC ）

输入单元格（ INC）都包含在专用的输入引脚。该

在INC。的方框图如图6所示。每一INC。

由一个多路复用器和一个寄存器/透明锁存器，

它可以从由所选择的各种源的时钟

全球小区（参见图7）。该寄存器上升沿

主频。锁存器是透明的，当钟高

和锁存时钟的下降沿。寄存器/锁存器

也可以绕过一个非注册输入。

环球细胞

全局细胞，如图10所示，用于引导全球

时钟信号和/或控制条件的低成本航空公司， IOC和

政府间谈判委员会。全球小区允许一个时钟被从所选择的

CLK1管脚， CLK2，销，或从逻辑阵列乘积项

（ PCLK ）。它们还提供了极性控制的公司和国际奥委会

时钟使能上升或下降时钟边沿输入

寄存器/锁存器。请注意，每个个体的LCC时钟具有其

自己的极性控制。供的LCC的全球小区包括sum-

的副产物控制方面的全局复位和预置，以及

快速乘积项控制对LCC寄存器型，用来保存

产品条款的可装载计数器和状态机（见

图11）。该PA7572提供了分隔两个全球电池

该低成本航空公司的LCC国际石油公司和成组， A和B以及半

国际石油公司使用全局小区A ，有一半使用全局细胞B.这意味着，

两个高速全局时钟可以使用的低成本航空公司之一。

CLK1

CLK2

M UX

PCLK

INC钟

I / O单元（ IOC）

所有PEEL 阵列具有I / O单元（ IOC）如上所示

图6.输入到国际石油公司可以从任何的馈

的LCC阵列中。每一个国际奥委会包括路由和控制

多路复用器，输入寄存器/透明锁存器，一个三

态缓冲器和输出极性控制。寄存器/

锁存器可以从不同的来源确定的时钟

由全球小区。它也可以被绕过一个非

注册的输入。在PA7572允许使用SUM -D的如

反馈到阵列时， I / O引脚是一个专用

输出。这使得更多的埋寄存器和逻辑

路径。（参见图8和图9）。

摹叶形手机： INC。

A组& B

CLK1

CLK2

Q D

M UX

LCC钟

M UX

PCLK

国际奥委会钟

输入可选

I / O

注册类型

预设

LCC注册类型

LCC预设

LCC复位

I / O与

独立

OUTPUT ENABLE

RESET

摹叶形手机： LCC & IO

08-15-010A

08-15-008A

图10.全局细胞

注册类型的水珠，细胞

图8. LCC & IOC带两个输出

Q D

注册泰PE切换功能

全球电池可以DYNAM ically更改用户

选择LCC寄存器从D到T或从D-

到JK 。这样可以节省乘积项S表示可加载

柜台或州米achines 。使用为D寄存器

加载，作为T或JK计数。蒂姆· ING

让s DYNAM IC的工作。

埋寄存器或

逻辑路径

本安输出

例如：

产品期限S代表10位可加载二进制计数器

D使用57乘积项S（ 47数， 10的负载）

T采用30乘积项S（ 10数， 20的负载）

D / T采用20乘积项S（ 10数， 10的负载）

08-15-011 A

08-15-009A

图9. LCC &奥委会提供三路输出

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图11.注册类型切换功能

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PEEL 阵列开发支持

为PEEL 阵列的开发支持由设

易亨电子和流行的开发工具制造商。

易亨电子提供的强大之处开发软件

（免费向合格的PLD设计人员）。

地方软件包括一个建筑主编，逻辑

编译器，波形模拟器，文档工具和

编程接口。地方图形编辑器

说明并控制PEEL 阵列的架构，

使得整体设计简单易懂，而

让布尔逻辑方程的有效性，国家

机械设计与真理表项。地方编译

进行逻辑转换和还原，使其

可以在几乎任何方式和合适的指定方程式

最可能的逻辑，在每一个设计。 PLACE还

提供了一种多级逻辑模拟器允许外部和

内部信号被模拟，并通过一个分析

波形显示（参见图12 ，图13 ，图14）

意想不到的变化可以迅速且不浪费地制成。

PEEL 阵列编程支持多

流行的第三方编程。

设计安全性和签名字

皮尔阵列提供了一个特殊的EEPROM安全位

防止未经授权的读取或设计的复制。

一旦设定，剥离阵列的编程位

不能被访问，直到整个芯片已

电擦除。另一种编程功能，

签名字，允许用户自定义代码，以

编入PEEL 阵列。该代码可以读

回连后的安全位被置位。签名

词可以被用于识别在所编程的图案

设备或记录的设计修改。

图13.将LCC和IOC屏幕

图12.将建筑编辑器

PEEL 阵列的发展也支持流行

开发工具，如亚伯和中国政法大学，通过信息通信技术的

PEEL 阵列钳工。一种特殊的智能翻译工具增加了

的能力，以直接转换的JEDEC文件等

设备分为相等的JEDEC文件引脚兼容

PEEL 阵列。

程序设计

PEEL 数组是EE -可重编程中的所有包

类型，塑料DIP ， PLCC和SOIC 。这使得他们的

理想的发展途径，使实验室。 EE-

可重编程也是生产有用的，可以让

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图14.将模拟器屏幕

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