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MX23L1654
16M位低电压,串行MASK ROM
与50MHz的SPI总线接口
特点
掩膜ROM 16Mbit的
2.7至3.6V单电源电压
SPI总线兼容的串行接口
50MHz的时钟速率(最大)
描述
该MX23L1654是16兆( 2M ×8 )串行掩膜ROM
通过高速SPI兼容总线访问。
销刀豆网络gurations
16引脚SOP ( 300万)
HOLD #
VCC
NC
NC
NC
NC
S#
Q
1
2
3
4
5
6
7
8
16
15
14
13
12
11
10
9
C
D
NC
NC
NC
NC
VSS
NC
引脚说明
符号
C
D
Q
S#
HOLD #
VCC
VSS
描述
串行时钟
串行数据输入
串行数据输出
芯片选择
HOLD
电源电压
注意:
1. NC =无连接
2.请参阅第16页(起)的封装尺寸,并
如何识别引脚1 。
订购信息
产品型号
MX23L1654MC-20
MX23L1654MC-20G
MX23L1654MI-20G
速度
20ns
20ns
20ns
16-SOP
16-SOP
16-SOP
备注
无铅
无铅(工业级)
注意:
*工业级工作温度: -25 85
°
C
商业级工作温度: 0 70
°
C
P / N : PM1174
1
REV 。 1.2 ,六月08,2005
MX23L1654
存储器组织
该存储器分为:
- 2M字节( 8位每)
框图
HOLD #
控制逻辑
S#
C
D
Q
I / O移位寄存器
地址寄存器
和反
64字节
数据缓冲区
Y译码
大小
只读
内存区
X解码器
P / N : PM1174
2
REV 。 1.2 ,六月08,2005
MX23L1654
信号说明
串行数据输出( Q) 。
该输出信号被用来
传输的数据串行移出器件。数据被移出
在串行时钟( C)的下降沿。
串行数据输入( D)。
这个输入信号被用来传送
数据串行地插入设备。接收指令,
地址和数据进行编程。值是
锁存串行时钟( C)的上升沿。
串行时钟(C) 。
此输入信号提供的定时
串行接口。指令,地址或数据
本在串行数据输入(D)中被锁存的上升
串行时钟( C)的边缘。串行数据输出数据( Q)
串行时钟( C)的下降沿后的变化。
芯片选择(S # ) 。
当该输入信号为高,则
设备被取消。驱动芯片选择(S # )低ENA-
BLES的设备,将其放置在有源功率模式。
上电后,在芯片选择(S # )的下降沿是
任何指令开始之前所需。
持有( HOLD # ) 。
的保持(HOLD # )信号被用于暂停
与没有该设备的任何串行通信
取消选择该设备。
在保持状态下,串行数据输出( Q)为高
阻抗和串行数据输入( D)和串行时钟(C )
都不在乎。
要启动保持状态,设备必须选择,
带片选(S # )驱动为低电平。
P / N : PM1174
3
REV 。 1.2 ,六月08,2005
MX23L1654
SPI模式
这些设备可以通过用微控制器来驱动其
在任一下列两种模式的SPI外设运行:
- CPOL = 0 , CPHA = 0
- CPOL = 1 , CPHA = 1
对于这两种模式中,输入数据被锁存的上升
串行时钟( C)和输出数据的边缘可以从
串行时钟( C)的下降沿。
两种模式之间的差异,如图
2 ,是时钟极性时,总线主机处于待机
模式,而不是传输数据:
- C保持为0 ( CPOL = 0 , CPHA = 0 )
- C保持为1 ( CPOL = 1 , CPHA = 1 )
图1. Bus Master,和内存上的SPI总线器件
SDO
SPI接口与
( CPOL , CPHA ) =
(0 ,0)或(1, 1)
SDI
SCK
Q D
总线主控
( ST6 , ST7 , ST9 ,
ST10 ,其他)
SPI存储器
设备
CS3
CS2
CS1
S#
HOLD #
S#
HOLD #
S#
HOLD #
SPI存储器
设备
SPI存储器
设备
Q D
Q D
注: 1。保持(HOLD # )信号应该是驱动,高低合适。
图2. SPI模式支持
CPOL
CPHA
C
0
0
1
1
C
D
最高位
Q
最高位
P / N : PM1174
4
REV 。 1.2 ,六月08,2005
MX23L1654
操作特性
有源电力,待机功耗
当片选(S # )为低电平时,器件处于启用状态,
在有源模式。当片选(S # )为高,
该设备被禁用,但仍然可以在Active
电源模式,直到所有的内部循环完成。该
然后设备进入到待机功耗模式。该
设备的消耗降到ICC1 。
的保持条件开始对保留的下降沿
( HOLD )的信号,只要该恰逢系列
时钟( C)为低(见图3)。
在保留的上升沿保持状态结束
( HOLD # )信号,只要该恰逢系列
时钟(C )为低。
如果下降沿不与串行时钟重合(C)的
是低,保持状态串行时钟( C)后开始
下一个变低。同样,如果上升沿不
与串行时钟( C)为低,保持一致的条件
化结束后,串行时钟( C)下一个变低。 (这是
在图2中示出)。
在保持状态下,串行数据输出( Q)是
高阻抗,以及串行数据输入( D)和串行时钟
( C)是不在乎。
通常情况下,器件将保持选中,带片选
(S # )驱动为低电平,为保持条件的整个持续时间
化。这是为了确保在内部逻辑的状态
保持进入保持的时刻不变
条件。
如果芯片选择(S # )变为高电平,而该设备在保持
条件,这具有重置内部逻辑的效果
该装置。要重新启动与器件的通信,
有必要驱动保持(HOLD # )高,然后向
驱动芯片选择(S # )低。这可防止设备
回到保持状态。
保护模式
其中,非易失性存储器器件的环境
使用可以很嘈杂。没有SPI器件可以工作
正确的过度噪音的存在。为了帮助
解决这个问题,该MX23L1654拥有以下数据
保护机制:
- 上电复位和一个内部定时器( tPUW )可提供
防止在电源疏忽造成的变化
供给是运行规范之外。
保持状态
的保持(HOLD # )信号被用于暂停任何串行
无需重新设置与设备的通信
时钟序列。
进入保持状态,设备必须选择,
带片选(S # )低。
图3.保持状态激活(用于数据输出只)
C
HOLD #
Q2
Q
Q0
Q1
Q2
Q3
Q4
Q5
C
HOLD #
Q2
Q
Q0
Q1
Q2
Q3
Q4
Q5
Q6
P / N : PM1174
5
REV 。 1.2 ,六月08,2005
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