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MV1442
HDB3编码器/解码器/时钟再生
DS3077
ISSUE 4.0
2001年7月
的MV1442 ，随着卓2Mbit的其他设备
PCM信号系列包括一组电路，这将
执行公共信道信令和误差检测
一为2.048Mbit PCM传输链路的操作功能
按照适当的CCITT建议。
该电路被制造在CMOS和从操作
+ 5V单电源供电，所有输入和输出为TTL
兼容。
的MV1442是编码器/解码器，用于对HDB3伪
三元传输代码，在CCITT的附录A中所描述
建议G.703 。该装置进行编码和解码
同时异步。错误监控
提供的功能来检测侵犯了HDB3
编码，所有的人的检测和输入的损失（全零检测）
另外一个回送功能被提供用于终端
测试。该MV1442可以选择的功能中的任一
内部或外部时钟恢复模式。内部时钟
恢复模式可以被选择器要么1.544MHz或
2.048MHz的操作和在该模式中的外部16.384MHz的
晶体（ 12.352MHz为1.544MHz工作）是必需的。
外部时钟恢复模式可以被选择为1.544MHz ，
为2.048MHz或8.448MHz操作。
订购信息
MV1442/IG/DPAS
DIL塑料封装
MV1442/IG/MPES
微型塑料包装
MV1442/IG/MPEG
微型塑料（磁带和卷轴）
NRZ DATA IN
编码器时钟
输入丢失
NRZ数据输出
解码器时钟
RESET AIS
AIS
模式
GND
1
2
3
4
5
6
7
8
9
18
17
16
15
14
13
12
11
10
V
DD
TXD2
TXD1
RXD2
回路测试开启
RXD1
CRYSTAL OUT / CDR
双遭受侵犯
水晶
DP18
特点
片上数字时钟再生
HDB3编码和解码，以CCITT
建议G.703
异步操作
同时编码和解码
时钟恢复信号使得片外时钟
再生
环回控制
HDB3错误监控
“全部问鼎”错误监控
输入丢失报警
低功耗工作
为2.048MHz或1.544MHz工作在外部或
内部时钟恢复模式
在外部时钟恢复8.448MHz操作
模式
NRZ DATA IN
编码器时钟
输入丢失
NRZ数据输出
解码器时钟
RESET AIS
AIS
模式
GND
1
2
3
4
5
6
7
8
9
18
17
16
15
14
13
12
11
10
V
DD
TXD2
TXD1
RXD2
回路测试开启
RXD1
CRYSTAL OUT / CDR
双遭受侵犯
水晶
MP18
（宽体）
图1 - 引脚连接 - 顶视图
绝对最大额定值
V
DD
输入
输出
储存温度
-0.5V至+ 7V
V
DD
-0.5V至GND -0.5V
V
DD
-0.5V至GND -0.5V
-55 ° C至+ 125°C
MV1442
NRZ
DATA IN
编码器
时钟
模式
水晶+
IN
OUT / CDR
编码器
时钟
再生器
解码器
时钟
RXD 1
回路测试
启用
RXD 2
计数器
解码器
错误
电路
AIS电路
损失
输入
NRZ数据
OUT
AIS
TXD 1
TXD 2
双遭受侵犯
RESET AIS
图2 - 框图
功能说明
高密度双极性3 （ HDB3 ）是一个伪三元反
任务的代码，其中的连续的零的数目
这可能会出现被限制为3 ，以允许足够的
时钟恢复在接收器。在四个任何序列
最后的零被取代的连续的二进制零
标记相同极性的前一个标记的，从而破坏掉
荷兰国际集团的交替传号反转（ AMI ）的代码。此标志是
称为冲突。此外，该第一个零也可以是
通过标记取代的，如果最后的标记和最后违反是
相同的极性。此标志不违反AMI码
并且确保连续侵犯交替极性
正因为如此介绍没有DC分量的HDB3信号。
该MV1442主要由三个模块组成： HDB3
编码器，解码器HDB3和时钟再生。
各块的功能现在被分开描述。
正因为如此该报警可以作为一个“全一”探测器。
解码过程和所有的报警电路是同步的
nised于时钟信号被输入到在该块
解码器时钟引脚。该时钟信号可以是asynchro-
理性与编码器的时钟信号。定时dia-
克的HDB3解码器和报警电路的示
在图4至图7 。
除了正常操作模式中，循环试验
模式可用于终端测试。这个模式被选择
通过采取回路测试ENABLE输入高。在此模式下
的的HDB3编码的伪三元数据输出
编码器块被反馈作为输入到解码器
块，从而解码这些数据，并将其在NRZ输出
形式。
时钟再生
HDB3编码器
该HDB3编码器负责转换
进来的NRZ数据转化为transmis-伪三元形式
锡永在一个PCM链路。这个转换是在
根据HDB3编码规律， CCITT规定
推荐G. 703中的数据将被编码的输入上
在NRZ数据输入引脚和编码过程是同步的
nised到时钟信号输入上的编码器
时钟引脚。这两个TXD输出TXD1和TXD2 。表象
在伪三元形式发送的HDB3数据。如果一个标记是要
发送时，输出后的上升沿变高
时钟。脉冲的长度是由正时钟设定
脉冲宽度。的HDB3编码器的时序图是
在网络连接gure 3所示。
时钟再生器块有两种可能的模式
操作。随着MODE引脚置高，内部晶体控制 -
导致时钟再生被选择，而与模式
引脚为低电平，外部时钟再生选择使用，为
例如，一个调谐电路。
在外部时钟再生模式下，逻辑或
版本的HDB3数据，从RXD输入，输出到
对晶体的外部时钟再生电路
OUT / CDR引脚。再生的时钟，然后反馈到
在解码器时钟引脚的外部时钟的MV1442
再生可用于操作的数据传输速率
1.544M比特， 2.048Mbits或8.448Mbits 。
在内部时钟再生模式下，逻辑或
数据被输入到一个数字再生哪个不断
resynchronises除以8计数器对输入的数据
流。这样再生的时钟被输出到设备
编码器电路，并就任何外部电路
解码器时钟引脚。频率的晶体8倍
需要的数据速率之间必须连接的
水晶和水晶OUT / CDR引脚。因此，该
晶振频率需要是16.384MHz的或12.352MHz
分别2.048Mbits或1.544M比特的数据传输速率。
内部时钟再生可能不能用于操作
在8.448Mbits的数据速率。
的MV1442能够承受高达0.25UI的
峰峰值输入抖动为2.048MHz的抖动频率
不将误差引入的解码数据。在较低的
抖动频率的MV1442能够承受的
更大值的峰值到峰值输入抖动。在
HDB3解码器
的HDB3解码器负责的HDB3解码
在其输入RXD1和RXD2成NRZ伪三元数据
表格上的NRZ数据输出引脚输出。此外
此，译码器电路提供三个报警输出。该
首先，这些报警的是双违规行为。正如它的名字
所暗示的，在此输出一个逻辑高电平表示两个
连续的侵权行为已经收到了同样的
极性，从而违反了HDB3编码规律。第二个
报警器，输入丢失，用来表示有11次连续
略去零收到的RXD输入。决赛
报警输出为AIS （全1）本报警变为高电平，如果少
超过3解码零已经在前中被检测
RESET AIS = 1期（即RESET AIS = 0脉冲之间）
2
MV1442
没有输入抖动的MV1442将产生一个输出
在之间的锯齿倾斜的形式抖动波形
0UI和0.125UI 。此波形的周期将被去
悬垂时的差之间的频率
遥控发射器的时钟和晶振时钟控制
在MV1442 。
该MV1442最初被设计为兼容的引脚
更换了很大的改进内部的MV1441
时钟恢复电路以及在8.448MHz ，允许操作
外部时钟恢复选择。
编码器
时钟
NRZ DATA IN
4 · 5个时钟周期
TXD1
B
B
B
V
TXD2
B
B
V
笔记
1.编码HDB3输出， TXD1和TXD2 。延迟DY相对于NRZ数据在4 · 5个时钟周期。
2， B为HDB3大关， V是HDB3冲突。
图3 - 波形编码器
RXD1
B
B
V
B
B
B
RXD2
B
B
B
B
CDR
解码器
时钟
5个时钟周期
NRZ数据输出
笔记
1.译码的NRZ输出延迟5个时钟周期相对于所述的HDB3输入。
2.图中假设的最后冲突发生在RXD2 。
3， B为HDB3大关， V是HDB3冲突。
图4 - 解码波形
RXD1
B
B
V
B
V
V
RXD2
解码器
时钟
双
违反
B
B
B
1个时钟周期
笔记
1.有从检测到错误的一个时钟周期的延迟和DOUBLE遭受侵犯的上升沿
2.图中假设的最后冲突发生在RXD2 。
3， B为HDB3大关， V是HDB3冲突。
图5 - HDB3双波形违规
3
MV1442
RXD1
RXD2
解码器
时钟
损失
输入
1
2
3
4
5
6
7
8
9
10
11
1个时钟周期
记
输入输出损耗延迟一个时钟周期就传入HDB3波形
图6 - 输入波形的失
解码器
时钟
NRZ数据输出
RESET AIS
AIS
图7 - AIS和RESET AIS波形
针
1
2
3
信号名称
NRZ DATA IN
编码器时钟
输入丢失
描述
输入引脚的数据被编码成伪三元HDB3形式。该数据移入
由编码器时钟的下降沿的编码块。
时钟输入数据引脚1的编码。
从输入电路的损耗后输出，该输出变为高电平一个时钟周期
检测11个连续的零上的解码器输入。任何逻辑“1”输入端
（ RXD1或RXD2 = 0 ）重置一个时钟周期的延迟之后，这个计数。
从伪三元输入的解码获得的解码器的NRZ数据输出
块。
时钟输入到解码器的块为上RXD1和RXD2或TXD1和TXD2解码数据
在环测试模式。在内部时钟再生模式下，该引脚用于输出
再生的时钟到外部电路。在外部时钟再生模式下，该引脚为
用于输入外部再生的时钟信号直接到解码器块。
复位输入到解码零反逻辑“0”在此输入复位解码零
计数器。它也将复位AIS的输出为'0'设置3个或多个零已被解码
在前面的RESET AIS = 1期，或设置AIS为1，如果小于零3已
在前述复位解码AIS = 1期间这可以用于指示丢失
时隙为零。该引脚上的逻辑“1”使能解码零专柜。
从AIS电路输出（见说明引脚6） 。
输入引脚选择时钟再生模式。在此输入逻辑高电平选择内部
晶体控制时钟再生，而逻辑低电平选择外部时钟再生。
数字地0V 。
表1 - 引脚说明
续...
4
5
NRZ数据输出
解码器时钟
6
RESET AIS
7
8
9
AIS
模式
GND
4
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MV1442
HDB3编码器/解码器/时钟再生
DS3077
ISSUE 4.0
2001年7月
的MV1442 ，随着卓2Mbit的其他设备
PCM信号系列包括一组电路，这将
执行公共信道信令和误差检测
一为2.048Mbit PCM传输链路的操作功能
按照适当的CCITT建议。
该电路被制造在CMOS和从操作
+ 5V单电源供电，所有输入和输出为TTL
兼容。
的MV1442是编码器/解码器，用于对HDB3伪
三元传输代码，在CCITT的附录A中所描述
建议G.703 。该装置进行编码和解码
同时异步。错误监控
提供的功能来检测侵犯了HDB3
编码，所有的人的检测和输入的损失（全零检测）
另外一个回送功能被提供用于终端
测试。该MV1442可以选择的功能中的任一
内部或外部时钟恢复模式。内部时钟
恢复模式可以被选择器要么1.544MHz或
2.048MHz的操作和在该模式中的外部16.384MHz的
晶体（ 12.352MHz为1.544MHz工作）是必需的。
外部时钟恢复模式可以被选择为1.544MHz ，
为2.048MHz或8.448MHz操作。
订购信息
MV1442/IG/DPAS
DIL塑料封装
MV1442/IG/MPES
微型塑料包装
MV1442/IG/MPEG
微型塑料（磁带和卷轴）
NRZ DATA IN
编码器时钟
输入丢失
NRZ数据输出
解码器时钟
RESET AIS
AIS
模式
GND
1
2
3
4
5
6
7
8
9
18
17
16
15
14
13
12
11
10
V
DD
TXD2
TXD1
RXD2
回路测试开启
RXD1
CRYSTAL OUT / CDR
双遭受侵犯
水晶
DP18
特点
片上数字时钟再生
HDB3编码和解码，以CCITT
建议G.703
异步操作
同时编码和解码
时钟恢复信号使得片外时钟
再生
环回控制
HDB3错误监控
“全部问鼎”错误监控
输入丢失报警
低功耗工作
为2.048MHz或1.544MHz工作在外部或
内部时钟恢复模式
在外部时钟恢复8.448MHz操作
模式
NRZ DATA IN
编码器时钟
输入丢失
NRZ数据输出
解码器时钟
RESET AIS
AIS
模式
GND
1
2
3
4
5
6
7
8
9
18
17
16
15
14
13
12
11
10
V
DD
TXD2
TXD1
RXD2
回路测试开启
RXD1
CRYSTAL OUT / CDR
双遭受侵犯
水晶
MP18
（宽体）
图1 - 引脚连接 - 顶视图
绝对最大额定值
V
DD
输入
输出
储存温度
-0.5V至+ 7V
V
DD
-0.5V至GND -0.5V
V
DD
-0.5V至GND -0.5V
-55 ° C至+ 125°C
MV1442
NRZ
DATA IN
编码器
时钟
模式
水晶+
IN
OUT / CDR
编码器
时钟
再生器
解码器
时钟
RXD 1
回路测试
启用
RXD 2
计数器
解码器
错误
电路
AIS电路
损失
输入
NRZ数据
OUT
AIS
TXD 1
TXD 2
双遭受侵犯
RESET AIS
图2 - 框图
功能说明
高密度双极性3 （ HDB3 ）是一个伪三元反
任务的代码，其中的连续的零的数目
这可能会出现被限制为3 ，以允许足够的
时钟恢复在接收器。在四个任何序列
最后的零被取代的连续的二进制零
标记相同极性的前一个标记的，从而破坏掉
荷兰国际集团的交替传号反转（ AMI ）的代码。此标志是
称为冲突。此外，该第一个零也可以是
通过标记取代的，如果最后的标记和最后违反是
相同的极性。此标志不违反AMI码
并且确保连续侵犯交替极性
正因为如此介绍没有DC分量的HDB3信号。
该MV1442主要由三个模块组成： HDB3
编码器，解码器HDB3和时钟再生。
各块的功能现在被分开描述。
正因为如此该报警可以作为一个“全一”探测器。
解码过程和所有的报警电路是同步的
nised于时钟信号被输入到在该块
解码器时钟引脚。该时钟信号可以是asynchro-
理性与编码器的时钟信号。定时dia-
克的HDB3解码器和报警电路的示
在图4至图7 。
除了正常操作模式中，循环试验
模式可用于终端测试。这个模式被选择
通过采取回路测试ENABLE输入高。在此模式下
的的HDB3编码的伪三元数据输出
编码器块被反馈作为输入到解码器
块，从而解码这些数据，并将其在NRZ输出
形式。
时钟再生
HDB3编码器
该HDB3编码器负责转换
进来的NRZ数据转化为transmis-伪三元形式
锡永在一个PCM链路。这个转换是在
根据HDB3编码规律， CCITT规定
推荐G. 703中的数据将被编码的输入上
在NRZ数据输入引脚和编码过程是同步的
nised到时钟信号输入上的编码器
时钟引脚。这两个TXD输出TXD1和TXD2 。表象
在伪三元形式发送的HDB3数据。如果一个标记是要
发送时，输出后的上升沿变高
时钟。脉冲的长度是由正时钟设定
脉冲宽度。的HDB3编码器的时序图是
在网络连接gure 3所示。
时钟再生器块有两种可能的模式
操作。随着MODE引脚置高，内部晶体控制 -
导致时钟再生被选择，而与模式
引脚为低电平，外部时钟再生选择使用，为
例如，一个调谐电路。
在外部时钟再生模式下，逻辑或
版本的HDB3数据，从RXD输入，输出到
对晶体的外部时钟再生电路
OUT / CDR引脚。再生的时钟，然后反馈到
在解码器时钟引脚的外部时钟的MV1442
再生可用于操作的数据传输速率
1.544M比特， 2.048Mbits或8.448Mbits 。
在内部时钟再生模式下，逻辑或
数据被输入到一个数字再生哪个不断
resynchronises除以8计数器对输入的数据
流。这样再生的时钟被输出到设备
编码器电路，并就任何外部电路
解码器时钟引脚。频率的晶体8倍
需要的数据速率之间必须连接的
水晶和水晶OUT / CDR引脚。因此，该
晶振频率需要是16.384MHz的或12.352MHz
分别2.048Mbits或1.544M比特的数据传输速率。
内部时钟再生可能不能用于操作
在8.448Mbits的数据速率。
的MV1442能够承受高达0.25UI的
峰峰值输入抖动为2.048MHz的抖动频率
不将误差引入的解码数据。在较低的
抖动频率的MV1442能够承受的
更大值的峰值到峰值输入抖动。在
HDB3解码器
的HDB3解码器负责的HDB3解码
在其输入RXD1和RXD2成NRZ伪三元数据
表格上的NRZ数据输出引脚输出。此外
此，译码器电路提供三个报警输出。该
首先，这些报警的是双违规行为。正如它的名字
所暗示的，在此输出一个逻辑高电平表示两个
连续的侵权行为已经收到了同样的
极性，从而违反了HDB3编码规律。第二个
报警器，输入丢失，用来表示有11次连续
略去零收到的RXD输入。决赛
报警输出为AIS （全1）本报警变为高电平，如果少
超过3解码零已经在前中被检测
RESET AIS = 1期（即RESET AIS = 0脉冲之间）
2
MV1442
没有输入抖动的MV1442将产生一个输出
在之间的锯齿倾斜的形式抖动波形
0UI和0.125UI 。此波形的周期将被去
悬垂时的差之间的频率
遥控发射器的时钟和晶振时钟控制
在MV1442 。
该MV1442最初被设计为兼容的引脚
更换了很大的改进内部的MV1441
时钟恢复电路以及在8.448MHz ，允许操作
外部时钟恢复选择。
编码器
时钟
NRZ DATA IN
4 · 5个时钟周期
TXD1
B
B
B
V
TXD2
B
B
V
笔记
1.编码HDB3输出， TXD1和TXD2 。延迟DY相对于NRZ数据在4 · 5个时钟周期。
2， B为HDB3大关， V是HDB3冲突。
图3 - 波形编码器
RXD1
B
B
V
B
B
B
RXD2
B
B
B
B
CDR
解码器
时钟
5个时钟周期
NRZ数据输出
笔记
1.译码的NRZ输出延迟5个时钟周期相对于所述的HDB3输入。
2.图中假设的最后冲突发生在RXD2 。
3， B为HDB3大关， V是HDB3冲突。
图4 - 解码波形
RXD1
B
B
V
B
V
V
RXD2
解码器
时钟
双
违反
B
B
B
1个时钟周期
笔记
1.有从检测到错误的一个时钟周期的延迟和DOUBLE遭受侵犯的上升沿
2.图中假设的最后冲突发生在RXD2 。
3， B为HDB3大关， V是HDB3冲突。
图5 - HDB3双波形违规
3
MV1442
RXD1
RXD2
解码器
时钟
损失
输入
1
2
3
4
5
6
7
8
9
10
11
1个时钟周期
记
输入输出损耗延迟一个时钟周期就传入HDB3波形
图6 - 输入波形的失
解码器
时钟
NRZ数据输出
RESET AIS
AIS
图7 - AIS和RESET AIS波形
针
1
2
3
信号名称
NRZ DATA IN
编码器时钟
输入丢失
描述
输入引脚的数据被编码成伪三元HDB3形式。该数据移入
由编码器时钟的下降沿的编码块。
时钟输入数据引脚1的编码。
从输入电路的损耗后输出，该输出变为高电平一个时钟周期
检测11个连续的零上的解码器输入。任何逻辑“1”输入端
（ RXD1或RXD2 = 0 ）重置一个时钟周期的延迟之后，这个计数。
从伪三元输入的解码获得的解码器的NRZ数据输出
块。
时钟输入到解码器的块为上RXD1和RXD2或TXD1和TXD2解码数据
在环测试模式。在内部时钟再生模式下，该引脚用于输出
再生的时钟到外部电路。在外部时钟再生模式下，该引脚为
用于输入外部再生的时钟信号直接到解码器块。
复位输入到解码零反逻辑“0”在此输入复位解码零
计数器。它也将复位AIS的输出为'0'设置3个或多个零已被解码
在前面的RESET AIS = 1期，或设置AIS为1，如果小于零3已
在前述复位解码AIS = 1期间这可以用于指示丢失
时隙为零。该引脚上的逻辑“1”使能解码零专柜。
从AIS电路输出（见说明引脚6） 。
输入引脚选择时钟再生模式。在此输入逻辑高电平选择内部
晶体控制时钟再生，而逻辑低电平选择外部时钟再生。
数字地0V 。
表1 - 引脚说明
续...
4
5
NRZ数据输出
解码器时钟
6
RESET AIS
7
8
9
AIS
模式
GND
4
QQ：2880707522 复制
