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E2O0009-27-X2

半导体

MSM80C85AHRS/GS/JS

半导体

8位CMOS微处理器

这个版本： 1998年1月

MSM80C85AHRS/GS/JS

上一版本： 1996年8月

GENRAL描述

该MSM80C85AH是一个完整的8位并行;在硅栅实现中央处理器

C-MOS技术，并与MSM80C85A兼容。

它的设计具有较高的处理速度（ max.5兆赫）和更低的功耗

与MSM80C85A和掉电模式相比提供，从而提供一个高层次

系统集成。

该MSM80C85AH使用多路复用地址/数据总线。地址被分成了8间

位地址总线和8位数据总线。片上地址锁存：一个MSM81C55-5存储器的

产品允许直接接口与MSM80C85AH 。

特点

掉电模式（ HALT - HOLD ）

低功耗： 50毫瓦（典型值）

单+ 3 + 6 V电源

-40至+ 85°C ，工作温度

兼容MSM80C85A

0.8

指令周期（V

= 5V)

片上时钟发生器（带外部晶振）

片上系统控制器;先进的循环状态信息可用于大型系统

控制

在MSM80C85AH错误操作是固定的

四个向量中断（一个是不可屏蔽的），再加上8080A兼容中断。

序列，输入/串行输出端口

十进制，二进制和双精度算术

寻址能力为内存的64K字节

TTL兼容

40引脚塑料DIP （ DIP40 -P - 600-2.54 ）：（产品名称： MSM80C85AHRS ）

44引脚塑料QFJ （ QFJ44 -P - S650-1.27 ）：（产品名称： MSM80C85AHJS ）

44引脚塑料QFP （ QFP44 -P - 910-0.80-2K ）：（产品名称： MSM80C85AHGS - 2K ）

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半导体

MSM80C85AHRS/GS/JS

功能框图

RST

INTR

INTA

5.5 6.5

7.5 TRAP

SID

超氧化物歧化酶

中断控制

串行I / O控制

8位内部数据总线

累加器

(8)

临时寄存器

(8)

FLAG （ 5 ）

人字拖

指令

算术

逻辑单元

ALU(8)

指令

解码器

和

机

周期

编码

B REG （ 8 ）

REG （ 8 ）

ARRAY

堆栈指针（ 16 ）

程序计数器（ 16 ）

增量/递减器

地址锁存（ 16 ）

动力

供应

+5V

GND

掉电

CLK

根

定时和控制

控制

状态

DMA

RESET

地址缓冲器（ 8 ）

数据/地址

缓冲器（8 ）

CLK

OUT

准备

RD WR

ALE

S1 IO /

HOLD HLDA

RESET IN

复位输出

- A

地址总线

- AD

地址/数据总线

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半导体

MSM80C85AHRS/GS/JS

引脚配置（顶视图）

40引脚塑料DIP

复位输出

超氧化物歧化酶

SID

陷阱

RST7.5

RST6.5

RST5.5

INTR

INTA

GND

33 READY

32 IO / M

31 S

28 ALE

27 S

26 A

25 A

24 A

23 A

HOLD

HLDA

CLK （OUT）

RESET IN

准备

IO / M

ALE

44引脚塑料QFP

42 RESET OUT

35 CLK （OUT）

陷阱1

RST7.5 2

RST6.5 3

RST5.5 4

INTR 5

INTA

NC 11

RESET IN

37 HOLD

36 HLDA

43超氧化物歧化酶

38 V

44 SID

39 NC

41 X

40 X

44引脚塑料QFJ

4复位输出

GND 16

NC 22

41 CLK （OUT）

陷阱7

RST7.5 8

RST6.5 9

RST5.5 10

INTR 11

NC 12

INTA

RESET IN

39 READY

38 IO / M

37 S

34 NC

33 ALE

32 S

31 A

30 A

29 A

43 HOLD

NC 19

GND 23

42 HLDA

5 SOD

44 V

6 SID

1 NC

3 X

2 X

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半导体

MSM80C85AHRS/GS/JS

MSM80C85AH功能引脚定义

下面介绍各引脚的功能：

符号

- A

（输出，三态）

- A

（输入/输出）

3-state

ALE

（输出）

功能

地址总线：最显著的8位内存地址或8位的I / O地址，

在保持和暂停模式和复位期间三态。

复用的地址/数据总线：低8位的内存地址（或I / O地址）出现在

在一个机器周期的第一个时钟周期（T状态）总线。这期间就成为数据总线

在第二和第三个时钟周期。

地址锁存使能：它发生在一个机器周期的第一个时钟状态，使地址

得到锁存到片上闩的外围设备。 ALE的下降沿被设定，以保证安装和

保持时间地址信息。下降沿的ALE也可用于选通的状态

信息ALE是从来没有三态。

机器周期状态：

IO / M传

国

IO / M传

国

中断响应

停止

= 3态

HOLD

（高阻抗）

RESET

=不详

, S

， IO / M

（输出）

存储器写

存储器读

I / O写

I / O读

取码

可以作为一种先进的R / W状态。 IO / M，S

和S

成为有效时的开始

在整个周期中一个机器周期和保持稳定。 ALE的下降沿可以被用来锁存

这些线的状态。

（输出，三态）

准备

（输入）

读控制：在低水平

指示所选择的存储器或I / O设备将要读那

数据总线可用于数据传输，在保持和HALT模式和复位期间三态。

WRITE控制：在低水平

表示在数据总线上的数据是要被写入到所选择的

内存或I / O位置。数据被设置在所述后缘

WR ，

保持和暂停期间三态

模式和复位过程中。

如果READY是在读或写周期的高，则表明该存储器或外设准备好

发送或接收数据。如果READY为低电平时，CPU将等待时钟周期READY的整数倍

完成读或写周期之前去高READY必须符合规定的设置和

保持时间。

HOLD表明另一个主机请求使用的地址和数据总线。

的CPU ，在接收到保持请求，将立即放弃总线的使用为完成

当前总线传输。内部处理可以继续。该处理器只能重新获得总线

后HOLD被删除。当HOLD得到确认，地址，数据，

RD ， WR ，

和IO / M

被三态线路。和断电的状态通过HOLD控制。

保持应答：表示CPU已收到HOLD请求，这将

放弃总线在下一时钟周期。 HLDA变为低电平保持请求被删除后。

该CPU采用总线半个时钟周期之后HLDA变低。

中断请求：作为一个通用中断。在它旁边是采样

在保持指令的最后一个时钟周期和暂停状态。如果是积极的，程序

计数器（PC）将来自递增和一个被禁止

INTA

将发行。在这个周期

重新启动或CALL指令可以插入跳转到中断服务程序。

该INTR被启用，通过软件关闭。它是由复位后立即禁用

接受中断。掉电模式是由INTR复位。

中断确认：用来代替（并具有相同的定时）

中

一个INTR后，指令周期被接受。

重启中断：这三个输入有相同的定时。INTR除了它们引起

内部RESTART被自动插入。

这些中断的优先级排序，如表1中。这些中断具有更高的优先级

比INTR 。此外，它们可以单独地被屏蔽掉使用SIM卡的指令。

掉电模式是由这些中断复位。

陷阱中断是不可屏蔽中断重启。这是在相同的定时INTR或识别

RST 5.5 - 7.5 。它不受任何屏蔽或中断禁用。它具有任何优先级最高

中断。（见表1 ），掉电模式是通过TRAP输入复位。

HOLD

（输入）

HLDA

（输出）

INTR

（输出）

INTA

（输出）

RST 5.5

RST 6.5

RST 7.5

（输入）

陷阱

（输入）

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半导体

MSM80C85AHRS/GS/JS

符号

功能

设置程序计数器为零并复位中断使能和HLDA触发器和释放

掉电模式。复位期间，数据和地址总线和控制线被三态和

因为复位的异步特性，处理器的内部寄存器和标志可能是

与不可预知的结果改变了复位。重置是一个施密特触发输入，允许

连接一个RC网络，用于上电复位延时。 CPU处于复位状态为持有

只要重新设置应用。

表示CPU处于复位状态。可作为一个系统复位。该信号被同步到

处理器时钟和持续的时钟周期的整数倍。

和X

被连接到晶体驱动内部时钟发生器。 X

也可以是一个外部

从一个逻辑门电路的时钟输入。输入频率除以2 ，得到处理器的内部

工作频率。

时钟输出用作系统时钟。 CLK的周期是两次在X

, X

输入周期。

串行输入数据线。在这条线的数据被加载到累加器的位7 ，每当一个RIM的指令

被执行。

串行输出数据线。输出SOD设置或重新设置SIM卡指令指定。

+ 5伏电源

接地参考。

RESET IN

（输入）

复位输出

（输出）

, X

（输入）

CLK

（输出）

SID

（输入）

超氧化物歧化酶

（输出）

GND

表1中断优先级，重新启动地址和灵敏度

名字

陷阱

RST 7.5

RST 6.5

RST 5.5

INTR

优先

地址分支到（1）

当产生中断时

24H

3CH

34H

2CH

(2)

触发类型

上升沿和高层次的单位进行采样。

上升沿（锁存）。

高水平自已的采样。

高电平直到采样。

注：（ 1）处理器将堆栈中的PC的分支所指示的前

地址。

（2）地址分支到依赖于提供给所述CPU的指令

当中断被确认。

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