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MPC859TTS/D
修订版1.2 , 4/2003
MPC859P/859T/859DSL
的PowerQUICC
家庭技术摘要
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本文档提供了MPC859P / 859T / 859DSL的PowerQUICC 的概述
家庭,描述主要功能和特点。该MPC859P / 859T / 859DSL的PowerQUICC
家庭包含的PowerPC 处理器内核。涉及的主题包括:
部分
第1.1节, “功能”
第1.2节, “嵌入式MPC8xx核心”
第1.3节“系统接口单元( SIU ) ”
第1.4节“ PCMCIA控制器”
第1.5节, “电源管理”
第1.6节, “通信处理器模块( CPM ) ”
第1.7节, “ ATM功能”
第1.8节, “ MPC859P / 859T和MPC859DSL之间的差异”
第1.9节, “文档修订历史”
页面
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该MPC859P / 859T / 859DSL的PowerQUICC系列是0.18微米版的MPC860的
PowerQUICC系列和可运行在高达133 MHz的上MPC8xx核心具有66 MHz的
外部总线。在MPC866系列具有1.8V内核,并与5 V 3.3 VI / O操作
TTL兼容。该MPC859P / 859T / 859DSL集成通信控制器
家庭是一个多功能的单芯片集成的微处理器和外围组合,可以
在多种控制应用中使用。它特别擅长在两个通信
和网络系统。
该MPC859P / 859T / 859DSL家庭是一个PowerPC架构为基础的衍生
摩托罗拉的MPC860四核集成通信控制器(的PowerQUICC ) 。该CPU
在MPC859P / 859T / 859DSL是MPC8xx芯,一个32位的微处理器,它
实现了PowerPC架构,集成内存管理单元(MMU )和
指令和数据高速缓存。该MPC859P主要描述本文档中。
表1示出了由MPC859P家族的成员支持的功能:
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特点
表1. MPC859T家庭
缓存
部分
指令
缓存
16字节
4字节
4字节
数据缓存
8字节
4字节
4字节
ETHERNET
10Base
T
1
1
1
SCC
10/100
1
1
1
1
1
1
串行ATM和UTOPIA
接口
串行ATM和UTOPIA
接口
串行ATM和UTOPIA
接口
ATM支持
MPC859P
MPC859T
MPC859DSL
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1.1
特点
嵌入式MPC8xx核心高达133 MHz的
外部总线的最大工作频率为66 MHz的
- 在为133MHz / 100MHz的核心频率,支持2 : 1模式下
- 该50MHz的/ 66MHz的核心频率既支持1:1和2:1的模式
单一问题, 32位内核(与PowerPC架构去连接nition兼容)与32 , 32位
通用寄存器(GPR )
- 核心执行分支预测有条件预取,没有条件执行
- 4-或8KB的数据高速缓存和4-或16K字节的指令高速缓冲存储器(见表1) 。
- 16K字节的指令缓存( MPC859P )是四通,组相联,256套; 4 -K字节
指令缓存( MPC859T和MPC859DSL )是双向的,组相联128套。
- 8KB的数据缓存( MPC859P )是双向的,组相联,256套; 4 KB的数据
缓存( MPC859T和MPC859DSL )是双向的,组相联128套。
- 高速缓存一致性的指令和数据高速缓存保持在128位( 4个字)
高速缓存块。
- 缓存在物理寻址,实现最近最少使用( LRU )置换
算法,并且可锁定的缓存块为基础。
- MMU的有32项TLB ,完全关联的指令和数据的TLB
- MMU的支持4,16和512千字节和8字节的多个页面大小; 16个虚拟地址
空间和16保护组
该MPC859P / 859T / 859DSL家庭提供了增强的自动取款机的功能上的发现
MPC866 。该MPC859P / 859T / 859DSL增加了可用的主要的新功能中的“增强特区”
(东南非区域)模式,其中包括:
- 改进的操作,管理和维护( OAM )支持
- OAM性能监控( PM )的支持
- 提供多个APC优先级,以支持一系列的TRAF网络步伐的要求
- 端口到端口切换,而不需要基于RAM的微码功能
- 同时MII (的100Base - T)和UTOPIA (半双工)功能
- 每个PHY可选统计细胞计数器
下面的列表总结了关键MPC859P / 859T / 859DSL家庭特点:
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MPC859P / 859T / 859DSL的PowerQUICC 系列技术总结
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特点
- 与加入的FIFO缓冲UTOPIA第2等级兼容接口,以减少总的细胞
传输时间。 (早期的乌托邦水平1特定网络阳离子也支持。 )
- 对MPC859P多PHY支持和MPC859T (上MPC859DSL四PHY支持)
- 参数RAM为SPI和I
2
C能没有基于RAM的微搬迁
- 支持使用全双工UTOPIA两个主( ATM侧)和从器件( PHY端)操作
“分裂”的公交车
- AAL2 / VBR功能ROM驻留
达32位的数据总线(动态母线调整为8 ,16,和32位)
32条地址线
内存控制器(八家银行)
- 包含完整的动态RAM ( DRAM )控制器
- 每个银行可以是一个片选或RAS支持DRAM银行
- 最多30个等待状态每个存储器组编程
- 无缝接口DRAM ,西姆斯SRAM , EPROM中,佛罗里达州灰的EPROM ,和其他内存
器件
- DRAM控制器,可编程,支持大多数的大小和高速存储器接口
- 中科院四线,四WE线,一条线OE
- 开机复位芯片选择(用于8位,16位或32位内存选项)
- 可变块大小( 32字节, 256兆字节)
- 可选择写保护
- 片上总线仲裁逻辑
通用定时器
- 4个16位定时器或两个32位定时器
- 门模式下可以启用/禁用计数
- 中断可以在基准匹配和事件捕获屏蔽
快速以太网控制器( FEC )
- 同时MII (的100Base - T)和UTOPIA操作使用UTOPIA复用时
总线。
系统集成单元( SIU )
- 公交车监控
- 软件看门狗
- 周期性中断定时器( PIT )
时钟合成器
- 递减器和时基
- 复位控制器
- IEEE 1149.1测试访问端口(JTAG)
中断
- 七外部中断请求( IRQ )线路
- 12端口引脚具有中断功能
20个内部中断源
- 鳞癌之间可编程优先级
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特点
- 可编程的最高优先级请求
通信处理器模块( CPM )
- RISC控制器
- 通讯 - 特定网络C命令(例如,
正常停止TRANSMIT
,
ENTER HUNT
模式
和
RESTART TRANSMIT
)
- 支持所有串行通道连续模式下发送和接收
- 双口RAM的8字节
- 对MPC859P和MPC859T 10个串行DMA ( SDMA )通道。 8个串行DMA
(SDMA)的MPC859DSL频道。
- 三个并行I / O和漏极开路功能寄存器
四波特率发生器
- 独立(可连接到SCC或SMC)的
- 允许运行过程中的变化
- 自动波特率支持选项
在MPC859T有一个SCC (串行通信控制器) (在MPC859DSL ,以太网
这SCC的唯一功能)
- 串行ATM功能
- 以太网/ IEEE 802.3支持全10 - Mbps操作
- HDLC / SDLC
- HDLC总线(实现一个基于HDLC的局域网络(LAN) )
- 异步HDLC支持PPP (点对点协议)
- 的AppleTalk
- 通用异步收发器( UART )
- 同步UART
- 串行红外( IrDA)的
- 二进制同步通信( BISYNC )
- 完全透明(比特流)
- 完全透明(基于具有可选的循环冗余校验帧( CRC ) )
两校董会(串行管理通道)
- UART 。该MPC859DSL只包含一个SMC实现UART 。
- 透明
- 通用电路接口( GCI )控制器
- 可连接的时分多路复用(TDM )信道
一个SPI (串行外设接口)
- 支持主从模式
支持在同一总线上多主机操作
- 一个我
2
℃(内部集成电路)端口
- 支持主从模式
- 多主机环境的支持
时隙分配器(TSA) (没有TSA上MPC859DSL )
- 允许SCC和平滑肌细胞,以在复用的和/或非多路复用操作运行
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MPC859P / 859T / 859DSL的PowerQUICC 系列技术总结
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特点
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支持T1 , CEPT , PCM高速公路,用户去定义网络
1-或8位分辨率
允许独立的发射和接收的路由,帧同步,时钟
允许动态变化
可以在内部连接到三个串行通道(一个SCC和两个校董会)
并行接口端口( PIP )
Centronics接口支持
支持在MPC859P / 859T或其他MPC8xx兼容端口之间的快速连接
设备。
PCMCIA接口
- 主(插座)接口, 2.1版兼容
- 支持两个独立的PCMCIA插槽。该MPC859DSL只支持一个PCMCIA
插座(港口B) 。
- 8内存或I / O支持的窗户
调试接口
- 八比较:在指令的地址4运行两个操作的数据地址,和两个
对数据进行操作的
- 支持条件: =
≠
& LT ; & GT ;
- 每个观察点可以由内部产生一个破发点
普通高中和普通低功率模式以节省电力
1.8 V核心,以5 V TTL兼容3.3 VI / O操作
357引脚的球栅阵列(BGA)封装
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