飞思卡尔半导体公司
MPC5200/D
第2版，第5/2004
MPC5200硬件
特定网络阳离子
话题
页面
注意：
飞思卡尔半导体公司...
1
2
3
4
5
6
7
概述...................................... 1
产品特点....................................... 1
电气和热
Characteristics..............................5
包装说明.................. 60
系统设计信息........ 69
订购信息.................. 74
文档修订历史........ 75
本文档中的信息如有
改变。关于MPC5200 ，访问的最新数据
www.mobilegt.com并继续向MPC5200
产品概述页面。
1
概观
该MPC5200集成了高性能的MPC603e系列G2_LE核心与
丰富的外设功能集中在通信和系统
集成。该G2_LE芯的设计是基于在PowerPC
核心架构。
MPC5200集成了一个创新的BestComm I / O子系统，它可以隔离
日常保养的外设功能的嵌入式G2_LE核心。该
MPC5200包含一个SDRAM / DDR内存控制器，灵活的外部总线
接口方面， PCI控制器， USB ， ATA ，以太网，六个可编程串行控制器
（ PSC ） ，我
2
C， SPI ， CAN ， J1850 ，定时器和通用输入输出。
2
特点
MPC603e系列G2_LE核心
—
—
—
—
—
—
—
—
—
—
—
超标量体系结构
760 MIPS在400兆赫（ -40 + 85
o
C)
16K的指令缓存， 16 K个数据缓存
双精度FPU
指令和数据MMU
标准和关键中断能力
高达132 MHz的操作
SDRAM和DDR SDRAM的支持
每CS 256兆字节寻址范围，二CS可用
32位数据总线
内置的初始化和刷新
主要特点如下所示。
SDRAM / DDR存储器接口
灵活的多功能外部总线接口
- 支持接口为ROM /闪存/ SRAM存储器或其他存储
映射设备
欲了解更多有关该产品，
转到： www.freescale.com
飞思卡尔半导体公司
特点
—
—
—
—
—
—
—
—
—
8个可编程芯片选择
使用8/16/32位数据总线高达26位的地址非复用的数据访问
短或长突发能力
使用8/16/32位数据总线与多达25位的地址的多路数据的访问
2.2版的PCI兼容
PCI启动器和目标操作
32位PCI地址/数据总线
33-和66 - MHz运行
PCI仲裁功能
外围组件互连（PCI ）控制器
ATA控制器
- 第4版ATA兼容的外部接口， IDE磁盘驱动器的连接
BestComm DMA子系统
- 智能虚拟DMA控制器
- 专用的DMA通道，以控制周围的接收和发送
- 本地存储器（SRAM 16K字节）
飞思卡尔半导体公司...
6个可编程串行控制器（ PSC ） ，配置为以下几点：
—
—
—
—
UART或RS232接口
CODEC接口的软调制解调器，主/从编解码方式，我
2
S和AC97
全双工SPI模式
IrDA的模式，从2400 bps到4 Mbps的
快速以太网控制器（ FEC ）
- 支持100Mbps的IEEE 802.3 MII ， 10Mbps的IEEE 802.3 MII ， 10 Mbps的7线接口
通用串行总线控制器（USB）的
- USB 1.1版主机
- 开放式主机控制器接口（ OHCI ）
- 集成USB集线器，带有两个端口。
两个内部集成电路接口（I
2
C)
串行外设接口（SPI ）
双CAN 2.0 A / B控制器（ MSCAN ）
- 摩托罗拉可扩展的控制器局域网（ MSCAN ）架构
- 版本2.0A / B CAN协议的实现
- 标准和扩展数据帧
J1850字节数据链路控制器（ BDLC ）
- J1850 B类数据通信网络接口兼容和ISO兼容低
速度（ <125 kbps）表示在汽车应用中的串行数据通信。
- 支持4X模式下， 41.6 kbps的
在帧响应（IFR）类型0，1 ，2和3的支持
2
MPC5200硬件规格
摩托罗拉
欲了解更多有关该产品，
转到： www.freescale.com
飞思卡尔半导体公司
特点
系统级功能
- 中断控制器支持4个外部中断请求线和47个内部中断
来源
- GPIO /定时器功能
- 多达56个总GPIO引脚（取决于复用功能选择）的支持
各种中断/唤醒功能。
- 8个GPIO引脚与定时器功能支持输入捕捉，输出比较和脉冲
宽度调制（PWM）功能
—
—
—
—
—
实时时钟有一秒钟的分辨率
系统保护（看门狗定时器，总线监视器）
功能块的时钟源独立控制
电源管理：小睡，打盹，睡眠，深度睡眠模式
支持的WakeUp从低功耗模式由不同的来源（ GPIO ， RTC ， CAN）
飞思卡尔半导体公司...
测试/调试功能
- JTAG （ IEEE 1149.1测试访问端口）
- 通用片上处理器（ COP ）调试端口
片上PLL和时钟发生器
图1
示出了一个简化的MPC5200框图。
摩托罗拉
MPC5200硬件规格
3
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飞思卡尔半导体公司
电气和热特性
3
3.1
电气和热特性
DC电气特性
3.1.1绝对最大额定值
本节中的表描述了MPC5200直流电气特性。
表1
给人的绝对
最大额定值。
表1绝对最大额定值
1
特征
电源电压 - G2_LE内核和外设逻辑
符号
VDD_CORE
VDD_IO ，
VDD_MEM_IO
SYS_PLL_AVDD
CORE_PLL_AVDD
VIN
VIN
比诺斯
Vinus
TSTG
民
–0.3
–0.3
–0.3
–0.3
–0.3
–0.3
–
–
–55
最大
1.8
3.6
2.1
2.1
VDD_IO + 0.3
VDD_MEM_IO
+ 0.3
1.0
1.0
150
单位
V
V
V
V
V
V
V
V
o
C
SpecID
D1.1
D1.2
D1.3
D1.4
D1.5
D1.6
D1.7
D1.8
D1.9
飞思卡尔半导体公司...
电源电压 - I / O缓冲器
电源电压 - 系统APLL
电源电压 - G2_LE APLL
输入电压（ VDD_IO ）
输入电压（ VDD_MEM_IO ）
输入电压过冲
输入电压的下冲
存储温度范围
1
绝对最大额定值只是应力额定值，以及运行在该最大值不能保证。讲
超越这些，可能会影响设备可靠性或造成永久性的损害。
3.1.2推荐工作条件
表2
给出了推荐的工作条件。
表2推荐工作条件
特征
电源电压 - G2_LE核心和外设
ERAL逻辑
电源电压 - 标准I / O缓冲区
电源电压 - 存储I / O缓冲器
（ SDR）的
电源电压 - 存储I / O缓冲器
（ DDR ）
电源电压 - 系统APLL
电源电压 - G2_LE APLL
输入电压 - 标准I / O缓冲区
输入电压 - 存储I / O缓冲器（ SDR ）
输入电压 - 存储I / O缓冲器（ DDR ）
符号
VDD_CORE
VDD_IO
VDD_MEM_IO
SDR
VDD_MEM_IO
DDR
SYS_PLL_AVDD
CORE_PLL_AVDD
VIN
VIN
SDR
VIN
DDR
民
1
1.42
3.0
3.0
2.42
1.42
1.42
0
0
0
最大
1
1.58
3.6
3.6
2.63
1.58
1.58
VDD_IO
VDD_MEM_IO
SDR
VDD_MEM_IO
DDR
单位
V
V
V
V
V
V
V
V
V
SpecID
D2.1
D2.2
D2.3
D2.4
D2.5
D2.6
D2.7
D2.8
D2.9
摩托罗拉
MPC5200硬件规格
5
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第2版，第5/2004
MPC5200硬件
特定网络阳离子
话题
页面
注意：
飞思卡尔半导体公司...
1
2
3
4
5
6
7
概述...................................... 1
产品特点....................................... 1
电气和热
Characteristics..............................5
包装说明.................. 60
系统设计信息........ 69
订购信息.................. 74
文档修订历史........ 75
本文档中的信息如有
改变。关于MPC5200 ，访问的最新数据
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1
概观
该MPC5200集成了高性能的MPC603e系列G2_LE核心与
丰富的外设功能集中在通信和系统
集成。该G2_LE芯的设计是基于在PowerPC
核心架构。
MPC5200集成了一个创新的BestComm I / O子系统，它可以隔离
日常保养的外设功能的嵌入式G2_LE核心。该
MPC5200包含一个SDRAM / DDR内存控制器，灵活的外部总线
接口方面， PCI控制器， USB ， ATA ，以太网，六个可编程串行控制器
（ PSC ） ，我
2
C， SPI ， CAN ， J1850 ，定时器和通用输入输出。
2
特点
MPC603e系列G2_LE核心
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超标量体系结构
760 MIPS在400兆赫（ -40 + 85
o
C)
16K的指令缓存， 16 K个数据缓存
双精度FPU
指令和数据MMU
标准和关键中断能力
高达132 MHz的操作
SDRAM和DDR SDRAM的支持
每CS 256兆字节寻址范围，二CS可用
32位数据总线
内置的初始化和刷新
主要特点如下所示。
SDRAM / DDR存储器接口
灵活的多功能外部总线接口
- 支持接口为ROM /闪存/ SRAM存储器或其他存储
映射设备
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飞思卡尔半导体公司
特点
—
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8个可编程芯片选择
使用8/16/32位数据总线高达26位的地址非复用的数据访问
短或长突发能力
使用8/16/32位数据总线与多达25位的地址的多路数据的访问
2.2版的PCI兼容
PCI启动器和目标操作
32位PCI地址/数据总线
33-和66 - MHz运行
PCI仲裁功能
外围组件互连（PCI ）控制器
ATA控制器
- 第4版ATA兼容的外部接口， IDE磁盘驱动器的连接
BestComm DMA子系统
- 智能虚拟DMA控制器
- 专用的DMA通道，以控制周围的接收和发送
- 本地存储器（SRAM 16K字节）
飞思卡尔半导体公司...
6个可编程串行控制器（ PSC ） ，配置为以下几点：
—
—
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—
UART或RS232接口
CODEC接口的软调制解调器，主/从编解码方式，我
2
S和AC97
全双工SPI模式
IrDA的模式，从2400 bps到4 Mbps的
快速以太网控制器（ FEC ）
- 支持100Mbps的IEEE 802.3 MII ， 10Mbps的IEEE 802.3 MII ， 10 Mbps的7线接口
通用串行总线控制器（USB）的
- USB 1.1版主机
- 开放式主机控制器接口（ OHCI ）
- 集成USB集线器，带有两个端口。
两个内部集成电路接口（I
2
C)
串行外设接口（SPI ）
双CAN 2.0 A / B控制器（ MSCAN ）
- 摩托罗拉可扩展的控制器局域网（ MSCAN ）架构
- 版本2.0A / B CAN协议的实现
- 标准和扩展数据帧
J1850字节数据链路控制器（ BDLC ）
- J1850 B类数据通信网络接口兼容和ISO兼容低
速度（ <125 kbps）表示在汽车应用中的串行数据通信。
- 支持4X模式下， 41.6 kbps的
在帧响应（IFR）类型0，1 ，2和3的支持
2
MPC5200硬件规格
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特点
系统级功能
- 中断控制器支持4个外部中断请求线和47个内部中断
来源
- GPIO /定时器功能
- 多达56个总GPIO引脚（取决于复用功能选择）的支持
各种中断/唤醒功能。
- 8个GPIO引脚与定时器功能支持输入捕捉，输出比较和脉冲
宽度调制（PWM）功能
—
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实时时钟有一秒钟的分辨率
系统保护（看门狗定时器，总线监视器）
功能块的时钟源独立控制
电源管理：小睡，打盹，睡眠，深度睡眠模式
支持的WakeUp从低功耗模式由不同的来源（ GPIO ， RTC ， CAN）
飞思卡尔半导体公司...
测试/调试功能
- JTAG （ IEEE 1149.1测试访问端口）
- 通用片上处理器（ COP ）调试端口
片上PLL和时钟发生器
图1
示出了一个简化的MPC5200框图。
摩托罗拉
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电气和热特性
3
3.1
电气和热特性
DC电气特性
3.1.1绝对最大额定值
本节中的表描述了MPC5200直流电气特性。
表1
给人的绝对
最大额定值。
表1绝对最大额定值
1
特征
电源电压 - G2_LE内核和外设逻辑
符号
VDD_CORE
VDD_IO ，
VDD_MEM_IO
SYS_PLL_AVDD
CORE_PLL_AVDD
VIN
VIN
比诺斯
Vinus
TSTG
民
–0.3
–0.3
–0.3
–0.3
–0.3
–0.3
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–55
最大
1.8
3.6
2.1
2.1
VDD_IO + 0.3
VDD_MEM_IO
+ 0.3
1.0
1.0
150
单位
V
V
V
V
V
V
V
V
o
C
SpecID
D1.1
D1.2
D1.3
D1.4
D1.5
D1.6
D1.7
D1.8
D1.9
飞思卡尔半导体公司...
电源电压 - I / O缓冲器
电源电压 - 系统APLL
电源电压 - G2_LE APLL
输入电压（ VDD_IO ）
输入电压（ VDD_MEM_IO ）
输入电压过冲
输入电压的下冲
存储温度范围
1
绝对最大额定值只是应力额定值，以及运行在该最大值不能保证。讲
超越这些，可能会影响设备可靠性或造成永久性的损害。
3.1.2推荐工作条件
表2
给出了推荐的工作条件。
表2推荐工作条件
特征
电源电压 - G2_LE核心和外设
ERAL逻辑
电源电压 - 标准I / O缓冲区
电源电压 - 存储I / O缓冲器
（ SDR）的
电源电压 - 存储I / O缓冲器
（ DDR ）
电源电压 - 系统APLL
电源电压 - G2_LE APLL
输入电压 - 标准I / O缓冲区
输入电压 - 存储I / O缓冲器（ SDR ）
输入电压 - 存储I / O缓冲器（ DDR ）
符号
VDD_CORE
VDD_IO
VDD_MEM_IO
SDR
VDD_MEM_IO
DDR
SYS_PLL_AVDD
CORE_PLL_AVDD
VIN
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SDR
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DDR
民
1
1.42
3.0
3.0
2.42
1.42
1.42
0
0
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最大
1
1.58
3.6
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D2.1
D2.2
D2.3
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D2.9
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