FEDL70511LA-03
半导体
1
这个版本：
2001年12月
上一版本： 2001年6月
ML70511LA
蓝牙基带控制器IC
概述
该ML70511LA是CMOS数字IC在2.4 GHz频段的蓝牙系统。该IC集成了
ARM7TDMI作为CPU核心，具有高度可扩展的体系结构，以及支持的接口，适用于各种
应用程序。用于与ML7050LA （蓝牙RF收发器IC）和OKI蓝牙协议一起使用
栈软件，数据/语音通信是可能的，同时保持互联互通与其它蓝牙
系统。
特点
符合蓝牙规范（ 1.1版）
该ARM7TDMI安装为（在最大的32兆赫在该LSI的操作）在CPU
1路， 16位自动重载定时器
3路， 18位自动重载定时器
中断控制器（17原因）
内置800字节， 4路统一缓存
内置32千字节
达总共2兆字节的SRAM ，ROM和闪存ROM的可连接到外部存储器总线。
可选择的主时钟（ 16年12月13日兆赫） 。
PCM- CVSD码器安装。
安装界面：
- UART
(*)
接口（最高可达921.6 Kbps的）
- USB
(*)
接口（符合USB1.1 ）
- UART /同步串行端口接口
- 通用I / O接口（可编程中断）
- PCM接口（ PCMLinear / A律/ μ律可以选择）
- JTAG接口
(*)
此标志表示支持HCI命令接口。
内置稳压器和上电复位
单电源电压： 3.0 3.6 V
封装： 144引脚BGA （ P- LFBGA144-1111-0.80 ）
（尺寸： 11毫米
×
11 mm
×
1.5毫米;引脚间距为0.8mm ）
ARM和ARM7TDMI登记ARM公司，英国的商标。
拇指是ARM公司，英国的商标。
Bluetooth是Bluetooth SIG ， Inc.所有，并授权给冲电气工业的商标。
本文所含信息如有更改，恕不由于产品正在开发中被通知。
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FEDL70511LA-03
1
半导体
ML70511LA
绝对最大额定值
参数
电源电压
输入电压
允许功耗
储存温度
符号
V
DD
V
I
P
d
T
英镑
条件
—
—
—
—
等级
-0.3到+4.5
-0.3到+4.5
1.35
-55到150
单位
V
V
W
°C
推荐工作条件
参数
电源电压
“ H”电平输入电压
“ L”电平输入电压
工作温度
符号
V
DD
VIH
VIL
Ta
条件
—
—
—
—
分钟。
3.0
2.2
0
–40
典型值。
3.3
—
—
—
马克斯。
3.6
3.6
0.8
85
单位
V
V
V
°C
电气特性
直流特性（ 1 ） （除USB端口）
(V
DD
= 3.3 V± 0.3 V ，TA = -40至85°C ）
参数
“ H”电平输出电压
“ L”电平输出电压
输入漏电流
输出漏电流
电源电流（在
操作）
电源电流（在
待机）
符号
VOH
VOL
Ii
Io
IDDO
IDDS
条件
IOH = -2毫安
IOL = 2毫安
VI = GND至3.6 V
VO = GND到V
DD
在32兆赫
手术
CLK停止
分钟。
2.4
—
–10
–10
0
—
典型值。
—
—
—
—
50
200
马克斯。
—
0.4
10
10
70
800
单位
V
V
A
A
mA
A
直流特性（ 2 ） USB端口（D + ， D-）
(V
DD
= 3.3 V± 0.3 V ，TA = -40至85°C ）
参数
差分输入灵敏度
差分共模
范围
单端接收器阈值
符号
V
DI
V
CM
V
SE
V
OH
V
OL
I
LO
条件
{(D+) – (D–)}
包括VDI
—
15 kΩ到GND
1.5 kΩ至3.6 V
0 V＆ LT ; V
IN
＆ LT ; V
DD
分钟。
0.2
0.8
0.8
2.8
—
–10
典型值。
—
—
—
—
—
—
马克斯。
—
2.5
2.0
3.6
0.3
+10
单位
V
V
V
V
V
A
“H”时的输出电压
“L”，输出电压
输出漏电流
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FEDL70511LA-03
1
半导体
ML70511LA
引脚布局
1
NC
A
PLL_LE
B
RX ±
POW
C
PLL-
关闭
D
PLL-
CLK
E
RXD
F
VDD
G
CIO15
H
CIO12
J
CIO9
K
CIO6
L
CIO4
M
NC
N
2
PLL_PS
3
PLL
LOCK
4
GND
MWE
5
MRE
6
GND
7
D-
8
TEST_L
9
10
11
12
13
NC
SCLK
FSEL0 TXCSEL AGND1 TEST_L
SCLK
SEL
GND
TMS
RXC
TEST_L
PLL-
POW
TX ±
POW
RSSI
CLK
测试TEST_L TEST_L
RESET
BBWSEL
PU
Out
MCS1
VDD
GND
TEST_L
VTM
TCK
TXD
MCS0
TEST_L AVDD1
GND
TRST
PLL-
数据
GND
TEST_H
RESET
D+
TEST_L TEST_L
SCLK REMAP0 XCLK
FSEL1
VDD
SCLK
LVDD
REGVBG AGND0 REGVDD AVDD0
TXC_IN
GND
RSSI
GND
REMAP1REGOUT
REG
GND
MOE0
PCM
OUT
PCMCLK PCMIN
MBS0
MOE1
GND
TDO
PCM
SYNC
TDI
MBS1
VDD
MD0
GND
GND
CIO11
CIO14
MD1
MD4
VDD
MD2
CIO13
CIO10
CIO7
MA15
MA11
VDD
MA6
MA3
MD13
MD7
MD3
MD5
CIO8
CIO2
CIO0
MA17
GND
MA9
MA7
MA0
VDD
MD9
MD6
MD8
CIO5
MA19
MA16
MA14
MA12
MA10
GND
MA5
MA2
MD14
MD11
MD10
CIO3
CIO1
MA18
GND
MA13
MA8
MA4
MA1
MD15
MD12
GND
NC
顶视图
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FEDL70511LA-03
1
半导体
ML70511LA
引脚说明
RF I / F
引脚名称
TXD
RXD
PLL_data
PLL_CLK
PLL_LE
PLL_OFF
PLL_POW
TX_POW
RX_POW
RSSI
RSSI_CLK
PLL_PS
PLLLOCK
RXC
方向
[*0]
O
I
O
O
O
O
O
O
O
I
O
O
I
O
国内
上拉/下拉
—
—
—
—
—
—
—
—
—
拆毁
—
—
拆毁
—
初始
价值
L
—
L
L
L
L
H
H
H
—
H
L
—
L
针
放置
C2
F1
D2
E1
B1
D1
C3
D3
C1
F4
E3
A2
A3
B2
描述
发送数据输出
（要ML7050LA针＃ A8 ）
接收数据输入
（要ML7050LA针＃ H5 ）
PLL设定数据输出
（要ML7050LA针＃ H3 ）
设置PLL时钟输出
（要ML7050LA针＃ G3 ）
PLL设定的负载使输出
（要ML7050LA针＃ H4 ）
PLL开环/闭环控制信号
输出（要ML7050LA针＃ G8）
本地传输电路功率控制信号
输出（要ML7050LA针＃ A7）
发射功率控制信号输出
（要ML7050LA针＃ B6 ）
接收功率控制信号输出
（要ML7050LA针＃ B3 ）
接收场强数据输入
RSSI传输时钟
PLL电源控制信号输出
PLL锁定信号输入
蓝牙接收时钟输出（ 1兆赫）
蓝牙传输时钟输入端（1 MHz）的
TXC_IN
I
拆毁
—
F2
当发送时钟用于由时钟
（ RXC ），其从所述接收生成
数据TXCSEL （引脚＃ A10）设置为H和
连接到RXC （引脚＃ B2 ） 。
蓝牙传输时钟设置引脚
TXCSEL
I
拆毁
—
A10
L：选择1 MHz的内部PLL分。
H：选择TXC_IN输入信号。
[*0]
“I” =输入， “ O” =输出， “ I / O” =输入/输出， “橘子郡男孩” =集电极开路
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1
半导体
CLK和配置
引脚名称
SCLK
XCLK
SCLKSEL
方向
I
I
I
国内
上拉/下拉
—
—
拆毁
初始
价值
—
—
—
针
放置
D13
D11
B10
描述
ML70511LA
主时钟（12 ， 13或16MHz ）输入管脚
（功率电平： CMOS电平）
用户时钟输入引脚
系统时钟选择引脚
L：选择CLK通过内部PLL分
H：选择XCLK输入信号
主时钟选择引脚
SCLKFSEL [1：0 ] = “00” ： 12兆赫
“01” ：13兆赫
“10” ： 16兆赫
“ 11 ” ：故宫
硬件复位引脚（复位= L）
硬件复位引脚（复位= L ） ，输出
BANK0区位宽度选择引脚
L： 8位
H： 16位
开机时重映射引脚选择
REMAP [1：0 ] = “00”禁
“01”故宫
“10”的外部
MCS1
设备
“ 11 ”外部
MCS0
设备
SCLKFSEL0
SCLKFSEL1
RESET
RESET_OUT
BBWSEL
I
I
I
O
I
拆毁
拆毁
—
—
拆毁
—
—
—
—
—
A9
D9
D5
B9
B8
REMAP0
REMAP1
I
I
—
—
—
—
D10
F11
内存I / F
引脚名称
MA [ 19 ： 0 ]
MD [ 15：0]
MWE
MRE
MCS0
MCS1
MBS0
MBS1
MOE0
MOE1
方向
O
I / O
O
O
O
O
O
O
O
O
国内
上拉/下拉
—
撩
—
—
—
—
—
—
—
—
初始
价值
L
—
H
H
H
H
H
H
H
H
针
放置
[*1]
[*2]
B4
A5
C4
C5
G10
H10
G13
G11
描述
外部地址总线
外部数据总线
外部写使能信号输出
外部的读使能信号输出
外部空间0片选
外部空间1片选
外部的低字节选择
外部的高字节选择
外
MCS0
器输出使能
（ MCS0和
MRE
或输出）
外
MCS1
器输出使能
（ MCS1和
MRE
或输出）
[*1]
MA19 ： M3 ; MA18 ： N4 ; MA17 ： L5 ;
MA13 ： N6 ; MA12 ： M6 ; MA11 ： K6 ;
MA6 ： K8 ;
MA5 ： M9 ; MA4 ： N8 ;
MA16 ： M4 ; MA15 ： K5 ; MA14 ： M5
MA10 ： M7 ; MA9 ： L7 ;
MA8 ： N7 ;
MA3 ： K9 ;
MA2 ： M10 ; MA1 ： N9 ;
MA7 ： L8
MA0 ： L9
[*2]
MD15 ： N10 ; MD14 ： M11 ; MD13 ： K10 ; MD12 ： N11 ; MD11 ： M12 ; MD10 ： M13
MD9 ： L11 ; MD8 ： L13 ; MD7 ： K11 ; MD6 ： L12 ; MD5 ： K13 ; MD4 ： J11 ; MD3 ： K12 ;
MD2 ： J13 ; MD1 ： J10 ; MD0 ： H12
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半导体
1
这个版本：
2001年12月
上一版本： 2001年6月
ML70511LA
蓝牙基带控制器IC
概述
该ML70511LA是CMOS数字IC在2.4 GHz频段的蓝牙系统。该IC集成了
ARM7TDMI作为CPU核心，具有高度可扩展的体系结构，以及支持的接口，适用于各种
应用程序。用于与ML7050LA （蓝牙RF收发器IC）和OKI蓝牙协议一起使用
栈软件，数据/语音通信是可能的，同时保持互联互通与其它蓝牙
系统。
特点
符合蓝牙规范（ 1.1版）
该ARM7TDMI安装为（在最大的32兆赫在该LSI的操作）在CPU
1路， 16位自动重载定时器
3路， 18位自动重载定时器
中断控制器（17原因）
内置800字节， 4路统一缓存
内置32千字节
达总共2兆字节的SRAM ，ROM和闪存ROM的可连接到外部存储器总线。
可选择的主时钟（ 16年12月13日兆赫） 。
PCM- CVSD码器安装。
安装界面：
- UART
(*)
接口（最高可达921.6 Kbps的）
- USB
(*)
接口（符合USB1.1 ）
- UART /同步串行端口接口
- 通用I / O接口（可编程中断）
- PCM接口（ PCMLinear / A律/ μ律可以选择）
- JTAG接口
(*)
此标志表示支持HCI命令接口。
内置稳压器和上电复位
单电源电压： 3.0 3.6 V
封装： 144引脚BGA （ P- LFBGA144-1111-0.80 ）
（尺寸： 11毫米
×
11 mm
×
1.5毫米;引脚间距为0.8mm ）
ARM和ARM7TDMI登记ARM公司，英国的商标。
拇指是ARM公司，英国的商标。
Bluetooth是Bluetooth SIG ， Inc.所有，并授权给冲电气工业的商标。
本文所含信息如有更改，恕不由于产品正在开发中被通知。
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1
半导体
ML70511LA
绝对最大额定值
参数
电源电压
输入电压
允许功耗
储存温度
符号
V
DD
V
I
P
d
T
英镑
条件
—
—
—
—
等级
-0.3到+4.5
-0.3到+4.5
1.35
-55到150
单位
V
V
W
°C
推荐工作条件
参数
电源电压
“ H”电平输入电压
“ L”电平输入电压
工作温度
符号
V
DD
VIH
VIL
Ta
条件
—
—
—
—
分钟。
3.0
2.2
0
–40
典型值。
3.3
—
—
—
马克斯。
3.6
3.6
0.8
85
单位
V
V
V
°C
电气特性
直流特性（ 1 ） （除USB端口）
(V
DD
= 3.3 V± 0.3 V ，TA = -40至85°C ）
参数
“ H”电平输出电压
“ L”电平输出电压
输入漏电流
输出漏电流
电源电流（在
操作）
电源电流（在
待机）
符号
VOH
VOL
Ii
Io
IDDO
IDDS
条件
IOH = -2毫安
IOL = 2毫安
VI = GND至3.6 V
VO = GND到V
DD
在32兆赫
手术
CLK停止
分钟。
2.4
—
–10
–10
0
—
典型值。
—
—
—
—
50
200
马克斯。
—
0.4
10
10
70
800
单位
V
V
A
A
mA
A
直流特性（ 2 ） USB端口（D + ， D-）
(V
DD
= 3.3 V± 0.3 V ，TA = -40至85°C ）
参数
差分输入灵敏度
差分共模
范围
单端接收器阈值
符号
V
DI
V
CM
V
SE
V
OH
V
OL
I
LO
条件
{(D+) – (D–)}
包括VDI
—
15 kΩ到GND
1.5 kΩ至3.6 V
0 V＆ LT ; V
IN
＆ LT ; V
DD
分钟。
0.2
0.8
0.8
2.8
—
–10
典型值。
—
—
—
—
—
—
马克斯。
—
2.5
2.0
3.6
0.3
+10
单位
V
V
V
V
V
A
“H”时的输出电压
“L”，输出电压
输出漏电流
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1
半导体
ML70511LA
引脚布局
1
NC
A
PLL_LE
B
RX ±
POW
C
PLL-
关闭
D
PLL-
CLK
E
RXD
F
VDD
G
CIO15
H
CIO12
J
CIO9
K
CIO6
L
CIO4
M
NC
N
2
PLL_PS
3
PLL
LOCK
4
GND
MWE
5
MRE
6
GND
7
D-
8
TEST_L
9
10
11
12
13
NC
SCLK
FSEL0 TXCSEL AGND1 TEST_L
SCLK
SEL
GND
TMS
RXC
TEST_L
PLL-
POW
TX ±
POW
RSSI
CLK
测试TEST_L TEST_L
RESET
BBWSEL
PU
Out
MCS1
VDD
GND
TEST_L
VTM
TCK
TXD
MCS0
TEST_L AVDD1
GND
TRST
PLL-
数据
GND
TEST_H
RESET
D+
TEST_L TEST_L
SCLK REMAP0 XCLK
FSEL1
VDD
SCLK
LVDD
REGVBG AGND0 REGVDD AVDD0
TXC_IN
GND
RSSI
GND
REMAP1REGOUT
REG
GND
MOE0
PCM
OUT
PCMCLK PCMIN
MBS0
MOE1
GND
TDO
PCM
SYNC
TDI
MBS1
VDD
MD0
GND
GND
CIO11
CIO14
MD1
MD4
VDD
MD2
CIO13
CIO10
CIO7
MA15
MA11
VDD
MA6
MA3
MD13
MD7
MD3
MD5
CIO8
CIO2
CIO0
MA17
GND
MA9
MA7
MA0
VDD
MD9
MD6
MD8
CIO5
MA19
MA16
MA14
MA12
MA10
GND
MA5
MA2
MD14
MD11
MD10
CIO3
CIO1
MA18
GND
MA13
MA8
MA4
MA1
MD15
MD12
GND
NC
顶视图
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FEDL70511LA-03
1
半导体
ML70511LA
引脚说明
RF I / F
引脚名称
TXD
RXD
PLL_data
PLL_CLK
PLL_LE
PLL_OFF
PLL_POW
TX_POW
RX_POW
RSSI
RSSI_CLK
PLL_PS
PLLLOCK
RXC
方向
[*0]
O
I
O
O
O
O
O
O
O
I
O
O
I
O
国内
上拉/下拉
—
—
—
—
—
—
—
—
—
拆毁
—
—
拆毁
—
初始
价值
L
—
L
L
L
L
H
H
H
—
H
L
—
L
针
放置
C2
F1
D2
E1
B1
D1
C3
D3
C1
F4
E3
A2
A3
B2
描述
发送数据输出
（要ML7050LA针＃ A8 ）
接收数据输入
（要ML7050LA针＃ H5 ）
PLL设定数据输出
（要ML7050LA针＃ H3 ）
设置PLL时钟输出
（要ML7050LA针＃ G3 ）
PLL设定的负载使输出
（要ML7050LA针＃ H4 ）
PLL开环/闭环控制信号
输出（要ML7050LA针＃ G8）
本地传输电路功率控制信号
输出（要ML7050LA针＃ A7）
发射功率控制信号输出
（要ML7050LA针＃ B6 ）
接收功率控制信号输出
（要ML7050LA针＃ B3 ）
接收场强数据输入
RSSI传输时钟
PLL电源控制信号输出
PLL锁定信号输入
蓝牙接收时钟输出（ 1兆赫）
蓝牙传输时钟输入端（1 MHz）的
TXC_IN
I
拆毁
—
F2
当发送时钟用于由时钟
（ RXC ），其从所述接收生成
数据TXCSEL （引脚＃ A10）设置为H和
连接到RXC （引脚＃ B2 ） 。
蓝牙传输时钟设置引脚
TXCSEL
I
拆毁
—
A10
L：选择1 MHz的内部PLL分。
H：选择TXC_IN输入信号。
[*0]
“I” =输入， “ O” =输出， “ I / O” =输入/输出， “橘子郡男孩” =集电极开路
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1
半导体
CLK和配置
引脚名称
SCLK
XCLK
SCLKSEL
方向
I
I
I
国内
上拉/下拉
—
—
拆毁
初始
价值
—
—
—
针
放置
D13
D11
B10
描述
ML70511LA
主时钟（12 ， 13或16MHz ）输入管脚
（功率电平： CMOS电平）
用户时钟输入引脚
系统时钟选择引脚
L：选择CLK通过内部PLL分
H：选择XCLK输入信号
主时钟选择引脚
SCLKFSEL [1：0 ] = “00” ： 12兆赫
“01” ：13兆赫
“10” ： 16兆赫
“ 11 ” ：故宫
硬件复位引脚（复位= L）
硬件复位引脚（复位= L ） ，输出
BANK0区位宽度选择引脚
L： 8位
H： 16位
开机时重映射引脚选择
REMAP [1：0 ] = “00”禁
“01”故宫
“10”的外部
MCS1
设备
“ 11 ”外部
MCS0
设备
SCLKFSEL0
SCLKFSEL1
RESET
RESET_OUT
BBWSEL
I
I
I
O
I
拆毁
拆毁
—
—
拆毁
—
—
—
—
—
A9
D9
D5
B9
B8
REMAP0
REMAP1
I
I
—
—
—
—
D10
F11
内存I / F
引脚名称
MA [ 19 ： 0 ]
MD [ 15：0]
MWE
MRE
MCS0
MCS1
MBS0
MBS1
MOE0
MOE1
方向
O
I / O
O
O
O
O
O
O
O
O
国内
上拉/下拉
—
撩
—
—
—
—
—
—
—
—
初始
价值
L
—
H
H
H
H
H
H
H
H
针
放置
[*1]
[*2]
B4
A5
C4
C5
G10
H10
G13
G11
描述
外部地址总线
外部数据总线
外部写使能信号输出
外部的读使能信号输出
外部空间0片选
外部空间1片选
外部的低字节选择
外部的高字节选择
外
MCS0
器输出使能
（ MCS0和
MRE
或输出）
外
MCS1
器输出使能
（ MCS1和
MRE
或输出）
[*1]
MA19 ： M3 ; MA18 ： N4 ; MA17 ： L5 ;
MA13 ： N6 ; MA12 ： M6 ; MA11 ： K6 ;
MA6 ： K8 ;
MA5 ： M9 ; MA4 ： N8 ;
MA16 ： M4 ; MA15 ： K5 ; MA14 ： M5
MA10 ： M7 ; MA9 ： L7 ;
MA8 ： N7 ;
MA3 ： K9 ;
MA2 ： M10 ; MA1 ： N9 ;
MA7 ： L8
MA0 ： L9
[*2]
MD15 ： N10 ; MD14 ： M11 ; MD13 ： K10 ; MD12 ： N11 ; MD11 ： M12 ; MD10 ： M13
MD9 ： L11 ; MD8 ： L13 ; MD7 ： K11 ; MD6 ： L12 ; MD5 ： K13 ; MD4 ： J11 ; MD3 ： K12 ;
MD2 ： J13 ; MD1 ： J10 ; MD0 ： H12
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