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OKI半导体
ML2110
语音控制处理器
FEDL2110-01
发行日期: 2002年3月25日
概述
所述ML2110是语音处理器LSI器件具有内部D / A转换器。它被用于文本到语音优化
合成。
特点
并行和串行接口
单3.3V电源
5V接口可用
内置12位D / A转换器
??包装:
144引脚塑料LQFP ( LQFP144 -P - 2020-0.50 -K ) ( ML2110TC )
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FEDL2110-01
OKI半导体
ML2110
框图
CLK
CLKENA
CLKEDBL
CLKA
CLKB
TSTM2-0
EXTINT1-0
BR3
BGT3
PD7-0
PACK
PSTB
PIOA
PIBF
POBF
RST
STBY
TXD
RXD
DTR
DSR
RTS
CTS
SCLK
PLL
RAM1KNB
RAM1KNB
RAM1KNB
RAM1KNB
中央处理器
A23-0
D31-0
只读存储器
SRAM
RD
WR0-3
AS
TST
PIO
MFU32
TMR
TMR
DRAMC
RAS
CAS3-0
WE
UPORT1-0
DOUT
XSYNC
BCLK
DAO
SIO
USR
DAC
2/101
FEDL2110-01
OKI半导体
ML2110
引脚配置(顶视图)
V
DD
D24
D23
D22
D21
D20
D19
GND
D18
D17
D16
D15
D14
D13
V
DD
D12
D11
D10
D9
D8
D7
GND
D6
D5
D4
D3
D2
D1
V
DD
D0
PIOA
PACK
PSTB
POBF
GND
D25
D26
D27
D28
D29
D30
GND
D31
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A1
A2
A3
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V
DD
A5
A6
A7
A8
A9
A10
GND
A11
A12
A13
A14
A15
A16
V
DD
A17
A18
A19
A20
A21
A22
A23
GND
73
74
75
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77
78
79
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58
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10
9
8
7
6
5
4
3
2
1
PIBF
PD7
PD6
PD5
PD4
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V
DD
PD2
PD1
PD0
SCLK
DTR
DSR
GND
RTS
CTS
RXD
TXD
CLKFDBL
CLKB
V
DD
CLKA
CLKENA
XO
CLK
RST
STBY
GND
GND
V
DD
V
DD
DAO
GND
GND
EXTINT0
UPORT1
UPORT0
TSTM1
TSTM2
V
DD
TSTM0
AS
RD
WR0
WR1
WR2
GND
WR3
等待
RAS
CAS0
CAS1
CAS2
V
DD
CAS3
WE
只读存储器
SRAM
GND
GND
EXTINT1
MD
V
DD
BCLK
XSYNC
V
DD
BR3
BGT3
GND
DOUT
144引脚塑料LQFP
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FEDL2110-01
OKI半导体
ML2110
引脚说明
符号
D 31-0
A23-0
只读存储器
SRAM
RD
WR0-3
RAS
CAS0-3
WE
AS
TXD
RXD
DTR
DSR
RTS
CTS
SCLK
PD7-0
PACK
PSTB
PIOA
POBF
PIBF
UPORT1-0
XSYNC
BCLK
DOUT
DAO
I / O
I / O
O
O
O
O
O
O
O
O
O
O
I
O
I
O
I
O
I / O
I
I
I
I
3-state
3-state
O
I
I
O
O
描述
32位数据总线。 8位器件通过D31-24访问。 16位器件
通过D31 -D16被访问。
24位地址总线。 DRAM的地址是从A13-0输出。
ROM选择信号。
只读存储器
表示ROM空间被分配给
指定的地址。它被用作芯片选择信号。
SRAM的选择信号。
SRAM
表示SRAM的空间被分配给
指定的地址。它被用作芯片选择信号。
READ信号。
RD
活跃在这两个8位和16位的读取。
写信号。
WR0
对应于写入从D31-24 ,
WR1
对应于
从D23-16写道,
WR2
对应于从D15-8写操作,并
WR3
对应于从D7-0写入。
行地址选通。
列地址选通。
CAS0
对应于从D31-24 , CAS1访问
对应于从D23-16访问,
CAS2
对应于从接入
D15-8和
CAS3
对应于从D7-0访问。
写使能。 WE有效时写入DRAM空间作为DRAM的写入
信号。
地址选通。
串行数据输出。
串行数据输入。
指示SIO可以发送和接收控制信号。
这表明调制解调器输入信号处于可操作状态。
SIO发送请求信号。
输入信号表明调制解调器可以传输。
同步传输时钟输出。
并行端口数据输入/输出。
并行端口的读信号。设置高的Centronics接口。
并行端口写信号。选通脉冲信号,用于Centronics接口。
并行端口的片选信号。
并行端口地址信号。在一个访问中选择数据或状态。
输出端口缓冲区已满。表示数据已在输出缓冲器被设置。
输入端口缓冲区满。表示有在输入缓冲器的数据。
忙输出信号为Centronics接口。
一般标志输出信号。
同步传输时钟。
移位时钟DOUT 。
数字信号输出。
D / A转换器输出。
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FEDL2110-01
OKI半导体
ML2110
符号
CLK
XO
CLKA
CLKB
CLKENA
CLKFDBL
RST
STBY
EXTINT1-0
等待
BR3
BGT3
MD
TSTM2-0
I / O
I
O
O
O
I
I
I
I
I
I / O
I
O
I
I
时钟输入信号。
时钟信号。逆CLK的。
内部时钟信号。
描述
内部时钟信号。逆CLK的。
时钟变化信号。
时钟周期变化信号。
复位输入。
待机信号。
STBY
暂停操作并在待机放置ML2110
状态。
外部中断信号。
等待信号。通常情况下,它被上拉“H”电平。
高速缓冲存储器/ BIU测试信号。
高速缓冲存储器/ BIU测试信号。
16/32位选信号。
测试模式选择输入信号。
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OKI半导体
ML2110
语音控制处理器
FEDL2110-01
发行日期: 2002年3月25日
概述
所述ML2110是语音处理器LSI器件具有内部D / A转换器。它被用于文本到语音优化
合成。
特点
并行和串行接口
单3.3V电源
5V接口可用
内置12位D / A转换器
??包装:
144引脚塑料LQFP ( LQFP144 -P - 2020-0.50 -K ) ( ML2110TC )
1/101
FEDL2110-01
OKI半导体
ML2110
框图
CLK
CLKENA
CLKEDBL
CLKA
CLKB
TSTM2-0
EXTINT1-0
BR3
BGT3
PD7-0
PACK
PSTB
PIOA
PIBF
POBF
RST
STBY
TXD
RXD
DTR
DSR
RTS
CTS
SCLK
PLL
RAM1KNB
RAM1KNB
RAM1KNB
RAM1KNB
中央处理器
A23-0
D31-0
只读存储器
SRAM
RD
WR0-3
AS
TST
PIO
MFU32
TMR
TMR
DRAMC
RAS
CAS3-0
WE
UPORT1-0
DOUT
XSYNC
BCLK
DAO
SIO
USR
DAC
2/101
FEDL2110-01
OKI半导体
ML2110
引脚配置(顶视图)
V
DD
D24
D23
D22
D21
D20
D19
GND
D18
D17
D16
D15
D14
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DD
D12
D11
D10
D9
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GND
D6
D5
D4
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D2
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DD
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PACK
PSTB
POBF
GND
D25
D26
D27
D28
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GND
D31
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DD
A17
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A21
A22
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CLKFDBL
CLKB
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CLKA
CLKENA
XO
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STBY
GND
GND
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GND
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UPORT1
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TSTM1
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等待
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只读存储器
SRAM
GND
GND
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XSYNC
V
DD
BR3
BGT3
GND
DOUT
144引脚塑料LQFP
3/101
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OKI半导体
ML2110
引脚说明
符号
D 31-0
A23-0
只读存储器
SRAM
RD
WR0-3
RAS
CAS0-3
WE
AS
TXD
RXD
DTR
DSR
RTS
CTS
SCLK
PD7-0
PACK
PSTB
PIOA
POBF
PIBF
UPORT1-0
XSYNC
BCLK
DOUT
DAO
I / O
I / O
O
O
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I
O
I
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I / O
I
I
I
I
3-state
3-state
O
I
I
O
O
描述
32位数据总线。 8位器件通过D31-24访问。 16位器件
通过D31 -D16被访问。
24位地址总线。 DRAM的地址是从A13-0输出。
ROM选择信号。
只读存储器
表示ROM空间被分配给
指定的地址。它被用作芯片选择信号。
SRAM的选择信号。
SRAM
表示SRAM的空间被分配给
指定的地址。它被用作芯片选择信号。
READ信号。
RD
活跃在这两个8位和16位的读取。
写信号。
WR0
对应于写入从D31-24 ,
WR1
对应于
从D23-16写道,
WR2
对应于从D15-8写操作,并
WR3
对应于从D7-0写入。
行地址选通。
列地址选通。
CAS0
对应于从D31-24 , CAS1访问
对应于从D23-16访问,
CAS2
对应于从接入
D15-8和
CAS3
对应于从D7-0访问。
写使能。 WE有效时写入DRAM空间作为DRAM的写入
信号。
地址选通。
串行数据输出。
串行数据输入。
指示SIO可以发送和接收控制信号。
这表明调制解调器输入信号处于可操作状态。
SIO发送请求信号。
输入信号表明调制解调器可以传输。
同步传输时钟输出。
并行端口数据输入/输出。
并行端口的读信号。设置高的Centronics接口。
并行端口写信号。选通脉冲信号,用于Centronics接口。
并行端口的片选信号。
并行端口地址信号。在一个访问中选择数据或状态。
输出端口缓冲区已满。表示数据已在输出缓冲器被设置。
输入端口缓冲区满。表示有在输入缓冲器的数据。
忙输出信号为Centronics接口。
一般标志输出信号。
同步传输时钟。
移位时钟DOUT 。
数字信号输出。
D / A转换器输出。
4/101
FEDL2110-01
OKI半导体
ML2110
符号
CLK
XO
CLKA
CLKB
CLKENA
CLKFDBL
RST
STBY
EXTINT1-0
等待
BR3
BGT3
MD
TSTM2-0
I / O
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O
O
O
I
I
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I
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I / O
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O
I
I
时钟输入信号。
时钟信号。逆CLK的。
内部时钟信号。
描述
内部时钟信号。逆CLK的。
时钟变化信号。
时钟周期变化信号。
复位输入。
待机信号。
STBY
暂停操作并在待机放置ML2110
状态。
外部中断信号。
等待信号。通常情况下,它被上拉“H”电平。
高速缓冲存储器/ BIU测试信号。
高速缓冲存储器/ BIU测试信号。
16/32位选信号。
测试模式选择输入信号。
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    联系人:杨小姐
    地址:深圳市福田区振兴路156号上步工业区405栋3层

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电话:13910052844(微信同步)
联系人:刘先生
地址:北京市海淀区增光路27号2-1-1102
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10199
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电话:0755-83039139
联系人:邓小姐
地址:深圳市福田区福华路29号16G(深圳市华美锐科技有限公司)
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