I C R 0
C
禄
描述
该MK2771-12是一种低成本，低抖动，高
性能和VCXO时钟合成器
设计用于机顶盒。片上电压
晶体振荡器接受0到3V
输入电压，以使输出时钟通过改变
±100 ppm的。使用MicroClock的专利VCXO
与模拟锁相环（PLL）的技术，
该器件采用一种廉价的13.5 MHz晶振
输入，以产生多个输出时钟，包括
可选择的处理器时钟，可选UART和
音频时钟，一个固定11.0592兆赫，和两个低
在27兆赫的歪斜副本。所有的时钟
频率锁定在27.00 MHz的输出（和
彼此）与零ppm误差，所以任何输出
可以用作VCXO的输出。
该芯片直接替换MK2771-02当
13.5MHz的输入晶体代入
14.31818兆赫-02使用。此外，该
-12增加了24.576兆赫到ACLK 。
MK2771-12
VCXO和机顶盒时钟源
特点
20引脚SOIC封装
引脚对引脚及功能升级MK2771-02
使用廉价的13.5 MHz晶振
片专利VCXO与拉范围
为200ppm
VCXO调谐为0 3V的电压
16.67兆赫的处理器频率， 20MHz时，
32兆赫， 40兆赫或50兆赫
在所有的钟表零ppm的综合误差（准确地全部
轨道27MHz的VCXO ） - 专利
为TTL电平25 mA输出驱动能力
先进的，低功耗，亚微米CMOS工艺
5 V工作电压
框图
2
VDD AVDD
GND
2
3
产量
卜FF器
产量
卜FF器
时钟
合成
电路
产量
卜FF器
产量
卜FF器
处理器时钟
11.0592 MHz的
3.6864兆赫
或18.432兆赫
49.152兆赫
或24.576兆赫
27.000兆赫
13.500兆赫
PCS1 ： 0
UCS
ACS
VIN
13.5兆赫
可牵引
水晶
X1
X2
电压
控制
水晶
振荡器
输出2
缓冲器
÷2
产量
卜FF器
1
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MDS 2771-12一
I C R 0
C
禄
引脚分配
1
2
3
4
5
6
7
8
9
10
MK2771-12
VCXO和机顶盒时钟源
处理器时钟选择表
PCS1
0
0
M
M
1
1
PCS0
0
1
0
1
0
1
PCLK （兆赫）
50.000
16.667
TEST
32.000
40.000
20.000
PCS0
X2
X1
AVDD
VIN
VDD
GND
PCLK
UCLK
ACLK
20
19
18
17
16
15
14
13
12
11
ACS
UCS
27M
GND
27M
VDD
GND
11.06M
PCS1
13.5M
0 =直接连接到地， 1 =直接连接
至VDD ， M =悬空或悬空
UART时钟表
UCS
0
1
UCLK （兆赫）
18.432
3.6864
ACLK选择表
ACS
0
1
ACLK （兆赫）
49.152
24.576
引脚说明
数
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
名字
PCS0
X2
X1
AVDD
VIN
VDD
GND
PCLK
UCLK
ACLK
13.5M
PCS1
11.06M
GND
VDD
27M
GND
27M
UCS
ACS
TYPE
I
O
I
P
I
P
P
O
O
O
O
TI
O
P
P
O
P
O
I
I
描述
处理器时钟选择0选择PCLK引脚8见上表。
水晶连接。连接到一个可牵引13.5 MHz的晶振。
水晶连接。连接到一个可牵引13.5 MHz的晶振。
模拟VDD 。连接到+ 5V 。
电压输入VCXO 。零至3V信号，其控制VCXO的频率。
连接到+ 5V 。
连接到地面。
通过PCS1,0状态的处理器时钟输出来确定。请参见上表。
通过UCS状态UART时钟输出来确定。请参见上表。
49.152 MHz或通过ACS决定24.576 MHz的时钟输出。见上表
13.5MHz的时钟输出。由两个27MHz的VCXO输出的鸿沟。
处理器时钟选择1.选择PCLK引脚8见上表。
11.0592 MHz时钟输出。
连接到地面。
连接到+ 5V 。
27.00 MHz的VCXO时钟输出。
连接到地面。
27.00 MHz的VCXO时钟输出。
UART时钟选择。选择引脚9见上表UCLK 。
ACLK选择。选择引脚10见上表ACLK 。
键： I =输入， TI =三电平输入， O =输出， P =电源连接
2
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MDS 2771-12一
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电气规格
参数
电源电压（VDD）
输入和时钟输出
工作环境温度
焊接温度
储存温度
工作电压（VDD）
只有输入高电压， VIH ， X1引脚
只有输入低电压， VIL ， X1引脚
输入高电压， VIH （除PCS1 ）
输入低电压， VIL （除PCS1 ）
只有输入高电压， VIH ， PCS1
只有输入低电压， VIL ， PCS1
输出高电压， VOH
输出低电压， VOL
输出高电压， VOH ， CMOS电平
工作电源电流， IDD
短路电流
输入电容
频率合成错误
VIN ， VCXO控制电压
条件
MK2771-12
VCXO和机顶盒时钟源
最低
典型
最大
7
VDD+0.5
70
260
150
5.25
2.5
2.5
1.5
0.8
VDD-0.5
0.5
单位
V
V
°C
°C
°C
V
V
V
V
V
V
V
V
V
V
mA
mA
pF
PPM
V
绝对最大额定值（注1 ）
参考GND
参考GND
10秒以内
-65
4.75
3.5
2
-0.5
0
直流特性（ VDD = 5.0V除非另有说明）
IOH=-25mA
IOL=25mA
IOH=-8mA
空载时，请注意2
每路输出
所有时钟
2.4
0.4
VDD-0.4
60
±100
7
0
0
3
交流特性（ VDD = 5.0V除非另有说明）
输入频率
13.50000
兆赫
输出时钟上升时间
0.8 2.0V
1.5
ns
输出时钟下降时间
2.0 0.8V
1.5
ns
输出时钟占空比
在1.4V
40
60
%
最大绝对抖动，短期
200
ps
27 MHz的输出歪斜
在1.4V上升沿
-500
0
500
ps
27 MHz的输出pullability ，注意3
0V
≤
VIN
≤
3V
±100
PPM
注意事项： 1.强调超出上述绝对最大额定值可能会导致器件永久性损坏。经久
置身于上述的操作限制，但下面的绝对最高配置水平可能影响器件的可靠性。
2. PCLK频率为50 MHz 。
3.用可牵引晶体符合ICS的规格。
外部元件
该MK2771-12需要的外部元件正常工作的最小数目。脱钩
0.01μF的电容应连接在VDD和GND ，并betweeen AVDD和GND之间，
尽量靠近MK2771-12越好。 33串联终端电阻
也可以使用为每个时钟
output.The 13.5 MHz晶体必须连接尽可能靠近芯片越好。 13.5 MHz晶体
应该是一个并行模式下，可牵引的，以16 pF的负载电容。咨询MicroClock推荐
供应商。仅在晶体的连接到X1和X2 ;不连接负载电容为这些引脚。
3
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MDS 2771-12一
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包装外形和包装尺寸
MK2771-12
VCXO和机顶盒时钟源
20引脚SOIC
符号
A
b
c
D
E
H
e
h
L
Q
英寸
民
最大
0.092 0.104
0.014 0.019
0.009 0.012
0.490 0.512
0.290 0.300
0.394 0.419
.050 BSC
0.016
0.016 0.035
0.003 0.011
MILLIMETERS
民
最大
2.3368 2.6416
0.356
0.483
0.229
0.305
12.446 13.005
7.366
7.620
10.008 10.643
1.27 BSC
0.406
0.406
0.889
0.076
0.279
E
H
D
Q
e
b
c
高x 45
A
L
订购信息
零件/订单号
MK2771-12S
MK2771-12STR
记号
MK2771-12S
MK2771-12S
运输包装
管
磁带和卷轴
包
20引脚SOIC
20引脚SOIC
温度
0-70°C
0-70°C
虽然这里介绍的信息已被检查准确性和可靠性，集成电路系统公司（ ICS）不承担任何其使用或不承担任何责任
任何第三方专利或其他权利，这将导致其使用的侵权行为。没有任何其他电路，专利或许可。本产品适用于使用
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