MK2058-01
通信时钟抖动衰减器
描述
该MK2058-01是VCXO （压控晶体
振荡器）的时钟抖动衰减器设计
系统时钟分配的应用程序。这种单片
集成电路，结合外部廉价的石英
晶体，可以用来代替更昂贵的混合
VCXO重定时模块。该器件接受和
输出中选择的范围内的相同的时钟频率
4kHz的覆盖到27MHz的。双输入多路复用器也
提供的。
通过控制中的VCXO频率
锁相环（PLL） ，输出时钟相位和
频率锁定至输入时钟。通过选择
外部环路滤波器组件， PLL环路
带宽和阻尼因子可被定制，以满足
系统时钟要求。环路带宽下降到
在赫兹的范围是可能的。
特点
优异的抖动衰减时钟电信
也可作为一般用途的时钟抖动
衰减器，用于分布式系统时钟和
恢复的数据或视频时钟
2 ： 1输入MUX输入参考时钟
VCXO型时钟产生提供了非常低的抖动
和相位噪声的产生
输出时钟的相位和频率锁定到
选定的输入参考时钟
固定的输入到输出的相位关系
+ 115ppm最小的晶振频率pullability
范围，建议使用水晶
工业温度范围
低功耗CMOS技术
20引脚SOIC封装
单3.3V电源
框图
P ü再填充XTAL
VD
ISE牛逼
X1
X2
VDD
3
在P UT 锁
在P UT 锁
IC LK 2
IC LK 1
1
0
PH ASE
etecto
建华ARGE
普庵P
VC ×○
可选
ivider
LK
IS EL
S EL 2 ： 0
3
CHGP
V在
GND
4
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MK2058-01
通信时钟抖动衰减器
引脚分配
X1
VD
VD
VD
V在
GN
GN
GN
CHG P
ISE牛逼
1
2
3
4
5
6
7
8
9
10
20
19
18
17
16
15
14
13
12
11
X2
GND
IS 左
IC L·K 1
IC L·K 2
S EL 0
CLK
NC
S EL 1
S EL 2
输出时钟选型表
SEL2 SEL1 SEL0
0
0
0
0
M
M
M
M
1
1
1
1
0
0
1
1
0
0
1
1
0
0
1
1
0
1
0
1
0
1
0
1
0
1
0
1
输入/输出
范围
4.4至8.79千赫
1到1.6兆赫
1.6到2.7兆赫
2.7到4.5兆赫
6.6 13.2千赫
7.8 15.734kHz
64到70千赫兹
105到210千赫
4.0到6.8兆赫
5.5至9兆赫
8.5到13.5兆赫
13.5 27兆赫
水晶
频率
3072 X ICLK
16× ICLK
10× ICLK
6× ICLK
2048× ICLK
1716 X ICLK
384 X ICLK
128× ICLK
4× ICLK
3× ICLK
2 X ICLK
1个ICLK
20引脚300密耳SOIC
注意：对于SEL输入引脚编程：
0 = GND ， 1 = VDD ， M =浮动
引脚说明
针
数
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
针
名字
X1
VDD
VDD
VDD
VIN
GND
GND
GND
CHGP
ISET
SEL2
SEL1
NC
CLK
SEL0
ICLK2
ICLK1
ISEL
GND
X2
针
TYPE
-
动力
动力
动力
输入
动力
动力
动力
产量
-
输入
输入
输入
产量
输入
输入
输入
输入
动力
-
引脚说明
晶振输入。该引脚连接到指定的结晶。
电源。连接到+ 3.3V 。
电源。连接到+ 3.3V 。
电源。连接到+ 3.3V 。
VCXO控制电压输入。该引脚连接到CHGP引脚和外部
环路滤波器在此数据表，如图所示。
连接到接地
连接到接地
连接到接地
电荷泵的输出。该引脚连接到外部环路滤波器和引脚
VIN 。
电荷泵电流设置节点，设置电阻连接。
输出频率选择引脚2.确定输出频率为每个表
以上。内部偏置到VDD / 2。
输出频率选择引脚1.确定输出频率为每个表
以上。内部上拉。
无内部连接。
时钟输出
输出频率选择引脚0确定输出频率为每个表
以上。内部上拉。
输入时钟连接2.输入参考时钟该引脚。如果
未使用的，连接到地面。
输入时钟连接1.输入参考时钟该引脚。如果
未使用的，连接到地面。
输入选择。用于选择参考输入时钟是活动的。低输入
等级选择ICLK1 ，高输入电平选择ICLK2 。内部上拉。
连接到地面。
晶振输出。该引脚连接到指定的结晶。
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通信时钟抖动衰减器
功能说明
该MK2058-01是一个时钟发生器集成电路，其生成
一个输出直接地从一个内部的VCXO电路时钟
其工作原理结合一个外部石英
水晶。压控振荡器是由一个内部的PLL控制
（锁相环）电路，使得设备可以
从输入参考时钟进行再生
时钟。该MK2058-01被配置成提供一个
输出时钟是相同的频率作为输入
时钟。有12个可选的输入/输出频率
的范围内，其中每个所支持的一个约数
石英晶体频率范围。请参阅
第2页输出时钟选择表。
最典型的PLL时钟器件使用内部VCO
（压控振荡器），用于输出时钟
一代。通过使用VCXO与外部晶体，
该MK2058-01能够产生一个低抖动，低
内的低带宽PLL相位噪声的输出时钟。
这是为了提供输入时钟抖动衰减和
能够实现稳定的动作与低频
参考时钟。
该VCXO电路需要一个外部晶振可牵引
用于操作。外部环路滤波器元件使
PLL配置低环路带宽。
输出时钟将改变以反映相位
新选择的输入以控制的相位斜坡（速率
的相变），为受PLL环路
的特点。
石英晶体
重要的是正确类型的石英晶体是
与MK2058-01使用。如果不这样做，可能会导致
在降频pullability范围，无力的
环路锁定，或者过高的输出相位抖动。
该MK2058-01工作由相位锁定VCXO
电路所选择的ICLK输入的输入信号。
该VCXO由外部晶振和中
集成VCXO振荡器电路。以达到最佳的
的性能和可靠性，一个液晶装置用
推荐的参数（如下所示）必须
使用和布局指南在PCB中讨论
布局建议部分必须遵循。
石英晶体振荡的频率是
通过其切割和由外部载荷确定
电容。该MK2058-01采用可变
负载电容片上哪个“拉” ，或改变，所述
频率的晶体。使用指定的结晶
与MK2058-01被设计为具有零
频率误差时的片+杂散的总
电容为14pF 。为了实现这一点，布局应
使用MK2058-01之间短路痕迹
水晶。
推荐水晶的完整描述
参数如下所示。
推荐的晶体参数：
工作温度范围
商业应用
工业应用
在25初始精度
°
C
温度稳定性
老化
负载电容
并联电容C0
C0 / C1比
等效串联电阻
0到70
°
C
-40到85
°
C
± 20 ppm的
± 30 ppm的
± 20 ppm的
注1
7 pF的最大
250最大
35
最大
应用信息
输入/输出频率配置
该MK2058-01被配置为产生输出
频率等于输入参考
频率。所支持的时钟频率
那些落入在输出中列出的范围
第2页的输入时钟选择表位SEL2 ： 0顷
根据该表中设置的，因为是外部晶振
频率。的频率的标称值（中心）
外部晶体将输入的整数倍/
输出时钟指定。请参考石英
水晶此页面上关于外部晶振部分
要求。
输入多路复用器
输入多路复用器提供两个备用的选择
输入参考时钟。根据输入的小区重选
钟，在输出时钟的时钟毛刺不会
由于产生的VCXO的“飞轮效应”
（石英晶体是一个高Q调谐电路） 。当
输入时钟都没有相位对准，的相位
注1： 13.5兆赫之间，晶体频率
27MHz的晶体标称负载电容
规格应该是14pF 。联系ICS MicroClock
关于使用的应用程序（408 ） 297-1201
水晶低于13.5兆赫。
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通信时钟抖动衰减器
为了获得符合资格的晶体器件列表
这些要求，请联系ICS MicroClock
应用部门。
外部元件原理图
C
L
不发凝灰岩
（R EFER与O PTIO NAL
RY实达牛逼uning
部分）
X1
VDD
VDD
VDD
VIN
C
L
PLL环路滤波器元件
所有的模拟PLL电路中使用的环路滤波器，以建立
工作稳定。该MK2058-01使用外循环
过滤器组件，原因如下：
1）较大的环路滤波器的电容值，可以使用
允许低环路带宽。这使得能够使用
低输入参考时钟频率，也
输入时钟抖动衰减能力。大循环
滤波电容也让高环的阻尼因素
当较少的通带峰值需要。
2）环路滤波器的值可以是用户选择的
优化环路响应特性对于给定的
应用程序。
引用外部元件的原理图
当前页，外部环路滤波器是由所述
分量R
Z
, C
1
和C
2
. R
SET
建立PLL
电荷泵电流，从而影响环
滤波器特性。
XTAL
1
2
3
4
5
6
7
8
9
10
20
19
18
17
16
15
14
13
12
11
X2
摹ND
IS EL
IC LK 1
IC LK 2
S EL0
LK
NC
S EL1
S EL2
C
2
R
Z
C
1
摹ND
摹ND
摹ND
HG P
IS ET
R
S等
推荐环路滤波器值比。输出频率范围选择
水晶
SEL2 SEL1 SEL0
倍增器
R
SET
R
Z
C
1
0.1
F
0.1
F
0.1
F
0.1
F
0.1
F
0.1
F
0.1
F
0.1
F
0.1
F
0.1
F
0.1
F
0.1
F
C
2
环
带宽
（ -3dB点）
阻尼
因素
1
1
1
1
1
1
1
1
1
1
1
1
0
0
0
0
M
M
M
M
1
1
1
1
0
0
1
1
0
0
1
1
0
0
1
1
0
1
0
1
0
1
0
1
0
1
0
1
(N)
3072
16
10
6
2048
1716
384
128
4
3
2
1
120 k
1.4 M
1.4 M
1.4 M
540 k
540 k
1.4 M
1.4 M
1.4 M
1.4 M
1.4 M
1.4 M
750 k
160 k
130 k
100 k
1.2 M
1.1 M
820 k
470 k
82 k
68 k
56 k
39 k
4.7 nF的
4.7 nF的
4.7 nF的
4.7 nF的
4.7 nF的
4.7 nF的
4.7 nF的
4.7 nF的
4.7 nF的
4.7 nF的
4.7 nF的
4.7 nF的
14赫兹
60赫兹
75赫兹
95赫兹
8.5赫兹
9赫兹
12赫兹
20赫兹
120赫兹
130赫兹
160赫兹
225赫兹
注意：对于SEL输入引脚编程： 0 = GND ， 1 = VDD ， M =浮动
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A“归一化”PLL环路带宽可以计算
如下：
R
Z
×
I
CP
×
575
NBW
= ---------------------------------------
-
N
上面的“归一化”带宽式不
考虑到阻尼因子或效应
第二个极点。但是，它提供了一个有用的
近似的过滤性能。
环路阻尼因子的计算方法如下：
625
×
I
CP
×
C
1
阻尼因数= R
Z
×
----------------------------------------
-
N
其中：
R
Z
电阻环路滤波器=值（欧姆）
I
CP
=电荷泵电流（安培）
（参考电荷泵电流表，下同）
在上述表中所示，N =水晶乘法器
C
1
电容C =价值
1
在环路滤波器（法拉）
作为一般规则，下面的关系应该是
C成分之间保持
1
和C
2
在环路
过滤器：
C
2
1）循环的电容应为低泄漏型到
避免泄漏引起的相位噪声。为此原因，
切勿使用任何类型的极化或电解
电容器。
2 ）微音（机械振动板）也可以
导致输出相位噪声，环路尤其是当
带宽小于1kHz的。出于这个原因，陶瓷
电容应具有C0G或NP0电介质。避免
高K电介质一样Z5U和X7R 。这些和一些
其他陶瓷具有压电性能的
将机械振动转换成电压噪声
干扰VCXO操作。
对于较大的回路电容值，如0.1
F
或1
F,
由松下制成PPS膜的类型，或金属聚类型
村田和康奈尔杜比利埃作出建议。
有关环路滤波器的问题或变化
特性，请联系您的销售区域FAE或
ICS MicroClock应用。
系列终端电阻
时钟输出走线超过一英寸应该用系列
终止。以系列终止50Ω迹线（一
常用的走线阻抗） ，放置一个33Ω的电阻
串联在时钟线，尽量靠近时钟输出
销越好。时钟的标称阻抗
输出为20Ω 。 （可选串联端接电阻
未在外部元件示意图所示）。
-
= -----
20
C
1
去耦电容
对于任何高性能的混合信号IC，该
MK2058-01必须与系统电源隔离
电源噪声，以达到最佳性能。
0.01μF的去耦电容必须连接
每个VDD与PCB地平面之间。对
对干扰系统电源噪声进一步后卫，
在MK2058-01应该使用一个共同的连接
在PCB电源层上的图中所示
下一页。铁氧体磁珠和大容量电容的帮助
减少供应那个可以较低频率的噪声
导致输出时钟的相位调制。
电荷泵电流表
R
SET
1.4 M
680 k
540 k
120 k
电荷泵电流
(I
CP
)
10
A
20
A
25
A
100
A
特别注意事项必须选择循环进行
C成分
1
和C
2
:
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