初步规格。
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三菱的LSI
MH4S64CWZTJ-12,-15
268435456 - BIT （ 4194304 - WORD 64位） SynchronousDRAM
描述
该MH4S64CWZTJ是4194304字由64位
同步DRAM模块。这包括16对
行业标准2Mx8同步DRAM中
TSOP和在一个industory标准的EEPROM
TSSOP封装。
TSOP的上边缘卡双列直插式安装
软件包提供的任何应用程序，其中高
密度和大量内存的
所需。
这是一个套接字类型 - 内存模块，适用于
方便的交换或增加模块。
85pin
1pin
94pin
95pin
10pin
11pin
特点
频率
-12
-15
83MHz
67MHz
CLK访问时间
8.5ns
9.5ns
背面
正面
-1
采用业界标准的2M ×8同步DRAM
100MH
8.5n
0
采用TSSOP TSOP和行业标准的EEPROM
z
s
168针（ 84脚双列直插式封装）
124pin
125pin
40pin
41pin
单3.3V ± 0.3V电源
时钟频率83MHz的/ 67MHz
充分参考时钟同步运行上升
EDGE
由BA控制的双行操作（银行地址）
/ CAS延时： 2/3/4 （可编程）
突发长度 - 1/4 （可编程）
突发类型 - 顺序/交错（可编程）
列存取 - 随机
自动预充电/所有银行预充电用A10的控制
自动刷新和自刷新
4096刷新周期/ 64ms的
LVTTL接口
168pin
84pin
应用
主存储器或图形存储器中的计算机系统
SPD表
第一个字节
0
1
2
3
4
5
6
7
8
9 10 11 12 13 14 15 16 17 18 19 20 126 127
06 01 05 02 04 01 01 83 06
06 01 05 02 04 01 01 66 06
MH4S64CWZTJ 12 80 08 04 0C 09 02
MH4S64CWZTJ 15 80 08 04 0C 09 02
40 00 01 C0 85 00 80 00
40 00 01 F0 95 00 80 00
MIT-DS-0053-0.2
三菱
电
( 1 / 44 )
Aug.8.1996
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三菱的LSI
MH4S64CWZTJ-12,-15
268435456 - BIT （ 4194304 - WORD 64位） SynchronousDRAM
PIN号
85
86
87
88
89
90
91
92
93
94
95
96
97
98
99
100
101
102
103
104
105
106
107
108
109
110
111
112
113
114
115
116
117
118
119
120
121
122
123
124
125
126
引脚名称
VSS
DQ32
DQ33
DQ34
DQ35
VDD
DQ36
DQ37
DQ38
DQ39
DQ40
VSS
DQ41
DQ42
DQ43
DQ44
DQ45
VDD
DQ46
DQ47
NC
NC
VSS
NC
NC
VDD
/ CAS
DQMB4
DQMB5
/S1
/ RAS
VSS
A1
A3
A5
A7
A9
BA
NC
VDD
CK1
NC
PIN号
127
128
129
130
131
132
133
134
135
136
137
138
139
140
141
142
143
144
145
146
147
148
149
150
151
152
153
154
155
156
157
158
159
160
161
162
163
164
165
166
167
168
引脚名称
VSS
CKE
/S3
DQMB6
DQMB7
NC
VDD
NC
NC
NC
NC
VSS
DQ48
DQ49
DQ50
DQ51
VDD
DQ52
NC
NC
NC
VSS
DQ53
DQ54
DQ55
VSS
DQ56
DQ57
DQ58
DQ59
VDD
DQ60
DQ61
DQ62
DQ63
VSS
NC
NC
SA0
SA1
SA2
VDD
PIN号
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
25
26
27
28
29
30
31
32
33
34
35
36
37
38
39
40
41
42
引脚名称
VSS
DQ0
DQ1
DQ2
DQ3
VDD
DQ4
DQ5
DQ6
DQ7
DQ8
VSS
DQ9
DQ10
DQ11
DQ12
DQ13
VDD
DQ14
DQ15
NC
NC
VSS
NC
NC
VDD
/WE0
DQMB0
DQMB1
/S0
NC
VSS
A0
A2
A4
A6
A8
A10
NC
VDD
VDD
CK0
PIN号
43
44
45
46
47
48
49
50
51
52
53
54
55
56
57
58
59
60
61
62
63
64
65
66
67
68
69
70
71
72
73
74
75
76
77
78
79
80
81
82
83
84
引脚名称
VSS
NC
/S2
DQMB2
DQMB3
NC
VDD
NC
NC
NC
NC
VSS
DQ16
DQ17
DQ18
DQ19
VDD
DQ20
NC
NC
NC
VSS
DQ21
DQ22
DQ23
VSS
DQ24
DQ25
DQ26
DQ27
VDD
DQ28
DQ29
DQ30
DQ31
VSS
NC
NC
NC
SDA
SCL
VDD
NC =无连接
MIT-DS-0053-0.2
三菱
电
( 2 / 44 )
Aug.8.1996
初步规格。
有些内容如有变更，恕不另行通知。
三菱的LSI
MH4S64CWZTJ-12,-15
268435456 - BIT （ 4194304 - WORD 64位） SynchronousDRAM
框图
CK0
/S1
/S0
DQMB0
DQM / CS CK0
DQM / CS CK0
DQMB4
DQM / CS CK0
DQM / CS CK0
DQ0
DQ1
DQ2
DQ3
DQ4
DQ5
DQ6
DQ7
DQMB1
I / O 0
I / O 1
I / O 2
I / O 3
I / O 4
I / O 5
I / O 6
I / O 7
D0
I / O 0
I / O 1
I / O 2
I / O 3
I / O 4
I / O 5
I / O 6
I / O 7
D8
DQ32
DQ33
DQ34
DQ35
DQ36
DQ37
DQ38
DQ39
DQMB5
I / O 0
I / O 1
I / O 2
I / O 3
I / O 4
I / O 5
I / O 6
I / O 7
D4
I / O 0
I / O 1
I / O 2
I / O 3
I / O 4 D12
I / O 5
I / O 6
I / O 7
DQM / CS CK0
DQM / CS CK0
DQM / CS CK0
DQM / CS CK0
DQ8
DQ9
DQ10
DQ11
DQ12
DQ13
DQ14
DQ15
CK1
/S3
/S2
DQMB2
I / O 0
I / O 1
I / O 2
I / O 3
I / O 4
I / O 5
I / O 6
I / O 7
D1
I / O 0
I / O 1
I / O 2
I / O 3
I / O 4
I / O 5
I / O 6
I / O 7
D9
DQ40
DQ41
DQ42
DQ43
DQ44
DQ45
DQ46
DQ47
I / O 0
I / O 1
I / O 2
I / O 3
I / O 4
I / O 5
I / O 6
I / O 7
D5
I / O 0
I / O 1
I / O 2
I / O 3
I / O 4
I / O 5
I / O 6
I / O 7
D13
DQMB6
DQM / CS CK0
DQM / CS CK0
DQM / CS CK0
DQM / CS CK0
DQ16
DQ17
DQ18
DQ19
DQ20
DQ21
DQ22
DQ23
DQMB3
I / O 0
I / O 1
I / O 2
I / O 3
I / O 4
I / O 5
I / O 6
I / O 7
D2
I / O 0
I / O 1
I / O 2
I / O 3
I / O 4
I / O 5
I / O 6
I / O 7
D10
DQ48
DQ49
DQ50
DQ51
DQ52
DQ53
DQ54
DQ55
DQMB7
I / O 0
I / O 1
I / O 2
I / O 3
I / O 4
I / O 5
I / O 6
I / O 7
D6
I / O 0
I / O 1
I / O 2
I / O 3
I / O 4 D14
I / O 5
I / O 6
I / O 7
DQM / CS CK0
DQM / CS CK0
DQM / CS CK0
DQM / CS CK0
DQ24
DQ25
DQ26
DQ27
DQ28
DQ29
DQ30
DQ31
CKE
/ RAS
/ CAS
/ WE
BA ， A<10 ： 0>
VCC
VSS
I / O 0
I / O 1
I / O 2
I / O 3
I / O 4
I / O 5
I / O 6
I / O 7
D3
I / O 0
I / O 1
I / O 2
I / O 3
I / O 4 D11
I / O 5
I / O 6
I / O 7
DQ56
DQ57
DQ58
DQ59
DQ60
DQ61
DQ62
DQ63
I / O 0
I / O 1
I / O 2
I / O 3
I / O 4
I / O 5
I / O 6
I / O 7
D7
I / O 0
I / O 1
I / O 2
I / O 3
I / O 4
I / O 5
I / O 6
I / O 7
D15
D0 - D15
D0 - D15
D0 - D15
D0 - D15
D0 - D15
D0 - D15
D0 - D15
串行PD
SCL
A0
A1
A2
SA0 SA1 SA2
SDA
MIT-DS-0053-0.2
三菱
电
( 3 / 44 )
Aug.8.1996
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三菱的LSI
MH4S64CWZTJ-12,-15
268435456 - BIT （ 4194304 - WORD 64位） SynchronousDRAM
引脚功能
CK
（ CK0 & CK1 ）
输入
主时钟：所有其他输入参考上升
CK边缘
时钟使能： CKE控制内部clock.When CKE是
对于下一个周期的低，内部时钟就停止。 CKE是
也可用于选择自动/自刷新。自刷新后，
模式启动， CKE ê变成异步input.Self
只要CKE是低刷新保持。
芯片选择：当/ S为高电平时，任何命令方式
无操作。
的RAS /组合， / CAS ， /我们定义了基本的命令。
A0-10与指定相结合的行/列地址
BA.The行地址由A0-10.The指定栏
地址是由A0-8.A10指定也可用于指示
预充电option.When A10的高，在一个读/写
命令，自动预充电被执行。当A10是
在高预充电命令，两家银行预充电。
银行地址： BA不是简单BA.BA指定银行
到一个命令applied.BA必须与设置
ACT ，预读，写命令
CKE
输入
/S
(/S0 ~ /S3)
/ RAS ， / CAS ， / WE
输入
输入
A0-10
输入
BA
输入
DQ0-63
数据在与数据输出被引用到的上升沿
输入/输出CK
嚣面膜/输出禁止：当DQMB是高爆
write.Din当前周期masked.When DQMB是高
在突发读取， Dout为下一个，但一个周期禁用。
DQMB0-7
输入
VDD，VSS
SLA
SDA
SA0-3
供电电源的安装内存模块。
输入
产量
输入
串行时钟，串行PD
串行数据串行PD
地址输入串行PD
MIT-DS-0053-0.2
三菱
电
( 4 / 44 )
Aug.8.1996
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三菱的LSI
MH4S64CWZTJ-12,-15
268435456 - BIT （ 4194304 - WORD 64位） SynchronousDRAM
基本功能
该MH4S64CWZTJ提供了基本的功能，银行（行）激活，突发读取/写入，
银行（行）预充电和自动/自刷新。
每一个命令是由/ RAS ， / CAS控制信号，在CK的上升沿定义和/ WE 。在
除了3个信号， / S， CKE和A10被用作芯片选择，刷新选项，并
预充电的选项，分别。
要知道的命令的详细定义请参阅命令真值表。
CK
/S
/ RAS
/ CAS
/ WE
CKE
A10
芯片选择： L =选择， H =取消
命令
命令
命令
刷新选项@refresh
命令
预充电选@precharge或读/写
命令
定义基本命令
激活（ ACT ） [ / RAS = L ， / CAS = / WE = H]
ACT命令激活一排由BA表示闲置银行。
读（READ ） [ / RAS = H ， / CAS = L ， / WE = H]
READ命令启动突发由BA.First输出指示当前行读
后/ CAS延迟数据出现。当A10 = H在此命令中，该行
读取（自动预充电， READA ）突发后停用。
写（ WRITE） [ / RAS = H， / CAS = / WE = L]
写命令启动突发写入由广管局表示活动的银行。总数据
要写入的长度是由脉冲串长度设置。当A10 = H在此命令中，该行
突发写入（自动预充电， WRITEA ）后停用。
预充电（PRE ） / RAS = L ， / CAS = H， / WE = L]
PRE命令将停用由BA表示活动的银行。该命令还
终止脉冲串的读/写操作。当A10 = H在此命令中，两家银行均
禁用（预充电所有，
PREA ） 。
自动刷新（ REFA ） [ / RAS = / CAS = L ， / WE = CKE = H ]
PEFA命令启动自动刷新周期。刷新地址包括银行地址
内部产生。该命令后，银行会自动预充电。
MIT-DS-0053-0.2
三菱
电
( 5 / 44 )
Aug.8.1996
初步规格。
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三菱的LSI
MH4S64CZTJ/CWZTJ-12,-15,-1539
268435456 - BIT （ 4194304 - WORD 64位） SynchronousDRAM
描述
该MH4S64CZTJ / CWZTJ是4194304字经
64位同步DRAM模块。这包括
16行业标准2Mx8同步DRAM
在TSOP和一个industory标准EEPROM
TSSOP封装。
TSOP的上边缘卡双列直插式安装
软件包提供的任何应用程序，其中高
密度和大量内存的
所需。
这是一个套接字类型 - 内存模块，适用于
方便的交换或增加模块。
85pin
1pin
94pin
95pin
10pin
11pin
特点
频率
-12
-15
-1539
83MHz
67MHz
67MHz
CLK访问时间
（组件SDRAM ）
8ns(CL=3)
9.5ns （CL = 2）的
背面
9ns （CL = 3）的
正面
采用业界标准的2M ×8同步DRAM
采用TSSOP TSOP和行业标准的EEPROM
168针（ 84脚双列直插式封装）
124pin
125pin
40pin
41pin
单3.3V ± 0.3V电源
时钟频率83MHz的/ 67MHz
充分参考时钟同步运行上升
EDGE
由BA控制的双行操作（银行地址）
/ CAS延时： 1/2/3 （可编程）
突发长度 - 1/2/4/8 （可编程）
突发类型 - 顺序/交错（可编程）
列存取 - 随机
自动预充电/所有银行预充电用A10的控制
自动刷新和自刷新
4096刷新周期/ 64ms的
LVTTL接口
168pin
84pin
应用
主存储器或图形存储器中的计算机系统
SPD表
第一个字节
MH4S64CZTJ/CWZTJ-12
MH4S64CZTJ/CWZTJ-15
0
1
2
3
4
5
6
7
8
9 10 11 12 13 14 15 16 17 18 19 20 126 127
80 08 04 0C 09 02
80 08 04 0C 09 02
08 04 0C 09 02
40 00 01 C0 80 00 80 00 06 01 05 02 06 01 01 83 06
40 00 01 F0 95 00 80 00 06 01 05 02 06 01 01 66 06
40 00 01 F0 90 00 80 00 04 01 05 02 04 01 01 66 04
MH4S64CZTJ/CWZTJ-1539
80
MIT-DS-0044-0.3
三菱
电
( 1 / 45 )
Oct.17.1996
初步规格。
有些内容如有变更，恕不另行通知。
三菱的LSI
MH4S64CZTJ/CWZTJ-12,-15,-1539
268435456 - BIT （ 4194304 - WORD 64位） SynchronousDRAM
PIN号
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
25
26
27
28
29
30
31
32
33
34
35
36
37
38
39
40
41
42
引脚名称
VSS
DQ0
DQ1
DQ2
DQ3
VDD
DQ4
DQ5
DQ6
DQ7
DQ8
VSS
DQ9
DQ10
DQ11
DQ12
DQ13
VDD
DQ14
DQ15
NC
NC
VSS
NC
NC
VDD
/WE0
DQMB0
DQMB1
/S0
NC
VSS
A0
A2
A4
A6
A8
A10
NC
VDD
VDD
CK0
PIN号
43
44
45
46
47
48
49
50
51
52
53
54
55
56
57
58
59
60
61
62
63
64
65
66
67
68
69
70
71
72
73
74
75
76
77
78
79
80
81
82
83
84
引脚名称
VSS
NC
/S2
DQMB2
DQMB3
NC
VDD
NC
NC
NC
NC
VSS
DQ16
DQ17
DQ18
DQ19
VDD
DQ20
NC
NC
NC
VSS
DQ21
DQ22
DQ23
VSS
DQ24
DQ25
DQ26
DQ27
VDD
DQ28
DQ29
DQ30
DQ31
VSS
NC
NC
NC
SDA
SCL
VDD
PIN号
85
86
87
88
89
90
91
92
93
94
95
96
97
98
99
100
101
102
103
104
105
106
107
108
109
110
111
112
113
114
115
116
117
118
119
120
121
122
123
124
125
126
引脚名称
VSS
DQ32
DQ33
DQ34
DQ35
VDD
DQ36
DQ37
DQ38
DQ39
DQ40
VSS
DQ41
DQ42
DQ43
DQ44
DQ45
VDD
DQ46
DQ47
NC
NC
VSS
NC
NC
VDD
/ CAS
DQMB4
DQMB5
/S1
/ RAS
VSS
A1
A3
A5
A7
A9
BA
NC
VDD
CK1
NC
PIN号
127
128
129
130
131
132
133
134
135
136
137
138
139
140
141
142
143
144
145
146
147
148
149
150
151
152
153
154
155
156
157
158
159
160
161
162
163
164
165
166
167
168
引脚名称
VSS
CKE
/S3
DQMB6
DQMB7
NC
VDD
NC
NC
NC
NC
VSS
DQ48
DQ49
DQ50
DQ51
VDD
DQ52
NC
NC
NC
VSS
DQ53
DQ54
DQ55
VSS
DQ56
DQ57
DQ58
DQ59
VDD
DQ60
DQ61
DQ62
DQ63
VSS
NC
NC
SA0
SA1
SA2
VDD
NC =无连接
MIT-DS-0044-0.3
三菱
电
( 2 / 45 )
Oct.17.1996
初步规格。
有些内容如有变更，恕不另行通知。
三菱的LSI
MH4S64CZTJ/CWZTJ-12,-15,-1539
268435456 - BIT （ 4194304 - WORD 64位） SynchronousDRAM
框图
CK0
/S1
/S0
DQMB0
DQM / CS CK0
DQM / CS CK0
MH4S64CZTJ
DQMB4
DQM / CS CK0
DQM / CS CK0
DQ0
DQ1
DQ2
DQ3
DQ4
DQ5
DQ6
DQ7
DQMB1
I / O 0
I / O 1
I / O 2
I / O 3
I / O 4
I / O 5
I / O 6
I / O 7
D0
I / O 0
I / O 1
I / O 2
I / O 3
I / O 4
I / O 5
I / O 6
I / O 7
D8
DQ32
DQ33
DQ34
DQ35
DQ36
DQ37
DQ38
DQ39
DQMB5
I / O 0
I / O 1
I / O 2
I / O 3
I / O 4
I / O 5
I / O 6
I / O 7
D4
I / O 0
I / O 1
I / O 2
I / O 3
I / O 4 D12
I / O 5
I / O 6
I / O 7
DQM / CS CK0
DQM / CS CK0
DQM / CS CK0
DQM / CS CK0
DQ8
DQ9
DQ10
DQ11
DQ12
DQ13
DQ14
DQ15
CK1
/S3
/S2
DQMB2
I / O 0
I / O 1
I / O 2
I / O 3
I / O 4
I / O 5
I / O 6
I / O 7
D1
I / O 0
I / O 1
I / O 2
I / O 3
I / O 4
I / O 5
I / O 6
I / O 7
D9
DQ40
DQ41
DQ42
DQ43
DQ44
DQ45
DQ46
DQ47
I / O 0
I / O 1
I / O 2
I / O 3
I / O 4
I / O 5
I / O 6
I / O 7
D5
I / O 0
I / O 1
I / O 2
I / O 3
I / O 4
I / O 5
I / O 6
I / O 7
D13
DQMB6
DQM / CS CK0
DQM / CS CK0
DQM / CS CK0
DQM / CS CK0
DQ16
DQ17
DQ18
DQ19
DQ20
DQ21
DQ22
DQ23
DQMB3
I / O 0
I / O 1
I / O 2
I / O 3
I / O 4
I / O 5
I / O 6
I / O 7
D2
I / O 0
I / O 1
I / O 2
I / O 3
I / O 4
I / O 5
I / O 6
I / O 7
D10
DQ48
DQ49
DQ50
DQ51
DQ52
DQ53
DQ54
DQ55
DQMB7
I / O 0
I / O 1
I / O 2
I / O 3
I / O 4
I / O 5
I / O 6
I / O 7
D6
I / O 0
I / O 1
I / O 2
I / O 3
I / O 4 D14
I / O 5
I / O 6
I / O 7
DQM / CS CK0
DQM / CS CK0
DQM / CS CK0
DQM / CS CK0
DQ24
DQ25
DQ26
DQ27
DQ28
DQ29
DQ30
DQ31
CKE
/ RAS
/ CAS
/ WE
BA ， A<10 ： 0>
VCC
VSS
I / O 0
I / O 1
I / O 2
I / O 3
I / O 4
I / O 5
I / O 6
I / O 7
D3
I / O 0
I / O 1
I / O 2
I / O 3
I / O 4 D11
I / O 5
I / O 6
I / O 7
DQ56
DQ57
DQ58
DQ59
DQ60
DQ61
DQ62
DQ63
I / O 0
I / O 1
I / O 2
I / O 3
I / O 4
I / O 5
I / O 6
I / O 7
D7
I / O 0
I / O 1
I / O 2
I / O 3
I / O 4
I / O 5
I / O 6
I / O 7
D15
D0 - D15
D0 - D15
D0 - D15
D0 - D15
D0 - D15
D0 - D15
D0 - D15
串行PD
SCL
A0
A1
A2
SA0 SA1 SA2
SDA
MIT-DS-0044-0.3
三菱
电
( 3 / 45 )
Oct.17.1996
初步规格。
有些内容如有变更，恕不另行通知。
三菱的LSI
MH4S64CZTJ/CWZTJ-12,-15,-1539
268435456 - BIT （ 4194304 - WORD 64位） SynchronousDRAM
框图
CK0
/S1
/S0
DQMB0
DQM / CS CK0
DQM / CS CK0
MH4S64CWZTJ
DQMB4
DQM / CS CK0
DQM / CS CK0
DQ0
DQ1
DQ2
DQ3
DQ4
DQ5
DQ6
DQ7
DQMB1
I / O 0
I / O 1
I / O 2
I / O 3
I / O 4
I / O 5
I / O 6
I / O 7
D0
I / O 0
I / O 1
I / O 2
I / O 3
I / O 4
I / O 5
I / O 6
I / O 7
D8
DQ32
DQ33
DQ34
DQ35
DQ36
DQ37
DQ38
DQ39
DQMB5
I / O 0
I / O 1
I / O 2
I / O 3
I / O 4
I / O 5
I / O 6
I / O 7
D4
I / O 0
I / O 1
I / O 2
I / O 3
I / O 4 D12
I / O 5
I / O 6
I / O 7
DQM / CS CK0
DQM / CS CK0
DQM / CS CK0
DQM / CS CK0
DQ8
DQ9
DQ10
DQ11
DQ12
DQ13
DQ14
DQ15
CK1
/S3
/S2
DQMB2
I / O 0
I / O 1
I / O 2
I / O 3
I / O 4
I / O 5
I / O 6
I / O 7
D1
I / O 0
I / O 1
I / O 2
I / O 3
I / O 4
I / O 5
I / O 6
I / O 7
D9
DQ40
DQ41
DQ42
DQ43
DQ44
DQ45
DQ46
DQ47
I / O 0
I / O 1
I / O 2
I / O 3
I / O 4
I / O 5
I / O 6
I / O 7
D5
I / O 0
I / O 1
I / O 2
I / O 3
I / O 4
I / O 5
I / O 6
I / O 7
D13
DQMB6
DQM / CS CK0
DQM / CS CK0
DQM / CS CK0
DQM / CS CK0
DQ16
DQ17
DQ18
DQ19
DQ20
DQ21
DQ22
DQ23
DQMB3
I / O 0
I / O 1
I / O 2
I / O 3
I / O 4
I / O 5
I / O 6
I / O 7
D2
I / O 0
I / O 1
I / O 2
I / O 3
I / O 4
I / O 5
I / O 6
I / O 7
D10
DQ48
DQ49
DQ50
DQ51
DQ52
DQ53
DQ54
DQ55
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I / O 0
I / O 1
I / O 2
I / O 3
I / O 4
I / O 5
I / O 6
I / O 7
D6
I / O 0
I / O 1
I / O 2
I / O 3
I / O 4 D14
I / O 5
I / O 6
I / O 7
DQM / CS CK0
DQM / CS CK0
DQM / CS CK0
DQM / CS CK0
DQ24
DQ25
DQ26
DQ27
DQ28
DQ29
DQ30
DQ31
CKE
/ RAS
/ CAS
/ WE
BA ， A<10 ： 0>
VCC
VSS
I / O 0
I / O 1
I / O 2
I / O 3
I / O 4
I / O 5
I / O 6
I / O 7
D3
I / O 0
I / O 1
I / O 2
I / O 3
I / O 4 D11
I / O 5
I / O 6
I / O 7
DQ56
DQ57
DQ58
DQ59
DQ60
DQ61
DQ62
DQ63
I / O 0
I / O 1
I / O 2
I / O 3
I / O 4
I / O 5
I / O 6
I / O 7
D7
I / O 0
I / O 1
I / O 2
I / O 3
I / O 4
I / O 5
I / O 6
I / O 7
D15
D0 - D15
D0 - D15
D0 - D15
D0 - D15
D0 - D15
D0 - D15
D0 - D15
串行PD
SCL
A0
A1
A2
SA0 SA1 SA2
SDA
MIT-DS-0044-0.3
三菱
电
( 4 / 45 )
Oct.17.1996
初步规格。
有些内容如有变更，恕不另行通知。
三菱的LSI
MH4S64CZTJ/CWZTJ-12,-15,-1539
268435456 - BIT （ 4194304 - WORD 64位） SynchronousDRAM
引脚功能
CK
（ CK0 & CK1 ）
输入
主时钟：所有其他输入参考上升
CK边缘
时钟使能： CKE控制内部clock.When CKE是
对于下一个周期的低，内部时钟就停止。 CKE是
也可用于选择自动/自刷新。自刷新后，
模式启动， CKE ê变成异步input.Self
只要CKE是低刷新保持。
芯片选择：当/ S为高电平时，任何命令方式
无操作。
的RAS /组合， / CAS ， /我们定义了基本的命令。
A0-10与指定相结合的行/列地址
BA.The行地址由A0-10.The指定栏
地址是由A0-8.A10指定也可用于指示
预充电option.When A10的高，在一个读/写
命令，自动预充电被执行。当A10是
在高预充电命令，两家银行预充电。
银行地址： BA不是简单BA.BA指定银行
到一个命令applied.BA必须与设置
ACT ，预读，写命令
CKE
输入
/S
(/S0 ~ /S3)
/ RAS ， / CAS ， / WE
输入
输入
A0-10
输入
BA
输入
DQ0-63
数据在与数据输出被引用到的上升沿
输入/输出CK
嚣面膜/输出禁止：当DQMB是高爆
write.Din当前周期masked.When DQMB是高
在突发读取， Dout为下一个，但一个周期禁用。
DQMB0-7
输入
VDD，VSS
SLA
SDA
SA0-3
供电电源的安装内存模块。
输入
产量
输入
串行时钟，串行PD
串行数据串行PD
地址输入串行PD
MIT-DS-0044-0.3
三菱
电
( 5 / 45 )
Oct.17.1996
初步规格。
有些内容如有变更，恕不另行通知。
三菱的LSI
MH4S64CZTJ/CWZTJ-12,-15,-1539
268435456 - BIT （ 4194304 - WORD 64位） SynchronousDRAM
描述
该MH4S64CZTJ / CWZTJ是4194304字经
64位同步DRAM模块。这包括
16行业标准2Mx8同步DRAM
在TSOP和一个industory标准EEPROM
TSSOP封装。
TSOP的上边缘卡双列直插式安装
软件包提供的任何应用程序，其中高
密度和大量内存的
所需。
这是一个套接字类型 - 内存模块，适用于
方便的交换或增加模块。
85pin
1pin
94pin
95pin
10pin
11pin
特点
频率
-12
-15
-1539
83MHz
67MHz
67MHz
CLK访问时间
（组件SDRAM ）
8ns(CL=3)
9.5ns （CL = 2）的
背面
9ns （CL = 3）的
正面
采用业界标准的2M ×8同步DRAM
采用TSSOP TSOP和行业标准的EEPROM
168针（ 84脚双列直插式封装）
124pin
125pin
40pin
41pin
单3.3V ± 0.3V电源
时钟频率83MHz的/ 67MHz
充分参考时钟同步运行上升
EDGE
由BA控制的双行操作（银行地址）
/ CAS延时： 1/2/3 （可编程）
突发长度 - 1/2/4/8 （可编程）
突发类型 - 顺序/交错（可编程）
列存取 - 随机
自动预充电/所有银行预充电用A10的控制
自动刷新和自刷新
4096刷新周期/ 64ms的
LVTTL接口
168pin
84pin
应用
主存储器或图形存储器中的计算机系统
SPD表
第一个字节
MH4S64CZTJ/CWZTJ-12
MH4S64CZTJ/CWZTJ-15
0
1
2
3
4
5
6
7
8
9 10 11 12 13 14 15 16 17 18 19 20 126 127
80 08 04 0C 09 02
80 08 04 0C 09 02
08 04 0C 09 02
40 00 01 C0 80 00 80 00 06 01 05 02 06 01 01 83 06
40 00 01 F0 95 00 80 00 06 01 05 02 06 01 01 66 06
40 00 01 F0 90 00 80 00 04 01 05 02 04 01 01 66 04
MH4S64CZTJ/CWZTJ-1539
80
MIT-DS-0044-0.3
三菱
电
( 1 / 45 )
Oct.17.1996
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三菱的LSI
MH4S64CZTJ/CWZTJ-12,-15,-1539
268435456 - BIT （ 4194304 - WORD 64位） SynchronousDRAM
PIN号
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
25
26
27
28
29
30
31
32
33
34
35
36
37
38
39
40
41
42
引脚名称
VSS
DQ0
DQ1
DQ2
DQ3
VDD
DQ4
DQ5
DQ6
DQ7
DQ8
VSS
DQ9
DQ10
DQ11
DQ12
DQ13
VDD
DQ14
DQ15
NC
NC
VSS
NC
NC
VDD
/WE0
DQMB0
DQMB1
/S0
NC
VSS
A0
A2
A4
A6
A8
A10
NC
VDD
VDD
CK0
PIN号
43
44
45
46
47
48
49
50
51
52
53
54
55
56
57
58
59
60
61
62
63
64
65
66
67
68
69
70
71
72
73
74
75
76
77
78
79
80
81
82
83
84
引脚名称
VSS
NC
/S2
DQMB2
DQMB3
NC
VDD
NC
NC
NC
NC
VSS
DQ16
DQ17
DQ18
DQ19
VDD
DQ20
NC
NC
NC
VSS
DQ21
DQ22
DQ23
VSS
DQ24
DQ25
DQ26
DQ27
VDD
DQ28
DQ29
DQ30
DQ31
VSS
NC
NC
NC
SDA
SCL
VDD
PIN号
85
86
87
88
89
90
91
92
93
94
95
96
97
98
99
100
101
102
103
104
105
106
107
108
109
110
111
112
113
114
115
116
117
118
119
120
121
122
123
124
125
126
引脚名称
VSS
DQ32
DQ33
DQ34
DQ35
VDD
DQ36
DQ37
DQ38
DQ39
DQ40
VSS
DQ41
DQ42
DQ43
DQ44
DQ45
VDD
DQ46
DQ47
NC
NC
VSS
NC
NC
VDD
/ CAS
DQMB4
DQMB5
/S1
/ RAS
VSS
A1
A3
A5
A7
A9
BA
NC
VDD
CK1
NC
PIN号
127
128
129
130
131
132
133
134
135
136
137
138
139
140
141
142
143
144
145
146
147
148
149
150
151
152
153
154
155
156
157
158
159
160
161
162
163
164
165
166
167
168
引脚名称
VSS
CKE
/S3
DQMB6
DQMB7
NC
VDD
NC
NC
NC
NC
VSS
DQ48
DQ49
DQ50
DQ51
VDD
DQ52
NC
NC
NC
VSS
DQ53
DQ54
DQ55
VSS
DQ56
DQ57
DQ58
DQ59
VDD
DQ60
DQ61
DQ62
DQ63
VSS
NC
NC
SA0
SA1
SA2
VDD
NC =无连接
MIT-DS-0044-0.3
三菱
电
( 2 / 45 )
Oct.17.1996
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有些内容如有变更，恕不另行通知。
三菱的LSI
MH4S64CZTJ/CWZTJ-12,-15,-1539
268435456 - BIT （ 4194304 - WORD 64位） SynchronousDRAM
框图
CK0
/S1
/S0
DQMB0
DQM / CS CK0
DQM / CS CK0
MH4S64CZTJ
DQMB4
DQM / CS CK0
DQM / CS CK0
DQ0
DQ1
DQ2
DQ3
DQ4
DQ5
DQ6
DQ7
DQMB1
I / O 0
I / O 1
I / O 2
I / O 3
I / O 4
I / O 5
I / O 6
I / O 7
D0
I / O 0
I / O 1
I / O 2
I / O 3
I / O 4
I / O 5
I / O 6
I / O 7
D8
DQ32
DQ33
DQ34
DQ35
DQ36
DQ37
DQ38
DQ39
DQMB5
I / O 0
I / O 1
I / O 2
I / O 3
I / O 4
I / O 5
I / O 6
I / O 7
D4
I / O 0
I / O 1
I / O 2
I / O 3
I / O 4 D12
I / O 5
I / O 6
I / O 7
DQM / CS CK0
DQM / CS CK0
DQM / CS CK0
DQM / CS CK0
DQ8
DQ9
DQ10
DQ11
DQ12
DQ13
DQ14
DQ15
CK1
/S3
/S2
DQMB2
I / O 0
I / O 1
I / O 2
I / O 3
I / O 4
I / O 5
I / O 6
I / O 7
D1
I / O 0
I / O 1
I / O 2
I / O 3
I / O 4
I / O 5
I / O 6
I / O 7
D9
DQ40
DQ41
DQ42
DQ43
DQ44
DQ45
DQ46
DQ47
I / O 0
I / O 1
I / O 2
I / O 3
I / O 4
I / O 5
I / O 6
I / O 7
D5
I / O 0
I / O 1
I / O 2
I / O 3
I / O 4
I / O 5
I / O 6
I / O 7
D13
DQMB6
DQM / CS CK0
DQM / CS CK0
DQM / CS CK0
DQM / CS CK0
DQ16
DQ17
DQ18
DQ19
DQ20
DQ21
DQ22
DQ23
DQMB3
I / O 0
I / O 1
I / O 2
I / O 3
I / O 4
I / O 5
I / O 6
I / O 7
D2
I / O 0
I / O 1
I / O 2
I / O 3
I / O 4
I / O 5
I / O 6
I / O 7
D10
DQ48
DQ49
DQ50
DQ51
DQ52
DQ53
DQ54
DQ55
DQMB7
I / O 0
I / O 1
I / O 2
I / O 3
I / O 4
I / O 5
I / O 6
I / O 7
D6
I / O 0
I / O 1
I / O 2
I / O 3
I / O 4 D14
I / O 5
I / O 6
I / O 7
DQM / CS CK0
DQM / CS CK0
DQM / CS CK0
DQM / CS CK0
DQ24
DQ25
DQ26
DQ27
DQ28
DQ29
DQ30
DQ31
CKE
/ RAS
/ CAS
/ WE
BA ， A<10 ： 0>
VCC
VSS
I / O 0
I / O 1
I / O 2
I / O 3
I / O 4
I / O 5
I / O 6
I / O 7
D3
I / O 0
I / O 1
I / O 2
I / O 3
I / O 4 D11
I / O 5
I / O 6
I / O 7
DQ56
DQ57
DQ58
DQ59
DQ60
DQ61
DQ62
DQ63
I / O 0
I / O 1
I / O 2
I / O 3
I / O 4
I / O 5
I / O 6
I / O 7
D7
I / O 0
I / O 1
I / O 2
I / O 3
I / O 4
I / O 5
I / O 6
I / O 7
D15
D0 - D15
D0 - D15
D0 - D15
D0 - D15
D0 - D15
D0 - D15
D0 - D15
串行PD
SCL
A0
A1
A2
SA0 SA1 SA2
SDA
MIT-DS-0044-0.3
三菱
电
( 3 / 45 )
Oct.17.1996
初步规格。
有些内容如有变更，恕不另行通知。
三菱的LSI
MH4S64CZTJ/CWZTJ-12,-15,-1539
268435456 - BIT （ 4194304 - WORD 64位） SynchronousDRAM
框图
CK0
/S1
/S0
DQMB0
DQM / CS CK0
DQM / CS CK0
MH4S64CWZTJ
DQMB4
DQM / CS CK0
DQM / CS CK0
DQ0
DQ1
DQ2
DQ3
DQ4
DQ5
DQ6
DQ7
DQMB1
I / O 0
I / O 1
I / O 2
I / O 3
I / O 4
I / O 5
I / O 6
I / O 7
D0
I / O 0
I / O 1
I / O 2
I / O 3
I / O 4
I / O 5
I / O 6
I / O 7
D8
DQ32
DQ33
DQ34
DQ35
DQ36
DQ37
DQ38
DQ39
DQMB5
I / O 0
I / O 1
I / O 2
I / O 3
I / O 4
I / O 5
I / O 6
I / O 7
D4
I / O 0
I / O 1
I / O 2
I / O 3
I / O 4 D12
I / O 5
I / O 6
I / O 7
DQM / CS CK0
DQM / CS CK0
DQM / CS CK0
DQM / CS CK0
DQ8
DQ9
DQ10
DQ11
DQ12
DQ13
DQ14
DQ15
CK1
/S3
/S2
DQMB2
I / O 0
I / O 1
I / O 2
I / O 3
I / O 4
I / O 5
I / O 6
I / O 7
D1
I / O 0
I / O 1
I / O 2
I / O 3
I / O 4
I / O 5
I / O 6
I / O 7
D9
DQ40
DQ41
DQ42
DQ43
DQ44
DQ45
DQ46
DQ47
I / O 0
I / O 1
I / O 2
I / O 3
I / O 4
I / O 5
I / O 6
I / O 7
D5
I / O 0
I / O 1
I / O 2
I / O 3
I / O 4
I / O 5
I / O 6
I / O 7
D13
DQMB6
DQM / CS CK0
DQM / CS CK0
DQM / CS CK0
DQM / CS CK0
DQ16
DQ17
DQ18
DQ19
DQ20
DQ21
DQ22
DQ23
DQMB3
I / O 0
I / O 1
I / O 2
I / O 3
I / O 4
I / O 5
I / O 6
I / O 7
D2
I / O 0
I / O 1
I / O 2
I / O 3
I / O 4
I / O 5
I / O 6
I / O 7
D10
DQ48
DQ49
DQ50
DQ51
DQ52
DQ53
DQ54
DQ55
DQMB7
I / O 0
I / O 1
I / O 2
I / O 3
I / O 4
I / O 5
I / O 6
I / O 7
D6
I / O 0
I / O 1
I / O 2
I / O 3
I / O 4 D14
I / O 5
I / O 6
I / O 7
DQM / CS CK0
DQM / CS CK0
DQM / CS CK0
DQM / CS CK0
DQ24
DQ25
DQ26
DQ27
DQ28
DQ29
DQ30
DQ31
CKE
/ RAS
/ CAS
/ WE
BA ， A<10 ： 0>
VCC
VSS
I / O 0
I / O 1
I / O 2
I / O 3
I / O 4
I / O 5
I / O 6
I / O 7
D3
I / O 0
I / O 1
I / O 2
I / O 3
I / O 4 D11
I / O 5
I / O 6
I / O 7
DQ56
DQ57
DQ58
DQ59
DQ60
DQ61
DQ62
DQ63
I / O 0
I / O 1
I / O 2
I / O 3
I / O 4
I / O 5
I / O 6
I / O 7
D7
I / O 0
I / O 1
I / O 2
I / O 3
I / O 4
I / O 5
I / O 6
I / O 7
D15
D0 - D15
D0 - D15
D0 - D15
D0 - D15
D0 - D15
D0 - D15
D0 - D15
串行PD
SCL
A0
A1
A2
SA0 SA1 SA2
SDA
MIT-DS-0044-0.3
三菱
电
( 4 / 45 )
Oct.17.1996
初步规格。
有些内容如有变更，恕不另行通知。
三菱的LSI
MH4S64CZTJ/CWZTJ-12,-15,-1539
268435456 - BIT （ 4194304 - WORD 64位） SynchronousDRAM
引脚功能
CK
（ CK0 & CK1 ）
输入
主时钟：所有其他输入参考上升
CK边缘
时钟使能： CKE控制内部clock.When CKE是
对于下一个周期的低，内部时钟就停止。 CKE是
也可用于选择自动/自刷新。自刷新后，
模式启动， CKE ê变成异步input.Self
只要CKE是低刷新保持。
芯片选择：当/ S为高电平时，任何命令方式
无操作。
的RAS /组合， / CAS ， /我们定义了基本的命令。
A0-10与指定相结合的行/列地址
BA.The行地址由A0-10.The指定栏
地址是由A0-8.A10指定也可用于指示
预充电option.When A10的高，在一个读/写
命令，自动预充电被执行。当A10是
在高预充电命令，两家银行预充电。
银行地址： BA不是简单BA.BA指定银行
到一个命令applied.BA必须与设置
ACT ，预读，写命令
CKE
输入
/S
(/S0 ~ /S3)
/ RAS ， / CAS ， / WE
输入
输入
A0-10
输入
BA
输入
DQ0-63
数据在与数据输出被引用到的上升沿
输入/输出CK
嚣面膜/输出禁止：当DQMB是高爆
write.Din当前周期masked.When DQMB是高
在突发读取， Dout为下一个，但一个周期禁用。
DQMB0-7
输入
VDD，VSS
SLA
SDA
SA0-3
供电电源的安装内存模块。
输入
产量
输入
串行时钟，串行PD
串行数据串行PD
地址输入串行PD
MIT-DS-0044-0.3
三菱
电
( 5 / 45 )
Oct.17.1996
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