MCF5271集成
微处理器
硬件特定网络阳离子
按：微控制器解决方案
在MCF5271系列是一款高集成度
实现了ColdFire的
家庭减少
指令集计算（RISC ）微处理器。这
文件描述了有关的特征和功能
在MCF5271家庭。在MCF5271系列包括
MCF5271和MCF5270微处理器。该
这些部件之间的差别将在下面总结
表1中。
这份文件是从的角度来写的
的MCF5271和除非另外说明，否则
信息也适用于MCF5270 。
在MCF5271系列结合使用成本低高
整合上流行的版本2的ColdFire内核
超过144 （ Dhrystone的2.1 ） MIPS在150兆赫。定位
对于需要成本敏感的32位应用程序
解决方案， MCF5271系列具有一个10/100以太网
MAC和可选的硬件加密，以确保
应用程序可以被连接和保护。此外，
在MCF5271系列采用了增强型乘法
累加单元（ EMAC ） ，大容量片上存储器（ 64
2Kb的SRAM ， 8 KB的可配置的高速缓存） ，和
32位SDR SDRAM内存控制器。
目录
1
2
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8
9
MCF5271系列配置。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 2
框图。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 2
特色： 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 4
信号说明。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 4
设计建议。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 8
机械性能/引脚和部件号。 。 。 。 。 。 。 。 。 。 。 。 12
电气特性。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 17
文档。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 39
文档修订历史记录。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 39
飞思卡尔半导体公司2009年版权所有。
由于从美国国际贸易委员会的命令， BGA封装生产线和部分数字在这里表示目前不提供
飞思卡尔在美国进口或销售前的2010年9月： MCF527x产品在196 MAPBGA包
飞思卡尔半导体公司
数据表：技术数据
文档编号： MCF5271EC
第4版， 08/2009
MCF5271系列配置
1
MCF5271系列配置
表1. MCF5271系列配置
模块
的ColdFire V2内核与EMAC和
硬件除法器
系统时钟
性能（ Dhrystone的/ 2.1 MIPS ）
指令/数据缓存
静态RAM（SRAM ）
中断控制器（ INTC ）
边缘端口模块（ EPORT ）
外部接口模块（ EIM ）
4通道直接存储器存取（ DMA ）
SDRAM控制器
快速以太网控制器（ FEC ）
硬件加密
看门狗定时器（ WDT ）
四周期中断定时器（ PIT ）
32位DMA定时器
QSPI
的UART （多个）
I
2
C
通用I / O模块（ GPIO ）
JTAG - IEEE 1149.1测试访问端口
包
2
x
x
x
x
x
—
x
x
4
x
3
x
x
x
MCF5270
x
MCF5271
x
150兆赫
144
8字节
64字节
2
x
x
x
x
x
x
x
x
4
x
3
x
x
x
160 QFP ，
160 QFP ，
196 MAPBGA 196 MAPBGA
2
框图
在MCF5271系列中的扩展集器件采用196模具阵列塑料球栅阵列（ MAPBGA ）
封装。
图1
示出了MCF5271的顶层框图。
MCF5271集成的微处理器硬件规范，第4版
2
飞思卡尔半导体公司
由于从美国国际贸易委员会的命令， BGA封装生产线和部分数字在这里表示目前不提供
飞思卡尔在美国进口或销售前的2010年9月： MCF527x产品在196 MAPBGA包
框图
由于从美国国际贸易委员会的命令， BGA封装生产线和部分数字在这里表示目前不提供
飞思卡尔在美国进口或销售前的2010年9月： MCF527x产品在196 MAPBGA包
SDRAMC
QSPI
EIM
（到/从SRAM后门）
芯片
SELECTS
I2C_SDA
I2C_SCL
UnTXD
UnRXD
UnRTS
EBI
ARBITER
INTC0
INTC1
PADI - 复用管脚
联合国国家工作队
DTnOUT
DTnIN
FEC
（到/从PADI ）
快
ETHERNET
调节器
（ FEC）的
UART
0
UART
1
UART
2
I
2
C
QSPI
SDRAMC
D[31:0]
（到/从PADI ）
（到/从
PADI ）
4路DMA
DTIM
0
DTIM
1
DTIM
2
DTIM
3
A[23:0]
读/写
CS [3：0 ]
TA
DREQ [2：0 ] DACK [2 ：0]的
MUX
TSIZ [1 ：0]的
BDM
JTAG_EN
的ColdFire V2 CPU
DIV
EMAC
茶
BS [3：0 ]
JTAG
龙头
64字节
SRAM
(8Kx16)x4
8字节
缓存
(1Kx32)x2
端口
（ GPIO ）
CIM
看门狗
定时器
（到/从仲裁者）
SKHA
PLL
CLKGEN
（到/从INTC）
PIT0
PIT1
PIT2
PIT3
RNGA
MDHA
密码学
模块
EDGE
PORT
图1. MCF5271框图
MCF5271集成的微处理器硬件规范，第4版
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3
特点
3
4
特点
信号说明
有关详细的功能列表，请参阅MCF5271参考手册（ MCF5271RM ）的。
本节描述了连接芯片外的信号，包括信号特性的一个表。为更
在MCF5271信号的详细讨论，请参考
MCF5271参考手册
(MCF5271RM).
4.1
信号属性
表4
列出了按功能分组的信号。在“目录”列是方向的主
功能的引脚。请参阅
第6条， “上机/插脚引线和部件号， ”
对于包图。
记
在此表中，并在本文档中的一组单个的信号是
无指定方括号（即A24 ），而命名为
在一组括号内使用多个信号（即A [ 23:21 ] ） ，其目的是
包括两个方括号内的数字时，这些数字范围内的所有信号
以冒号隔开。
记
销的主要功能不一定是其缺省功能。
这是与多路复用GPIO引脚默认为它们的GPIO功能。
表2. MCF5270和MCF5271信号信息和木星
信号名称
GPIO
备用1备用2目录。
1
MCF5270
MCF5271
160 QFP
MCF5270
MCF5271
196 MAPBGA
RESET
RESET
RSTOUT
—
—
—
—
—
—
时钟
EXTAL
XTAL
CLKOUT
—
—
—
—
—
—
—
—
—
模式选择
CLKMOD [1 ：0]的
RCON
—
—
—
—
—
—
I
I
20,21
79
G5,H5
K10
I
O
O
86
85
89
M14
N14
K14
I
O
83
82
N13
P13
外部存储器接口和端口
A[23:21]
PADDR [7：5 ]
CS [6：4 ]
—
O
126, 125, 124
B11 ，C11， D11
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4
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信号说明
表2. MCF5270和MCF5271信号信息和木星（续）
信号名称
A[20:0]
GPIO
—
备用1备用2
—
—
迪尔。
1
O
MCF5270
MCF5271
160 QFP
MCF5270
MCF5271
196 MAPBGA
123:115,
A12 ，B12 ，C12，
112： 106 ， 102： 98 A13 ，B13 ， B14 ，
C13 ，C14， D12，
D13 ，D14， E11，
E12, E13, E14,
F12, F13, F14,
G11, G12, G13
22:30, 33:39
G1，G2， H1，H2
H3，H4 ， J1，J2，
J3，J4 ， K1，K2
K3，K4 ，L1，L2
M1， N1 ，M2 ，N2
P 2， L 3 ，M 3 ，N 3
P3中， M4， N4 ，P4
L5 ， M5 ， N5 ， P5
B6 ，C6， D7 ，C7
N6
H11
J14
J13
P6
P7
H13
H12
D[31:16]
—
—
—
O
D[15:8]
D[7:0]
BS [3：0 ]
OE
TA
茶
读/写
TSIZ1
TSIZ0
TS
TIP
PDATAH [7 ：0]的
PDATAL [7 ：0]的
PBS [7：4 ]
PBUSCTL7
PBUSCTL6
PBUSCTL5
PBUSCTL4
PBUSCTL3
PBUSCTL2
PBUSCTL1
PBUSCTL0
—
—
CAS号[3：0 ]
—
—
DREQ1
—
DACK1
DACK0
DACK2
DREQ0
—
—
—
—
—
—
—
—
—
—
—
芯片选择
O
O
O
O
I
I
O
O
O
O
O
42:49
50:52, 56:60
143:140
62
96
—
95
—
—
97
—
CS [7：4 ]
CS [3：2 ]
CS1
CS0
PCS [7：4 ]
PCS [3：2 ]
PCS1
—
—
SD_CS [1 ：0]的
—
—
—
—
—
—
O
O
O
O
—
132,131
130
129
B9， A10 ，C10，
A11
A9 ， C9
B10
D10
SDRAM控制器
SD_WE
SD_SCAS
SD_SRAS
SD_CKE
PSDRAM5
PSDRAM4
PSDRAM3
PSDRAM2
—
—
—
—
—
—
—
—
—
—
O
O
O
O
O
92
91
90
—
—
K13
K12
K11
E8
L12, L13
SD_CS [1：0 ] PSDRAM [1 ：0]的
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