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数据表
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飞思卡尔半导体公司， 2005年， 2006年， 2007年。保留所有权利。
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3
修订历史
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修订历史
日期
四月，
2004
调整
水平
不适用
初始版本
9.7.3键盘中断使能寄存器 - 修正的位描述
在KBIP7 - KBIP0位。
14.8.8 ESCI预分频器寄存器 - 下PDS2 - PDS0返工笔记
说明清楚。
表22-1 。 MC订单号 - 修正了订单号。
五月，
2004
1.0
图22-1 。设备编号系统 - 重做图来反映
正确的顺序号。
表A - 1 。 MC订单号 - 修正了订单号。
图A - 3 。设备编号系统 - 重做图来反映
正确的顺序号。
B.4订购信息 - 修正了订单号。
图B - 3 。设备编号系统 - 重做图来反映
正确的顺序号。
重新格式化为飞思卡尔发布标准
六月，
2005
2.0
表14-6 。 ESCI LIN控制位 - 更正功能项
14.9.1 ESCI判优器控制寄存器 - 更正位ACLK位描述
14.9.3位时间测量 - 对ACLK位修正的定义
三月
2006
3.0
10.5时钟发生器模块（ CGM ） - 更新说明删除
错误的信息。
增加了部分1.5.15未使用引脚端接
第13章输入/输出（ I / O）端口 - 替换笔记
表14-6 。 ESCI LIN控制位 - 更新功能列。
18.6 TIM1在休息中断 - 为清楚起见，更新了第一段。
19.6 TIM2中断期间中断 - 为清楚起见，更新了第一段。
七月，
2006
4.0
20.2.1.2 TIM在休息中断 - 更新为清楚起见第一段。
图20-10 。正常监控模式的电路和图20-11 。强制监测
模式 - 改变电容值
21.5 5.0伏直流电气特性 - 更新了最小值
低电压抑制，行程上升的电压（ VTRIPR ） 。
21.9.2 CGM组件信息 - 更新反馈偏置值
电阻器
描述
页面
号码
不适用
119
212
329
329
342
342
346
346
始终
211
215
216
122
31
169
213
270
290
302
307
317
322
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修订历史（续）
日期
调整
水平
描述
12.2特点 - 从TIM2通道0到修正定时链路连接
TIM1通道0 。
十月，
2006
5.0
12.9定时器连接 - 从TIM2通道0到修正定时链路连接
TIM1通道0 。
21.5 5.0伏直流电气特性和
21.6 3.3伏直流电气特性 - 更新直流注入电流
特定连接的阳离子。
图2-2 。控制，状态和数据寄存器
- 改变TBMCLKSEL到
TMBCLKSEL为与开发工具命名法兼容
第5章配置寄存器（ CONFIG ）
- 改变COPCLK到
CGMXCLK和TBMCLKSEL到TMBCLKSEL要兼容
开发工具命名
10.6.2停止模式
- 改变COPCLK到CGMXCLK
图14-3 。 ESCI模块框图
- 改变BUS_CLK到BUS
时钟和移除参考4xBUSCLK
四月，
2007
14.4.2发射机
- 改变ESCIBDSRC到SCIBDSRC
6.0
14.9.1 ESCI仲裁器控制寄存器
和
14.9.3位时间测量
—
在为ACLK = 1的定义，代替四分之一与一个半
图17-1 。时基框图， 17.5 TBM中断率，
和
表
17-1 。时基分频器选择
- 改变TBMCLKSEL到TMBCLKSEL
为与开发工具命名法兼容
21.9时钟产生模块（ CGM ）特性
- 更新部分
包括以下内容：
21.9.1 CGM工作条件
21.9.2 CGM组件信息
21.9.3 CGM收购/锁定时间信息
页面
号码
135
147
317
319
37
91
92
93
125
192
194
217
218
260
261
322
322
323
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