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飞思卡尔半导体公司
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MC68LC302/D
MC68LC302
产品简介
低成本集成多协议处理器
飞思卡尔半导体公司...
飞思卡尔
介绍了公知的MC68302集成多协议处理器( IMP)的低成本版本。
它会被称为MC68LC302 ,并扩大家庭的基础上MC68302器件。
一些特征和销相比,已被除去,而其它特征已被增强
原来的MC68302 。简单地说, MC68LC302是一个传统的MC68302用一个新的静态68000芯,一个新的
定时器和低功耗模式,但没有第三个串行通信控制器(SCC) 。它被装在一个低
简介100 TQFP ,需要更少的电路板空间比普通MC68302 ,并使其适用于
在高度受限的应用,如PCMCIA使用。
.
动力
控制
打断
调节器
1常规 -
用途
DMA
通道
3定时器
4芯片选择
PIO
系统控制
的RAM / ROM的
STATIC
M68000
CORE
68000
系统总线
20个地址
8/16数据
1152字节
双端口
内存
4 SDMA
频道
PIT
本文件包含有关正在开发中的产品信息。
飞思卡尔
保留不另行通知,以更改或终止本产品的权利。
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转到: www.freescale.com
飞思卡尔半导体公司
特点
是MC68LC302的特点如下。
粗体
项目显示从MC68302主要区别。
静态68000核心
支持16位或8位M68000家族系统
SIB其中:
- 独立的直接内存访问( IDMA )控制器
- 中断控制器有两种操作模式
- 并行输入/输出( I / O)端口,一些具有中断功能
- 片上1152字节双口RAM
- 三个定时器包括一个看门狗定时器
- 新的周期中断定时器( PIT )
- 四个可编程的片选线与等待状态产生逻辑
- 双口RAM和IMP寄存器的可编程地址映射
- 片上时钟发生器,输出信号
- 片上PLL允许运行带32 kHz或4 MHz的晶体
- 无缝连接EPROM , SRAM,闪存EPROM和EEPROM
- 允许在启动8位模式和运行切换到16位模式
- 系统控制:
系统状态和控制逻辑
禁用逻辑CPU (从模式的工作)
硬件看门狗
新的低功耗(待机)模式与唤醒,从两个引脚或PIT
冻结控制调试(仅适用于PGA封装)
DRAM刷新控制器
CP包括:
- 主控制器( RISC处理器)
两个独立的全双工串行通信控制器( SCCS)
- 支持各种协议:
高级别/同步数据链路控制( HDLC / SDLC )
通用异步收发器( UART )
二进制同步通信( BISYNC )
透明模式
支持自动波特率
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MC68LC302产品信息
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MC68LC302应用
该MC68LC302擅长于多个应用程序的区域。
首先,使用MC68302 ,但是不需要所有这三个串行通道的任何应用程序是一个潜在的候选
该MC68LC302 。但是,请注意,该MC68LC302牺牲大多数提供的外部总线
控制权,从而MC68LC302可能并不合适,其中MC68302作为较大部分
系统。
二, MC68LC302擅长于低功耗和便携式应用。包含一个静态的68000内核,
再加上内置到设备的低功耗模式,使其非常适用于手持设备,或者其他低功耗
应用程序。新的32 kHz或4 MHz的PLL选大大减少了设计者的总功率预算
板,并允许MC68LC302是在低功率系统中的有效设备。该MC68LC302可以再
可选择由董事会其他成员产生一个全频的时钟使用。在低功率模式下,新
周期性中断定时器( PIT )允许器件唤醒定期。此外,两个引脚可以唤醒
该器件从低功耗模式。
第三,考虑到MC68LC302打包在一个100TQFP包,它允许要使用的MC68LC302
在空间有限的应用,以及诸如PCMCIA卡的高度的关键应用程序。
第四,由于禁止CPU的模式(也称为从属模式)仍然保留, MC68LC302可以起到
含有串行通道,定时器,片选等全智能DMA驱动的外围芯片
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THE MC68LC302和MC68302之间的差异
该MC68LC302已经从MC68302一些具体的差异。即使的功能
处理器和外围设备的保持相同,一些灵活性已经因针被移除
从132减少对原MC68302 , 100引脚的MC68LC302 。
以下功能已被删除或从MC68302修改,以使MC68LC302
可能。
SCC3其波特率发生器( BRG3 )将被删除。
外部的主人无法通过正常的总线仲裁要求坐大巴离MC68LC302
tration计划,因为这些引脚不再存在。外部主机仍然可以保持总线控制
通过使用HALT脚的简单方案。使用MC68LC302时,此限制不适用
在CPU禁用模式(从机模式) ,在这种情况下, BR , BG和BGACK一应俱全。
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在SCP引脚现在用多路复用PA8 , PA9 , PA10和。该TXD3 , RXD3和RCLK3功能于联系
ciated与SCC3被淘汰。
在UDS , LDS和R / W引脚不可用,除非在从模式下,他们更换IPL2-0引脚。
相反,新销WEH , WEL ,和OE已被定义为无缝连接到内存。
PA12现多路复用与MODCLK销,其与所述32千赫或4 MHz的锁相环相关联。该MOD-
复位后, CLK引脚进行采样,然后变成PA12 。
新VCCSYN , GNDSYN和XFC管脚,支持片上PLL被添加。
为了进行仿真和开发只支持下,支持特殊的132 PGA版本。这
版本增加了回FC2-0 , IAC , FRZ和AVEC引脚。该FC2-0引脚允许总线周期是distin-
程序和数据的访问兼容,中断周期等。 IAC , FRZ和AVEC引脚
提供这样仿真的厂商可以迅速改装其现有MC68302模拟器的设计来支持
端口MC68LC302 。
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MC68LC302引脚说明
NMSI1 / ISDN I / F
RXD1/L1RXD
TXD1/L1TXD
RCLK1/L1CLK
TCLK1/L1SY0/SDS1
CD1/L1SY1
CTS1/L1GR
RTS1/L1RQ/GCIDCL
地址总线
A1-A19
芯片选择
CS0/IOUT2
CS3-CS1
数据总线
D0-D15
NMSI2 / PAIO
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RXD2/PA0
TXD2/PA1
RCLK2/PA2
TCLK2/PA3
CTS2/PA4
RTS2/PA5
CD2/PA6
BRG2/SDS2/PA7
AS
WEH/A0
WEL / WE
DTACK
OE
总线控制
(UDS/A0)
( LDS / DS )
(R / W)的
系统控制
MC68LC302
信号的
RESET
停止
BUSW
DISCPU
PAIO / SCP
SPRXD/PA8
SPTXD/PA9
SPCLK/PA10
MODCLKPA12
中断控制
定时器/ PBIO
TIN1/PB3
TIN2/PB5
TOUT2/PB6
WDOG/PB7
IPL0 / IRQ1 ( BR )
IPL1 / IRQ6 ( BGACK )
IPL2 / IRQ7 ( BG )
PB8
PB9
PB10
PB11
IQGND(2)
IQVDD(2)
时钟
CLKO
EXTAL
XTAL
XFC
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