2.5 / 3.3V的差分LVPECL 2x2的时钟切换
和扇出缓冲器
飞思卡尔MC100ES6254是一个双极型单片2×2的差分时钟切换和
扇出缓冲器。专为要求最苛刻的时钟分配系统中，
MC100ES6254支持需要大量的输出到各种应用
驱动精确对准的时钟信号。该器件能够驱动和开关
差分LVPECL信号。采用SiGe技术和全差分架构，
器件提供卓越的数字信号的特性和非常低的时钟偏移误差。目标
此时钟驱动器应用的高性能时钟/数据开关，时钟
在计算，网络和电信系统分布或数据环回。
特点
全差分结构，从输入到输出的全部
SiGe技术支持接近零的输出偏移
支持DC至3 GHz的操作
(1)
时钟或数据信号的
兼容LVPECL差分时钟输入和输出
LVCMOS兼容控制输入
单一3.3 V或2.5 V电源
50 ps的最大设备倾斜
(1)
同步输出使能消除输出欠幅脉冲产生与亚稳态
标准的32引脚LQFP封装
工业温度范围
32引脚无铅封装
MC100ES6254
2.5 / 3.3 V差分
LVPECL 2×2
时钟切换
和扇出缓冲器
FA后缀
32引脚LQFP封装
CASE 873A -04
功能说明
MC100ES6254是专为非常重要的偏斜差分时钟分配系统
并且支持从DC的时钟频率高达3.0 GHz的。典型应用
MC100ES6254是主时钟分配，交换和高回送系统
的高性能计算机，网络和通信系统，以及车载
超频OC -3 ， OC -12和OC- 48高速通信系统。的主要目的
该MC100ES6254是高速时钟切换应用程序。此外，该
MC100ES6254可配置为单1:6或双1：3 LVPECL扇出时钟缓冲器
的信号，或作为在高速数据应用回送设备。
该MC100ES6254可以从3.3 V或2.5 V正电源供电无
一个负电源线的要求。
AC后缀
32引脚LQFP封装
无铅封装
CASE 873A -04
订购信息
设备
MC100ES6254FA
MC100ES6254FAR2
MC100ES6254AC
MC100ES6254ACR2
包
LQFP-32
LQFP-32
LQFP -32 （无铅）
LQFP -32 （无铅）
1.该设备的功能达到3 GHz和特征值最高达2.7 GHz的。
IDT / ICS
2.5V / 3.3V LVPECL时钟切换和扇出缓冲器
1
MC100ES6254 REV 。 6 2007年10月18日
MC100ES6254
2.5 / 3.3V的差分LVPECL 2x2的时钟切换和扇出缓冲器
飞思卡尔半导体，
MC100ES6254/D
公司
网通
V
CC
银行
CLK0
CLK0
0
1
QA0
QA0
QA1
QA1
QA2
QA2
V
CC
CLK1
CLK1
B组
0
1
飞思卡尔半导体公司...
SEL0
SEL1
QB0
QB0
QB1
QB1
QB2
QB2
OEA
OEB
SYNC
图1. MC100ES6254逻辑图
CLK0
CLK0
SEL0
GND
GND
18
VCC
24
23
22
21
20
19
17
16
15
14
13
QB2
QB2
VCC
QB1
QB1
VCC
QB0
QB0
QA2
QA2
VCC
QA1
QA1
VCC
QA0
QA0
25
26
27
28
MC100ES6254
29
30
31
32
1
2
3
4
5
6
7
8
12
11
10
9
OEB
GND
SEL1
CLK1
图2. 32引脚封装引脚
（ TOP VIEW ）
IDT
2.5 / 3.3V的差分LVPECL 2x2的时钟切换和扇出缓冲器
飞思卡尔时序解决方案组织已经收购了集成设备技术公司
2
2
CLK1
GND
VCC
VCC
VCC
OEA
MC100ES6254
时序解决方案
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MC100ES6254
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公司
网通
MC100ES6254/D
表1.引脚配置
针
CLK0,
CLK0
CLK1,
CLK1
OEA ， OEB
I / O
输入
输入
输入
输入
产量
供应
供应
TYPE
LVPECL
LVPECL
LVCMOS
LVCMOS
LVPECL
GND
VCC
差分参考时钟信号输入0
差分参考时钟信号输入端1
OUTPUT ENABLE
时钟切换选择
差分时钟输出（ A组和B ）
负电源
功能
SEL0 ， SEL1
QA[0-2],
QA[0-2]
QB[0-2],
QB[0-2]
GND
V
CC
正电源。所有V
CC
引脚必须连接到正确的电源正极
直流和交流操作
飞思卡尔半导体公司...
表2.功能表
控制
OEA
默认
0
0
1
QA[0-2],
Qx[0-2]
是活动的。中的无效
OE
可以是QA [0-2 ] = L时，
QA[0-2]
= H （输出禁用） 。断言
异步而不产生的参考时钟
OE
可以是异步的，以基准时钟
输出欠幅脉冲
不产生输出欠幅脉冲
QA[0-2],
Qx[0-2]
是活动的。中的无效
OE
可以是QA [0-2 ] = L时，
QA[0-2]
= H （输出禁用） 。断言
异步而不产生的参考时钟
OE
可以是异步的，以基准时钟
输出欠幅脉冲
不产生输出欠幅脉冲
参考表3
OEB
0
SEL0 ， SEL1
00
表3.时钟选择控制
SEL0
0
0
1
1
SEL1
0
1
0
1
CLK0排到
QA [0： 2]和QB [0： 2]
---
QA [0： 2]
QB [0： 2]
CLK1排到
---
QA [0： 2]和QB [0： 2]
QB [0： 2]
QA [0： 2]
应用模式
1:6扇出CLK0的
1:6扇出CLK1的
双1 ： 3的缓冲区
双1 ： 3的缓冲区（交叉）
表4.绝对最大额定值
a
符号
V
CC
V
IN
V
OUT
I
IN
I
OUT
T
S
a.
电源电压
直流输入电压
直流输出电压
DC输入电流
直流输出电流
储存温度
-65
特征
民
-0.3
-0.3
-0.3
最大
3.6
V
CC
+0.3
V
CC
+0.3
±20
±50
125
单位
V
V
V
mA
mA
°C
条件
绝对最大额定值连续超出其可能会损坏设备的最大值。暴露于这些条件
或超出指定的条件可能器件的可靠性产生不利影响。在绝对最大额定条件下的功能操作不
暗示。
IDT
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飞思卡尔时序解决方案组织已经收购了集成设备技术公司
3
时序解决方案
MC100ES6254
3
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飞思卡尔半导体，
MC100ES6254/D
公司
网通
表5.一般规格
符号
V
TT
MM
HBM
清洁发展机制
LU
C
IN
θ
JA
热阻结到环境
JESD 51-3 ，单层测试板
特征
输出端接电压
ESD保护（机器型号）
ESD保护（人体模型）
ESD保护（带电器件模型）
闭锁抗扰度
200
2000
1500
200
4.0
83.1
73.3
68.9
63.8
57.4
59.0
54.4
52.5
50.4
47.8
23.0
86.0
75.4
70.9
65.3
59.6
60.6
55.7
53.8
51.5
48.8
26.3
110
T
A
=-40
T
J
=+110
民
典型值
V
CC
- 2
a
最大
单位
V
V
V
V
mA
pF
° C / W
° C / W
° C / W
° C / W
° C / W
° C / W
° C / W
° C / W
° C / W
° C / W
° C / W
°C
°C
输入
自然对流
100英尺/分
200英尺/分钟
400英尺/分钟
800英尺/分钟
自然对流
100英尺/分
200英尺/分钟
400英尺/分钟
800英尺/分钟
MIL- SPEC 883E
方法1012.1
条件
飞思卡尔半导体公司...
JESD 51-6 ， 2S2P多层电路板测试
θ
JC
热阻结到外壳
工作结温
（连续工作）
MTBF = 9.1年
b
T
FUNC
a.
b.
实用温度范围
输出端接电压V
TT
= 0 V的V
CC
=支持2.5V的工作电压，但该装置的功率消耗也会增加。
工作结温影响设备的续航时间。最大连续工作结温应根据被选中
在应用程序的生命时间要求（见应用笔记AN1545和更多信息本数据手册应用部分） 。该
装置的AC和DC参数被指定到110 ℃的结温，允许在需要的应用程序所使用的MC100ES6254
工业级温度范围。它建议MC100ES6254的用户使用热建模分析，以协助应用
结温度规范其特定的应用。
表6.直流特性
(V
CC
= 3.3 V
±
5％或2.5伏
±
5%, T
J
= 0 °+ 110 ℃）的
符号
特征
民
典型值
最大
单位
条件
LVCMOS控制输入（
OEA
,
OEB
， SEL0 ， SEL1 ）
V
IL
V
IH
I
IN
V
PP
V
CMR
V
OH
V
OL
输入电压低
输入电压高
输入电流A
2.0
±100
0.8
V
V
A
V
IN
=V
CC
或V
IN
= GND
微分运算
微分运算
I
OH
= -30毫安
d
I
OL
= -5毫安
e
LVPECL时钟输入（ CLK0 ，
CLK0
， CLK1 ，
CLK1
)
AC差分输入voltageb
差分交叉点voltagec
0.1
1.0
1.3
V
CC
-0.3
V
CC
-1.005
V
CC
-1.705
V
CC
-1.705
52
V
CC
-0.7
V
CC
-1.5
V
CC
-1.3
85
V
V
LVPECL时钟输出（ QA0-2 ，
QA0-2
， QB0-2 ，
QB0-2
)
输出高电压
输出低电压
V
CC
=3.3 V
±5%
V
CC
=2.5 V
±5%
V
CC
-1.2
V
CC
-1.9
V
CC
-1.9
V
V
I
GND
a.
b.
c.
d.
最大静态电源电流
无输出电流终止
mA
GND引脚
输入具有内部上拉/下拉电阻影响输入电流。
V
PP
是保持AC性能所需的最小差分输入电压摆幅。
V
CMR
（直流）的差分输入信号的交叉点。当交叉点是V内获得功能性操作
CMR
（ DC ）范围
与输入摆幅在于内伏
PP
（DC）的规范。
等同于终止50
到V
TT
.
CC
OH
TT
负载
OL
-V
TT
)
÷
R
负载
)
。我
CC
计算：我
CC
= （所使用的差分输出对的数量）* （我
OH
+ I
OL
) + I
GND
IDT
2.5 / 3.3V的差分LVPECL 2x2的时钟切换和扇出缓冲器
(V -V )
÷
R
I = （差分输出对所使用的数量）*
+(V
+ I
GND
MC100ES6254
时序解决方案
飞思卡尔时序解决方案组织已经收购了集成设备技术公司
4
4
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飞思卡尔半导体，
公司
网通
MC100ES6254/D
表7. AC特性
(V
CC
= 3.3 V
±
5％或2.5伏
±
5%, T
J
= 0 °+ 110 ℃）的
a
符号
V
PP
V
CMR
V
O（ P-P ）
特征
差分输入voltageb （峰 - 峰）
差分输入电压交叉点
c
民
0.3
1.2
0.45
0.35
0.20
0
360
典型值
最大
1.3
V
CC
-0.3
单位
V
V
V
V
V
条件
差动输出电压（峰 - 峰值）
f
O
< 1.1 GHz的
f
O
<的2.5 GHz
f
O
< 3.0 GHz的
输入频率
传播延迟CLK ， 1 QA []或QB []
输出至输出扭曲
输出至输出偏斜（零件到部件）
输出脉冲skewe
输出占空比
输出周期至周期抖动
输出上升/下降时间
输出禁止时间
输出使能时间
t
REF
< 100兆赫
t
REF
< 800兆赫
RMS （ 1
σ)
0.7
0.55
0.35
3000
d
485
610
50
250
60
f
CLK
t
PD
t
SK （ O）
t
SK （PP）的
兆赫
ps
ps
ps
ps
%
%
ps
ps
ns
ns
DC
FREF
= 50%
DC
FREF
= 50%
SEL0
≠
SEL1
20 ％至80％
T为CLK周期
T为CLK周期
迪FF erential
迪FF erential
迪FF erential
飞思卡尔半导体公司...
t
SK （p）的
DC
O
t
JIT （ CC ）
t
r
, t
f
t
PDLF
t
PLDg
a.
b.
c.
49.4
45.2
50.6
54.8
1
0.05
2.5T + t
PD
3T + t
PD
300
3.5T + t
PD
4T + t
PD
AC特点，适用于50个并行输出端接
到V
TT
.
V
PP
是维持AC特性包括公吨和设备到设备偏斜所需的最小差分输入电压摆幅。
V
CMR
交流（AC）的差分输入信号的交叉点。当交叉点是V内获得正常交流操作
CMR
（ AC）范围
与输入摆幅在于内伏
PP
（ AC）特定连接的阳离子。违反第五
CMR
交流（AC）或V
PP
（AC）的影响，该装置的传播延迟，设备和
零件到部件歪斜。
该MC100ES6254已全面投入使用高达3.0 GHz的特点是高达2.7 GHz的。
输出脉冲歪斜是传播延迟时间的差的绝对值： |吨
PLH
- t
PHL
|.
传播延迟OE无效到差分输出禁用（差分低：真正的输出低电平，互补输出高） 。
传播延迟OE断言输出启用（激活） 。
CLKX
CLKX
d.
e.
f.
g.
50%
OEX
t
PDL
（ OEX到QX []）
t
PLD
（ OEX到QX []）
输出禁用
QX [ ]
QX [ ]
图3. MC100ES6254输出禁用/启用时间
迪FF erential
脉冲发生器
Z = 50
Z
O
= 50
Z
O
= 50
R
T
= 50
V
TT
DUT
MC100ES62
R
T
= 50
V
TT
MC100ES6254
5
图4. MC100ES6254 AC测试参考
IDT
2.5 / 3.3V的差分LVPECL 2x2的时钟切换和扇出缓冲器
飞思卡尔时序解决方案组织已经收购了集成设备技术公司
5
时序解决方案
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QQ：2880707522 复制
