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富士通半导体
数据表
DS04-22114-1E
通信控制
ASSP
IP数据包转发引擎
MB86977
s
描述
的MB86977是LSI ,它使以前被通过软件处理过程,诸如分组
目的地传送和过滤,通过硬件来处理,从而实现全线速双向
定向吞吐量100 Mbps的LAN -WAN 。 IP转发,可同时适用于IPv4和IPv6数据包
全钢丝speed.The 3/4层过滤功能使应用程序的基本安全策略,也使
有可能建立非军事区( DMZ)的服务器直接从WWW访问,而不
软件干预。在总共4的MAC接口的两个用于内部片段(即LAN0 , LAN1) ,
酮作为D.M.Z.口,剩余的作为广域网端口。该D.M.Z.interface可被配置作为一个额外的
内部链段(即, LAN2)如果需要的话。二层交换机可以切换从内部细分的数据包( LAN0 ,
基于MAC地址的LAN1和LAN2 ) 。
此外,实时应用,如流媒体流和VoIP流可以由优先
优先级控制功能。该MB86977提供了通过网络提供了优异的性能的理想解决方案
家电如宽带路由器。
s
特点
1.内置高性能的IP转发引擎“富士通/ FLS快速转发( FEF ) ”
发动机
IP报文转发
路由操作,如以太网MAC地址替换, TTL减少和校验代做
硬件
同时支持IPv4和IPv6
支持PPPoE隧道和IPv6在IPv4隧道的广域网接口
(续)
s
208引脚塑料LQFP
(FPT-208P-M06)
MB86977
(续)
NAT ( NAPT )
NAT操作,如IP地址的更换,传输层端口号替换和校验
代硬件完成
支持PPPoE隧道和IPv6在IPv4隧道的广域网接口
支持IPv4只。
3/4层过滤
基于IP地址过滤(DST和/或Src的,同时支持IPv4 / IPv6双)
基于TCP / UDP端口号过滤(支持TCP和ACK标志)
基于IP地址和TCP端口号的IPv4和IPv6的TCP连接的组合筛选。
基于ICMP类型过滤
基于协议类型过滤(以太网类型字段)
支持PPPoE发现阶段/会话阶段筛选
支持AH (认证头)类型的VPN数据包过滤通过3/4层信息
支持ESP (封装安全载荷),通过IP地址输入VPN报文过滤功能
过滤可独立按每个端口应用(LAN , DMZ , WAN)
支持最大64X2 (入站和出站)过滤表项
支持过滤日志
数据包优先排序功能
优先级基于IPv4地址和UDP端口号的组合
优先级基于IPv4的地址和ToS字段的组合
优先级基于IPv4的地址, ToS字段和UDP端口号的组合
优先级基于IPv6地址,交通类和流标签的组合
支持QoS映射ToS字段
注: FEF仅支持DIX型以太网帧,并且不支持IEEE802.1 LLC类型的帧,并
IEEE802.1Q VLAN标记的帧(这些帧,接收时,将被发送到主机) 。
实现100 Mbps的全线速双向吞吐量在50 MHz工作频率。
2.第2层( MAC)功能
四位一体的IEEE802.3标准的10 / 100BaseT / TX端口, MAC
端口可选RMII / MII接口(同时支持全双工和半双工)
SMI接口的PHY设备的配置
支持自动协商
支持IEEE802.3x流量控制
支持背压式半双工模式
集成的SRAM用于数据包缓冲( PRAM )
存储 - 转发交换方式
MAC地址表高达50项
MAC地址自动学习和老化
3.主机接口
32位宽SRAM主机接口
大尾端/ LittleEndian配置
4.其他特点
208引脚塑料LQFP封装
2
MB86977
s
引脚分配
PIN号
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
25
26
27
28
29
30
31
32
33
34
35
引脚名称
的tDOUT
SDO1
SDO2
SDO3
SDO4
SDO5
SDO6
Int_
VDDE
VSS
VDDI
VDDE
VSS
VDDI
DQ0
DQ1
DQ2
DQ3
DQ4
DQ5
DQ6
DQ7
DQ8
DQ9
DQ10
VDDE
VSS
VDDI
DQ11
DQ12
DQ13
DQ14
DQ15
DQ16
DQ17
PIN号
36
37
38
39
40
41
42
43
44
45
46
47
48
49
50
51
52
53
54
55
56
57
58
59
60
61
62
63
64
65
66
67
68
69
70
引脚名称
DQ18
DQ19
DQ20
VDDE
VSS
VDDI
DQ21
DQ22
DQ23
DQ24
DQ25
DQ26
DQ27
DQ28
DQ29
DQ30
DQ31
VDDE
VSS
VDDI
VDDE
VSS
VDDI
TX_EN_0
TXD_0 [0]
TXD_0 [1]
TXD_0 [2]
TXD_0 [3]
VDDE
VSS
VDDI
VDDE
VSS
VDDI
CRS_DV_0
PIN号
71
72
73
74
75
76
77
78
79
80
81
82
83
84
85
86
87
88
89
90
91
92
93
94
95
96
97
98
99
100
101
102
103
104
105
引脚名称
COL_0
TX_CLK_0
VSS
RX_DV_0
RXD_0 [0]
RXD_0 [1]
RXD_0 [2]
RXD_0 [3]
RX_ER_0
RX_CLK_0
VDDE
VSS
VDDI
CRS_DV_1
COL_1
TX_CLK_1
VSS
RX_DV_1
RXD_1 [0]
RXD_1 [1]
RXD_1 [2]
RXD_1 [3]
RX_ER_1
RX_CLK_1
VDDE
VSS
VDDI
VDDE
VSS
VDDI
TX_EN_1
TXD_1 [0]
TXD_1 [1]
TXD_1 [2]
TXD_1 [3]
PIN号
106
107
108
109
110
111
112
113
114
115
116
117
118
119
120
121
122
123
124
125
126
127
128
129
130
131
132
133
134
135
136
137
138
139
140
引脚名称
VSS
TX_EN_D
TXD_D [0]
TXD_D [1]
TXD_D [2]
TXD_D [3]
VDDE
VSS
VDDI
VDDE
VSS
VDDI
CRS_DV_D
COL_D
TX_CLK_D
VSS
RX_DV_D
RXD_D [0]
RXD_D [1]
RXD_D [2]
RXD_D [3]
RX_ER_D
RX_CLK_D
VDDE
VSS
VDDI
CRS_DV_W
COL_W
TX_CLK_W
VSS
RX_DV_W
RXD_W [0]
RXD_W [1]
RXD_W [2]
RXD_W [3]
(续)
3
MB86977
(续)
PIN号
141
142
143
144
145
146
147
148
149
150
151
152
153
154
155
156
157
引脚名称
RX_ER_W
RX_CLK_W
VDDE
VSS
VDDI
VDDE
VSS
VDDI
TX_EN_W
TXD_W [0]
TXD_W [1]
TXD_W [2]
TXD_W [3]
VSS
MDCLK
VDDE
VSS
PIN号
158
159
160
161
162
163
164
165
166
167
168
169
170
171
172
173
174
引脚名称
VDDI
VDDE
VSS
VDDI
MDIO
VSS
REF_CLK
VSS
CS_
WE_
RE =
VDDE
VSS
VDDI
SCLK
A2
A3
PIN号
175
176
177
178
179
180
181
182
183
184
185
186
187
188
189
190
191
引脚名称
A4
A5
A6
A7
A8
A9
A10
A11
A12
A13
SRST ±
VDDE
VSS
VDDI
SDI1
SDI2
SDI3
PIN号
192
193
194
195
196
197
198
199
200
201
202
203
204
205
206
207
208
引脚名称
SDI4
SDI5
SDI6
VSS
XTCK
VSS
TRST
TMODE
VPD
TDIN
TCLK
VDDE
VSS
VDDI
VDDE
VSS
VDDI
4
MB86977
s
引脚说明
主机( SRAM)的接口
PIN号
引脚名称
173到184
15至25
29至38
42至52
166
167
168
8
A2到A13
I / O
I
地址总线
地址输入
数据输入/输出
数据输入/输出(32位)
芯片选择
片选输入
写使能
写操作使能信号(低电平有效)
读使能
读操作使能信号(低电平有效)
打断
中断标志(低有效)
功能
DQ0到DQ31
I / O
CS_
WE_
RE =
Int_
I
I
I
O
RMII接口
PIN号
164
150, 151
108, 109
60, 61
102, 103
149
107
59
101
141
127
79
93
137, 138
123, 124
75, 76
89, 90
132
118
70
84
引脚名称
REF_CLK
TXD_W [1 :0]的
TXD_D [1 :0]的
TXD_0 [1 :0]的
TXD_1 [1 :0]的
TX_EN_W
TX_EN_D
TX_EN_0
TX_EN_1
RX_ER_W
RX_ER_D
RX_ER_0
RX_ER_1
RXD_W [1 :0]的
RXD_D [1 :0]的
RXD_0 [1 :0]的
RXD_1 [1 :0]的
CRS_DV_W
CRS_DV_D
CRS_DV_0
CRS_DV_1
I / O
I
功能
参考时钟
基准时钟从PHY设备。
频率为50兆赫为10 Mbps和100 Mbps 。
传输数据
这两个比特的数据通过这个传输到物理层设备
界面。同步于REF_CLK 。
发送使能
高电平信号表示TX数据valid.Synchronous与
REF_CLK 。
接收错误
高电平信号表明一个无效的符号已
在接收packet.This检测输入时将忽略
CRS_DV信号无效。
接收数据
两比特数据从物理层设备,通过该接收
界面。
载波侦听/接收数据有效
PHY器件输入高电平信号时,界面
接收数据。异步断言/取消断言由PHY
设备在载波检测/载波无效。
O
O
I
I
I
注: TX_EN和CRS_DV信号的逻辑,并指出在半双工模式下的碰撞。
5
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操作
    QQ: 点击这里给我发消息 QQ:2880707522 复制 点击这里给我发消息 QQ:2369405325 复制

    电话:0755-82780082
    联系人:杨小姐
    地址:深圳市福田区振兴路156号上步工业区405栋3层

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