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19-2575 ;冯0 ; 10/02
一到四LVCMOS至LVPECL
输出时钟和数据驱动器
概述
在MAX9323低偏移，低抖动时钟和数据DRI-
版本分布的两个单端LVCMOS输入中的一个
四个差分LVPECL输出。一个单一的逻辑CON-
控制信号（ CLK_SEL ）选择输入的信号，以通过分布
UTE的所有输出。该器件工作于3.0V至
3.6V ，从而使该器件非常适用于3.3V系统和
消耗的电源电流仅25毫安（最大值） 。
该MAX9323具有低150ps的一部分，对部分歪斜，低
11ps输出至输出扭曲和低1.7ps RMS抖动，
从而使该器件非常适用于时钟和数据分发
通过背板或电路板。所有输出启用
和禁用同步的时钟输入预
发泄部分输出时钟脉冲。
该MAX9323提供节省空间的20引脚
TSSOP和超小型20引脚4mm
4mm薄型QFN
封装，工作在扩展级（ -40°C至
+ 85 ° C）温度范围。该MAX9323引脚的COM
兼容与集成电路系统公司ICS8535-01 。
o
1.7ps
RMS
增加了随机抖动
o
为150ps （最大）部件到部件歪斜
o
11ps输出至输出偏斜
o
450ps传输延迟
o
引脚兼容于ICS8535-01
o
仅消耗25毫安（最大值）电源电流
（比ICS8535-01少50 ％ ）
o
同步输出使能/禁用
o
两个可选的LVCMOS输入
o
3.0V至3.6V电源电压范围
o
-40 ° C至+ 85 ° C工作温度范围
特点
MAX9323
订购信息
部分
MAX9323EUP
温度范围
-40 ° C至+ 85°C
PIN- PACKAGE
20 TSSOP
应用
精密时钟分配
低抖动数据中继器
数据和时钟驱动器与缓冲器
局端背板时钟分配
DSLAM背板
基站
集线器
MAX9323ETP*
-40 ° C至+ 85°C
20薄型QFN -EP **
*未来
接触产品的工厂。
** EP
=裸露焊盘。
功能框图和典型工作电路在
数据资料的最后。
销刀豆网络gurations
CLK_SEL
CLK_EN
GND
Q0
17
Q0
16
GND 1
CLK0 1
北卡罗来纳州2
CLK1 3
北卡罗来纳州4
北卡罗来纳州5
15 V
CC
14 Q1
CLK_EN 2
CLK_SEL 3
CLK0 4
北卡罗来纳州5
12 Q2
11 Q2
CLK1 6
北卡罗来纳州7
北卡罗来纳州8
6
北卡罗来纳州
7
V
CC
8
Q3
9
Q3
10
V
CC
北卡罗来纳州9
V
CC
10
12 Q3
11 Q3
20 Q0
19 Q0
18 V
CC
17 Q1
顶视图
20
19
18
MAX9323
**裸焊盘
13 Q1
MAX9323
16 Q1
15 Q2
14 Q2
13 V
CC
薄型QFN -EP ** （采用4mm x 4mm ）
** CONNECT裸露焊盘接地。
TSSOP
________________________________________________________________
Maxim Integrated Products版权所有
1
对于定价，交付和订购信息，请联系美信/达拉斯直接！在
1-888-629-4642 ，或访问Maxim的网站www.maxim-ic.com 。
一到四LVCMOS至LVPECL
输出时钟和数据驱动器
MAX9323
绝对最大额定值
V
CC
到GND ................................................ ...........- 0.3V至+ 4.0V
Q_,
Q_,
CLK_ ， CLK_SEL ，
CLK_EN到GND .....................................- 0.3V至（V
CC
+ 0.3V)
连续输出电流............................................... ..50mA
浪涌输出电流............................................... ......... 100毫安
连续功率耗散（T
A
= +70°C)
20引脚TSSOP （减免11mW的/ ° C） .............................. 879.1mW
20引脚4mm
4mm薄型QFN （减免16.9mW / ° C） ... 1349.1mW
结到环境在静止空气热阻
20引脚TSSOP .............................................. .............. + 91 ° C / W
20引脚4mm
4mm薄型QFN ................................. + 59.3 ° C / W
结到外壳热阻
20引脚TSSOP .............................................. .............. + 20 ° C / W
20引脚4mm
4mm薄型QFN ...................................... + 2 ° C / W
工作温度范围...........................- 40 ° C至+ 85°C
结温................................................ ...... + 150°C
存储温度范围.............................- 65 ° C至+ 150°C
焊接温度（ 10秒） ........................................... + 300 ℃，
超出“绝对最大额定值”，强调可能会造成永久性损坏设备。这些仅仅是极限参数和功能
该设备在这些或超出了规范的业务部门所标明的任何其他条件，操作不暗示。接触
绝对最大额定值条件下工作会影响器件的可靠性。
DC电气特性
(V
CC
= 3.0V至3.6V ，输出端接50Ω± 1％ （V
CC
- 2V ） ， CLK_SEL = V
CC
或GND ， CLK_EN = V
CC
, T
A
= -40 ° C至+ 85°C ，
除非另有说明。典型值是在V
CC
= 3.3V ，T
A
= + 25°C 。 ）（注1 ，2，和3）
参数
符号
条件
CLK0 ， CLK1
CLK_EN ， CLK_SEL
CLK0 ， CLK1
CLK_EN ， CLK_SEL
民
2
2
0
0
-5
-5
-150
4
V
CC
-
1.4
V
CC
-
2.0
0.6
V
CC
-
1.0
V
CC
-
1.7
0.85
25
典型值
最大
V
CC
V
CC
1.3
0.8
150
+5
+5
单位
输入（ CLK0 ， CLK1 ， CLK_SEL ， CLK_EN ）
输入高电压
输入低电压
输入高电流
输入低电平电流
输入电容
输出（ Q_ ，
Q_)
单端输出高电平
电压
单端输出低电平
电压
差分输出电压
供应
电源电流（注5 ）
I
CC
mA
V
OH
V
OL
V
OD
图1
图1
图1中，V
OD
= V
OH
- V
OL
V
V
V
V
IH
V
IL
I
IH
I
IL
C
IN
图1
图1
V
V
A
A
pF
CLK0 ， CLK1 ， CLK_SEL = V
CC
CLK_EN = V
CC
CLK0 ， CLK1 ， CLK_SEL = GND
CLK_EN = GND
CLK0 ， CLK1 ， CLK_SEL ， CLK_EN （注4 ）
2
_______________________________________________________________________________________
一到四LVCMOS至LVPECL
输出时钟和数据驱动器
AC电气特性
(V
CC
= 3.0V至3.6V ，输出端接50Ω± 1％ （V
CC
-2V ），F
IN
＆ LT ; 266MHz的输入占空比= 50 ％ ，输入转换时间=
1.1ns （20 ％至80％ ），V
IH
= V
CC
, V
IL
= GND ， CLK_SEL = V
CC
或GND ， CLK_EN = V
CC
, T
A
= -40° C到+ 85 ℃，除非另有说明。
典型值是在V
CC
= 3.3V ，T
A
= + 25°C 。 ） （注4 ）
参数
开关频率
传播延迟
输出至输出扭曲
部分到部分斜
输出上升时间
输出下降时间
输出占空比
增加了随机抖动
附加抖动（注9 ）
符号
f
最大
t
PHL
, t
PLH
t
SKOO
t
SKPP
t
R
t
F
ODC
t
RJ
t
AJ
f
IN
= 266MHz的时钟模式（注9 ）
V
CC
= 3.3V与25mV的叠加
正弦噪声在100kHz
条件
V
OH
- V
OL
≥
0.6V
V
OH
- V
OL
≥
0.3V
CLK0或CLK1至Q_ ，
Q_,
图1 （注6）
（注7 ）
（注8）
20 ％至80％ ，图1
80 ％至20％ ，图1
100
100
48
203
198
50
1.7
民
266
1500
100
450
600
30
150
300
300
52
3
10
典型值
800
最大
单位
兆赫
ps
ps
ps
ps
ps
%
ps
（ RMS）
ps
(P-P)
MAX9323
注1 ：
注2 ：
注3 ：
注4 ：
注5 ：
注6 ：
注7 ：
注8 ：
测量是与装置中的热平衡。
正电流流入引脚。负电流流出的插头的。
在T DC参数进行生产测试
A
= + 25 ° C和设计在整个工作温度范围内保证。
通过设计和特性保证。限制设置为± 6西格玛。
所有引脚打开，除了V
CC
和GND 。
测从输入到差动输出信号的交叉点的50％点。
测得的同边沿转换的差分信号交叉点的相同部分的输出之间。
测得的不同部分的输出端之间，在相同的条件下的差分信号交叉点的相同边缘
过渡。
注9 ：
抖动添加到输入信号。
_______________________________________________________________________________________
3
一到四LVCMOS至LVPECL
输出时钟和数据驱动器
MAX9323
典型工作特性
(V
CC
= 3.3V ，输出端接至（V
CC
- 2V ）通过50Ω ， CLK_SEL = V
CC
或GND ， CLK_EN = V
CC
, T
A
= +25°C.)
输出幅度（V
OH
- V
OL
)
与频率的关系
MAX9323 TOC01
电源电流与温度的关系
14.0
13.5
电源电流（mA ）
13.0
12.5
12.0
11.5
11.0
10.5
10.0
-40
-15
10
35
60
85
温度（℃）
800
700
输出幅度（MV ）
600
500
400
300
200
100
0
0
200 400 600 800 1000 1200 1400 1600
频率（MHz）
输出上升/下降时间
与温度的关系
MAX9323 toc03
传播延迟
与温度的关系
490
传播延迟（ PS ）
480
470
460
450
440
430
420
410
400
t
PHL
t
PLH
MAX9323 toc04
230
220
输出上升/下降时间（ PS ）
210
200
190
180
170
160
150
140
-40
-15
10
35
60
t
F
t
R
500
85
-40
-15
10
35
60
85
温度（℃）
温度（℃）
4
_______________________________________________________________________________________
MAX9323 toc02
一到四LVCMOS至LVPECL
输出时钟和数据驱动器
引脚说明
针
TSSOP
1
QFN
18
名字
GND
功能
地面上。提供一个低阻抗连接到地平面。
同步输出使能。 CLK_EN连接到V
CC
或者浮启用
差分输出。 CLK_EN连接至GND禁用差分输出。当
残疾人， Q_断言低，
Q_
置为高电平。内部51kΩ电阻上拉至V
CC
允许
要左CLK_EN浮动。
时钟选择输入。连接CLK_SEL到V
CC
选择CLK1输入。连接CLK_SEL到
GND或悬空选择CLK0输入。只有选定CLK_信号被再现
在每个输出。内部51kΩ下拉电阻到GND允许CLK_SEL被悬空。
LVCMOS时钟输入。当CLK_SEL = GND ，每一组输出差分再现
CLK0 。内部51kΩ下拉电阻到GND强制输出（ Q_ ，
Q_)
差分低
当CLK0被悬空或接地， CLK_SEL = GND和输出使能。
无连接。没有内部连接。
LVCMOS时钟输入。当CLK_SEL = V
CC
中，每个组的输出差分再现
CLK1 。内部51kΩ下拉电阻到GND强制输出（ Q_ ，
Q_)
差分低
当CLK1被悬空或接地， CLK_SEL = V
CC
且输出被使能。
正电源电压。绕道V
CC
到GND三0.01μF和一个0.1μF的陶瓷
电容器。把0.01μF电容尽量靠近每个V
CC
输入按V可能（ 1
CC
输入）。将所有V
CC
输入在一起，旁路至GND 0.1μF的陶瓷电容。
反相差分LVPECL输出。终止
Q3
到（Ⅴ
CC
- 2V ）用50Ω± 1 ％的电阻。
同相差分LVPECL输出。终止Q3到（V
CC
- 2V ）用50Ω± 1 ％的电阻。
反相差分LVPECL输出。终止
Q2
到（Ⅴ
CC
- 2V ）用50Ω± 1 ％的电阻。
同相差分LVPECL输出。终止Q2为（V
CC
- 2V ）用50Ω± 1 ％的电阻。
反相差分LVPECL输出。终止
Q1
到（Ⅴ
CC
- 2V ）用50Ω± 1 ％的电阻。
同相差分LVPECL输出。终止Q1到（V
CC
- 2V ）用50Ω± 1 ％的电阻。
反相差分LVPECL输出。终止
Q0
到（Ⅴ
CC
- 2V ）用50Ω± 1 ％的电阻。
同相差分LVPECL输出。终止Q0至（Ⅴ
CC
- 2V ）用50Ω± 1 ％的电阻。
MAX9323
2
19
CLK_EN
3
20
CLK_SEL
4
5, 7, 8, 9
6
1
2, 4, 5, 6
3
CLK0
北卡罗来纳州
CLK1
10, 13, 18
11
12
14
15
16
17
19
20
7, 10, 15
8
9
11
12
13
14
16
17
V
CC
Q3
Q3
Q2
Q2
Q1
Q1
Q0
Q0
详细说明
在MAX9323低偏移，低抖动时钟和数据DRI-
版本分布的两个单端LVCMOS输入1
信号四差分LVPECL输出。输入
多路转换器允许选择两个输入中的一个显
良。输出驱动器频率高达操作
的1.5GHz 。在MAX9323采用3.0V至3.6V ，
从而非常适用于3.3V系统。
选择CLK0 。连接CLK_SEL到V
CC
选择CLK1 。
CLK0和CLK1通过内部拉至GND
51kΩ电阻器，当没有连接。
CLK_EN输入
CLK_EN启用/禁用的差分输出
MAX9323 。 CLK_EN连接到V
CC
使存在差
无穷区间输出。在（ Q_ ，
Q_)
输出被驱动到differ-
当CLK_EN = GND无穷区间低的状态。每
差分输出对禁用以下连续利培
荷兰国际集团和CLK_下降沿，后CLK_EN连接
GND 。无论在CLK_的上升沿和下降沿都需要
完成启用/禁用功能（图2 ） 。
数据输入
单端LVCMOS输入
在MAX9323接受两个单端LVCMOS
输入（ CLK0和CLK1 ，图1）。一个内部参考
ENCE （V
CC
/ 2）提供输入thresold电压为
CLK0和CLK1 。 CLK_SEL选择CLK0输入或
CLK1的输入转换为4差分LVPECL
信号（见表1） 。 CLK_SEL连接至GND
CLK_SEL输入
CLK_SEL选择其中单端LVCMOS输入
信号输出差分四LVPECL信号。
CLK_SEL连接至GND ，选择CLK0输入。
5
_______________________________________________________________________________________
19-2575 ;冯0 ; 10/02
一到四LVCMOS至LVPECL
输出时钟和数据驱动器
概述
在MAX9323低偏移，低抖动时钟和数据DRI-
版本分布的两个单端LVCMOS输入中的一个
四个差分LVPECL输出。一个单一的逻辑CON-
控制信号（ CLK_SEL ）选择输入的信号，以通过分布
UTE的所有输出。该器件工作于3.0V至
3.6V ，从而使该器件非常适用于3.3V系统和
消耗的电源电流仅25毫安（最大值） 。
该MAX9323具有低150ps的一部分，对部分歪斜，低
11ps输出至输出扭曲和低1.7ps RMS抖动，
从而使该器件非常适用于时钟和数据分发
通过背板或电路板。所有输出启用
和禁用同步的时钟输入预
发泄部分输出时钟脉冲。
该MAX9323提供节省空间的20引脚
TSSOP和超小型20引脚4mm
4mm薄型QFN
封装，工作在扩展级（ -40°C至
+ 85 ° C）温度范围。该MAX9323引脚的COM
兼容与集成电路系统公司ICS8535-01 。
o
1.7ps
RMS
增加了随机抖动
o
为150ps （最大）部件到部件歪斜
o
11ps输出至输出偏斜
o
450ps传输延迟
o
引脚兼容于ICS8535-01
o
仅消耗25毫安（最大值）电源电流
（比ICS8535-01少50 ％ ）
o
同步输出使能/禁用
o
两个可选的LVCMOS输入
o
3.0V至3.6V电源电压范围
o
-40 ° C至+ 85 ° C工作温度范围
特点
MAX9323
订购信息
部分
MAX9323EUP
温度范围
-40 ° C至+ 85°C
PIN- PACKAGE
20 TSSOP
应用
精密时钟分配
低抖动数据中继器
数据和时钟驱动器与缓冲器
局端背板时钟分配
DSLAM背板
基站
集线器
MAX9323ETP*
-40 ° C至+ 85°C
20薄型QFN -EP **
*未来
接触产品的工厂。
** EP
=裸露焊盘。
功能框图和典型工作电路在
数据资料的最后。
销刀豆网络gurations
CLK_SEL
CLK_EN
GND
Q0
17
Q0
16
GND 1
CLK0 1
北卡罗来纳州2
CLK1 3
北卡罗来纳州4
北卡罗来纳州5
15 V
CC
14 Q1
CLK_EN 2
CLK_SEL 3
CLK0 4
北卡罗来纳州5
12 Q2
11 Q2
CLK1 6
北卡罗来纳州7
北卡罗来纳州8
6
北卡罗来纳州
7
V
CC
8
Q3
9
Q3
10
V
CC
北卡罗来纳州9
V
CC
10
12 Q3
11 Q3
20 Q0
19 Q0
18 V
CC
17 Q1
顶视图
20
19
18
MAX9323
**裸焊盘
13 Q1
MAX9323
16 Q1
15 Q2
14 Q2
13 V
CC
薄型QFN -EP ** （采用4mm x 4mm ）
** CONNECT裸露焊盘接地。
TSSOP
________________________________________________________________
Maxim Integrated Products版权所有
1
对于定价，交付和订购信息，请联系美信/达拉斯直接！在
1-888-629-4642 ，或访问Maxim的网站www.maxim-ic.com 。
一到四LVCMOS至LVPECL
输出时钟和数据驱动器
MAX9323
绝对最大额定值
V
CC
到GND ................................................ ...........- 0.3V至+ 4.0V
Q_,
Q_,
CLK_ ， CLK_SEL ，
CLK_EN到GND .....................................- 0.3V至（V
CC
+ 0.3V)
连续输出电流............................................... ..50mA
浪涌输出电流............................................... ......... 100毫安
连续功率耗散（T
A
= +70°C)
20引脚TSSOP （减免11mW的/ ° C） .............................. 879.1mW
20引脚4mm
4mm薄型QFN （减免16.9mW / ° C） ... 1349.1mW
结到环境在静止空气热阻
20引脚TSSOP .............................................. .............. + 91 ° C / W
20引脚4mm
4mm薄型QFN ................................. + 59.3 ° C / W
结到外壳热阻
20引脚TSSOP .............................................. .............. + 20 ° C / W
20引脚4mm
4mm薄型QFN ...................................... + 2 ° C / W
工作温度范围...........................- 40 ° C至+ 85°C
结温................................................ ...... + 150°C
存储温度范围.............................- 65 ° C至+ 150°C
焊接温度（ 10秒） ........................................... + 300 ℃，
超出“绝对最大额定值”，强调可能会造成永久性损坏设备。这些仅仅是极限参数和功能
该设备在这些或超出了规范的业务部门所标明的任何其他条件，操作不暗示。接触
绝对最大额定值条件下工作会影响器件的可靠性。
DC电气特性
(V
CC
= 3.0V至3.6V ，输出端接50Ω± 1％ （V
CC
- 2V ） ， CLK_SEL = V
CC
或GND ， CLK_EN = V
CC
, T
A
= -40 ° C至+ 85°C ，
除非另有说明。典型值是在V
CC
= 3.3V ，T
A
= + 25°C 。 ）（注1 ，2，和3）
参数
符号
条件
CLK0 ， CLK1
CLK_EN ， CLK_SEL
CLK0 ， CLK1
CLK_EN ， CLK_SEL
民
2
2
0
0
-5
-5
-150
4
V
CC
-
1.4
V
CC
-
2.0
0.6
V
CC
-
1.0
V
CC
-
1.7
0.85
25
典型值
最大
V
CC
V
CC
1.3
0.8
150
+5
+5
单位
输入（ CLK0 ， CLK1 ， CLK_SEL ， CLK_EN ）
输入高电压
输入低电压
输入高电流
输入低电平电流
输入电容
输出（ Q_ ，
Q_)
单端输出高电平
电压
单端输出低电平
电压
差分输出电压
供应
电源电流（注5 ）
I
CC
mA
V
OH
V
OL
V
OD
图1
图1
图1中，V
OD
= V
OH
- V
OL
V
V
V
V
IH
V
IL
I
IH
I
IL
C
IN
图1
图1
V
V
A
A
pF
CLK0 ， CLK1 ， CLK_SEL = V
CC
CLK_EN = V
CC
CLK0 ， CLK1 ， CLK_SEL = GND
CLK_EN = GND
CLK0 ， CLK1 ， CLK_SEL ， CLK_EN （注4 ）
2
_______________________________________________________________________________________
一到四LVCMOS至LVPECL
输出时钟和数据驱动器
AC电气特性
(V
CC
= 3.0V至3.6V ，输出端接50Ω± 1％ （V
CC
-2V ），F
IN
＆ LT ; 266MHz的输入占空比= 50 ％ ，输入转换时间=
1.1ns （20 ％至80％ ），V
IH
= V
CC
, V
IL
= GND ， CLK_SEL = V
CC
或GND ， CLK_EN = V
CC
, T
A
= -40° C到+ 85 ℃，除非另有说明。
典型值是在V
CC
= 3.3V ，T
A
= + 25°C 。 ） （注4 ）
参数
开关频率
传播延迟
输出至输出扭曲
部分到部分斜
输出上升时间
输出下降时间
输出占空比
增加了随机抖动
附加抖动（注9 ）
符号
f
最大
t
PHL
, t
PLH
t
SKOO
t
SKPP
t
R
t
F
ODC
t
RJ
t
AJ
f
IN
= 266MHz的时钟模式（注9 ）
V
CC
= 3.3V与25mV的叠加
正弦噪声在100kHz
条件
V
OH
- V
OL
≥
0.6V
V
OH
- V
OL
≥
0.3V
CLK0或CLK1至Q_ ，
Q_,
图1 （注6）
（注7 ）
（注8）
20 ％至80％ ，图1
80 ％至20％ ，图1
100
100
48
203
198
50
1.7
民
266
1500
100
450
600
30
150
300
300
52
3
10
典型值
800
最大
单位
兆赫
ps
ps
ps
ps
ps
%
ps
（ RMS）
ps
(P-P)
MAX9323
注1 ：
注2 ：
注3 ：
注4 ：
注5 ：
注6 ：
注7 ：
注8 ：
测量是与装置中的热平衡。
正电流流入引脚。负电流流出的插头的。
在T DC参数进行生产测试
A
= + 25 ° C和设计在整个工作温度范围内保证。
通过设计和特性保证。限制设置为± 6西格玛。
所有引脚打开，除了V
CC
和GND 。
测从输入到差动输出信号的交叉点的50％点。
测得的同边沿转换的差分信号交叉点的相同部分的输出之间。
测得的不同部分的输出端之间，在相同的条件下的差分信号交叉点的相同边缘
过渡。
注9 ：
抖动添加到输入信号。
_______________________________________________________________________________________
3
一到四LVCMOS至LVPECL
输出时钟和数据驱动器
MAX9323
典型工作特性
(V
CC
= 3.3V ，输出端接至（V
CC
- 2V ）通过50Ω ， CLK_SEL = V
CC
或GND ， CLK_EN = V
CC
, T
A
= +25°C.)
输出幅度（V
OH
- V
OL
)
与频率的关系
MAX9323 TOC01
电源电流与温度的关系
14.0
13.5
电源电流（mA ）
13.0
12.5
12.0
11.5
11.0
10.5
10.0
-40
-15
10
35
60
85
温度（℃）
800
700
输出幅度（MV ）
600
500
400
300
200
100
0
0
200 400 600 800 1000 1200 1400 1600
频率（MHz）
输出上升/下降时间
与温度的关系
MAX9323 toc03
传播延迟
与温度的关系
490
传播延迟（ PS ）
480
470
460
450
440
430
420
410
400
t
PHL
t
PLH
MAX9323 toc04
230
220
输出上升/下降时间（ PS ）
210
200
190
180
170
160
150
140
-40
-15
10
35
60
t
F
t
R
500
85
-40
-15
10
35
60
85
温度（℃）
温度（℃）
4
_______________________________________________________________________________________
MAX9323 toc02
一到四LVCMOS至LVPECL
输出时钟和数据驱动器
引脚说明
针
TSSOP
1
QFN
18
名字
GND
功能
地面上。提供一个低阻抗连接到地平面。
同步输出使能。 CLK_EN连接到V
CC
或者浮启用
差分输出。 CLK_EN连接至GND禁用差分输出。当
残疾人， Q_断言低，
Q_
置为高电平。内部51kΩ电阻上拉至V
CC
允许
要左CLK_EN浮动。
时钟选择输入。连接CLK_SEL到V
CC
选择CLK1输入。连接CLK_SEL到
GND或悬空选择CLK0输入。只有选定CLK_信号被再现
在每个输出。内部51kΩ下拉电阻到GND允许CLK_SEL被悬空。
LVCMOS时钟输入。当CLK_SEL = GND ，每一组输出差分再现
CLK0 。内部51kΩ下拉电阻到GND强制输出（ Q_ ，
Q_)
差分低
当CLK0被悬空或接地， CLK_SEL = GND和输出使能。
无连接。没有内部连接。
LVCMOS时钟输入。当CLK_SEL = V
CC
中，每个组的输出差分再现
CLK1 。内部51kΩ下拉电阻到GND强制输出（ Q_ ，
Q_)
差分低
当CLK1被悬空或接地， CLK_SEL = V
CC
且输出被使能。
正电源电压。绕道V
CC
到GND三0.01μF和一个0.1μF的陶瓷
电容器。把0.01μF电容尽量靠近每个V
CC
输入按V可能（ 1
CC
输入）。将所有V
CC
输入在一起，旁路至GND 0.1μF的陶瓷电容。
反相差分LVPECL输出。终止
Q3
到（Ⅴ
CC
- 2V ）用50Ω± 1 ％的电阻。
同相差分LVPECL输出。终止Q3到（V
CC
- 2V ）用50Ω± 1 ％的电阻。
反相差分LVPECL输出。终止
Q2
到（Ⅴ
CC
- 2V ）用50Ω± 1 ％的电阻。
同相差分LVPECL输出。终止Q2为（V
CC
- 2V ）用50Ω± 1 ％的电阻。
反相差分LVPECL输出。终止
Q1
到（Ⅴ
CC
- 2V ）用50Ω± 1 ％的电阻。
同相差分LVPECL输出。终止Q1到（V
CC
- 2V ）用50Ω± 1 ％的电阻。
反相差分LVPECL输出。终止
Q0
到（Ⅴ
CC
- 2V ）用50Ω± 1 ％的电阻。
同相差分LVPECL输出。终止Q0至（Ⅴ
CC
- 2V ）用50Ω± 1 ％的电阻。
MAX9323
2
19
CLK_EN
3
20
CLK_SEL
4
5, 7, 8, 9
6
1
2, 4, 5, 6
3
CLK0
北卡罗来纳州
CLK1
10, 13, 18
11
12
14
15
16
17
19
20
7, 10, 15
8
9
11
12
13
14
16
17
V
CC
Q3
Q3
Q2
Q2
Q1
Q1
Q0
Q0
详细说明
在MAX9323低偏移，低抖动时钟和数据DRI-
版本分布的两个单端LVCMOS输入1
信号四差分LVPECL输出。输入
多路转换器允许选择两个输入中的一个显
良。输出驱动器频率高达操作
的1.5GHz 。在MAX9323采用3.0V至3.6V ，
从而非常适用于3.3V系统。
选择CLK0 。连接CLK_SEL到V
CC
选择CLK1 。
CLK0和CLK1通过内部拉至GND
51kΩ电阻器，当没有连接。
CLK_EN输入
CLK_EN启用/禁用的差分输出
MAX9323 。 CLK_EN连接到V
CC
使存在差
无穷区间输出。在（ Q_ ，
Q_)
输出被驱动到differ-
当CLK_EN = GND无穷区间低的状态。每
差分输出对禁用以下连续利培
荷兰国际集团和CLK_下降沿，后CLK_EN连接
GND 。无论在CLK_的上升沿和下降沿都需要
完成启用/禁用功能（图2 ） 。
数据输入
单端LVCMOS输入
在MAX9323接受两个单端LVCMOS
输入（ CLK0和CLK1 ，图1）。一个内部参考
ENCE （V
CC
/ 2）提供输入thresold电压为
CLK0和CLK1 。 CLK_SEL选择CLK0输入或
CLK1的输入转换为4差分LVPECL
信号（见表1） 。 CLK_SEL连接至GND
CLK_SEL输入
CLK_SEL选择其中单端LVCMOS输入
信号输出差分四LVPECL信号。
CLK_SEL连接至GND ，选择CLK0输入。
5
_______________________________________________________________________________________
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