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M68000UMAD/AD
通信和高级
消费科技集团
M68000
增编
M68000
用户手册
1997年8月7日
该增编
M68000UM / AD用户手册
修订8 ，提供更正原文为
以及附加信息。这对这款产品文档和其他信息保持的世界
万维网在http://www.motorola.com/68000 。
概观
本手册包括硬件细节和编程信息的MC68HC000 ， MC68HC001的，
该MC68EC000和MC68SEC000 。为了便于阅读，名称M68000主控板时，将使用
参照所有处理器。请参阅M68000PM / AD ，
M68000程序员参考手册
，详细
在MC68000指令集的信息。
四个微处理器都非常相似，彼此都具有以下特点：
16个32位数据和地址寄存器
16M字节的直接寻址范围
程序计数器
6指令类型
对五种主要的数据类型的操作
内存映射输入/输出（ I / O）
14寻址模式
下面处理器包含额外的功能：
MC68HC001/MC68EC000/MC68SEC000
—
静态可选择的8位或16位数据总线
MC68HC000/MC68EC000/MC68HC001/MC68SEC000
—
低功耗
本文件包含有关正在开发中的产品信息。摩托罗拉保留不另行通知变更或终止本产品的权利。
半导体产品信息
1997年，摩托罗拉， Inc.保留所有权利。
在MC68SEC000嵌入式处理器的主要特性包括：
直接替换MC68EC000
—
—
—
引脚对引脚兼容的MC68EC000在塑料QFP和TQFP封装
为MC68EC000支持种类繁多的现有的第三方开发工具
MC68SEC000
软件为MC68EC000写上运行的MC68SEC000不变
电源管理
—
—
—
—
低功耗HCMOS技术
静态设计使停止的处理器时钟
3.3V或5V操作
典型0.5μA电流消耗在3.3V睡眠模式
软件实力
—
—
完全向上对象的代码与其他M68000系列产品兼容
M68000的体系结构，可以有效地汇编代码用C编译器
升级
—
—
完全向上代码兼容具有更高的性能680X0和68300家庭成员
的ColdFire
代码兼容稍作修改
1. MC68HC000
在MC68HC000的主要优点是减少了电力消耗。该器件消耗更少的功率（由
一个数量级），比NMOS MC68000 。
在MC68HC000是M68000 16 / -32位微处理器体系结构的实现。该
MC68HC000有一个16位的数据总线实现的MC68000 ，并且是向上代码兼容的
MC68010和MC68020 32位实现的体系结构。
1.1 MC68HC001
该MC68HC001提供了一个功能扩展， MC68HC000 HCMOS 16位/ 32位微处理器
添加静态可选择8位或16位数据总线的操作。在MC68HC001是目标代码兼容
与MC68HC000 。你可以不加修改地迁移为MC68HC001编写的代码的任何成员
的M68000家庭。
1.2 MC68EC000
该MC68EC000是一个旨在满足的需求的经济型高性能的嵌入式控制器
成本敏感的嵌入式控制器市场。该HCMOS MC68EC000有一个内部的32位架构，
由静态可选择的8位或16位数据总线的支持。这种结构提供了快速和有效的
可根据高级别满足复杂的应用的要求处理装置
语言。
该MC68EC000是完全面向对象代码与MC68000兼容。您可以迁移的代码编写
MC68EC000不加修饰的M68000家庭的任何成员。
该MC68EC000带来M68000系列的性能水平，以预先与相关的成本水平
8位微处理器。从富M68000指令集MC68EC000利益及其相关的高码
密度与低内存带宽的需求。
2
M68000用户手册附录
摩托罗拉
1.3 MC68SEC000
该MC68SEC000是专为低功耗应用提供具有成本效益的静态嵌入式处理器。在
除了提供MC68EC000的大量的成本和性能优势，在低功耗模式下
该MC68SEC000的提供的功率消耗和功率管理显著优点。该
在MC68SEC000的典型电流消耗仅为0.5
A的静态待机模式， 15.0毫安正常
工作电压为3.3V 。该MC68SEC000工作在3.3V或5.0V系统。在非常低的功耗
消费，小尺寸封装，静态的实施相结合，在MC68SEC000为低
电源应用，如便携式测量设备，电子游戏机，电池供电的手持式
消费产品。
该HCMOS MC68SEC000的静态结构是一个直接替换MC68EC000 ，它提供了
成本最低的入口点到32位处理。内部32位架构提供了快速，高效的
处理中满足基于高级语言的复杂的应用的要求。
所有广泛使用的现有的第三方开发工具的MC68EC000将直接支持
MC68SEC000 。可以发现，这些工具中的详细描述
高性能嵌入式系统
源目录。
摩托罗拉
M68000用户手册附录
3
2.0信号描述
变化图3-3 3-2页。
V
CC
GND
CLK
A23-A0
地址总线
D15-D0
AS
数据总线
处理器
状态
FC0
FC1
FC2
读/写
UDS
LDS
DTACK
MC68SEC000
BR
BG
总线仲裁
控制
异步
总线控制
BERR
系统
控制
RESET
停止
模式
IPL0
IPL1
IPL2
AVEC
打断
控制
图1.输入和输出信号（ MC68EC000和MC68SEC000 ）
2.1数据总线（ D15 - D0 ）
在第3-4页的第3.2节，将“ MC68EC000和MC68HC001使用D7 - D0在8位模式， D15-
D8是不确定的。 “与”使用MC68HC001 ， MC68EC000和MC68SEC000模式引脚，可以
静态地选择8位或16位模式进行数据传输。该MC68EC000 ， MC68SEC000和
MC68HC001使用D7 - D0在8位模式。 D15 - D8是不确定的。 “
2.2总线仲裁控制
在第3-5页的第3.4节，一句“在MC68008和MC68EC000的48引脚版本，无引脚
可用的总线许可的确认信号;该微处理器采用两线总线仲裁
方案。 “应改为”在64引脚MC68EC000和MC68SEC000 ，无引脚可用于总线授权
应答信号。这些微处理器采用两线总线仲裁机制。 “
2.3系统控制
3.6节的第3-7页上的模式小节标题应改为'模式（MODE ） （ MC68HC001 /
68EC000/68SEC000).’’
2.4 MC68SEC000低功耗模式
以下内容添加到第4和第5 ，总线操作。
该MC68SEC000进行了重新设计，以提供充分static-和低功耗操作。本节
描述了所建议的方法用于将MC68SEC000进入低功率模式，以减少
4
M68000用户手册附录
摩托罗拉
功耗的静态值
1
同时保持了处理器的内部状态。该
下面描述的低功率模式将被定期地测试所提供的MC68SEC000测试向量的一部分
摩托罗拉。
为了成功地进入低功耗模式下， MC68SEC000首先必须在管理员模式下。一
进入低功率模式的推荐的方法是使用TRAP指令，这将导致
处理器开始异常处理，从而进入超级用户模式。外部电路应
完成陷阱程序中执行以下步骤：
1.外部检测，在写低功率地址。你选择这个地址可以是任何地址
在MC68SEC000的16兆字节地址范围。写低功耗地址可以是
通过轮询A23- A0， R / W，和FC2 - FC0检测。当检测到低功率地址中，R / W为
逻辑低，并且通过功能代码有一个5 （101）上的输出，该处理器被写入到
在管理员模式下的低功耗地址和用户的电路设计应该断言
在图2和图3中示出地址匹配信号。
地址匹配
AS
D
CK
Q
AS
Q
CL
D
CK
Q
D
CK
Q
Q
CL
Q
CPU_CLK
重新开始
RESET
SYSTEM_CLK
图2. 16位数据总线MC68SEC000低功耗电路
地址匹配
AS
D
CK
Q
AS
Q
CL
D
CK
Q
AS
Q
CL
D
CK
Q
D
CK
Q
Q
CL
Q
CPU_CLK
重新开始
RESET
SYSTEM_CLK
图3. MC68SEC000低功耗电路的8位数据总线
2.执行STOP指令。在图2和图3所示的外部电路，将计数
开始与写入到所述低功耗地址总线周期的数目，将停止所述处理器
在系统时钟的总线周期后的第一个下降沿时钟读取的即时数据
STOP指令。图3中多了一个触发器比图2是因为MC68SEC000中
1.
而在低功耗模式下的初步特定网络连接的阳离子为MC68SEC000的漏电流是独立同< 2
一种用于3.3V和操作
国际直拨< 5
一种用于5.0V操作。
5
M68000用户手册附录
摩托罗拉
飞思卡尔半导体公司
通过订购此文件
MC68328/D
微处理器和内存
科技集团
MC68328
MC68328V
产品简介
集成的便携式系统处理器龙珠
ΤΜ
飞思卡尔半导体公司...
随着便携式消费类市场的增长在全速，在系统的要求也变得更加严格
比以往任何时候。最少的元件，小的电路板空间，功耗低，以及低系统成本是几个
最低标准为成功的产品。为了满足这些需求，摩托罗拉设计了一个新的处理器
MC68328龙珠
TM
。通过提供3.3V ，全静态操作以高效封装， MC68328提供
具有成本效益的性能，以满足当今便携式消费市场的广泛的需求。
该MC68328 （如图1所示）是68K系列的第一款集成处理器包括一个LCD控制器，
这表明摩托罗拉专注便携市场。与除LCD控制器， MC68328
提供了适用于多种便携式应用的关键特性。像RTC ， PWM ，定时器，主站模块
SPI ，从SPI ， UART ，以及系统集成模块（ SIM28 ），方便与更多的系统工程师
灵活性和资源来设计高效，创新的产品。
68EC000 HCMOS
STATIC
CORE
8-/16-Bit
68000 BUS
接口
动态总线宽度延长
PWM
模块
双
16-BIT
定时器
模块
系统
积分
时钟
模块
合成
(SIM28)
和
动力
控制
PCMCIA 1.0
支持
68EC000内部总线
RTC
打断
调节器
液晶显示
控制
模块
主
SPI
SLAVE
SPI
UART
同
红外线
支持
处理器
控制
和
PORTC
图1. MC68328框图
本文件包含有关正在开发中的产品信息。摩托罗拉保留不另行通知变更或终止本产品的权利。
半导体产品信息
MOTOROLA ， 1995年
欲了解更多有关该产品，
转到： www.freescale.com
飞思卡尔半导体公司
主要特点
是MC68328的主要特点如下：
静态68EC000核处理器等同于MC68EC000微处理器
- 全面兼容MC68000和MC68EC000
- 32位外部和内部地址总线，可寻址4GB空间
- 16位片上数据总线MC68000总线操作
- 静态设计使得处理器时钟将停止提供戏剧省电
- 2.7 MIPS性能在16.67 MHz的处理器时钟
外部M68000总线接口，具有动态总线宽度为8位和16位数据端口
系统集成模块（ SIM28 ） ，集成了许多功能通常退居外部阵列
逻辑，诸如：
- 系统配置，可编程地址映射
- 无缝连接SRAM ， EPROM ， FLASH存储器
- 16个可编程外围芯片的选择与等待状态产生逻辑
- 中断控制器与13灵活的输入
- 可编程的中断向量响应片上外设模块
- 硬件看门狗定时器
- 软件看门狗定时器
- 低功耗模式控制
- 高达78位独立可编程并行I / O端口
- PCMCIA 1.0支持
- UART
- 支持IrDA物理层协议
- 8字节FIFO的Rx和Tx
两个独立的串行外设接口端口（ Master和Slave ）
- 支持外部POCSAG解码器（从）
- 支持数字化的A / D输入或EEPROM （主）
双通道16位通用定时器/计数器
- 多模操作的，独立的捕获/比较寄存器
- 自动中断产生
- 240 ns的分辨率在16.67 MHz的系统时钟
- 每个定时器都有一个输入和一个输出引脚用于捕捉和比较
脉冲宽度调制输出，可用于发声
- 可编程的帧速率
- 16位可编程
- 支持电机控制
- 实时时钟
- 24小时时间
- 一个可编程报警
电源管理
- 5 V或3.3 V操作
- 全静态HCMOS技术
- 可编程时钟合成器的全频控制
- 低功率停机功能
- 模块可以单独关断
- 最低功耗模式控制（关闭CPU和外设）
飞思卡尔半导体公司...
2
MC68328产品信息
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摩托罗拉
飞思卡尔半导体公司
LCD控制模块
- 软件可编程的屏幕尺寸，支持单（非分割）单色/ STN面板
- 能够直接驱动热门的LCD驱动器/模块摩托罗拉，夏普，日立，东芝等。
- 支持多达4个灰度级别
- 利用系统内存作为显示内存
IEEE 1149.1边界扫描测试访问端口（ JTAG ）
操作从DC至16.67兆赫（处理器时钟）
3.3V工作电压的
±
0.3V和5V
±
0.5V
紧凑的144引脚薄型四方扁平封装（ TQFP ）封装
系统集成模块
飞思卡尔半导体公司...
的MC68328系统集成模块（ SIM28 ）由若干个函数控制该系统起动
向上，初始化，配置，以及外部总线具有最小的外部设备。的存储器接口
允许用户与流行的SRAM接口无缝地，EPROM以及PCMCIA 1.0存储卡，
与芯片选择逻辑的协助下，等待状态可以是可编程的。的硬件和软件
看门狗定时器帮助做系统保护用户。中断控制器接受并解析
从内部模块和外部产生的中断，并优先处理的掩蔽和唤醒
选择控制的功率控制。低功率逻辑可以由控制CPU的功耗
改变频率或停止它。该SIM28也能够配置所述销，以允许用户选择
无论是专用的I / O或并行I / O 。此功能有助于通过增加可用的I / O端口的数量
回收时的专用功能在旧
系统CON组fi guration
的MC68328系统配置逻辑包括一个系统控制寄存器（SCR）并允许用户
配置的主要功能如下操作：
系统状态和控制逻辑
注册双重映射
总线错误发电控制
由用户程序从接入保护模块控制寄存器
VCO / PLL时钟合成器
时钟合成器可与任何外部晶振或外部振荡器作为参考进行操作，使用
内部锁相环（PLL ）和电压控制振荡器（ VCO）或外部时钟可以直接
驱动在操作频率的时钟信号。
芯片选择逻辑
该MC68328提供16可编程通用的片选信号。对于给定的芯片选择
块，用户可以选择片选是否允许只读，或读取和写入访问，是否
在芯片选择应符合只有一个功能码值或所有值，一个DTACK是否自动为
此片选，经过多少等待状态（从零到六） DTACK将产生产生。
摩托罗拉
MC68328产品信息
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3
飞思卡尔半导体公司
外部总线接口
外部总线接口处理的信息的内部68EC000芯和之间的转移
存储器，外围设备，或在外部地址空间的其它处理单元。它由一个16位的68000的
总线接口，用于内部和一个可选择的8位或16位接口到外部。
中断控制器
中断控制器接受并优先内部和外部的中断请求，并产生一个
在CPU的中断响应周期向量号。中断嵌套，还提供使一个跨
一个低优先级中断的中断服务程序可以被更高优先级的中断请求暂停。该
片上中断控制器具有以下主要特点：
优先中断源（内部和外部）
一个完全中断嵌套环境
可编程矢量生成
中断屏蔽
唤醒中断屏蔽
飞思卡尔半导体公司...
并行通用I / O端口
的MC68328支持多达78位通用I / O端口，它可以被配置为通用
I / O管脚或片上模块的专用外设接口引脚。
每个端口引脚可独立编程的通用I / O引脚，即使其他有关引脚
到相同的片上外围被用作专用引脚。即使所有的引脚为特定的外设都
配置为通用的I / O ，外围仍将正常工作，虽然这只是在有用
情况下， RTC和定时器模块。
软件看门狗
软件看门狗定时器，提供从逃避的手段来防止系统故障
不期望的输入的条件下，外部事件，或编程错误。一旦启动，该软件看门狗
计时器必须用软件清零定期，以便它永远不会达到其超时值。在到达
所用的超时值，则假设，即发生了系统故障时，与该软件监视逻辑
复位或中断68EC000核心。
低功耗停止逻辑
提供多种选项，省电可供选择：关闭不使用的外设，从而降低处理器的时钟
速，禁止共处理器或它们的组合。
唤醒从低功耗模式可以通过产生一个中断，在中断控制器的逻辑来实现这
贯穿处理器低功耗的时期。可选的中断将导致唤醒EC000的
核心其次是中断处理。
片上外设可以启动唤醒;例如，定时器可设定经过一定的唤醒
经过的时间，或外部事件的数量。
4
MC68328产品信息
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摩托罗拉
飞思卡尔半导体公司
LCD控制器
用单色STN液晶显示模块的接口
多达4级灰度，通过帧速率控制
利用系统内存为显存
屏幕通过DMA刷新
UART和红外通讯支持
该UART正常波特率支持标准的异步串行通信和兼容
与HPSIR / IrDA物理通信协议
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实时时钟
实时时钟在MC68328由32.76KHz / 38.4kHz晶体是相同的时钟驱动
合成时钟源。它提供了中断报警。
JTAG测试访问端口
为了帮助系统诊断MC68328包含专用的用户可访问的测试逻辑完全兼容
与IEEE 1149.1标准的边界扫描测试性，通常被称为JTAG （联合测试行动
组）。
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1997年8月7日
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以及附加信息。这对这款产品文档和其他信息保持的世界
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概观
本手册包括硬件细节和编程信息的MC68HC000 ， MC68HC001的，
该MC68EC000和MC68SEC000 。为了便于阅读，名称M68000主控板时，将使用
参照所有处理器。请参阅M68000PM / AD ，
M68000程序员参考手册
，详细
在MC68000指令集的信息。
四个微处理器都非常相似，彼此都具有以下特点：
16个32位数据和地址寄存器
16M字节的直接寻址范围
程序计数器
6指令类型
对五种主要的数据类型的操作
内存映射输入/输出（ I / O）
14寻址模式
下面处理器包含额外的功能：
MC68HC001/MC68EC000/MC68SEC000
—
静态可选择的8位或16位数据总线
MC68HC000/MC68EC000/MC68HC001/MC68SEC000
—
低功耗
本文件包含有关正在开发中的产品信息。摩托罗拉保留不另行通知变更或终止本产品的权利。
半导体产品信息
1997年，摩托罗拉， Inc.保留所有权利。
在MC68SEC000嵌入式处理器的主要特性包括：
直接替换MC68EC000
—
—
—
引脚对引脚兼容的MC68EC000在塑料QFP和TQFP封装
为MC68EC000支持种类繁多的现有的第三方开发工具
MC68SEC000
软件为MC68EC000写上运行的MC68SEC000不变
电源管理
—
—
—
—
低功耗HCMOS技术
静态设计使停止的处理器时钟
3.3V或5V操作
典型0.5μA电流消耗在3.3V睡眠模式
软件实力
—
—
完全向上对象的代码与其他M68000系列产品兼容
M68000的体系结构，可以有效地汇编代码用C编译器
升级
—
—
完全向上代码兼容具有更高的性能680X0和68300家庭成员
的ColdFire
代码兼容稍作修改
1. MC68HC000
在MC68HC000的主要优点是减少了电力消耗。该器件消耗更少的功率（由
一个数量级），比NMOS MC68000 。
在MC68HC000是M68000 16 / -32位微处理器体系结构的实现。该
MC68HC000有一个16位的数据总线实现的MC68000 ，并且是向上代码兼容的
MC68010和MC68020 32位实现的体系结构。
1.1 MC68HC001
该MC68HC001提供了一个功能扩展， MC68HC000 HCMOS 16位/ 32位微处理器
添加静态可选择8位或16位数据总线的操作。在MC68HC001是目标代码兼容
与MC68HC000 。你可以不加修改地迁移为MC68HC001编写的代码的任何成员
的M68000家庭。
1.2 MC68EC000
该MC68EC000是一个旨在满足的需求的经济型高性能的嵌入式控制器
成本敏感的嵌入式控制器市场。该HCMOS MC68EC000有一个内部的32位架构，
由静态可选择的8位或16位数据总线的支持。这种结构提供了快速和有效的
可根据高级别满足复杂的应用的要求处理装置
语言。
该MC68EC000是完全面向对象代码与MC68000兼容。您可以迁移的代码编写
MC68EC000不加修饰的M68000家庭的任何成员。
该MC68EC000带来M68000系列的性能水平，以预先与相关的成本水平
8位微处理器。从富M68000指令集MC68EC000利益及其相关的高码
密度与低内存带宽的需求。
2
M68000用户手册附录
摩托罗拉
1.3 MC68SEC000
该MC68SEC000是专为低功耗应用提供具有成本效益的静态嵌入式处理器。在
除了提供MC68EC000的大量的成本和性能优势，在低功耗模式下
该MC68SEC000的提供的功率消耗和功率管理显著优点。该
在MC68SEC000的典型电流消耗仅为0.5
A的静态待机模式， 15.0毫安正常
工作电压为3.3V 。该MC68SEC000工作在3.3V或5.0V系统。在非常低的功耗
消费，小尺寸封装，静态的实施相结合，在MC68SEC000为低
电源应用，如便携式测量设备，电子游戏机，电池供电的手持式
消费产品。
该HCMOS MC68SEC000的静态结构是一个直接替换MC68EC000 ，它提供了
成本最低的入口点到32位处理。内部32位架构提供了快速，高效的
处理中满足基于高级语言的复杂的应用的要求。
所有广泛使用的现有的第三方开发工具的MC68EC000将直接支持
MC68SEC000 。可以发现，这些工具中的详细描述
高性能嵌入式系统
源目录。
摩托罗拉
M68000用户手册附录
3
2.0信号描述
变化图3-3 3-2页。
V
CC
GND
CLK
A23-A0
地址总线
D15-D0
AS
数据总线
处理器
状态
FC0
FC1
FC2
读/写
UDS
LDS
DTACK
MC68SEC000
BR
BG
总线仲裁
控制
异步
总线控制
BERR
系统
控制
RESET
停止
模式
IPL0
IPL1
IPL2
AVEC
打断
控制
图1.输入和输出信号（ MC68EC000和MC68SEC000 ）
2.1数据总线（ D15 - D0 ）
在第3-4页的第3.2节，将“ MC68EC000和MC68HC001使用D7 - D0在8位模式， D15-
D8是不确定的。 “与”使用MC68HC001 ， MC68EC000和MC68SEC000模式引脚，可以
静态地选择8位或16位模式进行数据传输。该MC68EC000 ， MC68SEC000和
MC68HC001使用D7 - D0在8位模式。 D15 - D8是不确定的。 “
2.2总线仲裁控制
在第3-5页的第3.4节，一句“在MC68008和MC68EC000的48引脚版本，无引脚
可用的总线许可的确认信号;该微处理器采用两线总线仲裁
方案。 “应改为”在64引脚MC68EC000和MC68SEC000 ，无引脚可用于总线授权
应答信号。这些微处理器采用两线总线仲裁机制。 “
2.3系统控制
3.6节的第3-7页上的模式小节标题应改为'模式（MODE ） （ MC68HC001 /
68EC000/68SEC000).’’
2.4 MC68SEC000低功耗模式
以下内容添加到第4和第5 ，总线操作。
该MC68SEC000进行了重新设计，以提供充分static-和低功耗操作。本节
描述了所建议的方法用于将MC68SEC000进入低功率模式，以减少
4
M68000用户手册附录
摩托罗拉
功耗的静态值
1
同时保持了处理器的内部状态。该
下面描述的低功率模式将被定期地测试所提供的MC68SEC000测试向量的一部分
摩托罗拉。
为了成功地进入低功耗模式下， MC68SEC000首先必须在管理员模式下。一
进入低功率模式的推荐的方法是使用TRAP指令，这将导致
处理器开始异常处理，从而进入超级用户模式。外部电路应
完成陷阱程序中执行以下步骤：
1.外部检测，在写低功率地址。你选择这个地址可以是任何地址
在MC68SEC000的16兆字节地址范围。写低功耗地址可以是
通过轮询A23- A0， R / W，和FC2 - FC0检测。当检测到低功率地址中，R / W为
逻辑低，并且通过功能代码有一个5 （101）上的输出，该处理器被写入到
在管理员模式下的低功耗地址和用户的电路设计应该断言
在图2和图3中示出地址匹配信号。
地址匹配
AS
D
CK
Q
AS
Q
CL
D
CK
Q
D
CK
Q
Q
CL
Q
CPU_CLK
重新开始
RESET
SYSTEM_CLK
图2. 16位数据总线MC68SEC000低功耗电路
地址匹配
AS
D
CK
Q
AS
Q
CL
D
CK
Q
AS
Q
CL
D
CK
Q
D
CK
Q
Q
CL
Q
CPU_CLK
重新开始
RESET
SYSTEM_CLK
图3. MC68SEC000低功耗电路的8位数据总线
2.执行STOP指令。在图2和图3所示的外部电路，将计数
开始与写入到所述低功耗地址总线周期的数目，将停止所述处理器
在系统时钟的总线周期后的第一个下降沿时钟读取的即时数据
STOP指令。图3中多了一个触发器比图2是因为MC68SEC000中
1.
而在低功耗模式下的初步特定网络连接的阳离子为MC68SEC000的漏电流是独立同< 2
一种用于3.3V和操作
国际直拨< 5
一种用于5.0V操作。
5
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通过订购此文件
M68000UMAD/AD
通信和高级
消费科技集团
M68000
增编
M68000
用户手册
1997年8月7日
该增编
M68000UM / AD用户手册
修订8 ，提供更正原文为
以及附加信息。这对这款产品文档和其他信息保持的世界
万维网在http://www.motorola.com/68000 。
概观
本手册包括硬件细节和编程信息的MC68HC000 ， MC68HC001的，
该MC68EC000和MC68SEC000 。为了便于阅读，名称M68000主控板时，将使用
参照所有处理器。请参阅M68000PM / AD ，
M68000程序员参考手册
，详细
在MC68000指令集的信息。
四个微处理器都非常相似，彼此都具有以下特点：
16个32位数据和地址寄存器
16M字节的直接寻址范围
程序计数器
6指令类型
对五种主要的数据类型的操作
内存映射输入/输出（ I / O）
14寻址模式
下面处理器包含额外的功能：
MC68HC001/MC68EC000/MC68SEC000
—
静态可选择的8位或16位数据总线
MC68HC000/MC68EC000/MC68HC001/MC68SEC000
—
低功耗
本文件包含有关正在开发中的产品信息。摩托罗拉保留不另行通知变更或终止本产品的权利。
半导体产品信息
1997年，摩托罗拉， Inc.保留所有权利。
在MC68SEC000嵌入式处理器的主要特性包括：
直接替换MC68EC000
—
—
—
引脚对引脚兼容的MC68EC000在塑料QFP和TQFP封装
为MC68EC000支持种类繁多的现有的第三方开发工具
MC68SEC000
软件为MC68EC000写上运行的MC68SEC000不变
电源管理
—
—
—
—
低功耗HCMOS技术
静态设计使停止的处理器时钟
3.3V或5V操作
典型0.5μA电流消耗在3.3V睡眠模式
软件实力
—
—
完全向上对象的代码与其他M68000系列产品兼容
M68000的体系结构，可以有效地汇编代码用C编译器
升级
—
—
完全向上代码兼容具有更高的性能680X0和68300家庭成员
的ColdFire
代码兼容稍作修改
1. MC68HC000
在MC68HC000的主要优点是减少了电力消耗。该器件消耗更少的功率（由
一个数量级），比NMOS MC68000 。
在MC68HC000是M68000 16 / -32位微处理器体系结构的实现。该
MC68HC000有一个16位的数据总线实现的MC68000 ，并且是向上代码兼容的
MC68010和MC68020 32位实现的体系结构。
1.1 MC68HC001
该MC68HC001提供了一个功能扩展， MC68HC000 HCMOS 16位/ 32位微处理器
添加静态可选择8位或16位数据总线的操作。在MC68HC001是目标代码兼容
与MC68HC000 。你可以不加修改地迁移为MC68HC001编写的代码的任何成员
的M68000家庭。
1.2 MC68EC000
该MC68EC000是一个旨在满足的需求的经济型高性能的嵌入式控制器
成本敏感的嵌入式控制器市场。该HCMOS MC68EC000有一个内部的32位架构，
由静态可选择的8位或16位数据总线的支持。这种结构提供了快速和有效的
可根据高级别满足复杂的应用的要求处理装置
语言。
该MC68EC000是完全面向对象代码与MC68000兼容。您可以迁移的代码编写
MC68EC000不加修饰的M68000家庭的任何成员。
该MC68EC000带来M68000系列的性能水平，以预先与相关的成本水平
8位微处理器。从富M68000指令集MC68EC000利益及其相关的高码
密度与低内存带宽的需求。
2
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摩托罗拉
1.3 MC68SEC000
该MC68SEC000是专为低功耗应用提供具有成本效益的静态嵌入式处理器。在
除了提供MC68EC000的大量的成本和性能优势，在低功耗模式下
该MC68SEC000的提供的功率消耗和功率管理显著优点。该
在MC68SEC000的典型电流消耗仅为0.5
A的静态待机模式， 15.0毫安正常
工作电压为3.3V 。该MC68SEC000工作在3.3V或5.0V系统。在非常低的功耗
消费，小尺寸封装，静态的实施相结合，在MC68SEC000为低
电源应用，如便携式测量设备，电子游戏机，电池供电的手持式
消费产品。
该HCMOS MC68SEC000的静态结构是一个直接替换MC68EC000 ，它提供了
成本最低的入口点到32位处理。内部32位架构提供了快速，高效的
处理中满足基于高级语言的复杂的应用的要求。
所有广泛使用的现有的第三方开发工具的MC68EC000将直接支持
MC68SEC000 。可以发现，这些工具中的详细描述
高性能嵌入式系统
源目录。
摩托罗拉
M68000用户手册附录
3
2.0信号描述
变化图3-3 3-2页。
V
CC
GND
CLK
A23-A0
地址总线
D15-D0
AS
数据总线
处理器
状态
FC0
FC1
FC2
读/写
UDS
LDS
DTACK
MC68SEC000
BR
BG
总线仲裁
控制
异步
总线控制
BERR
系统
控制
RESET
停止
模式
IPL0
IPL1
IPL2
AVEC
打断
控制
图1.输入和输出信号（ MC68EC000和MC68SEC000 ）
2.1数据总线（ D15 - D0 ）
在第3-4页的第3.2节，将“ MC68EC000和MC68HC001使用D7 - D0在8位模式， D15-
D8是不确定的。 “与”使用MC68HC001 ， MC68EC000和MC68SEC000模式引脚，可以
静态地选择8位或16位模式进行数据传输。该MC68EC000 ， MC68SEC000和
MC68HC001使用D7 - D0在8位模式。 D15 - D8是不确定的。 “
2.2总线仲裁控制
在第3-5页的第3.4节，一句“在MC68008和MC68EC000的48引脚版本，无引脚
可用的总线许可的确认信号;该微处理器采用两线总线仲裁
方案。 “应改为”在64引脚MC68EC000和MC68SEC000 ，无引脚可用于总线授权
应答信号。这些微处理器采用两线总线仲裁机制。 “
2.3系统控制
3.6节的第3-7页上的模式小节标题应改为'模式（MODE ） （ MC68HC001 /
68EC000/68SEC000).’’
2.4 MC68SEC000低功耗模式
以下内容添加到第4和第5 ，总线操作。
该MC68SEC000进行了重新设计，以提供充分static-和低功耗操作。本节
描述了所建议的方法用于将MC68SEC000进入低功率模式，以减少
4
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功耗的静态值
1
同时保持了处理器的内部状态。该
下面描述的低功率模式将被定期地测试所提供的MC68SEC000测试向量的一部分
摩托罗拉。
为了成功地进入低功耗模式下， MC68SEC000首先必须在管理员模式下。一
进入低功率模式的推荐的方法是使用TRAP指令，这将导致
处理器开始异常处理，从而进入超级用户模式。外部电路应
完成陷阱程序中执行以下步骤：
1.外部检测，在写低功率地址。你选择这个地址可以是任何地址
在MC68SEC000的16兆字节地址范围。写低功耗地址可以是
通过轮询A23- A0， R / W，和FC2 - FC0检测。当检测到低功率地址中，R / W为
逻辑低，并且通过功能代码有一个5 （101）上的输出，该处理器被写入到
在管理员模式下的低功耗地址和用户的电路设计应该断言
在图2和图3中示出地址匹配信号。
地址匹配
AS
D
CK
Q
AS
Q
CL
D
CK
Q
D
CK
Q
Q
CL
Q
CPU_CLK
重新开始
RESET
SYSTEM_CLK
图2. 16位数据总线MC68SEC000低功耗电路
地址匹配
AS
D
CK
Q
AS
Q
CL
D
CK
Q
AS
Q
CL
D
CK
Q
D
CK
Q
Q
CL
Q
CPU_CLK
重新开始
RESET
SYSTEM_CLK
图3. MC68SEC000低功耗电路的8位数据总线
2.执行STOP指令。在图2和图3所示的外部电路，将计数
开始与写入到所述低功耗地址总线周期的数目，将停止所述处理器
在系统时钟的总线周期后的第一个下降沿时钟读取的即时数据
STOP指令。图3中多了一个触发器比图2是因为MC68SEC000中
1.
而在低功耗模式下的初步特定网络连接的阳离子为MC68SEC000的漏电流是独立同< 2
一种用于3.3V和操作
国际直拨< 5
一种用于5.0V操作。
5
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MC68LC302/D
MC68LC302
产品简介
低成本集成多协议处理器
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飞思卡尔
介绍了公知的MC68302集成多协议处理器（ IMP）的低成本版本。
它会被称为MC68LC302 ，并扩大家庭的基础上MC68302器件。
一些特征和销相比，已被除去，而其它特征已被增强
原来的MC68302 。简单地说， MC68LC302是一个传统的MC68302用一个新的静态68000芯，一个新的
定时器和低功耗模式，但没有第三个串行通信控制器（SCC） 。它被装在一个低
简介100 TQFP ，需要更少的电路板空间比普通MC68302 ，并使其适用于
在高度受限的应用，如PCMCIA使用。
.
低
动力
控制
打断
调节器
1常规 -
用途
DMA
通道
3定时器
4芯片选择
PIO
系统控制
的RAM / ROM的
STATIC
M68000
CORE
68000
系统总线
20个地址
8/16数据
1152字节
双端口
内存
4 SDMA
频道
PIT
本文件包含有关正在开发中的产品信息。
飞思卡尔
保留不另行通知，以更改或终止本产品的权利。
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飞思卡尔半导体公司
特点
是MC68LC302的特点如下。
粗体
项目显示从MC68302主要区别。
片
静态68000核心
支持16位或8位M68000家族系统
SIB其中：
- 独立的直接内存访问（ IDMA ）控制器
- 中断控制器有两种操作模式
- 并行输入/输出（ I / O）端口，一些具有中断功能
- 片上1152字节双口RAM
- 三个定时器包括一个看门狗定时器
- 新的周期中断定时器（ PIT ）
- 四个可编程的片选线与等待状态产生逻辑
- 双口RAM和IMP寄存器的可编程地址映射
- 片上时钟发生器，输出信号
- 片上PLL允许运行带32 kHz或4 MHz的晶体
- 无缝连接EPROM ， SRAM，闪存EPROM和EEPROM
- 允许在启动8位模式和运行切换到16位模式
- 系统控制：
系统状态和控制逻辑
禁用逻辑CPU （从模式的工作）
硬件看门狗
新的低功耗（待机）模式与唤醒，从两个引脚或PIT
冻结控制调试（仅适用于PGA封装）
DRAM刷新控制器
CP包括：
- 主控制器（ RISC处理器）
—
两个独立的全双工串行通信控制器（ SCCS）
- 支持各种协议：
高级别/同步数据链路控制（ HDLC / SDLC ）
通用异步收发器（ UART ）
二进制同步通信（ BISYNC ）
透明模式
支持自动波特率
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MC68LC302产品信息
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飞思卡尔半导体公司
MC68LC302应用
该MC68LC302擅长于多个应用程序的区域。
首先，使用MC68302 ，但是不需要所有这三个串行通道的任何应用程序是一个潜在的候选
该MC68LC302 。但是，请注意，该MC68LC302牺牲大多数提供的外部总线
控制权，从而MC68LC302可能并不合适，其中MC68302作为较大部分
系统。
二， MC68LC302擅长于低功耗和便携式应用。包含一个静态的68000内核，
再加上内置到设备的低功耗模式，使其非常适用于手持设备，或者其他低功耗
应用程序。新的32 kHz或4 MHz的PLL选大大减少了设计者的总功率预算
板，并允许MC68LC302是在低功率系统中的有效设备。该MC68LC302可以再
可选择由董事会其他成员产生一个全频的时钟使用。在低功率模式下，新
周期性中断定时器（ PIT ）允许器件唤醒定期。此外，两个引脚可以唤醒
该器件从低功耗模式。
第三，考虑到MC68LC302打包在一个100TQFP包，它允许要使用的MC68LC302
在空间有限的应用，以及诸如PCMCIA卡的高度的关键应用程序。
第四，由于禁止CPU的模式（也称为从属模式）仍然保留， MC68LC302可以起到
含有串行通道，定时器，片选等全智能DMA驱动的外围芯片
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THE MC68LC302和MC68302之间的差异
该MC68LC302已经从MC68302一些具体的差异。即使的功能
处理器和外围设备的保持相同，一些灵活性已经因针被移除
从132减少对原MC68302 ， 100引脚的MC68LC302 。
以下功能已被删除或从MC68302修改，以使MC68LC302
可能。
SCC3其波特率发生器（ BRG3 ）将被删除。
外部的主人无法通过正常的总线仲裁要求坐大巴离MC68LC302
tration计划，因为这些引脚不再存在。外部主机仍然可以保持总线控制
通过使用HALT脚的简单方案。使用MC68LC302时，此限制不适用
在CPU禁用模式（从机模式） ，在这种情况下， BR ， BG和BGACK一应俱全。
MC68LC302产品信息
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在SCP引脚现在用多路复用PA8 ， PA9 ， PA10和。该TXD3 ， RXD3和RCLK3功能于联系
ciated与SCC3被淘汰。
在UDS ， LDS和R / W引脚不可用，除非在从模式下，他们更换IPL2-0引脚。
相反，新销WEH ， WEL ，和OE已被定义为无缝连接到内存。
PA12现多路复用与MODCLK销，其与所述32千赫或4 MHz的锁相环相关联。该MOD-
复位后， CLK引脚进行采样，然后变成PA12 。
新VCCSYN ， GNDSYN和XFC管脚，支持片上PLL被添加。
为了进行仿真和开发只支持下，支持特殊的132 PGA版本。这
版本增加了回FC2-0 ， IAC ， FRZ和AVEC引脚。该FC2-0引脚允许总线周期是distin-
程序和数据的访问兼容，中断周期等。 IAC ， FRZ和AVEC引脚
提供这样仿真的厂商可以迅速改装其现有MC68302模拟器的设计来支持
端口MC68LC302 。
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MC68LC302产品信息
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MC68LC302引脚说明
NMSI1 / ISDN I / F
RXD1/L1RXD
TXD1/L1TXD
RCLK1/L1CLK
TCLK1/L1SY0/SDS1
CD1/L1SY1
CTS1/L1GR
RTS1/L1RQ/GCIDCL
地址总线
A1-A19
芯片选择
CS0/IOUT2
CS3-CS1
数据总线
D0-D15
NMSI2 / PAIO
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RXD2/PA0
TXD2/PA1
RCLK2/PA2
TCLK2/PA3
CTS2/PA4
RTS2/PA5
CD2/PA6
BRG2/SDS2/PA7
AS
WEH/A0
WEL / WE
DTACK
OE
总线控制
(UDS/A0)
（ LDS / DS ）
（R / W）的
系统控制
MC68LC302
信号的
RESET
停止
BUSW
DISCPU
PAIO / SCP
SPRXD/PA8
SPTXD/PA9
SPCLK/PA10
MODCLKPA12
中断控制
定时器/ PBIO
TIN1/PB3
TIN2/PB5
TOUT2/PB6
WDOG/PB7
IPL0 / IRQ1 （ BR ）
IPL1 / IRQ6 （ BGACK ）
IPL2 / IRQ7 （ BG ）
PB8
PB9
PB10
PB11
IQGND(2)
IQVDD(2)
时钟
CLKO
EXTAL
XTAL
XFC
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订购此文件
由MC68322 / D
微处理器和内存
科技集团
MC68322
产品简介
集成的打印机处理器
的MC68322是一种高性能集成打印机处理器，它结合了一个MC68000兼容
EC000核心处理器，RISC图形处理器（RGP ）和一个打印引擎，视频控制器（PVC）的用
众多的系统集成功能单一的集成电路上。这是第一个摩托罗拉的M68000系列的
专为激光打印机设计的。该MC68322提供了新的设计，独特的解决方案，以及
一个优秀的迁移路径存在M68000供电的打印机。此外，新的芯片将找到现成
应用到喷墨打印机和多功能外设（传真/调制解调器/打印机）市场等
嵌入式控制应用，这需要非常快速的位操作。该MC68322提供
突出表现在一个非常实惠的价格。
从历史上看，打印机应用已经使用单一的通用处理器和外部解决
专用电路。的MC68322采用了高度专业化的，多处理器体系结构，其
使用户能够采取的存储器减少技术优势。这种设计的实现提供了一个
技术上的优势，更具成本效益的系统解决方案。专业的显示列表中带技术
由专用的RISC图形处理器执行时使系统存储器的要求是显著
减少。
使用单独的软件内存缩减技术，采取传统的控制器的方法，
缺乏需要处理复杂的页面的力量，从而使控制器回落到较低的分辨率或
降低页面的吞吐量。通过集成EC000核心， RGP ，并采用PVC独特的双总线
体系结构中， MC68322优化总体系统性能。双总线架构，消除了总线
处理单元创建一个真正的并行处理环境之间的争用。附加
带宽允许每个处理单元运行在最佳性能。工作结合的导通
芯片，可编程，爆破DRAM控制器，所述处理单元能够实现出色的
吞吐量。这些专用的处理单元使MC68322 ，以产生每英寸的图像600的点
使用比传统的控制器的内存少得多。该MC68322扩展了这些好处到低
费用为每分钟打印机4-8页。
该MC68322显著减少了元件数量，电路板空间，功耗和其固有的
成本的同时获得较高的可靠性和缩短设计时间。该MC68322提供碳粉的支持
养护，使打印控制器在草稿模式打印时可以节省墨粉。该MC68322
提供了完美的打印环境，为用户复杂的页面描述语言（如PCL
和PostScript ）和更少的可扩展的图形成像模型，如Windows打印系统和
QuickDraw的） 。与M68000家庭完整的代码兼容性，使设计获得了广泛的
建立实时内核，操作系统，编程语言，应用和开发工具的基础上，
其中有许多是用于嵌入式处理和打印应用进行了优化。图1示出了块
图中的MC68322的。
飞思卡尔半导体公司...
本文件包含有关正在开发中的产品信息。摩托罗拉保留随时更改或终止本产品不正确
这本文档中出现notice.Company和产品名称是识别目的，应被视为注册商标的
各自的所有者。
半导体产品信息
1994年摩托罗拉
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飞思卡尔半导体公司
飞思卡尔半导体公司...
并口
IEEE 1284
STATIC
EC000核心
并口
DMA
图像
执行单元（ GEU ）
RISC图形
处理器（ RGP ）
DMA
舞会
系统
积分
模块（SIM）
EC000 BUS
DRAM控制
打印引擎视频
控制器（PVC）的
公共汽车
接口单元
图形总线
外设
（可选）
在电路
仿真
（可选）
LOCAL TALK
串行
ETHERNET
SCSI
时钟
DRAM
打印引擎
图1.系统框图
2
MC68322产品信息
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摩托罗拉
飞思卡尔半导体公司
特点
静态EC000核处理器
- 与M68000家庭完整的代码兼容性
- 无缝连接外设
- 256兆字节的地址范围
图形执行单元（ GEU ）
- 内存减少技术
- 运行长度编码扫描线表
- RISC图形处理器（ RGP ）
- 处理从显示列表多操作图形订单
- 生成压缩的位图图象使用硬件捆扎
飞思卡尔半导体公司...
- 专用的图形总线允许多达8个PPM的性能，在600 dpi的分辨率
- 打印引擎视频控制器（ PVC）
- 位图图像转换为串行数据流，并送入打印引擎
- 通用，可编程，非击打式打印机通信接口
- 爽肤水保护技术
- 专用高性能DMA控制器的操作GEU
总线接口单元（ BIU ）
- 双总线体系结构允许独立的总线，以独立运作
- 分布式处理更优的系统性能
系统集成模块（ SIM）
- 8个可编程芯片选择
- 256 KB到512 MB的PROM地址空间
- 每个ROM银行独立的可编程时序参数
- 集成的系统定时器
DRAM系统集成模块（ DSIM ）
- 支持512字节，兆字节2和8 MB的DRAM库存规模
- 直接控制多达6家银行的DRAM ;支持多达48个字节的DRAM
- DRAM银行可编程透明刷新
- 爆破DRAM接口
通用DMA控制器模块
- 提供高速下载不影响到核处理器的性能
IEEE 1284并行接口控制器模块
- DMA控制器支持2兆字节/秒的双向通信传输
为16MHz或20MHz的操作
160引脚塑料四方扁平封装（ QFP ）
摩托罗拉
MC68322产品信息
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3
飞思卡尔半导体公司
MC68322信号说明
图2示出了它们的官能团中的MC68322输入和输出信号。表1列出了
信号名称，助记符和MC68322信号的功能说明。
PD7–PD0
选择
频闪
AUTOFD
A25–A1
D15–D0
CS7–CS0
RD
WRU
WRL
等待
IRQ1–IRQ0
CLK2
RESET
TEST
MC68322
MA10–MA0
MD15–MD0
RAS5–RAS0
CAS1–CAS0
WE
DREQ
DACK
AS
读/写
EDTACK
BR
BG
地址总线
数据总线
飞思卡尔半导体公司...
并口
接口
INIT
确认
忙
SELECT
PERROR
故障
VCLK
EC000核心
接口
系统
接口
存储器地址总线
存储器数据总线
DRAM
接口
DMA
接口
PVC
接口
FSYNC
LSYNC
视频
打印
CCLK
打印机
通讯
接口
CBSY
SBSY
CMD / STS
STS
外
总线主控
接口
图2. MC68322的功能信号组
4
MC68322产品信息
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摩托罗拉
飞思卡尔半导体公司
表1.信号指数
信号名称
地址总线
地址选通
自动进给控制
公交格兰特
总线请求
芯片选择
时钟
助记符
A25–A1
AS
AUTOFD
BG
BR
CS7–CS0
CLK2
25位外部地址总线。
表示一个有效的地址总线上。
并口控制信号。
置给予总线控制向外部装置。
通过外部设备请求总线主舰断言。
PROM和I / O芯片选择。
2×系统时钟。
DRAM列地址选通。
命令忙指示一个命令将被发送到打印机。
命令时钟是命令/状态时钟向/从打印机。
命令/状态数据是同步通信和数据输出到
打印机，或双向命令/状态数据或从打印机。
用于字节或字传输16位数据总线。
输出，用于指示数据传输完成。
输入启动DMA传输。
复DRAM地址总线。
16位的DRAM数据总线。
外部主机支持的信号。
表示页面响应于打印请求的顶部。
并口初始化控制。
中断请求输入。
表示页面的左边缘。
并行接口双向数据总线。
打印请求请求要打印的页面。
并口打印机忙。
并行端口信号锁存输入数据。
并口打印机错误。
并口纸错误。
对于"on - line"地位并行端口的请求。
打印机"on - line" 。
PROM和I / O读使能信号。
标识传递的读或写操作。
处理器复位。
DRAM行地址选通。
表示状态想要从打印机接收。
状态数据是从打印机的同步状态的数据。
功能
列地址选通
CAS1 ， CAS0
命令忙
CBSY
CCLK
CMD
/ STS
D15–D0
DACK
DREQ
MA10–MA0
MD15–MD0
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指令时钟
命令/状态数据
数据总线
DMA应答
DMA请求
DRAM地址总线
DRAM数据总线
外部主DTACK
EDTACK
帧同步
初始化输入
中断请求
行同步
PPI数据总线
打印请求
打印机忙
打印机的数据选通
打印机错误
FSYNC
INIT
IRQ1 ， IRQ0
LSYNC
PD7–PD0
打印
忙
频闪
故障
打印纸张路径错误PERROR
打印机选择
打印机精选
读使能
读/写
RESET
行地址选通
忙碌状态
状态数据
选择
SELECT
RD
读/写
RESET
RAS5–RAS0
SBSY
STS
摩托罗拉
MC68322产品信息
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通过MC68360D
MC68360
产品简介
MC68360四通道集成通信
控制器（ QUICC
)
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介绍
该MC68360四通道集成通信控制器（ QUICC
）是一种多功能单芯片内集成
微处理器，并且可以在多种控制应用中使用的外围组合。它
尤其擅长于沟通活动。该QUICC （发音为“快速” ），可谓一
下一代MC68302与设备运行的各个方面更高的性能，更大的灵活性，
在能力主要扩展和更高的集成度。 "quad"来自这样的事实，有术语
四个串行通信控制器（ SCC的）设备上;然而，实际上有7串行
通道： 4的SCC ，两个串行管理控制器（平滑肌细胞） ，和一个串行外围接口（SPI） 。
QUICC主要特点
下面的列表总结了关键的MC68360 QUICC特点：
CPU32 +处理器（ 4.5 MIPS在25兆赫）
- 32位的CPU32内核（完全兼容的CPU32 ）的版本
- 背景调试模式
- 字节对齐的地址
高达32位的数据总线（动态总线宽度为8位和16位）
多达32根地址线（至少28始终可用）
完全静态设计（ 0-25 MHz的操作）
从模式禁用CPU32 + （允许使用与外部处理器）
- 多QUICCs可以共用一个系统总线（一个主）
- MC68040伴侣模式允许QUICC是一个MC68040伴侣
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存储器（SRAM ），电可编程只读存储器（EPROM ） ，闪速EPROM ，等。
- 中科院四线，四WE线，一条线OE
- 引导芯片复位时选择用（ 8,16或32位内存选项）
- 特殊功能的MC68040含连拍模式支持
四个通用定时器
- MC68302定时器的超集
- 4个16位定时器或两个32位定时器
- 门模式下可以启用/禁用计数
两个独立的DMA （ IDMAs ）
—
—
—
—
为了达到最快的接送单地址模式
缓冲区链接和自动缓冲模式
自动执行高效填料
32位内部和外部转移
公交车监控
双总线故障监控器
伪中断监控
软件看门狗
周期中断定时器
低功耗停止模式
时钟合成器
断点逻辑提供片上硬件断点
外部的主机可能使用的片上功能，如芯片选择
片上总线仲裁中无开销的内部大师
IEEE 1149.1测试访问端口
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系统集成模块（ SIM60 ）
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—
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—
中断
- 七外部IRQ线
- 12端口引脚具有中断功能
16个内部中断源
- 鳞癌之间可编程优先级
- 可编程的最高优先级请求
通信处理器模块（ CPM ）
- RISC控制器
- 许多新的命令（例如，正常停止发送，关闭RxBD ）
- 224缓冲区描述符
- 支持所有串行通道连续模式下发送和接收
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四鳞癌
- 以太网/ IEEE 802.3可选的SCC1 （全10 - Mbps的支持） （仅适用于
MC68EN360)
- HDLC / SDLC
（所有四个通道，可支持2 Mbps的）
- HDLC总线（实现一个基于HDLC的局域网络（LAN） ）
- 的AppleTalk
- 信令系统＃ 7
- 通用异步收发器（ UART ）
- 同步UART
- 二进制同步通信（ BISYNC ）
- 完全透明（比特流）
- 完全透明（基于具有可选的循环冗余校验帧（ CRC ） ）
- 现场总线（ RAM微可选）
- 异步HDLC （ RAM微码选项）支持PPP （点对点协议）
- DDCMP
（ RAM微可选）
- V.14 （ RAM微可选）
- X.21 （ RAM微可选）
两个校董会
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—
UART
透明
通用电路接口（ GCI ）控制器
可连接到时分复用（ TDM）的频道
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一个SPI
- 对MC68302 SCP超集
- 支持主从模式
- 支持在同一总线上多主机操作
时间时隙分配器
支持双通道TDM
- 每个TDM通道可以T1 ， CEPT ， PCM公路， ISDN基本速率，
ISDN基群速率，用户自定义
- 1-或8位分辨率
- 允许独立的发送和接收路由，帧同步，时钟
- 允许动态变化
- 可以在内部连接到六个串行通道（四鳞癌和
两校董会）
- 并行接口端口
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QUICC架构概述
的QUICC是32位控制器，其中的其他成员的延伸
飞思卡尔
M68300的家庭。喜欢
该M68300家族的其他成员，在QUICC采用了模块间总线（ IMB ） 。 （该MC68302是
一个例外，在芯片上有一个M68000总线）国际海事局提供的所有模块的通用接口
M68300系列，它允许
飞思卡尔
通过使用现有的库更快地开发新设备
模块。虽然IMB定义总是包括用于芯片上的32位总线的一个选项，所述的QUICC是
第一个设备来实现此选项。
的QUICC由三个模块： CPU32 +核心， SIM60 ，和CPM 。每个模块
利用32位的IMB 。的MC68360 QUICC框图如图1所示。
SIM卡60
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系统
保护
CPU32+
CORE
周期
定时器
时钟
GENERATION
其他
特点
JTAG
断点
逻辑
DRAM
调节器
和
芯片选择
系统
I / F
IMB （ 32位）
外
公共汽车
接口
CPM
通信处理器
RISC
调节器
两
IDMAs
第十四SERIAL
DMAS
七
串行
频道
2.5-KBYTE
双端口
内存
打断
调节器
FOUR
常规 -
用途
计时器
定时器SLOT
分配器
其他
特点
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取2字长的指令在一个总线周期内，更快速地填充所述内部指令队列。该
CPU32 +核心还可以读取和写入在一个总线周期的32位数据。
虽然CPU32 +指令定时的改善，其指令集是相同的，在CPU32的。它
也将执行整个M68000指令集。它包含相同的背景调试模式（ BDM ）
特点为CPU32 。没有新的编译器，汇编器，或其他软件支持工具需要的话
实现了CPU32 + ;标准CPU32工具都可以使用。
该CPU32 +在25兆赫提供约4.5的MIPS ，基于标准的（接受的）假设是
一个10 MHz的M68000提供1 VAX MIPS 。如果一个应用程序需要更多的性能， CPU32 +可
禁止，允许QUICC的其余部分以作为一个智能外围设备，以更快的处理器。该
QUICC提供称为MC68040协同模式的一种特殊模式，以允许它方便地接口到
该M68040家族的成员。此双芯片解决方案提供了一个22 MIPS的性能，在25兆赫。
该CPU32 +还提供未在CPU32提供自动字节对齐功能。这些
功能允许16位或32位的数据进行读取或写入奇地址。该CPU32 +自动执行
所需的总线周期的数目。
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系统集成模块（ SIM60 ）
将SIM60集成通用特征，将在几乎任何32位处理器系统是有用的。
术语“ SIM60 ”是从QUICC部件号， MC68360而得。该SIM60是一个加强版
上存在的MC68340和MC68330器件SIM40 。
首先，新的功能，诸如DRAM控制器和断点逻辑，已被添加。其次， SIM40
被修改，以支持一个32位的IMB以及一个32位外部系统总线。第三，新的配置，例如
因为从模式和内部访问由外部主机，支持。
虽然QUICC始终是一个32位的内部设备，它可以被配置为具有16位的数据进行操作
总线。无论系统总线大小的选择，支持动态母线调整。总线宽度允许8位，
16位和32位的外设和存储器中的32位的系统总线模式和8位和16位的外围设备存在
而在16位的系统总线模式存在存储器中。
通信处理器模块（ CPM ）
在CPM包含功能，使QUICC在通信和控制应用出类拔萃。这些
特征可以被分为三个子组：
通讯处理器（ CP ）
两个IDMA控制器
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