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LTC1448

双通道12位轨至轨

微DAC

特点

描述

此外，LTC

1448是一款双通道，轨到轨电压输出12位

数字 - 模拟转换器（DAC ）。它包括轨至轨

输出缓冲放大器和一个易于使用的3线串行

界面。它采用8引脚SO和PDIP封装，

任何提供双通道12位DAC的最小尺寸。

该LTC1448具有一个外部基准输入引脚（ REF ）

其输出摆幅为0V至REF 。 REF输入即可

连接到V

从电源提供轨到轨工作

的2.7V至5.5V 。（对于具有内部基准的设备看

LTC1446数据表。）的LTC1448的功耗只有2.5mW

从一个5V电源。

低电源电流和小型SO- 8封装

使LTC1448非常适用于电池供电的应用。

SO- 8封装

12位分辨率

缓冲真正的轨到轨电压输出

外部基准输入可连接到V

输出摆幅为0V至V

REF

3V和5V电源供电

施密特触发器的时钟输入可以直接

光电耦合器接口

上电复位清除的DAC为0V

3线串行接口

最大DNL误差： 0.5 LSB

低成本

应用

数字校准

工业过程控制

自动测试设备

移动电话

， LTC和LT是凌特公司的注册商标。

典型用途

功能框图： 12位轨至轨双路DAC

2.7V至5.5V

0.5

2 D

REF

DNL误差（ LSB ）

12-BIT

DAC B

OUT B

1 CLK

3 CS / LD

24-BIT

移

REG

和

DAC

LATCH

–

轨到轨

电压

输出

12-BIT

DAC A

OUT A

–

POWER- ON

RESET

GND

1448 TA01

微分非线性

与输入代码

0.4

0.3

0.2

0.1

–0.1

–0.2

–0.3

–0.4

–0.5

512 1024 1536 2048 2560 3072 3584 4095

CODE

1448 TA02

LTC1448

绝对

最大

评级

到GND .............................................. - 0.5 V到7.5V

逻辑输入到GND ................................ - 0.5V至7.5V

OUT A

, V

OUT B

， REF和GND ........... - 0.5V至V

+ 0.5V

最高结温.......................... 125°C

工作温度范围

LTC1448C ............................................ 0 ° C至70 ℃，

LTC1448I ......................................... - 40 ° C至85°C

存储温度范围................ - 65℃ 150℃

引线温度（焊接， 10秒） ................. 300℃

PACKAGE / ORDER我FOR ATIO

顶视图

CLK 1

CS / LD 3

REF 4

N8包装

8引脚PDIP

OUT B

GND

OUT A

订购部件

数

LTC1448CN8

LTC1448IN8

LTC1448CS8

LTC1448IS8

S8最热

1448

1448I

S8包装

8引脚塑料SO

JMAX

= 125°C,

= 100 ℃/ W（ N8 ）

JMAX

= 125°C,

= 150℃ / W （S8）

咨询工厂的军工级配件。

电气特性

= 2.7V至5.5V ，V

OUT A

和V

OUT B

卸载， REF

≤

, T

= T

民

给T

最大

中，除非另有说明。

符号

DAC

决议

单调性

DNL

INL

微分非线性

积分非线性

偏移误差

偏移误差温度

系数

满量程电压

温度COEF网络cient

正电源电压

电源电流

短路电流低

短路电流高

输出阻抗接地

输出线路调整

对于指定的性能

（注4 ）

OUT

接地短路

OUT

短到V

输入代码= 0

输入代码= 4095 V

= 4.5V至5.5V ，V

REF

= 4.096V

参数

条件

民

典型值

最大

单位

位

REF

≤

- 0.1V （注1 ）

REF

≤

- 0.1V （注1 ），T

= 25°C

REF

≤

- 0.1V （注1 ）

测量代码20 ，T

= 25°C

测量代码20

± 0.2

± 0.5

± 5.0

± 5.5

± 10

± 15

±15

REF

= 4.096V ，T

= 25°C

REF

= 4.096V

4.070

4.060

4.095

4.120

4.130

μV/°C

PPM /°C的

电源

2.7

450

0.2

5.5

700

120

1.5

LSB / V

运算放大器的直流性能

最低位

W W

LTC1448

电气特性

= 2.7V至5.5V ，V

OUT A

和V

OUT B

卸载， REF

≤

, T

= T

民

给T

最大

中，除非另有说明。

符号

参数

输出电压摆率

输出电压建立时间

数字馈通

参考输入

REF

数字I / O

泄漏

数字输入高电压

数字输入低电压

数字输入泄漏

数字输入电容

有效期至CLK建立

有效期至CLK保持

CLK高电平时间

CLK低的时间

CS / LD脉冲宽度

LSB CLK到CS / LD

CS / LD低到CLK

CLK低到CS / LD低

有效期至CLK建立

有效期至CLK保持

CLK高电平时间

CLK低的时间

CS / LD脉冲宽度

LSB CLK到CS / LD

CS / LD低到CLK

CLK低到CS / LD低

（注6 ）

= 5V

= 3V

= 5V

= 3V

= GND到V

（注6 ）

条件

民

0.5

典型值

1.0

0.3

最大

单位

V / μs的

纳伏s的

AC性能

（注2,3）到± 0.5LSB

参考输入电阻

REF输入范围

（注5,6）

7.5

2.4

2.0

12.5

0.8

0.6

± 10

开关（V

= 4.5V至5.5V ）

开关（V

= 2.7V至5.5V ）

该

表示该指标适合整个工作

温度范围。

注1 ：

非线性是从20码定义代码4095 （满量程）。

请参阅应用信息。

注2 ：

负载5K与100pF电容并联。

注3 ：

DAC开关全1，对应V之间的代码

对的部分。

注4 ：

在0V或V数字输入

注5 ：

OUT

只能从（ GND摆动+

)

到（Ⅴ

–

)

当

输出被卸载。

注6 。

通过设计保证，不受测试。

LTC1448

典型性能特性

积分非线性（ INL ）

INL误差（ LSB ）

DNL误差（ LSB ）

–1

–2

–3

–4

–5

512 1024 1536 2048 2560 3072 3584 4095

CODE

1448 G01

– V

OUT

(V)

最小输出电压VS

输出灌电流

800

输出下拉压（MV ）

CODE ：全0

700

电源电流（mA ）

600

125°C

500

400

300

–55°C

200

100

25°C

输出灌电流（mA）

引脚功能

CLK （引脚1 ）：

串行接口时钟。内部施密特触发

蒙古包在此输入可直接光耦接口。

（引脚2 ）：

串行接口数据。在D个数据

引脚

锁存到移位寄存器的串行的上升沿

时钟。

CS / LD （引脚3 ）：

串行接口使能和负荷控制。

当CS / LD低CLK信号被激活，因此数据

可移入。当CS / LD被拉高，数据是

从移位寄存器载入DAC寄存器

更新DAC输出与CLK被禁用

在内部。

REF （引脚4 ）：

参考输入的两个DAC 。该引脚可

连接到V

。输出摆幅会从0V至REF 。该

典型的输入阻抗为12.5K 。

OUT A

, V

OUT B

（管脚5,8）：

缓冲DAC输出。

GND （引脚6 ）：

地面上。

（引脚7 ）：

正电源输入。 2.7V

≤

5.5V.

需要一个旁路电容到地。

ü W

微分非线性（ DNL ）

0.5

0.4

0.3

0.2

0.1

–0.1

–0.2

–0.3

–0.4

–0.5

512 1024 1536 2048 2560 3072 3584 4095

CODE

1448 TA02

最低供应余量为

满摆幅输出与负载电流

0.8

0.7

0.6

0.5

0.4

0.3

0.2

0.1

负载电流（mA ）

1448 G03

OUT

< 1LSB

代码：全1

OUT

= 4.095V

供应电流与

逻辑输入电压

2.0

1.6

1.2

0.8

0.4

1448 G04

逻辑输入电压（ V）

1448 G06

LTC1448

BLOCK DIAGRA

CLK 1

DAC B

12-BIT

DAC B

OUT B

–

24-BIT

移

CS / LD 3

REF 4

DAC A

12-BIT

DAC A

GND

OUT A

–

POWER- ON

RESET

1448 BD

TI I G DIAGRA S

操作顺序

DAC A输入

最高位

D11

D10

LSB MSB

D11

D10

DAC B输入

最低位

CLK

CS / LD

（时钟使能）

（更新DAC输出）

1448 TD01

CLK

B0-B

前一个单词

B11-A

最高位

B0-A

最低位

B11-B

最高位

B0-B

最低位

CS / LD

1448 TD02