LM2507低功率移动像素链路（ MPL ） 0级， 16位CPU的显示接口串行器和
解串器
2006年8月
LM2507
低功率移动像素链路（ MPL ） 0级， 16位CPU
显示接口串行器和解串
概述
该LM2507装置采用I80 CPU风格的显示界面
在移动像素链路（ MPL ）的零级串行链路。当
使用智能CPU型接口，两个片选支持
主，副显示器。 A模式引脚器件配置为一
主站（MST）或从（SLV ），以便在同一芯片可用于
在界面的两侧上。
互连从21信号减少到只有3活性
与LM2507芯片的信号缓解柔性互连
设计，尺寸的限制和成本。
在MST模式的LM2507驻留在应用程序旁边，
图形或基带处理器和转换的并行
从LVCMOS电平串行移动像素链路电平车
传输柔性电缆（或同轴电缆）和PCB走线
在SLV位于显示器模块（S ）附近。
当POWER_DOWN （ PD * ）输入被置在中，主机
之三，在MDN和MC线路驱动器断电保存
电流。奴隶是由一个独立的POWER_DOWN控制
输入。
的LM2507实现MPL级的物理层
0标准（MPL -0）和一个150微安我
B
电流（ 0级） 。
特点
n
CPU的显示接口支持高达
800 x 300
1
2
SVGA格式
n
双显示器支持 - CS1
*
& CS2
*
n
使用两个数据，一个MPL- 0级的物理层
时钟信号
n
低功耗
n
引脚排列镜像能够直接通过与布局
最小导通孔
n
主机和显示器之间的电平转换
n
链接省电模式降低静态功耗
下
＆ LT ;
10 A
n
1.74V至2.0V核心/模拟电源电压范围
n
1.74V至3.0V的I / O电源电压范围
系统优势
n
n
n
n
小接口
低功耗
低EMI
内在的电平转换
典型应用图 - CPU模式
20186001
2006美国国家半导体公司
DS201860
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LM2507
引脚说明 - CPU
引脚名称
号
针脚数
1
1
1
1
2
2
9
1
I / O类型
（续）
描述
CPU主
（ MST）的
CPU从
（ SLV ）
电源/接地引脚
V
DDA
V
SSA
V
DDCORE
V
SSCORE
V
DDIO
V
SSIO
V
体积
DAP
动力
地
动力
地
动力
地
电源引脚的MST PLL和MPL接口。 1.74V至2.0V
接地引脚为MPL接口和模拟电路。
电源引脚的数字内核。 1.74V至2.0V
接地引脚为数字核心。
电源引脚并行接口I / O 。 1.74V至3.0V
接地引脚并行接口的I / O 。
连接至接地 - uArray套餐
连接至接地 - LLP封装
注意：
I =输入， O =输出， IO =输入/输出。
不浮动输入引脚。
订购信息
NSID
LM2507GR
LM2507SQ
套餐类型
49L微阵列， 4.0 X 4.0 X 1.0毫米，节距为0.5mm
40L LLP ， 5.0× 5.0 ×0.8毫米，间距为0.4mm
包ID
GRA49A
SQF40A
3
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LM2507
绝对最大额定值
（注1 ）
如果是用于军事/航空航天特定网络版设备是必需的，
请向美国国家半导体销售办事处/
经销商咨询具体可用性和规格。
电源电压（V
DDA
)
电源电压（V
DD
)
电源电压（V
DDIO
)
LVCMOS输入/输出电压
MPL的输入/输出电压
结温
储存温度
无铅焊接温度，
40秒
ESD额定值：
HBM ， 1.5 kΩ的， 100 pF的
EIAJ ， 0Ω ， 200 pF的
≥
±
2千伏
≥
±
200V
-0.3V至+ 2.2V
-0.3V至+ 2.2V
-0.3V至+ 3.6V
-0.3V到（V
DDIO
+0.3V)
-0.3V到V
DDA
+150C
-65 ° C至+ 150°C
+260C
最大封装功耗容量在25℃
GRA套餐
减免GRA套餐25℃以上
SQF套餐
减免SQF套餐25℃以上
1.8W
15mW/C
1.8W
15mW/C
推荐工作
条件
最小典型最大
电源电压
V
DDA
到V
SSA
和
V
DDCORE
到V
SSCORE
V
DDIO
到V
SSIO
时钟频率
环境温度
1.74 1.8
1.74
3
30
25
2.0
3.0
20
85
V
V
兆赫
C
单位
电气特性
在推荐，除非另有规定工作电源和温度范围内。 （注2,3）
符号
MPL
I
OLL
I
OMS
I
OLH
I
B
I
关闭
V
IH
V
IL
V
HY
I
IH
I
IL
V
OH
V
OL
I
DD
逻辑低电流（ 5X我
B
)
中秋节当期
（注4,9 ）
逻辑高电流（ 1X我
B
)
电流偏置
MPL漏电流
输入电压高电平
输入电压低电平
输入滞后
输入电流的高级别
输入电流低的水平
输出电压较高水平
输出电压低的水平
总供给
电流 - 已启用
条件： MC = 80 MHz时，
MD = 160 Mbps的
（注5 ） AAAA / 5555
I
OH
= -2毫安
I
OL
= 2毫安
主
V
DDIO
V
DD
/V
DDA
SLAVE
V
DDIO
V
DD
/V
DDA
V
DDIO
= 1.74V
V
DDIO
= 3.0V
包括我
OZ
VIN = V
DDIO
VIN = GND
1
1
0.75
V
DDIO
V
SSIO
0.02
5
4
6
V
MPL
= 0.8V
2
0.7 V
DDIO
GND
150
200
0
0
+1
+1
V
DDIO
0.2 V
DDIO
0.07
11
10
11
3.67 I
B
2.1I
B
0.7 I
B
5.0 I
B
3.0 I
B
1.0 I
B
150
+2
V
DDIO
0.3 V
DDIO
6.33 I
B
3.9I
B
1.4 I
B
A
A
A
A
A
V
V
mV
mV
A
A
V
V
mA
mA
mA
mA
参数
条件
民
典型值
最大
单位
LVCMOS （ 1.74V至3.0V操作）
电源电流
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4
LM2507
电气特性
符号
I
DDZ
参数
电源电流 - 禁用
T
A
= 25C
省电模式
电源电流
（续）
在推荐，除非另有规定工作电源和温度范围内。 （注2,3）
条件
MST
PD * = L
SLV
PD * = L
V
DDIO
V
DD
/V
DDA
V
DDIO
V
DD
/V
DDA
民
典型值
最大
2
2.2
2
2.2
单位
A
A
A
A
＆ LT ;
1
＆ LT ;
1
＆ LT ;
1
＆ LT ;
1
开关特性
在推荐，除非另有规定工作电源和温度范围内。 （注2 ）
符号
t
SET
t
HOLD
t
上升
参数
成立时间
保持时间
上升时间
边沿触发
仅输出，
（注6 ）
C
L
= 15 pF的，
图2
SLV输入
图1
V
DDIO
= 1.74V
V
DDIO
= 3.0V
V
DDIO
= 1.74V
V
DDIO
= 3.0V
MC = 80MHz的
（注9 ）
条件
民
5
5
7
3
7
2
15.5
6.5
15.5
6
典型值
最大
单位
ns
ns
ns
ns
ns
ns
并行总线时序见
t
秋天
下降时间
串行总线时序
t
DVBC
t
DVAC
串行数据才有效
时钟（设定时间）
经过有效的串行数据
时钟（保持时间）
MST PLL锁定计数器
MC脉冲宽度低
MC脉冲宽度高
MC H- L到空闲状态
1.5
1.5
ns
ns
上电时序
t
0
t
1
t
2
t
3
4,096
180
180
180
CLK
周期
MC
周期
MC
周期
MC
周期
MPL POWER OFF时序
t
拉巴斯
关闭时间为动力
下
（注8）
2
ms
推荐的输入时序要求
在推荐，除非另有规定工作电源和温度范围内。 （注2 ）
符号
f
t
CP
CLK
DC
t
T
参数
时钟频率
时钟周期
时钟占空比
时钟/数据转换
时间（上升或下降，
10%–90%)
（注7 ）
条件
民
3
50
30
2
50
典型值
最大
20
333
70
单位
兆赫
ns
%
ns
主基准时钟（CLK ）
注1 ：
“绝对最大额定值”是那些价值超过该设备的安全性不能得到保证。它们不意味着暗示该设备
应该在这些限制条件下运行。的“电气特性”表中指定的设备运行状况。
注2 ：
典型值给出了V
DDIO
= 1.8V和V
DD
= V
DDA
= 1.8V和T
A
= 25C.
注3 ：
电流转换成设备引脚被定义为正。当期开出的器件引脚定义为负。电压以地为参考，除非另有
指定的。
注4 ：
MPL的电流阈值被设定为3XI
B
通过对MPL启动序列 - 这是只有一个功能规范。
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