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LF2247

设备公司

与系数RAM图像过滤器

LF2247

设备公司

与系数RAM图像过滤器

描述

该

LF2247

由四个阵列的

11注册×10位乘法器

其次是一个夏天和一个25位的

累加器。该LF2247提供

包含四个系数寄存器文件

32 ×11位寄存器，其能够

存储32组不同的过滤器的

系数乘法器阵列。

所有乘数数据输入是用户

访问，可以每天进行更新

时钟周期，无论是分数或

整数2的补码数据。该

流水线结构有充分

注册输入和输出端口和

异步三态输出

使能控制，以简化设计

的复杂的系统。该管道

潜伏期为所有输入为5个时钟

周期。

一个25位累加器路径允许

累计字增长，可

在内部舍入到16位。

输出数据被更新每个时钟

周期和下用户可以保持

控制权。的数据输入/输出和

控制输入被登记在

上升CLK的边缘。该串行数据

信号， SDIN ，被登记在

特点

66 MHz的数据输入和Compu-

塔季翁率

四个11 ×10位乘法器与

个人数据和系数

输入和25位累加器

4个32 ×11位串行可加载

系数寄存器

小数或整数的两个的

补操作数

封装类型：

84引脚PLCC ， J形引线

100引脚PQFP

LF2247 B

LOCK

IAGRAM

ENBA

4-0

系数寄存器文件

SDIN

SEN

SCLK

9-0

ENB

系数

注册1

（32× 11位）的

SEN

SCLK

9-0

ENB

系数

注册2

（32× 11位）的

SEN

SCLK

9-0

ENB

系数

寄存器3

（32× 11位）的

SEN

SCLK

9-0

ENB

系数

注册4

（32× 11位）的

加

OCEN

FSEL

OEN

CLK

所有的寄存器

（ EXCEPT系数寄存器）

15-0

视频影像产品

08/16/2000–LDS.2247-H

LF2247

设备公司

与系数RAM图像过滤器

输入

9-0

– D4

9-0

- 数据输入

IGURE

NPUT

ORMATS

数据

系数

小数补码（ FSEL = 0 ）

9 8 7

–2

–1

–2

（登录）

2 1 0

–7

–8

–9

10 9 8

–2

–1

（登录）

2 1 0

–7

–8

–9

D1D4是第10位的注册数据

输入端口。数据被锁存的

上升CLK的边缘。

4-0

- 行地址

4-0

确定的数据，其中行

系数寄存器文件用于

数据传送到乘法器阵列。一

4-0

被锁定在CLK的上升沿。

当一个新的行地址被加载

入行地址寄存器，数据

从寄存器文件将被锁存

到乘法器输入寄存器上

CLK的下一个上升沿。

SDIN - 串行数据输入

SDIN用于串行数据加载到

系数寄存器。目前的数据

上SDIN移入系数

在SCLK的上升沿寄存器文件

当SEN低。 11位coeffi-

cients被加载到系数

寄存器中的16位字的文件，如图

在图2中的五个最显著

在第一个16位字的比特确定

该行中的数据被写入到在

系数寄存器。注意，五

剩余的最显著位

3个16位字被忽略。后

所有4个16位字被转移到

寄存器文件中，低11位

每个单词（系数数据）的是

存储到系数寄存器。

输出

15-0

- 数据输出

15-0

是16位的注册数据

输出端口。

控制

ENB

-ENB

- 数据输入启用

该ENB

(

= 1， 2，3，或4）输入

允许的DN寄存器被更新

在每个时钟周期。当ENB

在DN低，数据

9-0

被锁存到

整数补码（ FSEL = 1 ）

9 8 7

–2

（登录）

2 1 0

10 9 8

–2

（登录）

2 1 0

IGURE

安输出

ORMATS

小数补码（ FSEL = 0 ）

15 14 13 12 11 10 9 8 7 6 5 4 3 2 1 0

–2

–1

–2

–3

–4

–5

–6

–7

–8

–9

（登录）

整数补码（ FSEL = 1 ）

15 14 13 12 11 10 9 8 7 6 5 4 3 2 1 0

–2

（登录）

个SCLK上升沿。该LF2247

工作在66 MHz的时钟速率

在整个温度和电源

电压范围。

的LF2247适用于perform-

在图像荷兰国际集团像素插值

处理和过滤的应用

系统蒸发散。的LF2247可以执行

的图像的双线性插值（ 4-

像素内核）的实时视频率

具有图像重采样时使用

音序器。大粒以上

复杂的功能可以由实现

利用多个设备。

不受限制地访问所有数据端口

和一个可寻址寄存器系数

文件提供了consid-的LF2247

在应用例如erable灵活性

作为数字滤波器，自适应FIR滤波器，

混频器，以及其他类似的系统

需要高速处理。

信号定义

动力

和GND

+ 5V电源。所有引脚必须

连接。

钟

CLK - 主时钟

CLK的上升沿选通所有

除使能寄存器

系数寄存器。

SCLK - 串行时钟

SCLK的上升沿数据转移

进入和通过系数

当启用了它的注册文件

串行数据移位。

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-2

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IGURE

ERIAL

ATA

ORMAT

第一个16位字

第二个16位字

上的上升沿的DN寄存器

CLK 。当ENB

为高电平时，数据就

9-0

不会被锁存到的DN

注册和登记内容将

不能改变。

ENBA - 行地址输入使能

该ENBA输入允许的行

地址寄存器进行更新每个

时钟周期。当ENBA为低，

在数据

4-0

被锁存到行

上的上升沿地址寄存器

CLK 。当ENBA为高电平时，数据就

4-0

不会被锁存到行

地址寄存器中，寄存器

内容也不会被改变。

OEN - 输出使能

当OEN为低电平，S

15-0

已启用

为输出。当OEN为高电平，S

15-0

被置于高阻抗状态。

OCEN - 时钟使能

当OCEN为低时，在预数据

多路转换器寄存器（累加器输出）是

上装入输出寄存器

CLK的一个上升沿。当OCEN

为高电平时，在预多路复用器寄存器数据

被保持防止输出

从改变寄存器的内容（如果

FSEL不会改变）。积累

继续在内部，只要是行政协调会

高，尽管OCEN的状态。

FSEL - 格式选择

当FSEL为低电平时，数据输入

在当前时钟周期是

假定是在分数2的

补码格式，和上部16

累加器的位送到

在输出上。圆的

累加器的结果为16位，是per-

1 2 3 4 5 6 7 8 9 10 11 12 13 14 15 16 17 18 19 20 21 22 23 24 25 26 27 28 29 30 31 32

0 0 0 1 0 1 1 1 1 1 1 0 1 1 0 0 X X X X X 0 0 0 1 0 0 0 1 1 0 0

ROW

地址

数据

系数寄存器4

别

CARES

数据

系数寄存器3

第三16位字

第四个16位字

33 34 35 36 37 38 39 40 41 42 43 44 45 46 47 48 49 50 51 52 53 54 55 56 57 58 59 60 61 62 63 64

X X X X X 0 0 1 1 0 1 0 0 1 0 0 X X X X X 1 1 1 1 1 1 0 0 1 0 0

别

CARES

数据

系数寄存器2

别

CARES

数据

注册系数1

显示的是串行数据流带载行地址2 ：

系数寄存器1 = 7E4

系数寄存器2 = 1A4

系数寄存器3 = 08C

系数寄存器4 = 7EC

如果蓄压器控制形成

输入ACC低。当FSEL是

高电平时，输入的数据被假定为

在整数二进制补码格式，

和积聚的低16位

器呈现在输出端。没有

舍时FSEL是执行

高。

ACC - 蓄电池控制

在ACC输入决定是否

内部积累进行对

在当前过程中的数据输入

时钟周期。如果ACC低，无

积累被执行时，在现有

累加和清零，并且

产品电流之和输出。如果

FSEL也低，二分之一的LSB

舍入为16位进行上

结果。当ACC为高电平时，

新兴的产品被加入到总和

以前的产品，没有

另外四舍五入。

SEN - 串行输入使能

森输入使能的转移

通过在该寄存器中的串行数据

系数寄存器文件。当森

在SDIN低，串行数据移位

成的系数寄存器文件

个SCLK上升沿。 SEN绝

保持低电平，直到所有四个系数

已移入。 SEN不

需要次连续之间进行脉冲

略去数据集。它可以保持低

而整个寄存器堆装

由一个恒定的比特流。当森

高电平时，数据不能被移入

寄存器文件和文件寄存器的

内容也不会被改变。当

有利的系数寄存器文件

串行数据输入端，所述LF2247需要

一个HIGH到SEN的低过渡

才能正常工作。因此，

SEN需要设置高被立即

后ately电源，以确保适当的

串行输入电路的操作。

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AXIMUM

ATINGS

以上这些有用的生命可能受到损害（注1 ， 2 ， 3 ， 8 ）

储存温度........................................................................................................... -65 ° C至+ 150°C

工作环境温度............................................... ............................................ -55 ° C至+ 125°C

电源电压相对于地............................................ ................................ -0.5 V至7.0 V

输入信号相对于地............................................ ................................... -0.5 V到V

+ 0.5 V

信号应用于高阻抗输出............................................ .......................... -0.5 V到V

+ 0.5 V

输出电流转换成低输出............................................................................................................. 25毫安

闭锁电流............................................................................................................................... > 400毫安

操作摄像机

ONDITIONS

为了满足规定的电气和开关特性

模式

积极运作，商业

积极运作，军事

温度范围

（环境）

0 ° C至+ 70°C

-55 ° C至+ 125°C

供应

电压

4.75 V

≤

5.25 V

4.50 V

≤

5.50 V

LECTRICAL

极特

在工作条件（注4 ）

符号

CC1

CC2

OUT

参数

输出高电压

输出低电压

输入高电压

输入低电压

输入电流

输出漏电流

目前，动态

目前，静态

输入电容

输出电容

（注3）

测试条件

=最小值，

= -2.0毫安

=最小值，

= 4.0毫安

民

2.4

典型值

最大

单位

0.4

2.0

0.0

0.8

±10

±40

100

6.0

地

≤

（注12 ）

地

≤

OUT

≤

（注12 ）

（注5,6）

（注7 ）

= 25 ° C，F = 1兆赫

视频影像产品

-4

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432109876543210987654321

ISCONTINUED

撒尿

RADE

符号

15-0

高阻抗

1098765432109876543210987654321

民

6543210987654321

民

设备公司

ILITARY

操作摄像机

ANGE

（ -55 ° C至+ 125°C ）

笔记9,10 （纳秒）

OMMERCIAL

操作摄像机

ANGE

（ 0 ° C至+ 70 ° C）

笔记9,10 （纳秒）

魔力

AVEFORMS

开关特性

ENA

DIS

威尔斯亲王医院

PWL

CYC

ENA

DIS

威尔斯亲王医院

PWL

CYC

控制

（除OEN ）

9-0

– D4

9-0

OEN

三态输出使能延迟

（注11 ）

三态输出禁用延迟

（注11 ）

输出延迟

输入保持时间

输入建立时间

时钟脉冲宽度高

时钟脉冲宽度低

周期

参数

三态输出使能延迟

（注11 ）

三态输出禁用延迟

（注11 ）

输出延迟

输入保持时间

输入建立时间

时钟脉冲宽度高

时钟脉冲宽度低

周期

CLK

4-0

N+1

ATA

I / O

N+1

N+2

DIS

威尔斯亲王医院

CYC

ENA

PWL

与系数RAM图像过滤器

33*

最大

N–1

视频影像产品

民

LF2247–

33*

最大

LF2247–

民

08/16/2000–LDS.2247-H

LF2247

25*

N+1

最大