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CMOS LSI
LC895925
信号处理LSI的CD-R驱动器
Preliminaly
概观
该LC895925提供了以下的信号处理
对于CD -R驱动器的功能： CD - ROM解码/编码
（完成与ECC处理前） ，子码
解码/编码，光盘编码， ATIP解码， CLV
伺服和SCSI接口寄存器。
1到32兆之间的缓冲内存大小（使用16
位的DRAM ）
在光盘主渠道， C2标志的大小用户控制，
并且在缓冲RAM中的子码区域
内置批量传送功能传送整个
光盘主要通道， C2标志，或者在一个单一的子码区
手术
内置多块传输函数传递
在一个操作中的多个块
注意事项：
1.使用20 MHz的主频达到一个SCSI主时钟
到8倍。
2.使用的17.2872 MHz的一个SCSI主时钟
速度最高可达4倍。
特点
CD -ROM解码/编码完全错误
检测和纠错
子码解码/编码完全错误
更正
ATIP解码和CRC校验两种编码
和解码
编码过程中使用ATIP数据CLV伺服控制
保监会代码中插入和EFM调制
编码
编码过程中的PCA随机EFM输出支持
支持可重写CD （ CD - RW ）写入策略
信号输出
获得通过缓冲来自微控制器的RAM
LC895925
内置SCSI接口
12× ，用于解码和4×用于编码转速
- 频率
解码： 17.2872 MHz的
编码： 17.2872 MHz的不写策略
支持
69.1488 MHz的写策略
支持
房车接送10兆字节/秒（同步）和5速
兆字节/秒（异步）与16 80纳秒的DRAM * 1
包装尺寸
单位：mm
3153A-QFP160E
[LC895925]
三洋： QIP160E
三洋电机有限公司。半导体公司经营业务总部
东京办事处东京大厦。 ， 1-10 ， 1丁目，上野，台东区，东京， 110-0005 JAPAN
D1997RM （ OT ）第5784-1 / 7
LC895925
特定网络阳离子
最大额定值
在Ta = 25 ° C，V
SS
= 0 V
参数
最大电源电压
I / O电压
最大功率耗散
工作温度
储存温度
阻焊
符号
V
DD
最大
V
I
, V
O
钯最大
TOPR
TSTG
10秒
Ta
≤
70°C
条件
评级
-0.3到+7.0
-0.3到V
DD
+0.3
600
-30至+70
-55到+125
260
单位
V
V
mW
°C
°C
°C
允许的工作范围
在Ta = -30 + 70 ° C，V
SS
= 0 V
参数
电源电压
输入电压范围
符号
V
DD
V
IN
条件
评级
民
4.5
0
典型值
5.0
最大
5.5
V
DD
单位
V
V
DC特性
在Ta = -30 + 70 ° C，V
SS
= 0 V, V
DD
= 4.5 5.5 V
参数
输入高电平电压
输入低电平电压
输入高电平电压
输入低电平电压
输入高“电平电压
输入低电平电压
输出高电平电压
输出低电平电压
输出高电平电压
输出低电平电压
输出高电平电压
输出低电平电压
输出低电平电压
输入漏电流
上拉电阻
上述销的类型指的是下述基团。
符号
V
IH
V
IL
V
IH
V
IL
V
IH
V
IL
V
OH
V
OL
V
OH
V
OL
V
OH
V
OL
V
OL
I
IL
R
UP
条件
评级
民
2.2
0.8
2.2
0.8
2.5
0.6
V
DD
– 2.1
0.4
V
DD
– 2.1
0.4
V
DD
– 2.1
0.4
0.4
–10
40
80
+10
160
典型值
最大
单位
V
V
V
V
V
V
V
V
V
V
V
V
V
A
k
TTL电平，引脚类型1和6
TTL电平，为针型4，具有上拉电阻
TTL电平，引脚0和7 ，与施密特输入
I
OH
= -2 mA，用于针型3
I
OL
= 2 mA，用于针型3
I
OH
= -2 mA，用于销的类型2 ，图4和6
I
OL
= 2毫安，对于销类型2,4 ，和6
I
OH
= -48 mA，用于针型7
I
OL
= 48 mA，用于针型7
I
OL
= 2 mA，用于针型5
V
I
= V
SS
, V
DD
为销型0,1， 5,6和7
对于引脚类型4和5
输入
（ 0 ） BCK ， BICLKIN ， BIDATAI ， C2PO ， LOCKIN ， LRCK ， PLLOUTIN ，粗糙， SBSO ， SCOR ， SDATA ， WFCK ， CS ，
RD ， WR
（ 1 ） SUA0到SUA6 ， TEST0到TEST6 ， X1EN ， RESET
产量
（2）的CLV
+
， CLV
–
， FSW
（ 3 ） DATACKO ， EFM ， EFMG ， EFMGATE0到EFMGATE6 ， EXCK ， LOCK ， MCK ， MON ， PSUBSYNC ， RA0到RA9 ，
SUBSYNC ， CAS0到CAS1 ， RAS0到RAS1 ， ERROR ， EXTACK ， FRCK ， LWE ，西英格兰大学， OE
输入/输出
（4） D0到D7， IO0至IO15
（ 5 ）为INT0 INT1 ， SWAIT
（ 6 ） ATIPSYNC ， Reserve0到Reserve5
（ 7 ） ACK ， ATN ， BSY ，C / D ， DB0到DB7 ， DBP ， I / O ，味精， REQ ， RST ， SEL
注： XTAL0 ， XTAL1 ， XTALCK0和XTALCK1针落在这些DC性能规格之外。
第5784-2 / 7
LC895925
框图
*1
*2
*3
*4
*6
*7
*8
*9
*10
*11
*12
WFCK ， SBSO ， SCOR
BCK ， SDATA ， LRCK ， C2PO
DB0到DB7 ， DBP ， BSY ，味精， SEL ， RST ， REQ ， I / O，C / D
ACK ， ATN
RD ， WR ， SUA0到SUA6 ， CS
D0到D7
IO0到IO15
RA0到RA9 ， RAS0 ， RAS1 ， CAS0 ， CAS1 ， OE ，西英格兰大学， LWE
PLLOUTIN ，粗糙， LOCKIN ， BICLKIN ， BIDATAIN
ERROR ， LOCK ， CLV
+
（MDP） ， CLV
–
（ MDS ） ， MON ， FSW
SUBSYNC ， PSUBSYNC ， FRCK ， EFM ， EFMG ， EFMGATE3到EFMGATE0 ， EXTACK ， DATACK0
第5784-3 / 7
LC895925
引脚说明
类型：I ：输入脚，O：输出引脚，B ：双向引脚，P ：电源引脚， N：无连接引脚
引脚数
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
25
26
27
28
29
30
31
32
33
34
35
36
37
38
39
40
41
引脚名称
V
SS
Reserve0
Reserve1
Reserve2
TEST1
XTALCK0
XTAL0
TEST2
MCK
TEST3
XTALCK1
XTAL1
TEST4
V
DD
V
SS
CLV
+
（MDP）
CLV
–
（ MDS）的
MON
FSW
V
DD
V
SS
PLLOUTIN
粗
lockin
LOCK
错误
ATIPSYNC
BIDATAI
BICLKIN
V
DD
IO0
IO1
IO2
IO3
IO4
IO5
IO6
IO7
IO8
V
DD
V
SS
TYPE
P
B
B
B
I
I
O
I
O
I
I
O
I
P
P
O
O
O
O
P
P
I
I
I
O
O
B
I
I
P
B
B
B
B
B
B
B
B
B
P
P
对于ROM编码器/解码器的缓冲区RAM中的数据信号引脚，上拉电阻
摆动信号载波时钟输入引脚
粗糙的CLV伺服摆动信号输入引脚
CD解码器锁定信号输入引脚
CLV伺服锁定监控引脚
ATIP奇偶校验错误检测引脚
ATIP同步信号I / O引脚
双相数据输入引脚
双相数据传输时钟输入引脚
CLV伺服信号输出引脚
保留为将来扩展（悬空）
保留为将来扩展（连接到地面）
保留为将来扩展（连接到地面）
测试引脚（连接到V
SS
)
晶体振荡器电路的输入引脚（ 17.2872至69.1488兆赫）
晶振电路输出引脚
测试引脚（连接到V
SS
)
主时钟输出引脚
测试引脚（连接到V
SS
)
晶体振荡器电路的输入引脚（ 20兆赫）
晶振电路输出引脚
测试引脚（连接到V
SS
)
描述
接下页。
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LC895925
从接下页。
类型：I ：输入脚，O：输出引脚，B ：双向引脚，P ：电源引脚， N：无连接引脚
引脚数
42
43
44
45
46
47
48
49
50
51
52
53
54
55
56
57
58
59
60
61
62
63
64
65
66
67
68
69
70
71
72
73
74
75
76
77
78
79
80
81
82
83
84
85
86
87
88
89
引脚名称
IO9
IO10
IO11
IO12
IO13
IO14
IO15
V
SS
RA0
RA1
RA2
RA3
RA4
RA5
RA6
RA7
RA8
RA9
V
DD
V
SS
RAS0
RAS1
CAS0
CAS1
OE
UWE
LWE
TEST0
V
DD
EXCK
WFCK
SBSO
SCOR
V
SS
BCK
SDATA
LRCK
C2PO
V
DD
V
SS
DB0
DB1
V
DD
DB2
DB3
VSS
DB4
DB5
TYPE
B
B
B
B
B
B
B
P
O
O
O
O
O
O
O
O
O
O
P
P
O
O
O
O
O
O
O
I
P
O
I
I
I
P
I
I
I
I
P
P
B
B
P
B
B
P
B
B
SCSI销
SCSI销
SCSI销
串行数据输入时钟输入引脚
串行数据输入管脚
44.1 kHz的选通脉冲信号输入引脚
C2指针输入引脚
子码数据读取移位时钟输出引脚
子码帧同步输入引脚
子码的串行数据输入管脚
子码块同步输入引脚
DRAM的RAS信号输出引脚
对于ROM的编码器/解码器的DRAM地址信号引脚
对于ROM编码器/解码器，DRAM数据信号引脚，上拉电阻
描述
DRAM的CAS信号输出引脚
DRAM的输出使能信号输出端子
DRAM输出上写使能信号输出引脚
DRAM产出较低的写使能信号输出引脚
测试引脚（连接到V
SS
)
接下页。
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