【K4B4G0446BK4B4G0846BDDP的4Gb DDR3 SDRAMDDP的4Gb B-死D】,IC型号K4B4G0846B-MCF7,K4B4G0846B-MCF7 PDF资料,K4B4G0846B-MCF7经销商,ic,电子元器件-51电子网

K4B4G0446B

K4B4G0846B

DDP的4Gb DDR3 SDRAM

DDP的4Gb B-死DDR3 SDRAM规格

78 FBGA无铅&无卤

（符合RoHS ）

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1.0版2009年3月

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DDP的4Gb DDR3 SDRAM

YEAR

2009

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1.0

MONTH

三月

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1.0版2009年3月

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DDP的4Gb DDR3 SDRAM

1.0订购信息...................................................................................................................五

2.0主要特点................................................................................................................................五

3.0封装引脚/机械尺寸&地址.......................................... .................. 6

3.1 X4 DDP封装引脚（顶视图）： 78ball FBGA封装

.............................................................. 6

3.2 x8的DDP封装引脚（顶视图）： 78ball FBGA封装

.............................................................. 7

3.3 FBGA封装尺寸（ X4）

..................................................................................................... 8

3.4 FBGA封装尺寸（ X8 ）

..................................................................................................... 9

4.0输入/输出功能描述............................................ ........................................... 10

5.0 DDR3 SDRAM地址........................................................................................................ 11

6.0绝对最大额定值...................................................................................................... 12

6.1绝对最大额定直流电压

................................................................................................... 12

6.2 DRAM元件工作温度范围

......................................................................... 12

7.0交流& DC操作条件............................................ .................................................. .. 12

7.1建议的直流工作条件（ SSTL_1.5 ）

..................................................................... 12

8.0交流&直流输入测量级别........................................... ............................................. 13

8.1交流和直流逻辑输入电平为单端singnals

................................................................ 13

8.2 VREF公差

....................................................................................................................... 14

8.3交流和直流逻辑输入电平为Ditterential信号

................................................................... 15

8.3.1差分信号定义

................................................................................................ 15

8.3.2差分摆幅要求时钟（ CK - CK）和选通脉冲（ DQS - DQS ）

.............................. 15

差分信号8.3.3单端的要求

................................................................. 16

8.4差分输入交叉点电压

.......................................................................................... 17

8.5压摆率的定义为单端输入信号

...................................................................... 17

对于差分输入信号8.6压摆率的定义

........................................................................... 17

9.0交流和直流输出测量水平........................................... ...................................... 18

9.1单端交流和直流输出电平

....................................................................................... 18

9.2差分交流和直流输出电平

.......................................................................................... 18

9.3单端输出压摆率

................................................................................................... 18

9.4差分输出摆率

...................................................................................................... 19

9.5参考负载的AC时序和输出摆率

.................................................................... 19

9.6过冲/下冲规格

........................................................................................... 20

9.6.1地址和控制过冲和下冲规格

............................................. 20

9.6.2时钟，数据，选通和面具过冲和下冲规格

................................. 20

9.7 34欧姆输出驱动器的直流电气特性

....................................................................... 21

................................................................. 22

9.8片上端接（ ODT）水平和IV特性

............................................................... 22

9.8.1 ODT DC电气特性

........................................................................................ 23

9.8.2 ODT温度和电压灵敏度

............................................................................. 24

9.7.1输出驱动温度和电压灵敏度

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9.9 ODT时序定义

DDP的4Gb DDR3 SDRAM

.............................................................................................................. 25

9.9.1测试负载的ODT计时

................................................................................................. 25

9.9.2 ODT时序定义

........................................................................................................ 25

10.0 IDD规格参数和测试条件........................................... .................. 28

10.1 IDD测量条件

.................................................................................................... 28

10.2 IDD规格定义

..................................................................................................... 30

11.0 DDP 4GB DDR3 SDRAM B-模具IDD规格表....................................... .............................. 37

12.0输入/输出电容....................................................................................................... 38

13.0电气特性和AC到DDR3-1600时序DDR3-800 .............................. 39

13.1时钟规格

............................................................................................................. 39

13.1.1定义为TCK （ AVG）

..................................................................................................... 39

13.1.2定义为TCK （ABS ）

..................................................................................................... 39

13.1.3定义为总胆固醇（ AVG）和TCL （ AVG）

................................................................................... 39

13.1.4定义的音符tJIT （元）， tJIT （元，伊克）

........................................................................ 39

...................................................................................... 39

13.1.6定义为TERR （ NPER ）

................................................................................................... 39

通过器件密度13.2刷新参数

....................................................................................... 40

13.3速箱和CL ， tRCD的，激进党，真相与和解委员会tRAS的相应斌

............................................. 40

13.3.1转速表斌Notes...........................................................................................................................

13.1.5定义为tJIT （CC ）， tJIT （CC ，伊克）

由速度等级14.0时序参数............................................ .......................................... 44

14.1抖动注意事项

............................................................................................................................. 47

14.2时序参数说明

........................................................................................................... 48

14.3地址/命令设置，保持和降额：

........................................................................... 49

14.4数据建立，保持和压摆率降额：

.................................................................................. 55

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1.0订购信息

【表1】三星DDP 4GB DDR3 B-死订购信息表

组织

1Gx4

512Mx8

DDR3-800 （ 6-6-6 ）

K4B4G0446B-MCF7

K4B4G0846B-MCF7

DDR3-1066 （ 7-7-7 ）

K4B4G0446B-MCF8

K4B4G0846B-MCF8

DDP的4Gb DDR3 SDRAM

DDR3-1333 （ 9-9-9 ）

K4B4G0446B-MCH9

K4B4G0846B-MCH9

包

78 FBGA

注意：

1.速度斌是为了CL- tRCD的-TRP的。

2.0主要特点

[表2]的DDP的4Gb DDR3乙型模速箱

速度

TCK （分钟）

CAS延迟

的tRCD （MIN）

激进党（分钟）

tRAS的（分）

的tRC （分钟）

DDR3-800

6-6-6

2.5

37.5

52.5

DDR3-1066

7-7-7

1.875

13.125

37.5

50.625

DDR3-1333

9-9-9

1.5

13.5

49.5

单位

NCK

JEDEC标准的1.5V ± 0.075V电源

DDQ

= 1.5V ± 0.075V

400 MHz的F

为800MB /秒/针， 533 F

为1066MB /秒/针，

667 F

为1333Mb /秒/针

8银行

中科院发布

可编程CAS延迟（ CAS贴）： 6 ， 7 ， 8 ， 9 ， 10

可编程的附加延迟： 0 ， CL -2或CL- 1的时钟

可编程CAS延迟写入（CWL ） = 5 （ DDR3-800 ）， 6

（ DDR3-1066 ）和7 （ DDR3-1333 ）

8位预取

突发长度： 8 （交错，没有任何限制，顺序与出发

地址为“ 000”只）， 4 TCCD = 4不允许无缝

读或写[无论是在使用A12或MRS飞]

双向差分数据选通

内部（个体经营）校准：通过ZQ引脚内部自校准

（ RZQ ：240欧姆± 1％）的

片上终端使用ODT引脚

平均更新周期7.8us时于T低

例

85°C ，在3.9us

85°C <牛逼

例

< 95

°C

异步复位

封装： 78球FBGA - X4 / X8

所有无铅产品符合RoHS指令的

所有的产品都是无卤

民进党4GB DDR3 SDRAM B-模具是作为一个128Mbit的×4 I / OS X

8banks ， 64Mbit的×8个I / O X 8banks 。该同步装置实现高

高达1333Mb /秒/针的速度双倍数据率传输速率（ DDR3-

1333 ）的一般应用。

该芯片的设计符合以下关键DDR3 SDRAM为特色的

Tures的，如贴CAS ，可编程CWL ，内部（自我）的校准

化，在使用ODT引脚和异步复位片内终结。

所有的控制和地址输入端的一对克斯特同步

应受供应差分时钟。输入被锁定在昼夜温差的交叉点

髓鞘时钟（ CK上升沿和CK下降）。所有的I / O与同步

对双向选通（DQS和DQS ）在源同步fash-

离子。地址总线用于传送行，列和行地址

在一个RAS / CAS复样式的信息。在DDR3器件工作

用单1.5V ± 0.075V电源和1.5V ± 0.075VV

DDQ

4GB的DDR3 B-模具设备处于78ball FBGAs （ X4 / X8 ）提供。

注： 1，功能描述包含了时序规范

本数据手册对操作的DLL启用模式。

注：本数据手册是全DDR3规格的抽象，并不包括在“ DDR3 SDRAM器件的描述的共同特征

操作&时序图“ 。

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