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可编程逻辑器件3256A
在系统可编程高密度PLD
特点
高密度可编程逻辑
- 128个I / O引脚
- 11000 PLD盖茨
- 384寄存器
- 高速全球互联
- 宽输入选通高速计数器,国家
机,地址解码器等
- 小逻辑块大小为随机逻辑
高性能é
2
CMOS
技术
f
最大
= 90 MHz的最高工作频率
t
pd
= 12 ns的传播延迟
TTL兼容的输入和输出
- 电可擦除和可重复编程
- 非易失性
- 100%测试在制造时
- 未使用的产品长期关机节省电源
在系统可编程
- 5V在系统可编程( ISP )用格子
ISP或边界扫描测试( IEEE 1149.1 )协议
- 提高生产良率,减少时间用于─
市场和提高产品质量
- 重新编程锡焊设备的快速调试
100 %的IEEE 1149.1边界扫描兼容
提供使用和快速的系统的易用性
可编程逻辑器件速度与密度和灵活性
现场可编程门阵列
- 完整的可编程器件可以结合胶
逻辑和结构化设计
- 增强的引脚锁定功能
- 五个专用时钟输入引脚
- 同步和异步时钟
- 可编程的输出压摆率控制要最大
程度降低开关噪声
- 灵活的引脚布局
- 优化的全球路由池提供全球
互联
ispDesignEXPERT - 逻辑编译器和COM-
完整的ISP器件设计系统免受高密度脂蛋白
合成THROUGH在系统编程
- 业绩卓越的品质
- 紧密集成了领先的CAE供应商工具
- 提高生产率的时序分析,探索
工具,时序仿真和ispANALYZER
- PC和UNIX平台
功能框图
输出路由池
H3
输出路由池
输出路由池
G3
Q
H2
H1
H0
G2
G1
G0
边界
扫描
A1
A2
和阵列
OR
ARRAY
Q
F2
F1
双胞胎
GLB
F0
Q
Q
A3
Q
OR
输出路由池
Q
ARRAY
Q
B1
B2
Q
E2
E1
全球路由池
B3
C0
C1
C2
C3
D0
D1
D2
D3
E0
输出路由池
输出路由池
0139A
描述
所述可编程逻辑器件3256A是一个高密度可编程逻辑
含384寄存器, 128通用I / O引脚器件,
5专用时钟输入管脚,八个输出路由
池( ORP)和全球路由池( GRP )的
允许所有的这些之间完全相互连通
元素。在系统可编程逻辑器件3256A配备5V的系统
可编程性和系统诊断功能。
在系统可编程逻辑器件3256A提供非易失性可重编程
的逻辑,以及互连,以提供真正的
可重构系统。
逻辑的可编程逻辑器件3256A设备上的基本单位是
双床通用逻辑块( GLB双床)标记的A0 , A1 ... H3 。
总共有32双床GLBs在系统可编程逻辑器件3256A是
装置。每双GLB有24个输入,一个可编程
与门阵列和两个或/异或阵列,和八
可配置的输出是任combinato-
里亚尔或注册。所有双GLB的输入来自
GRP 。
版权所有1999莱迪思半导体公司的所有品牌或产品名称均为其各自所有者的注册商标。此处的规格和信息如有
更改,恕不另行通知。
莱迪思半导体股份有限公司, 5555东北摩尔的Ct 。 ,俄勒冈州希尔斯伯勒97124 , USA
电话: ( 503 ) 268-8000 ; 1-800- LATTICE ;传真( 503 ) 268-8556 ; http://www.latticesemi.com
1999年5月
3256a_09
1
输出路由池
B0
E3
输出路由池
A0
F3
特定网络阳离子
可编程逻辑器件3256A
功能框图
图1.可编程逻辑器件3256A功能框图
BSCAN / ISPEN
TCLK / SCLK
TMS / MODE
I / O 127
I / O 126
I / O 125
I / O 124
I / O 123
I / O 122
I / O 121
I / O 120
I / O 119
I / O 118
I / O 117
I / O 116
I / O 115
I / O 114
I / O 113
I / O 112
I / O 111
I / O 110
I / O 109
I / O 108
I / O 107
I / O 106
I / O 105
I / O 104
I / O 103
I / O 102
I / O 101
I / O 100
GOE0
GOE1
TOE
通用
逻辑
输入总线
输出布线区( ORP )
H3
H2
H1
H0
输入总线
输出布线区( ORP )
G3
G2
G1
G0
ISP和
边界
扫描TAP
I / O 99
I / O 98
I / O 97
I / O 96
TDI / SDI
TRST
TDO / SDO
I / O 95
I / O 94
I / O 93
I / O 92
输出布线区( ORP )
A0
F3
输入总线
A1
F2
I / O 8
I / O 9
I / O 10
I / O 11
I / O 12
I / O 13
I / O 14
I / O 15
输入总线
输入总线
I / O 4
I / O 5
I / O 6
I / O 7
输出布线区( ORP )
I / O 0
I / O 1
I / O 2
I / O 3
I / O 91
I / O 90
I / O 89
I / O 88
I / O 87
I / O 86
I / O 85
I / O 84
I / O 83
I / O 82
I / O 81
I / O 80
A2
F1
A3
F0
输出布线区( ORP )
B0
E3
输入总线
I / O 20
I / O 21
I / O 22
I / O 23
I / O 24
I / O 25
I / O 26
I / O 27
I / O 28
I / O 29
I / O 30
I / O 31
输出布线区( ORP )
I / O 16
I / O 17
I / O 18
I / O 19
全球路由池
( GRP )
I / O 79
I / O 78
I / O 77
I / O 76
I / O 75
I / O 74
I / O 73
I / O 72
I / O 71
I / O 70
I / O 69
I / O 68
I / O 67
I / O 66
I / O 65
I / O 64
B1
E2
B2
E1
B3
E0
输出布线区( ORP )
输入总线
RESET
输出布线区( ORP )
输入总线
I / O 32
I / O 33
I / O 34
I / O 35
I / O 36
I / O 37
I / O 38
I / O 39
I / O 40
I / O 41
I / O 42
I / O 43
I / O 44
I / O 45
I / O 46
I / O 47
I / O 48
I / O 49
I / O 50
I / O 51
I / O 52
I / O 53
I / O 54
I / O 55
I / O 56
I / O 57
I / O 58
I / O 59
I / O 60
I / O 61
I / O 62
I / O 63
2
Y0
Y1
Y2
Y3
Y4
0139isp/3256A
CLK 0
CLK 1
CLK 2
IOCLK 0
IOCLK 1
C0
C1
C2
C3
D0
D1
D2
D3
特定网络阳离子
可编程逻辑器件3256A
描述(续)
所有本地逻辑块输出带回了
GRP ,这样他们可以连接到任何其他的输入
设备上的逻辑块。该器件还具有128个I / O
单元,其中每一个被直接连接到I / O引脚。
每个I / O单元可单独编程为一个
组合输入,注册输入,锁存输入,
输出或双向I / O引脚具有三态控制。该
信号电平与TTL兼容电压和输出
司机可以源4 mA或下沉8毫安。可以在每个输出
可独立编程的快速或慢速输出
压摆率,以减少整体输出开关噪声。
128 I / O单元被分成八组16位。
每个I / O的基团都与一个相关的逻辑
Megablock通过使用ORP的。这些基团的
16个I / O单元共用一个乘积项输出使这
与特定的一对Megablocks和两个相关联的
全球输出使能。
四双GLBs , 16个I / O单元和一个ORP是CON-
已连接在一起,使逻辑Megablock 。该
Megablock是由它共享资源定义。该
四个双GLBs的输出端被连接到一组
16个I / O单元的氧化还原电位。在系统可编程逻辑器件3256A设备
包含这些Megablocks八。
玻璃钢作为其输入来自所有双子的输出
GLBs和所有从双向I / O单元的输入。
所有这些信号被提供给的所述输入端
双GLBs 。通过GRP有所延误equal-
化,以最大限度地减少时序偏差和逻辑毛刺。
在系统可编程逻辑器件3256A器件时钟是通过提供
五个专用时钟引脚。这五个引脚提供三种
时钟双子GLBs和两个时钟的I / O单元。
该装置沿右侧表列出了关键属性
与可用资源的数量。
所述可编程逻辑器件3256A的另一特征是其边界
扫描功能,这是由细胞组成的连接
在芯片上系统逻辑和器件的输入端之间
和输出引脚。所有的I / O引脚有关联的边界
扫描寄存器,具有三态I / O使用三个边界
使用扫描寄存器和输入中的一个。
在系统可编程逻辑器件3256A支持完整的边界扫描IEEE
1149.1规范ISP编程和板级
通过TAP控制器端口级测试。它也是充分
向后兼容莱迪思ISP接口。而
完全符合JEDEC文件,并与功能兼容
较早系统可编程逻辑器件3256设备中, 3256A需要作案
田间边界扫描描述库( BSDL )模式
支持边界扫描测试和编程。作为
使用该边界的结果,现有3256测试程序
扫描测试功能必须更新为使用3256A 。
请联系莱迪思应用的新模式。
在系统可编程逻辑器件3256A支持所有IEEE 1149.1强制性
说明书,其中包括旁路, EXTEST和
样本。
在系统可编程逻辑器件3256A的主要属性
属性
双GLBs
注册
I / O引脚
全局时钟
全球OE
测试OE
QUANTITY
32
384
128
5
2
1
表1-0003A / 3256
3
特定网络阳离子
可编程逻辑器件3256A
绝对最大额定值
1
电源电压V
cc
.................................. -0.5至+ 7.0V
输入电压应用........................ -2.5到V
CC
+1.0V
断态输出电压的应用..... -2.5到V
CC
+1.0V
存储温度................................ -65 ℃150℃
情况下的温度。与电源应用.............. -55 125°C
马克斯。结温。 (T
J
)与电源应用... 150℃
1.条件超过了上述“绝对最大额定值”,可能对器件造成永久性损坏。实用
该器件在这些或高于任何其他条件本规范的业务部门所标明的操作
是不是暗示(编程时,遵循编程规范) 。
DC推荐工作条件
符号
参数
电源电压
输入低电压
输入高电压
广告
产业
T
A
= 0 ° C至+ 70°C
T
A
= -40 ° C至+ 85°C
分钟。
4.75
4.5
0
2.0
马克斯。
5.25
5.5
0.8
V
cc
+1
单位
V
V
V
V
表2-0005 / 3256A
V
CC
V
IL
V
IH
电容(T
A
= 25 ° C,F = 1.0兆赫)
符号
参数
I / O电容(商业/工业)
时钟电容
典型
9
11
单位
pf
pf
测试条件
V
CC
= 5.0V, V
I / O
= 2.0V
V
CC
= 5.0V, V
Y
= 2.0V
表2-0006 / 3256A
C
1
C
2
数据保留规格
参数
数据保留
可编程逻辑器件擦除/重写数
最低
20
10000
最大
单位
岁月
周期
表2-0008 / 3256A
4
特定网络阳离子
可编程逻辑器件3256A
开关测试条件
输入脉冲电平
输入上升和下降时间
输入定时基准水平
输出时序参考电平
输出负载
三态水平的测量0.5V
稳态有效电平。
GND到3.0V
3ns的10 %至90%
1.5V
1.5V
见图2
表2-0003 / 3256A
图2.测试负载
+ 5V
R1
设备
产量
R2
C L
*
TEST
输出负载条件下(见图2)
测试条件
A
B
高电平有效
低电平有效
高电平到Z
at
V
OH
-0.5V
低电平到Z
at
V
OL
+0.5V
R1
470
470
470
R2
390
390
390
390
390
CL
35pF
35pF
35pF
5pF
5pF
表2 - 0004A
*
CL包括测试夹具和探头电容。
0213A
C
DC电气特性
在推荐工作条件
符号
参数
输出低电压
输出高电压
输入或I / O低漏电流
输入或I / O的高漏电
ISPEN输入低漏电流
I / O主动上拉电流
输出短路电流
工作电源电流
I
OL
= 8毫安
I
OH
= -4毫安
0V
V
IN
V
IL
( MAX 。 )
3.5V
V
IN
V
CC
0V
V
IN
V
IL
0V
V
IN
V
IL
V
CC
= 5V, V
OUT
= 0.5V
V
IL
= 0.0V, V
IH
= 3.0V
f
时钟
= 1兆赫
广告
产业
条件
分钟。
2.4
典型值。
200
200
3
MAX 。单位
0.4
-10
10
-150
-150
-200
V
V
A
A
A
A
mA
mA
mA
V
OL
V
OH
I
IL
I
IH
I
IL - ISP
I
IL - PU
I
OS
1
I
CC
2, 4
表2-0007 / 3256A
1.一个输出的时间为一秒的最大持续时间。 V
OUT
= 0.5V选择,以避免测试问题
通过测试地面下降。特征值,未经100 %测试。
2.用16个16位计数器测量。
3.典型值是在V
CC
= 5V和T
A
= 25°C.
4.我最大
CC
广泛地使用特定的设备配置和操作频率而变化。请参阅功耗
莱迪思半导体公司数据手册的这个数据表和热管理部分或CD - ROM来第
估计我最大
CC
.
5
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