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ISL6590
数据表
2003年4月
FN9061
数字多相PWM控制器
核心电压调节
那上面运行一个千兆赫处理器需要快速,智能
电源系统。 Intersil的ISL6590控制器报价
智能数字多相位控制,可提供高
带宽,优化控制频率响应,噪声
免疫和活性的瞬态响应的控制算法。
该设计是完全可扩展的,用于控制多达六个阶段,
每间均设有Intersil的ISL6580智能功率级。
用户可以配置,并通过监控电力系统
异步串行接口( ASI ) 。该ISL6590
控制器灵活性可以扩展,增加了一个
外部EEPROM用于更新关键电路的工作
在控制环和整个系统的设计参数。
该数字架构降低了设计时间
工程师们通过使用我们的软件。该软件允许
设计人员可自由选择输出级
组件,而且还能达到优化的系统
性能。
该ISL6590数字控制器与通信
ISL6580集成功率级通过100%的数字信号。
串行通信可以用于控制器的分离
和输出级,提供了位置和布局
自由与功率级。数字控制器
实现相位平衡,以保证均匀分布
相电流。该ISL6590控制器配置
ISL6580功率级电流限制, VID参考,不
重叠期间,主动瞬态响应( ATR )触发
水平和最高温度的限制。数字控制器
还监测ISL6580功率级的峰值电流,过
温度故障,欠电压输入,输出上/下
电压,以确保电源的正确操作。
特点
开放式架构具有软件可编程
控制环路补偿实现最佳的系统
性能
- 用户可访问的异步串行接口
英特尔VR10
- 6位动态VID
- 以1.600Vdc输出电压调节范围0.8375V
250kHz至1MHz的开关频率
100%的数字控制和信令
主动瞬态响应( ATR)控制算法
最小电压降和过冲
控制多达六个ISL6580智能功率级( 20A
每相, 120A的系统总电流)的
可编程自适应电压定位( AVP )的负载
LINE
可配置的控制回路参数(可选
外部EEPROM )
MOSFET可编程死区时间控制
高速电压和电流控制环
PWRGD和OUTEN
串行接口ISL6580功率级系统
监控和配置
64 Ld的9x9的QFN封装
QFN封装选项
- QFN封装符合JEDEC PUB95 MO- 220 QFN - 四
扁平无引脚 - 产品概述
- 近QFN芯片级封装尺寸;改善
PCB效率,在档案稀释剂。
引脚
ISL6590 ( QFN )
顶视图
PLL_FILTER
PLL_ANALOG_VDD
PLL_ANALOG_VSS
PLL_DIGITAL_VDD
PLL_DIGITAL_VSS
OSC_IN
OSC_OUT
VDD_CORE
ARX
ATX
VDD_IO
SCLK
SDATA
TEST4
TEST3
ATRH
订购信息
产品型号
ISL6590DR
测试2
ATRL
SOC
ERR
VDD_IO
SYS_CLK
VDD_IO
NC
NC
VDD_CORE
NC
NC
IDIG6
PWM6
NDRIVE6
TEST1
TEMP 。 (
o
C)
0到85
PKG 。号
64 Ld的9x9的QFN L64.9x9 -S
OUTEN
VID [0]
VID [1]
VID [2]
VID [3]
VID [4]
VID [5]
VDD_CORE
PWRGD
VDD_IO
MCLK
MDO
MDI
MCS
NDRIVE1
PWM1
64
01
49
48
16
17
IDIG1
NDRIVE2
PWM2
IDIG2
VDD_CORE
NDRIVE3
PWM3
IDIG3
VDD_IO
NDRIVE4
PWM4
IDIG4
33
32
EXT_RESETB
NDRIVE5
PWM5
IDIG5
1
c注意:这些器件对静电放电敏感;遵循正确的IC处理程序。
1-888- INTERSIL或321-724-7143
|
Intersil公司(和设计)是Intersil Americas Inc.公司的注册商标。
版权所有 Intersil公司美洲2003版权所有
提及的所有其他商标均为其各自所有者的财产。动态VID 是Intersil美洲公司的商标。
ISL6590
典型应用电路
3.3 V 5-12 V 12 V
3.3 V
1.8 V
2.5 V
VDD
VDRIVE
VCC
VDD_IO
VDD_CORE
VREF
ATRH
ATRL
ERR
SOC
SCLK
SDATA
CLK
V SENP
VSENN
ISENSE
VSW
NGATE
VID [0: 5]
PWRGD
OUTEN
ERR
SOC
SCLK
SDATA
系统时钟
PWM
IDIG
NDRIVE
ISL6580
VOUT
PWM
IDIG
NDRIVE
保护地
GND
通道
ARX
ATX
VOUT
RTN
ISL6590
3.3 V
5-12 V 12 V
VDD
VDRIVEVCC
ATRH
ATRL
VREF
ATRH
ATRL
ERR
SOC
SCLK
SDATA
CLK
V SENP
VSENN
ISENSE
VSW
NGATE
ISL6580
OSC_IN
OSC_OUT
PWM
IDIG
NDRIVE
TEST1
TEST2
TEST3
TEST4
PWM
IDIG
NDRIVE
保护地
GND
5-12 V 12 V
ATR通道
3.3 V
VDD
VDRIVE
VCC
MDO
EEPROM
VREF
ATRH
ATRL
ERR
SOC
SCLK
SDATA
CLK
PWM
IDIG
NDRIVE
V SENP
VSENN
ISENSE
VSW
NGATE
MDI
MCS
MCLK
ISL6580
PWM
IDIG
NDRIVE
保护地
GND
UV / OV CHANNEL
GND
调节器
接口总线
2
ISL6590
绝对最大额定值
电源电压
( VDD_IO ) 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 + 3.63V
( VDD_CORE ) 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 + 1.98V
ESD分类科幻阳离子。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 1.5KV
热信息
热阻
θ
JC
. . . . . . . . . . . . . . . . . . . . . . . . . . . .
θ
JA- 0 LFPM AIR
. . . . . . . . . . . . . . . . . . .
θ
JA- 100 LFPM AIR
. . . . . . . . . . . . . . . . .
θ
JA- 200 LFPM AIR
. . . . . . . . . . . . . . . . .
θ
JA- 400 LFPM AIR
. . . . . . . . . . . . . . . . .
θ
JB
. . . . . . . . . . . . . . . . . . . . . . . . . . . .
(
o
C / W )
3
29.0
26.6
25.0
23.2
8
推荐工作条件
电源电压
( VDD_IO ) 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 + 3.3V
±5%
( VDD_CORE ) 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 + 1.8V
±5%
(模拟PLL ) 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 + 1.8V
±5%
(数字PLL) 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 + 1.8V
±5%
环境温度。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 0
o
C至85
o
C
最大存储温度范围。 。 。 。 。 。 。 。 。 -65
o
C至150
o
C
最大的铅温度(焊接10秒) 。 。 。 。 。 。 。 。 。 。 。 。 .300
o
C
最高结温。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 .125
o
C
最大存储温度范围。 。 。 。 。 。 。 。 。 -65
o
C至150
o
C
最大的铅温度(焊接10秒) 。 。 。 。 。 。 。 。 。 。 。 。 .300
o
C
注意:压力超过上述“绝对最大额定值” ,可能对器件造成永久性损坏。这是一个应力只评级和操作
器件在这些或以上的本规范的操作章节中所示的任何其他条件不暗示。
注意:
1.
θ
JA
测量与安装在“高效”热导板与“直连”功能组件
.
(参见技术简介
TB379了解详细信息。 )
电气规格
参数
输入
OUTEN , VID [ 0 : 5 ] ,V
IH
OUTEN , VID [ 0 : -5 ] ,V
IL
工作条件: V
DDIO
= 3.3V, V
DDCORE
= 1.8V ,T
A
= 25
o
C,除非另有规定编
测试条件
典型值
最大
单位
3.3V内部没有上拉/下拉电阻
3.3V内部没有上拉/下拉电阻
3.3V内部下拉电阻
3.3V内部下拉电阻
3.3V内部上拉电阻
3.3V内部上拉电阻
3.3V内部上拉电阻
3.3V内部上拉电阻
没有内部上拉/下拉电阻
没有内部上拉/下拉电阻
0.8
-
2.0
-
2.0
-
2.0
-
2.0
-
-
-
-
-
-
-
-
-
-
-
-
0.4
-
0.8
-
0.8
-
0.8
-
0.8
V
V
V
V
V
V
V
V
V
V
MDI , IDIG [1-6] , ATRL , ATRH , SOC ,
ERR V
IH
MDI , IDIG [1-6] , ATRL , ATRH , SOC ,
ERR V
IL
EXT_RESETB ,V
IH
EXT_RESETB ,V
IL
ARX ,V
IH
ARX ,V
IL
OSC_IN ,V
IH
OSC_IN ,V
IL
输出
MCLK , MDO ,MCS NDRIVE [0: 5]
PWM [ 0 : 5 ] , ATX ,V
OH
MCLK , MDO ,MCS NDRIVE [0: 5]
PWM [ 0 : 5 ] , ATX ,V
OL
SYS_CLK ,V
OH
SYS_CLK ,V
OL
SCLK ,V
OH
SCLK ,V
OL
SDATA ,V
OH
SDATA ,V
OL
SDATA ,V
IH
SDATA ,V
IL
PWRGD ,V
OH
PWRGD ,V
OL
OSC_OUT ,V
OH
OSC_OUT ,V
OL
没有内部上拉/下拉电阻, 8毫安驱动器
没有内部上拉/下拉电阻, 8毫安驱动器
没有内部上拉/下拉电阻,均有20mA的驱动
没有内部上拉/下拉电阻,均有20mA的驱动
没有内部上拉/下拉电阻, 16毫安驱动器
没有内部上拉/下拉电阻, 16毫安驱动器
3.3V上拉电阻, 16毫安驱动器
3.3V上拉电阻, 16毫安驱动器
3.3V的上拉电阻
3.3V的上拉电阻
开漏输出, 6毫安驱动器
开漏输出, 6毫安驱动器
没有内部上拉/下拉电阻,具有10mA的驱动器
没有内部上拉/下拉电阻,具有10mA的驱动器
2.4
-
2.4
-
2.4
-
2.4
-
2.0
-
2.4
-
2.4
-
-
-
-
-
-
-
-
-
-
-
-
-
-
-
-
0.4
-
0.4
-
0.4
-
0.4
-
0.8
-
0.4
-
0.4
V
V
V
V
V
V
V
V
V
V
V
V
V
V
3
ISL6590
电气规格
参数
上电复位和启用
POR阈值
V
DDIO
升起
V
DDIO
落下
V
ddcore上升
V
ddcore下降
OUTEN门槛
OUTEN上升
OUTEN下降
振荡器
调整范围
最大占空比
注意:
1.保留了注释。
0.250
24
-
待定
1
-
兆赫
%
1.4
-
0.7
-
-
-
-
-
-
-
0.71
0.64
-
2.55
-
1.4
-
-
V
V
V
V
V
V
工作条件: V
DDIO
= 3.3V, V
DDCORE
= 1.8V ,T
A
= 25
o
C,除非另有规定编
(续)
测试条件
典型值
最大
单位
框图
ext_reset
POR
ATX
ARX
异步
串行接口
内存总线
MUX
反馈
控制
PWM [ 6:1 ]
PWM驱动器
NDRIVE [ 6:1 ]
ATRH
ATRL
OUTEN
PWRGD
VID [5:0 ]
状态
控制和
故障
MONITOR
当前
电压
IDIG [ 6:1 ]
MDI
MCLK
MCS
MDO
非挥发
SPI EEPOM
接口
控制/
状态
注册
AVP
SOC
ERR
OSC_OUT
OSC_IN
PLL_FILTER
时钟
分配
状态
MHz内存
映射
注册
背面序列
公共汽车
SCLK
SDATA
SYS_CLK
图1. ISL6590框图
4
ISL6590
引脚说明
PIN号
1
2-7
8, 21, 39, 57
9
10, 25, 42,
44, 54
11
12
13
14
15, 18, 22,
26, 30, 34
16, 19, 23,
27, 31, 35
17, 20, 24,
28, 32, 36
引脚名称
OUTEN
VID [0: 5]
VDD_CORE
PWRGD
VDD_IO
MCLK
MDO
MDI
MCS
NDRIVE [1: 6]
PWM [1: 6]
IDIG [1: 6]
TYPE
输入
输入
动力
产量
动力
产量
产量
输入
产量
产量
产量
输入
引脚说明
输出使能用于在命令调节高输入信号和低输入信号接通
该稳压器关闭。
电压识别( 6位)。节目Vout的调节电压。
IC内部的内核电源电压( 1.8伏逻辑) 。
电源良好的高输出信号,以指示所述调节器的输出电压是在规定的
范围内。低信号指示的电压不在范围之内。
IC I / O输入电源电压( 3.3伏逻辑) 。
EEPROM的外部存储器的时钟,数据同步输出的IC的上升沿和数据是
移入ISL6580 IC上的下降沿。兼容SPI EEPROM的。
EEPROM的外部存储器的数据输出。符合SPI EEPROM的
.
EEPROM的外部存储器的数据输入端。符合SPI EEPROM的。
EEPROM外部存储器片选(低电平有效) 。符合SPI EEPROM的。
低压侧驱动信号用于启动ISL6580打开LSFET 。
PWM执行其用于打开ISL6580的电源装置的脉冲宽度调制。
当前的A / D数据串行7位数字字( MSB在前) 。第一位是起始位(Start = 1)。该
剩下的6位代表所采样的峰值电流在特定ISL6580的漏极
P沟道HSFET 。 ( IDIG字的传输是由PWM信号的下降沿触发)。
IDIG的是,在使用SYSCLK / 2,常66.6MHz频率范围内接收到的输入。
电压识别( 6位)。节目Vout的调节电压。
测试引脚部分评价
这些引脚没有被结合了。
系统时钟运行在用于时钟ISL6580一个133.3MHz率。这是通过将生成的
内部PLL电路产生的OSC_IN频率的4倍频率倍增。
在66MHz的(或SYSCLK / 2 )传输速率的串行数据。这6位电压误差反馈到
控制回路以及用于调节输出电压。
开始转换信号由ISL6580的电压A / D启动创建ERR信号。
从ISL6580主动瞬态响应低输入信号指示的电压过冲
该转换器的输出。
从ISL6580主动瞬态响应高输入信号指示的电压跌落
转换器的输出。
为之间的通信,监视和配置数据控制器串行接口
ISL6580和ISL6590控制器。
串行数字总线时钟提供的16.67MHz的时钟,它通过在伴随SDATA
擦屁股串行总线。
异步串行接口发送
异步串行接口接收
仅当部件是用晶体来产生系统时钟使用。
需要一个33.33MHz振荡器或晶体被用来产生系统时钟。
数字地为4X时钟倍频PLL
.
测试模式绕过PLL输入到核心。
为4X时钟倍频PLL时钟树驱动1.8V电源( 1.8 VDC逻辑)
.
模拟地为4X时钟倍频PLL 。
为4X时钟倍频PLL 1.8V电源电压( 1.8伏逻辑) 。
29
33, 48, 50,
51
37, 38, 40,
41
43
45
46
47
49
52
53
55
56
58
59
60
61
62
63
64
65
ext_reset
测试[ 1 :4]
NC
系统时钟
ERR
SOC
ATRL
ATRH
SDATA
SCLK
ATX
ARX
OSC_OUT
OSC_IN
PLL_DIG_VSS
PLL旁路
PLL_DIG_VDD
PLL_ANA_VSS
PLL_ANA_VDD
PLL_FILTER
GND
输入
产量
不适用
输入/输出
输入
输入
输入
输入
输入/输出
产量
产量
输入
产量
输入
输入
动力
动力
模拟量输入滤波上限PLL 。
桨式IC地面
5
查看更多ISL6590DRPDF信息
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厂家
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数量
封装
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    电话:0755-82780082
    联系人:杨小姐
    地址:深圳市福田区振兴路156号上步工业区405栋3层

    ISL6590DR
    -
    -
    -
    -
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电话:13910052844(微信同步)
联系人:刘先生
地址:北京市海淀区增光路27号院增光佳苑2号楼1单元1102室
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√ 欧美㊣品
▲10/11+
9295
贴◆插
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电话:13910052844(微信同步)
联系人:刘先生
地址:海淀区增光路27号院增光佳苑2号楼1单元1102室
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