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ISL34340
数据表
2008年3月7日
FN6255.0
WSVGA 24位长距离视频的Serdes
与双向侧通道
该ISL34340是LVCMOS并行串行器/解串器
视频数据。呈现给串行器上的视频数据
并行LVCMOS总线被序列化为一个高速
差分信号。此差分信号被转换回
在远程端通过解串器的并行视频。这也
双向地在同一链路传输的辅助数据
在视频的垂直回扫时间间隔。
特点
24位RGB传输比单差分对
无需额外的辅助双向数据传输
带宽和在同一差分对
40MHz的PCLK运输
- SVGA 800 ×600 @ 70fps , 16 %消隐
- WSVGA 1024 ×600 @ 60fps的, 8 %消隐
内部100Ω终端上的高速串行线
DC平衡的8B / 10B线路编码允许使用AC耦合
- 提供免疫力地上移
订购信息
部分
部分
记号
温度。
范围
(°C)
PKG 。
DWG 。 #
变送器幅度提升和预加重和
接收器均衡允许更长的电缆长度和
更高的数据速率
同一台设备的串行器和解串器简化
库存
I
2
C接口
高速串行线路达到8kV的ESD额定值
ISL34340INZ * ISL34340INZ -40到+85 64 Ld的EPTQFP Q64.10x10B
(注)
(无铅)
*添加“ -T13 ”后缀磁带和卷轴。请参阅TB347的细节
卷筒规格。
注意:这些Intersil无铅产品采用塑料包装特殊
无铅材料制成,模塑料/晶片的附属材料和
100 %雾锡板加退火 - E3终止完成,这是
符合RoHS标准,既锡铅和无铅焊接兼容
操作。 Intersil无铅产品分类MSL在无铅峰值
达到或超过的无铅要求的回流温度
IPC / JEDEC J STD- 020 。
应用
导航和显示系统
视频娱乐系统
工业计算终端
远程摄像机
典型应用图
3.3V
1.8V
VDD_IO
3.3V
1.8V
VDD_IO
VDD_CR
VDD_CDR
VDD_CR
VDD_TX
VDD_AN
VDD_TX
VDD_AN
RSTB / PDB
VDD_CDR
VDD_P
VDD_P
RSTB / PDB
VDD_IO
VDD_IO
24
24
RGB
RGB
27 nF的
10米差
电缆
27 nF的
SERIOP
SERIOP
27 nF的
视频
来源
VSYNC
HSYNC
DE
PCLK_IN
ISL34340
(串行模式)
赛润
27 nF的
ISL34340
赛润
(解串器
VSYNC
HSYNC
DE
模式)
PCLK_OUT
视频
SINK
REF_CLK
GND_CR
GND_AN
GND_P
GND_Tx
GND_CDR
GND_IO
VIDEO_TX
REF_RES
TEST_EN
PCLK_IN
GND_CR
GND_AN
GND_P
GND_Tx
GND_CDR
GND_IO
VIDEO_TX
REF_RES
TEST_EN
I2CA1
I2CA0
3.16 KΩ
VDD_IO
1
注意:这些器件对静电放电敏感;遵循正确的IC处理程序。
1-888- INTERSIL或1-888-468-3774
|
Intersil公司(和设计)是Intersil Americas Inc.公司的注册商标。
版权所有Intersil公司美洲2008.保留所有权利
提及的所有其他商标均为其各自所有者的财产。
3.16 KΩ
I2CA1
I2CA0
ISL34340
引脚
ISL34340
( 64 LD EPTQFP )
顶视图
框图
SCL
SDA
I
2
C
VCM
发电机
内存
PRE-
突破重点
3
V / H / DE
TDM
RGB
24
RX
EQ
8b/10b
MUX
解复用
赛润
SERIOP
TX
VIDEO_TX
( HI )
CDR
PCLK_IN
( REF_CLK WHEN
VIDEO_TX IS LO )
PCLK_OUT
x30
÷30
2
FN6255.0
2008年3月7日
ISL34340
绝对最大额定值
电源电压
VDD_P到GND_P , VDD_TX到GND_TX ,
VDD_IO到GND_IO 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 -0.5V至4.6V
VDD_CDR到GND_CDR , VDD_CR到GND_CR 。 。 -0.5V至2.5V
任何一对GND_P , GND_TX之间,
GND_IO , GND_CDR , GND_CR 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 -0.1V至0.1V
3.3V LVTTL容错/ LVCMOS输入电压。 。 。 。 。 。 。 -0.5V至4.6V
差分输入电压。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 - 0.3V至VDD_IO + 0.3V
差分输出电流。 。 。 。 。 。 。 。 。 。 。 。 。 。短路保护功能
LVTTL / LVCMOS输出。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。短路保护功能
ESD额定值
人体模型
所有引脚。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 .4kV
SERIOP / N (所有的VDD连接,所有的GND相连) 。 。 。 。 。 。 .8kV
机器型号。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 .200V
热信息
热电阻(典型,注意事项1, 2 )
θ
JA
θ
JC
( ° C / W)
EPTQFP 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。
33
4.5
最大功率耗散。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 327mW
最高结温。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 + 125°C
最大存储温度范围。 。 。 。 。 。 。 。 。 。 - 65 ° C至+ 150°C
工作温度范围。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 - 40 ° C至+ 85°C
无铅回流焊曲线。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。下面。见链接
http://www.intersil.com/pbfree/Pb-FreeReflow.asp
注意:不要达到或接近上市较长时间的最高收视率运行。暴露于这样的条件可能不利地影响了产品的可靠性和
导致不在保修范围内的故障。
注意事项:
1.
θ
JA
测量在自由空气与装在一个高有效热导率测试板用“直接连接”的功能的组件。看
技术简介TB379 。
2.
θ
JC
的“外壳温度”的位置是在封装底部的裸露金属焊盘的中心。
电气规格
参数
电源电压
VDD_CDR , VDD_CR
除非另有说明,所有数据为:
VDD_CDR = VDD_CR = 1.8V , VDD_IO = 3.3V
,
VDD_TX = VDD_P =
VDD_AN = 3.3V ,T
A =
+ 25 ° C, Ref_Res = 3.16kΩ ,高速交流耦合电容= 27nF 。
符号
条件
典型值
最大
单位
1.7
3.0
1.8
3.3
1.9
3.6
V
V
VDD_TX , VDD_P , VDD_AN , VDD_IO
串行器电源电流
模拟TX电源电流
模拟CDR电源电流
数字I / O电源电流
数字电源电流
PLL / VCO的电源电流
模拟偏置电源电流
总1.8V电源电流
总3.3V电源电流
解串器电源电流
模拟TX电源电流
模拟CDR电源电流
数字I / O电源电流
数字电源电流
PLL / VCO的电源电流
模拟偏置电源电流
总1.8V电源电流
总3.3V电源电流
I
DDTX
I
DDCDR
I
DDIO
I
DDCR
I
DDP
I
DDAn
VIDEO_TX = 0
REF_CLK = 40MHz的
I
DDTX
I
DDCDR
I
DDIO
I
DDCR
I
DDP
I
DDAn
VIDEO_TX = 1
PCLK_IN = 40MHz的
17
57
1
20
17
5.5
77
40
90
46
2
mA
mA
mA
mA
mA
mA
mA
mA
24
45
17
32
17
5.4
77
64
90
80
25
mA
mA
mA
mA
mA
mA
mA
mA
3
FN6255.0
2008年3月7日
ISL34340
电气规格
参数
掉电电源电流
总1.8V掉电电源电流
总3.3V掉电电源电流
并行接口
高电平输入电压
低电平输入电压
输入漏电流
高电平输出电压
低电平输出电压
输出短路电流
输出上升和下降时间
V
IH
V
IL
I
IN
V
OH
V
OL
I
OSC
t
OR
/t
OF
压摆率控制设置到最小,
C
L
=驱动8pF
压摆率控制设置为最大值,
C
L
=驱动8pF
串行器并行接口
PCLK_IN频率
PCLK_IN占空比
并行输入建立时间
并行输入保持时间
解串并行接口
PCLK_OUT频率
PCLK_OUT占空比
PCLK_OUT周期抖动( RMS)
PCLK_OUT展宽
时间并行输出数据有效
解串器输出延迟
f
OUT
t
ODC
t
OJ
t
OSPRD
t
DV
t
CPD
随机数发生器的时钟关闭
时钟随机数发生器
相对于PCLK_OUT
部分到部分,
侧信道已禁用
-4.7
4
9
6
50
0.5
±20
5.5
14
40
兆赫
%
% TPCLK
% TPCLK
ns
PCLK
f
IN
t
IDC
t
IS
t
IH
6
40
3.6
1.6
50
40
60
兆赫
%
ns
ns
1
4
I
OH
= -2.0mA , VDD_IO = 3V
I
OL
= 2.0毫安, VDD_IO = 3V
-10
0.8*VDD_IO
0.2*VDD_IO
50
±0.01
2.0
0.8
10
V
V
A
V
V
mA
ns
ns
RSTB = GND ;
规范是每个设备
0.5
1
mA
mA
除非另有说明,所有数据为:
VDD_CDR = VDD_CR = 1.8V , VDD_IO = 3.3V
,
VDD_TX = VDD_P =
VDD_AN = 3.3V ,T
A =
+ 25 ° C, Ref_Res = 3.16kΩ ,高速交流耦合电容= 27nF 。
(续)
符号
条件
典型值
最大
单位
解串器参考时钟( REF_CLK被送入PCLK_IN )
REF_CLK锁定时间
REF_CLK到PCLK_OUT最大时钟
频率偏移
HIGH -SPEED变送器
HS差分输出电压,转换位
视频点播
TR
TXCN = 0×00
TXCN =为0x0F
TXCN = 0XF0
TXCN = 0xFF的
HS差分输出电压,非过渡
视频点播
NTR
TXCN = 0×00
TXCN =为0x0F
TXCN = 0XF0
TXCN = 0xFF的
HS生成的输出共模电压
V
OCM
600
600
825
1170
975
1300
825
460
975
600
2.35
990
990
mV
P-P
mV
P-P
mV
P-P
mV
P-P
mV
P-P
mV
P-P
mV
P-P
mV
P-P
V
t
PLL
PCLK_OUT是
恢复时钟
1500
100
5000
s
PPM
4
FN6255.0
2008年3月7日
ISL34340
电气规格
参数
HS共模串行器 - 解串器
电压差
HS差分输出阻抗
HS输出延迟
HS输出上升和下降时间
HS差分偏移
HS输出随机抖动
HS输出确定性抖动
高速接收器
HS差分输入电压
HS生成的输入共模电压
HS差分输入阻抗
HS最大抖动容限
I
2
C
I
2
C时钟速率(在SCL )
I
2
C时钟脉冲宽度(高或低)
I
2
C时钟低到数据输出有效
I
2
C启动/停止建立/保持时间
I
2
C数据的建立时间
I
2
C数据保持时间
I
2
C数据输出保持时间
F
I2C
1.3
0
0.6
100
100
100
1
100
400
千赫
s
s
s
ns
ns
ms
V
ID
V
ICM
R
IN
80
150
2.32
100
0.52
120
mV
P-P
V
Ω
UI
P-P
除非另有说明,所有数据为:
VDD_CDR = VDD_CR = 1.8V , VDD_IO = 3.3V
,
VDD_TX = VDD_P =
VDD_AN = 3.3V ,T
A =
+ 25 ° C, Ref_Res = 3.16kΩ ,高速交流耦合电容= 27nF 。
(续)
符号
ΔV
CM
R
OUT
t
LPD
t
R/
t
F
t
SKEW
t
RJ
t
DJ
部分到第
20 %至80%
80
4
条件
典型值
20
100
7
150
<10
13.4
40
最大
120
120
10
单位
mV
Ω
PCLK
ps
ps
ps
RMS
ps
P-P
引脚说明
描述
引脚数
52至63 ,
2至13
22
23
21
26
51
41, 40
24
引脚名称
串行器
解串器
并行视频数据LVCMOS输出
水平(行)同步LVCMOS输出
垂直(帧)同步LVCMOS输出
视频数据使能LVCMOS输出
PLL的参考时钟输入端LVCMOS
恢复时钟输出LVCMOS
高速差分串行I / O
RGBA [7: 0],
并行视频数据LVCMOS输入
RGBB [7: 0], RGBC [7 :0]的
HSYNC
VSYNC
DATAEN
PCLK_IN
PCLK_OUT
SERIOP / N
HSYNCPol
水平(行)同步LVCMOS输入
垂直(帧)同步LVCMOS输入
视频数据使能输入端LVCMOS
像素时钟LVCMOS输入
默认情况下未使用
高速差分串行I / O
CMOS输入的水平同步
1: HSYNC是有源低
0 : HSYNC为高电平有效
CMOS输入VSYNC
1: VSYNC为低电平有效
0 : VSYNC为高电平有效
CMOS输入视频流的方向
1 :视频串行器
0 :视频解串器
25
VSYNCPol
49
VIDEO_TX
5
FN6255.0
2008年3月7日
IGNS
ES牛逼
EW
AR
F或M E NT P
E
D·埃德
M E n个R EPL A C
数据表
OM E D
C
341
牛逼 M EN
4
NO
M
我SL3
EC
R
ISL34340
2008年6月23日
FN6255.1
WSVGA 24位长距离视频
SERDES与双向侧通道
该ISL34340是LVCMOS并行串行器/解串器
视频数据。呈现给串行器上的视频数据
并行LVCMOS总线被序列化为一个高速
差分信号。此差分信号被转换回
在远程端通过解串器的并行视频。这也
双向地在同一链路传输的辅助数据
在视频的垂直回扫时间间隔。
特点
24位RGB传输比单差分对
无需额外的辅助双向数据传输
带宽和在同一差分对
40MHz的PCLK运输
- SVGA 800×600 @ 70fps , 16 %消隐
- WSVGA 1024×600 @ 60fps的, 8 %消隐
内部100Ω终端上的高速串行线
DC平衡的8B / 10B线路编码允许使用AC耦合
- 提供免疫力地上移
订购信息
部分
(注)
部分
记号
温度。
范围
(°C)
(无铅)
PKG 。
DWG 。 #
变送器幅度提升和预加重和
接收器均衡允许更长的电缆长度和
更高的数据速率
同一台设备的串行器和解串器简化
库存
I
2
C接口
高速串行线路达到8kV的ESD额定值
无铅(符合RoHS )
ISL34340INZ * ISL34340INZ -40到+85 64 Ld的EPTQFP Q64.10x10B
*添加“ -T13 ”后缀磁带和卷轴。请参阅TB347的细节
卷筒规格。
注意:这些Intersil无铅产品采用塑料包装特殊
无铅材料套,模塑料/晶片的附属材料,
100 %雾锡板加退火( E3终止完成,这是符合RoHS
标准,既锡铅和无铅焊接兼容
操作)。 Intersil无铅产品分类MSL在无铅峰值
达到或超过的无铅要求的回流温度
IPC / JEDEC J STD- 020 。
应用
导航和显示系统
视频娱乐系统
工业计算终端
远程摄像机
3.3V
1.8V
VDD_IO
3.3V
1.8V
VDD_IO
VDD_AN
VDD_CR
VDD_AN
VDD_CDR
VDD_CR
RSTB / PDB
VDD_CDR
VDD_TX
VDD_TX
VDD_IO
VDD_IO
VDD_P
VDD_P
24
RSTB / PDB
24
RGBA / B / C
27nF
10米差分电缆
27nF
SERIOP
SERIOP
27nF
27nF
RGBA / B / C
视频
来源
VSYNC
HSYNC
DATAEN
PCLK_IN
ISL34340
赛润
REF_CLK
VIDEO_TX
赛润
PCLK_IN
ISL34340
VSYNC
HSYNC
DATAEN
PCLK_OUT
VIDEO_TX
视频
SINK
GND_CR
GND_AN
GND_P
GND_Tx
GND_CDR
GND_IO
GND_CR
GND_AN
GND_P
GND_Tx
GND_CDR
GND_IO
REF_RES
REF_RES
I2CA0
3.16 KΩ
VDD_IO
3.16 KΩ
VDD_IO
1
注意:这些器件对静电放电敏感;遵循正确的IC处理程序。
1-888- INTERSIL或1-888-468-3774
|
Intersil公司(和设计)是Intersil Americas Inc.公司的注册商标。
版权所有Intersil公司美洲2008.保留所有权利
提及的所有其他商标均为其各自所有者的财产。
I2CA0
ISL34340
引脚
ISL34340
( 64 LD EPTQFP )
顶视图
GND_IO
VDD_CDR
VDD_CDR
GND_CDR
GND_CDR
VDD_TX
GND_Tx
SERIOP
赛润
GND_Tx
VDD_AN
GND_AN
REF_RES
TEST
I2CA0
I2CA1
48
47
46
45
44
43
42
41
40
39
38
37
36
35
34
33
32
31
30
29
28
27
26
25
24
23
22
21
20
19
18
17
框图
SCL
SDA
I
2
C
VCM
发电机
内存
PRE-
突破重点
3
V / H / DE
TDM
RGB
24
RX
EQ
8b/10b
MUX
解复用
赛润
TX
SERIOP
VIDEO_TX
( HI )
CDR
PCLK_IN
( REF_CLK WHEN
VIDEO_TX IS LO )
PCLK_OUT
x30
÷30
2
VDD_IO
RGBB4
RGBB5
RGBB6
RGBB7
RGBC0
RGBC1
RGBC2
RGBC3
RGBC4
RGBC5
RGBC6
RGBC7
状态
TEST_EN
RSTB / PDB
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
VIDEO_TX
VDD_IO
PCLK_OUT
RGBA0
RGBA1
RGBA2
RGBA3
RGBA4
RGBA5
RGBA6
RGBA7
RGBB0
RGBB1
RGBB2
RGBB3
GND_IO
49
50
51
52
53
54
55
56
57
58
59
60
61
62
63
64
I2CA2
I2CA3
SDA
SCL
VDD_P
GND_P
PCLK_IN
VSYNCPol
HSYNCPol
VSYNC
HSYNC
DATAEN
VDD_CR
VDD_CR
GND_CR
GND_CR
FN6255.1
2008年6月23日
ISL34340
绝对最大额定值
电源电压
VDD_P到GND_P , VDD_TX到GND_TX ,
VDD_IO到GND_IO 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 -0.5V至4.6V
VDD_CDR到GND_CDR , VDD_CR到GND_CR 。 。 -0.5V至2.5V
任何一对GND_P , GND_TX之间,
GND_IO , GND_CDR , GND_CR 。 。 。 。 。 。 。 。 。 。 。 。 。 -0.1V至0.1V
3.3V LVTTL容错/ LVCMOS输入电压
。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 - 0.3V至VDD_IO + 0.3V
差分输入电压。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 - 0.3V至VDD_IO + 0.3V
差分输出电流。 。 。 。 。 。 。 。 。 。 。 。 。 。短路保护功能
LVTTL / LVCMOS输出。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。短路保护功能
ESD额定值
人体模型
所有引脚。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 .4kV
SERIOP / N (所有的VDD连接,连接所有接地) 。 。 。 。 .8kV
机器型号。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 .200V
热信息
热电阻(典型,注意事项1, 2 )
θ
JA
θ
JC
( ° C / W)
EPTQFP 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。
33
4.5
最大功率耗散。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 327mW
最高结温。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 + 125°C
最大存储温度范围。 。 。 。 。 。 。 。 。 。 - 65 ° C至+ 150°C
工作温度范围。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 - 40 ° C至+ 85°C
无铅回流焊曲线。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。下面。见链接
http://www.intersil.com/pbfree/Pb-FreeReflow.asp
注意:不要达到或接近上市较长时间的最高收视率运行。暴露于这样的条件可能不利地影响了产品的可靠性和
导致不在保修范围内的故障。
注意事项:
1.
θ
JA
测量在自由空气与装在一个高有效热导率测试板用“直接连接”的功能的组件。看
技术简介TB379 。
2.
θ
JC
的“外壳温度”的位置是在封装底部的裸露金属焊盘的中心。
电气规格
除非另有说明,所有数据为:
VDD_CDR = VDD_CR = 1.8V , VDD_IO = 3.3V
,
VDD_TX = VDD_P = VDD_AN = 3.3V ,T
A
= + 25 ° C, Ref_Res = 3.16kΩ ,高速交流耦合
电容= 27nF 。
符号
条件
典型值
最大
单位
参数
电源电压
VDD_CDR , VDD_CR
VDD_TX , VDD_P , VDD_AN , VDD_IO
串行器电源电流
模拟TX电源电流
模拟CDR电源电流
数字I / O电源电流
数字电源电流
PLL / VCO的电源电流
模拟偏置电源电流
总1.8V电源电流
总3.3V电源电流
解串器电源电流
模拟TX电源电流
模拟CDR电源电流
数字I / O电源电流
数字电源电流
PLL / VCO的电源电流
模拟偏置电源电流
总1.8V电源电流
总3.3V电源电流
1.7
3.0
1.8
3.3
1.9
3.6
V
V
I
DDTX
I
DDCDR
I
DDIO
I
DDCR
I
DDP
I
DDAn
VIDEO_TX = 1
PCLK_IN = 40MHz的
17
57
1
20
17
5.5
77
40
90
46
2
mA
mA
mA
mA
mA
mA
mA
mA
I
DDTX
I
DDCDR
I
DDIO
I
DDCR
I
DDP
I
DDAn
VIDEO_TX = 0
REF_CLK = 40MHz的
24
45
17
32
17
5.4
77
64
90
80
25
mA
mA
mA
mA
mA
mA
mA
mA
3
FN6255.1
2008年6月23日
ISL34340
电气规格
除非另有说明,所有数据为:
VDD_CDR = VDD_CR = 1.8V , VDD_IO = 3.3V
,
VDD_TX = VDD_P = VDD_AN = 3.3V ,T
A
= + 25 ° C, Ref_Res = 3.16kΩ ,高速交流耦合
电容= 27nF 。
(续)
符号
条件
典型值
最大
单位
参数
掉电电源电流
总1.8V掉电电源电流
总3.3V掉电电源电流
并行接口
高电平输入电压
低电平输入电压
输入漏电流
高电平输出电压
低电平输出电压
输出短路电流
输出上升和下降时间
RSTB = GND ;
规范是每个设备
0.5
1
mA
mA
V
IH
V
IL
I
IN
V
OH
V
OL
I
OSC
t
OR
/t
OF
压摆率控制设置到最小,
C
L
=驱动8pF
压摆率控制设置为最大值,
C
L
=驱动8pF
I
OH
= -2.0mA , VDD_IO = 3V
I
OL
= 2.0毫安, VDD_IO = 3V
2.0
0.8
-10
0.8*VDD_IO
0.2*VDD_IO
50
1
4
±0.01
10
V
V
A
V
V
mA
ns
ns
串行器并行接口
PCLK_IN频率
PCLK_IN占空比
并行输入建立时间
并行输入保持时间
解串并行接口
PCLK_OUT频率
PCLK_OUT占空比
PCLK_OUT周期抖动( RMS)
PCLK_OUT展宽
时间并行输出数据有效
解串器输出延迟
f
OUT
t
ODC
t
OJ
t
OSPRD
t
DV
t
CPD
随机数发生器的时钟关闭
时钟随机数发生器
相对于PCLK_OUT
部分到部分,
侧信道已禁用
-4.7
4
9
6
50
0.5
±20
5.5
14
40
兆赫
%
%t
PCLK
%t
PCLK
ns
PCLK
f
IN
t
IDC
t
IS
t
IH
6
40
3.6
1.6
50
40
60
兆赫
%
ns
ns
解串器参考时钟( REF_CLK被送入PCLK_IN )
REF_CLK锁定时间
REF_CLK到PCLK_OUT最大时钟
频率偏移
HIGH -SPEED变送器
HS差分输出电压,转换位
视频点播
TR
TXCN = 0×00
TXCN =为0x0F
TXCN = 0XF0
TXCN = 0xFF的
HS差分输出电压,非过渡
视频点播
NTR
TXCN = 0×00
TXCN =为0x0F
TXCN = 0XF0
TXCN = 0xFF的
600
600
825
1170
975
1300
825
460
975
600
990
990
mV
P-P
mV
P-P
mV
P-P
mV
P-P
mV
P-P
mV
P-P
mV
P-P
mV
P-P
t
PLL
PCLK_OUT是
恢复时钟
1500
100
5000
s
PPM
4
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2008年6月23日
ISL34340
电气规格
除非另有说明,所有数据为:
VDD_CDR = VDD_CR = 1.8V , VDD_IO = 3.3V
,
VDD_TX = VDD_P = VDD_AN = 3.3V ,T
A
= + 25 ° C, Ref_Res = 3.16kΩ ,高速交流耦合
电容= 27nF 。
(续)
符号
V
OCM
ΔV
CM
R
OUT
t
LPD
t
R/
t
F
t
SKEW
t
RJ
t
DJ
部分到第
20 %至80%
80
4
条件
典型值
2.35
20
100
7
150
<10
13.4
40
120
120
10
最大
单位
V
mV
Ω
PCLK
ps
ps
ps
RMS
ps
P-P
参数
HS生成的输出共模电压
HS共模串行器 - 解串器
电压差
HS差分输出阻抗
HS输出延迟
HS输出上升和下降时间
HS差分偏移
HS输出随机抖动
HS输出确定性抖动
高速接收器
HS差分输入电压
HS生成的输入共模电压
HS差分输入阻抗
HS最大抖动容限
I
2
C
I
2
C时钟速率(在SCL )
I
2
C时钟脉冲宽度(高或低)
I
2
C时钟低到数据输出有效
I
2
C启动/停止建立/保持时间
I
2
C数据的建立时间
I
2
C数据保持时间
I
2
C数据输出保持时间
V
ID
V
ICM
R
IN
150
2.32
80
100
0.52
120
mV
P-P
V
Ω
UI
P-P
f
I2C
1.3
0
0.6
100
100
100
100
400
千赫
s
1
s
s
ns
ns
ms
引脚说明
描述
引脚数
52至63 ,
2至13
22
23
21
26
51
41, 40
24
引脚名称
串行器
解串器
并行视频数据LVCMOS输出
水平(行)同步LVCMOS输出
垂直(帧)同步LVCMOS输出
视频数据使能LVCMOS输出
PLL的参考时钟输入端LVCMOS
恢复时钟输出LVCMOS
高速差分串行I / O
RGBA [7: 0],
并行视频数据LVCMOS输入
RGBB [7: 0], RGBC [7 :0]的
HSYNC
VSYNC
DATAEN
PCLK_IN
PCLK_OUT
SERIOP ,赛润
HSYNCPol
水平(行)同步LVCMOS输入
垂直(帧)同步LVCMOS输入
视频数据使能输入端LVCMOS
像素时钟LVCMOS输入
默认情况下;不使用
高速差分串行I / O
CMOS输入的水平同步
1: HSYNC是有源低
0 : HSYNC为高电平有效
CMOS输入VSYNC
1: VSYNC为低电平有效
0 : VSYNC为高电平有效
25
VSYNCPol
5
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2008年6月23日
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联系人:刘经理
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