数据表
修订版1.1
数字汽车
像素链路发射器
该INAP125T12 / 24是发送器，用于将新
自动
动机
像素
（ APIX ）链接，显示器和照相机的基础
点至点的应用程序。该APIX链接的功能
单向像素和全双工单边带传输数据
任务超过一单一双屏蔽双绞线
（ STP ）的铜电缆。上游边带也可以是
在一个单独的线对服务的重新传送
要求，可汽车应用。此外，该
线可以用于电源。
该INAP125T12视频接口支持彩色宽
的10和12位，所述INAP125T24宽度的10 ，12，18
和24位。该接口可以单独配置，以
匹配所有流行的显示和图像传感器接口。
像素接口能够处理宽扩展像素
时钟最低的EMI。
该INAP125T12 / 24发射器专用的功能
可调驱动电流高速输出和
预加重，以方便适应于不同的链路
距离，同时提供最高品质的电缆
数据的完整性和充分EMI合规性。
包：
48引脚QFN （四方扁平无引线）
64引脚QFN
产品特点：
INAP125T12
INAP125T24
高达1 Gbit / s的下行链路
高达62.5 Mbit / s上行链路
低EMI ，两线或四线全双工链路
接受广泛的扩频像素时钟
与低调STP电缆15米距离
10/12/18/24位像素接口
可配置的采样边缘的像素数据
直流平衡线路编码，支持交流
耦合
线路驱动器电流和预加重
可调整的
扩展的温度。范围： -40 + 105°C
AEC -Q100
应用范围：
汽车信息娱乐显示器
汽车仪表板显示
平视显示器
后座娱乐系统
汽车驾驶员辅助
监控系统
机器视觉
检测系统
10兆赫
10兆赫
下行链路
像素
接口
上行链路（可选）
边带
接口
像素
接口
INAP125
TX
INAP125
RX
边带
接口
CON组fi guration
接口
上行链路（可选）
CON组fi guration
接口
CONFIG
变频器额定
当前
预加重
驱动电流
CONFIG
变频器额定
当前
图1： APIX系统概述
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1.0简介
该APIX链接与传输的持续和分辨率无关的链路数据速率未压缩像素数据
无论是1 Gbit / s的或500 Mbit / s的在一个单一的对STP铜缆。除了像素数据，双向
边带控制数据可经由相同的线对。
链路支持高达+ 15米（ 1 Gbit / s的模式）和高达视+ 40米（ 500 Mbit / s的模式）的距离
的输出设置（电流，预加重）和电缆特性。
优化了低EMI，该APIX链接专用车辆内点至点应用。高IN-
tegrated架构允许视频和音频的链接实现像中央信息应用
显示器，仪表盘和抬头显示器，而且还摄像头的链接作为辅助驾驶系统的一部分，需要
实时的数字视频流。
1.1传输通道
该APIX链接提供的数据传输三个独立渠道
高速下行像素渠道
下行通道边带
上游边带通道
像素信道和下行信道的边带被多路复用，并通过常用的发送
下游环节。
上游边带信道既可以在相同的线对作为下游链路建立
（嵌入的返回信道），或者在一个单独的一对导线。配置需要per-
由配置向量形成（参见3.1节） 。
10兆赫
10兆赫
PX_CLK
PX_DATA [..]
PX_CTRL
SBDOWN_DATA [..]
SBUP_CLK
SBUP_DATA [..]
INAP125
T12/24
像素渠道
下游的边带通道
PX_CLK
PX_DATA [..]
PX_CTRL
SBDOWN_DATA [..]
SBDOWN_CLK
上游边带通道
（嵌入式共同
模式信号）
SBUP_DATA [..]
INAP125
R12/24
图1-1 ：单线传输信道配置
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10兆赫
像素渠道
PX_CLK
PX_DATA [..]
PX_CTRL
SBDOWN_DATA [..]
SBUP_CLK
SBUP_DATA [..]
INAP125
T12/24
上游边带通道
（如专用CML信号）
下游的边带通道
10兆赫
PX_CLK
PX_DATA [..]
PX_CTRL
SBDOWN_DATA [..]
SBDOWN_CLK
SBUP_DATA [..]
INAP125
R12/24
图1-2 ：两线制传输信道配置
1.2链路带宽
下行链路的带宽可以由这两种模式中选择：
“全带宽”模式的1 Gbit / s的链路数据速率，提供847MBit / s的净数据速率视频
“半带宽”模式具有500兆比特/秒的链路的数据速率，提供423.6MBit /秒的净视频数据率
的带宽也限定的最大数据速率可以为边带信道。下游副作用
带通道在专用插槽下游链路上传输，因此可保证低LA-
tency实时特性。的最大传输速率是由所述采样频率确定
输入引脚在第2.3.2节中定义。
上游边带信道被发送或者作为共模信号在相同或作为差分
在单独的行信号（见图1-2） 。上行信道数据速率是配置向量配置
限定在3.1节中，并不受选择用于上行边带信令方法器
通道。
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2.2串行链路接口
2.2.1下行链路接口
该接口（ SDOUT + ， SDOUT- ）下游串行链路器（Tx -> Rx）的与差分电流来实现
租金模式逻辑（ CML ） 。
2.2.2上行链路接口
作为上游串行通道（从接收到的Tx ）也可以在下行链路建立（嵌入式
返回信道）或单独的一对STP电缆的，不同的信令技术将被采用。
选项1 ：
上行和下行信道共用同一对STP电缆。上行链路采用
共模信号的技术。
选项2 ：
上行和下行信道传输2个独立的对STP电缆。该额外
该APIX设备（ SDIN + ， SDIN- ）的tional上行接口实现了与差分电流模式逻辑
（CML） 。
2.3数字接口
2.3.1像素数据接口
象素数据接口是输入用于表示视频数据的24位并行的像素数据。另外3
像的HSYNC ， VSYNC和DATA像素控制信号ENABLE可以传送。该接口必须是
由外部像素时钟在PX_CLK ，其作为同步时钟的接口驱动。所述象素时钟脉冲
被限制为62兆赫，如表7-6中指定。数据的宽度和用于像素控制数据的结构
通过配置向量定义（见3.1 ）
.
频道
下游
带宽模式
1GBit/s
控制信号发送模式
像素控制信号的传输的结构
PX_DATA宽度
10位
12位
18位
24位
从来没有
62.0兆赫
62.0兆赫
47.0兆赫
35.3兆赫
42.3兆赫
35.2兆赫
23.5兆赫
17.6兆赫
只有偶数像素
62.0兆赫
62.0兆赫
43.4兆赫
33.2兆赫
36.8兆赫
31.3兆赫
21.7兆赫
16.6兆赫
每个像素
62.0兆赫
56.4兆赫
40.3兆赫
31.3兆赫
32.5兆赫
28.2兆赫
20.1兆赫
15.6兆赫
带宽模式
500MBit/s
10位
12位
18位
24位
表2-1 ：最大像素时钟频率不同PX_CTRL和数据宽度的设置
并行像素接口支持10 ， 12 ， 18和24位+ 3控制信号的像素格式。的像素数据和
控制信号进行采样的像素时钟。活性边缘可以被配置为上升沿或下降沿。
建议考虑串联电阻为所有PX_DATA ， PX_CTRL和PX_CLK输入引脚附近
视频源设备，以减少数据相关的排放和反射的风险。
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