IDT71V3557 ， IDT71V3559 ， 128K ×36 ， 256K ×18 ， 3.3V同步SRAM与
ZBT 功能， 3.3VI / O ，突发计数器和流过输出
商用和工业温度范围
引脚德网络nitions
(1)
符号
A
0
-A
17
ADV /
LD
引脚功能
地址输入
前进/负载
I / O
I
I
活跃
不适用
不适用
描述
同步地址输入。地址寄存器由CLK的上升沿的组合触发，
ADV /
LD
低，
CEN
低，真正的芯片使。
ADV /
LD
]是用于加载新的地址和控制时，它的内部寄存器的同步输入
采样在低时钟与所选芯片的上升沿。当ADV /
LD
是低的与芯片
取消选择，正在进行的任何突发终止。当ADV /
LD
被采样为高电平则内部爆裂
计数器先进的，这是正在进行的任何突发。外部地址将被忽略时， ADV /
LD
is
采样为高。
R/
W
信号是一个同步输入，标识发起的当前负载周期是否是读或写
存取存储器阵列。对于当前周期中的数据总线活动发生一个时钟周期之后。
SY nchronous时钟使能输入。当
CEN
采样为高电平，其它所有的同步输入，包括时钟
被忽略，输出保持不变。的效果
CEN
采样高的器件输出好像
低到高时钟转换并没有出现。对于正常操作，
CEN
必须SAMP LED小上升沿
的时钟。
同步字节写使能。每个9位字节都有自己的有源低字节写使能。上载写
个周期（当R /
W
和ADV /
LD
采样低）相应的字节写信号（
BW
1
-
BW
4
）必须是有效的。
字节写信号，还必须对突发写入的每个周期中有效。字节写信号被忽略时，
R/
W
采样为高电平。数据的邑propriate字节（多个）的一个周期后写入到器件中。
BW
1
-
BW
4
都可以接低电平，如果总是在做写入整个36位字。
同步低电平有效芯片使能。
CE
1
和
CE
2
使用带有CE
2
使IDT71V3557 / 59 。 （
CE
1
or
CE
2
高采样或CE
2
采样低点）和ADV /
LD
低，在时钟的上升沿，启动解选
周期。该ZBT
TM
有一个周期的DESE择，即数据总线将三态，一个时钟周期之后是取消
发起。
同步高电平有效芯片使能。 CE
2
用于与
CE
1
和
CE
2
以使芯片。 CE
2
已反转
极性，但其它方面与
CE
1
和
CE
2
.
这是时钟输入到IDT71V3557 / 59 。以外
OE
，对于该设备的所有的定时提述
相对于CLK的上升沿。
数据输入/输出（ I / O）引脚。数据输入路径被登记时，由CLK的上升沿触发。数据
输出路径是通流（无输出寄存器）。
突发为了选择输入。当
LBO
是高的交错突发序列被选择。当
LBO
是低
线性脉冲串顺序被选择。
LBO
是一个静态的输入，并在器件工作期间，必须不会改变..
异步输出使能。
OE
必须低，读取从71V3557 / 59的数据。当
OE
是高的I / O
引脚处于高阻状态。
OE
并不需要进行主动控制的用于读取和写入周期。在
正常运行时，
OE
可以连接到低电平。
给出了TAP控制器的输入命令。采样TDK的上升沿。该引脚具有内部上拉。
寄存器置于TDI和TDO之间的串行输入。采样于TCK的上升沿。该引脚具有
内部上拉电阻。
TAP控制器的时钟输入。每个TAP事件计时。测试输入被捕获在TCK的上升沿，
而测试输出由TCK的下降沿驱动。该引脚具有内部上拉。
寄存器置于TDI和TDO之间的串行输出。视的状态这个输出是活动
TAP控制器。
可选的异步JTAG复位。可用于复位TAP控制器，但不是必需的。 JTAG复位
在上电和使用TMS和TCK每IEEE 1149.1也RESE TS自动发生。如果不使用
TRST
可以
悬空。该引脚具有内部上拉。
同步睡眠模式的输入。 ZZ HIGH将门CLK内部和电源关闭的IDT71V3557 / 3559到
它的功耗最低水平。数据保存期限保证睡眠模式。该引脚具有内部
下拉。
3.3V内核电源。
3.3V的I / O供电。
地面上。
5282 TBL 02
R/
W
READ / WRITE
时钟使能
I
I
不适用
低
CEN
BW
1
-
BW
4
单个字节
写入启用
I
低
CE
1
,
CE
2
芯片使
I
低
CE
2
CLK
I / O
0
-I / O
31
I / O
P1
-I / O
P4
芯片使能
时钟
数据输入/输出
线性突发顺序
OUTPUT ENABLE
I
I
I / O
I
I
高
不适用
不适用
低
低
LBO
OE
TMS
TDI
TCK
TDO
测试模式选择
测试数据输入
测试时钟
测试数据输出
JTAG复位
（可选）
I
I
I
O
不适用
不适用
不适用
不适用
TRST
I
低
ZZ
V
DD
V
DDQ
V
SS
睡眠模式
电源
电源
地
I
不适用
不适用
不适用
高
不适用
不适用
不适用
注意：
1.所有的同步输入必须符合规定的建立和保持时间相对于CLK 。
6.42
2
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