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位置：首页 > IC型号导航 > 首字符I型号页 > 首字符I的型号第896页 > ICS9DB102
数据表
2输出的PCI Express *缓冲带CLKREQ ＃功能
描述
1至2零延迟或扇出缓冲器，用于PCI Express.The
ICS9DB102
零延迟缓冲器支持PCI Express时钟
要求。该
ICS9DB102
由差分SRC从动
输出对从ICS CK409 / CK410兼容的主时钟
发电机如ICS952601或ICS954101 。它减弱
抖动对输入时钟，并具有可选的PLL频带宽度，以
带或不带电子数最大化系统性能
频谱时钟。
ICS9DB102
特点/优势
CLKREQ ＃引脚输出1和4 /输出使能快
卡应用
PLL或旁路模式/ PLL可以去抖动输入时钟
可选的PLL带宽/最小化的抖动峰值
下游PLL的
扩频兼容/曲目蔓延输入时钟
较低的EMI
SMBus接口/未使用的输出可以被禁用
输出特性
2 - 0.7V电流模式差分输出对（ HSCL ）
关键的特定连接的阳离子
周期到周期抖动< 35ps
输出至输出歪曲< 25PS
Funtional框图
CLKREQ0#
CLKREQ1#
PCIEX0
CLK_INT
传播
兼容
PLL
PCIEX1
LK_IN
PLL_BW
SMBDAT
SMBCLK
控制
逻辑
IREF
IDT
TM
/ ICS
TM
2输出快车*缓冲带CLKREQ ＃功能
ICS9DB102
F版07年8月6日
1
ICS9DB102
2输出的PCI Express *缓冲带CLKREQ ＃功能
引脚配置
PLL_BW
CLK_INT
CLK_INC
**CLKREQ0#
VDD
GND
PCIEXT0
PCIEXC0
VDD
SMBDAT
1
2
3
4
5
6
7
8
9
10
20
19
18
17
16
15
14
13
12
11
VDDA
GNDA
IREF
**CLKREQ1#
VDD
GND
PCIEXT1
PCIEXC1
VDD
SMBCLK
电源组
注意：
引脚通过'**' preceeded有内部
120K欧姆的下拉电阻
20引脚SSOP & TSSOP
引脚说明
针＃
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
引脚名称
PLL_BW
CLK_INT
CLK_INC
**CLKREQ0#
VDD
GND
PCIEXT0
PCIEXC0
VDD
SMBDAT
SMBCLK
VDD
PCIEXC1
PCIEXT1
GND
VDD
**CLKREQ1#
PIN TYPE
输入
输入
输入
输入
动力
动力
产量
产量
动力
I / O
输入
动力
产量
产量
动力
动力
输入
描述
3.3V的输入选择PLL带宽度
0 =低， 1 =高
"True"参考时钟输入。
"Complementary"参考时钟输入。
输出使能SRC / PCI Express的双输出“0”
0 =启用，1 =三态
供电，标称3.3V
接地引脚。
差分PCI_Express对真正的时钟。
差分PCI_Express对补钟。
供电，标称3.3V
SMBUS电路的数据引脚，可承受5V
SMBUS电路的时钟引脚，可承受5V
供电，标称3.3V
差分PCI_Express对补钟。
差分PCI_Express对真正的时钟。
接地引脚。
供电，标称3.3V
输出使能SRC / PCI Express的双输出“1”
0 =启用，1 =三态
该引脚建立基准电流的差分电流 -
模式输出对。该引脚需要一个固定的精密电阻连接到
地面，以便建立相应的电流。 475欧姆的
标准值。
接地引脚PLL内核。
3.3V电源为PLL内核。
18
19
20
IREF
GNDA
VDDA
ICS9DB102
引脚数
VDD
GND
5,9,12,16
6,15
9
6
20
19
20
19
描述
PCI Express的输出
SMBUS
IREF
模拟VDD & GND为核心PLL
产量
动力
动力
注意：
引脚通过'**' preceeded内部有120K欧姆的下拉电阻
IDT
TM
/ ICS
TM
2输出快车*缓冲带CLKREQ ＃功能
ICS9DB102
F版07年8月6日
2
ICS9DB102
2输出的PCI Express *缓冲带CLKREQ ＃功能
绝对最大
符号
VDDA
VDD
Ts
TAMBIENT
TCASE
ESD PROT
参数
3.3V内核电源电压
3.3V输出电源电压
储存温度
工作环境温度
外壳温度
输入ESD保护
人体模型
民
GND - 0.5
-65
0
最大
V
DD
+ 0.5V
V
DD
+ 0.5V
150
70
115
单位
V
V
°
C
°C
°C
V
2000
电气特性 - 输入/电源/通用输出参数
T
A
= 0 - 70 ℃;电源电压V
DD
= 3.3 V +/-5%
参数
输入高电压
输入低电压
输入高电流
输入低电平电流
I
IL2
工作电源电流
输入频率
3
引脚电感
1
输入电容
1
CLK稳定
1,2
I
DD3.3OP
F
i
L
针
C
IN
C
OUT
T
刺
符号
V
IH
V
IL
I
IH
I
IL1
条件
民
典型值
最大
V
DD
+ 0.3
0.8
5
单位备注
V
V
uA
uA
uA
75
27
100
100
50
101
7
5
4.5
1.8
30
25
2.7
4
1000
300
33
45
5.5
0.4
mA
mA
兆赫
nH
pF
pF
ms
千赫
千赫
V
V
mA
ns
ns
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
3.3 V +/-5%
2
V
SS
- 0.3
3.3 V +/-5%
V
IN
= V
DD
-5
V
IN
= 0 V ;输入没有上拉
-5
电阻器
V
IN
= 0 V ;输入上拉
-200
电阻器
全部活动，C
L
=满负荷;
所有差分对三态
V
DD
= 3.3 V
99
逻辑输入
输出引脚电容
从V
DD
电到第一钟
三角波调制
调制频率
扩频调制
f
MOD
利盟调制
频率
V
DD
SM总线电压
V
OLSMBUS
@ I
上拉
低电平输出电压
I
上拉
SMBus的SDATA引脚
目前沉没在V
OL
= 0.4 V
SCLK / SDATA
T
RI2C
（最大VIL - 0.15 ）至（最小VIH + 0.15 ）
时钟/数据上升时间
SCLK / SDATA
T
FI2C
（最小VIH + 0.15 ）至（最大VIL - 0.15 ）
时钟/数据下降时间
1
通过设计和特性保证，而不是100 ％生产测试。
IDT
TM
/ ICS
TM
2输出快车*缓冲带CLKREQ ＃功能
ICS9DB102
F版07年8月6日
3
ICS9DB102
2输出的PCI Express *缓冲带CLKREQ ＃功能
电气特性 - PCIEX 0.7V电流模式差分对
T
A
= 0 - 70℃ ; V
DD
= 3.3V +/- 5 ％ ;
L
=为2pF ，R
S
=33.2, R
P
=49.9,
Ι
REF
= 475
参数
符号
条件
民
电流源输出
V
O
= V
x
3000
Zo
阻抗
单统计测量
VHIGH
660
电压高
使用示波器端信号
电压低
VLOW
-150
在测量单端
最大电压
Vovs
使用绝对值信号。
分压
Vuds
-300
过零电压（ABS ） Vcross （ ABS）
过零电压（ VAR ）
长精度
平均周期
绝对分钟内
上升时间
下降时间
上升时间变化
秋季时间变化
输入到输出的延迟
占空比
输出至输出扭曲
抖动，周期循环
1
2
典型值
最大
单位备注
1
1,3
1,3
1,3
1,3
1,3
1,3
1,2
2
2
1,2
1
1
1
1
1
1
1
1
1
1
850
150
1150
350
12
550
140
0
10.0030
10.0533
700
700
125
125
185
3.7
55
25
35
30
mV
mV
mV
mV
PPM
ns
ns
ns
ps
ps
ps
ps
ps
ns
%
ps
ps
ps
250
过路的变化对所有
边缘
看到TPERIOD最小 - 最大价值
100.00MHz名义
100.00MHz蔓延
100.00MHz名义/扩散
V
OL
= 0.175V, V
OH
= 0.525V
V
OH
= 0.525V V
OL
= 0.175V
D- Vcross
PPM
TPERIOD
Tabsmin
t
r
t
f
D-吨
r
D-吨
f
t
pd
t
pdBYP
d
t3
t
sk3
t
jcyc - 环
t
jcyc - cycbyp
9.9970
9.9970
9.8720
175
175
30
30
PLL模式。
旁路模式
从差分测量
李沙
V
T
= 50%
PLL模式。从测量
差分李沙
在旁路模式Additve抖动
135
3.2
45
.
通过设计保证，而不是100 ％生产测试。
所有的长期精度和时钟周期的规格都保证与假设输入
时钟符合CK409 / CK410精度要求
3
I
REF
= V
DD
/(3xR
R
） 。对于R
R
= 475 (1%), I
REF
= 2.32毫安。我
OH
= 6 ×1
REF
和V
OH
= 0.7V @ Z
O
=50.
IDT
TM
/ ICS
TM
2输出快车*缓冲带CLKREQ ＃功能
ICS9DB102
F版07年8月6日
4
ICS9DB102
2输出的PCI Express *缓冲带CLKREQ ＃功能
电气特性 - PLL参数
T
A
= 0 - 70 ℃;电源电压V
DD
= 3.3 V +/-5%
组
PLL抖动峰值
PLL抖动峰值
PLL带宽
PLL带宽
参数
j
峰hibw
j
峰lobw
PLL
HIBW
PLL
LOBW
描述
（ PLL_BW = 1）
（ PLL_BW = 0）
（ PLL_BW = 1）
（ PLL_BW = 0）
第二代PCIe 1相位抖动
（ 1.5 - 22兆赫）
第二代PCIe抖动
（ 8-16兆赫， 5-16兆赫）的Hi-带>1.5MHz
(PLL_BW=1)
第二代PCIe抖动
（ 8-16兆赫， 5-16兆赫）的Hi-带>1.5MHz
(PLL_BW=0)
第二代PCIe抖动
（ 8-16兆赫， 5-16兆赫）罗波段<1.5MHz
民
0
0
2
0.4
典型值
1
1
2.5
0.5
40
2.7
最大
2.5
2
3
1
108
3.1
单位
dB
dB
兆赫
兆赫
ps
ps的均方根
笔记
1,4
1,4
1,5
1,5
1,2,3
1,2,3
抖动，相位
t
jphasePLL
2.2
1.3
3.1
3
ps的均方根
ps的均方根
1,2,3
1,2,3
注意事项：
1.通过设计和特性保证，而不是100 ％生产测试。
2.完整的规格，请参阅http://www.pcisig.com
3.设备由932S421BGLF或同等驱动
4.
测得的最大通带增益。当频率瓦特ithin环路带宽，最高点的放大倍率称为PLL抖动峰值。
5.
测量3分贝道琼斯n或半POW ER点。
IDT
TM
/ ICS
TM
2输出快车*缓冲带CLKREQ ＃功能
ICS9DB102
F版07年8月6日
5
集成
电路
系统公司
ICS9DB102
2输出的PCI Express *缓冲带CLKREQ ＃功能
推荐应用：
1至2零延迟或扇出缓冲器用于PCI Express
输出特点：
2 - 0.7V电流模式差分输出对（ HSCL ）
关键的特定连接的阳离子：
周期到周期抖动< 35ps
输出至输出歪曲< 25 PS
特点/优势：
CLKREQ ＃引脚输出1和4 /输出使能
Express卡应用
PLL或旁路模式/ PLL可以去抖动输入时钟
可选的PLL带宽/最小化的抖动峰值
下游PLL的
扩频兼容/曲目蔓延输入
时钟低EMI
SMBus接口/未使用的输出可以被禁用
引脚配置
PLL_BW
CLK_INT
CLK_INC
**CLKREQ0#
VDD
GND
PCIEXT0
PCIEXC0
VDD
SMBDAT
1
2
3
4
5
6
7
8
9
10
20
19
18
17
16
15
14
13
12
11
VDDA
GNDA
IREF
**CLKREQ1#
VDD
GND
PCIEXT1
PCIEXC1
VDD
SMBCLK
注意：
引脚通过'**' preceeded有内部
120K欧姆的下拉电阻
20引脚SSOP & TSSOP
0852BC—09/12/05
*其他名称和品牌可能是其他公司的财产。
ICS9DB102
集成
电路
系统公司
ICS9DB102
引脚说明
针＃
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
PLL_BW
CLK_INT
CLK_INC
**CLKREQ0#
VDD
GND
PCIEXT0
PCIEXC0
VDD
SMBDAT
SMBCLK
VDD
PCIEXC1
PCIEXT1
GND
VDD
**CLKREQ1#
引脚名称
PIN TYPE
IN
IN
IN
IN
PWR
PWR
OUT
OUT
PWR
I / O
IN
PWR
OUT
OUT
PWR
PWR
IN
描述
3.3V的输入选择PLL带宽度
0 =低， 1 =高
"True"参考时钟输入。
"Complementary"参考时钟输入。
输出使能SRC / PCI Express的双输出“0”
0 =启用，1 =三态
供电，标称3.3V
接地引脚。
差分PCI_Express对真正的时钟。
差分PCI_Express对补钟。
供电，标称3.3V
SMBUS电路的数据引脚，可承受5V
SMBUS电路的时钟引脚，可承受5V
供电，标称3.3V
差分PCI_Express对补钟。
差分PCI_Express对真正的时钟。
接地引脚。
供电，标称3.3V
输出使能SRC / PCI Express的双输出“1”
0 =启用，1 =三态
该引脚建立基准电流的差分电流 -
模式输出对。该引脚需要一个固定的精密电阻连接到
地面，以便建立相应的电流。 475欧姆的
标准值。
接地引脚PLL内核。
3.3V电源为PLL内核。
18
19
20
IREF
GNDA
VDDA
OUT
PWR
PWR
注意：
引脚通过'**' preceeded内部有120K欧姆的下拉电阻
0852C—09/12/05
2
集成
电路
系统公司
ICS9DB102
概述
该
ICS9DB102
零延迟缓冲器支持PCI Express时钟要求。该
ICS9DB102
由差分驱动
SRC输出对来自ICS的CK409 / CK410兼容的主时钟发生器如ICS952601或ICS954101 。它
衰减抖动在输入时钟，并具有可选的PLL频带宽度以最大化系统性能具有或不具有
扩频时钟。一个SMBus接口允许的PLL带宽和旁路控制选项，同时2个时钟
请求（ OE ＃ ）引脚使
ICS9DB102
适合Express卡应用。
框图
CLKREQ0#
CLKREQ1#
PCIEX0
CLK_INT
传播
兼容
PLL
PCIEX1
LK_IN
PLL_BW
SMBDAT
SMBCLK
控制
逻辑
IREF
电源组
引脚数
VDD
GND
5,9,12,16
6,15
9
6
20
19
20
19
描述
PCI Express的输出
SMBUS
IREF
模拟VDD & GND为核心PLL
0852C—09/12/05
3
集成
电路
系统公司
ICS9DB102
绝对最大
符号
VDDA
VDD
Ts
TAMBIENT
TCASE
ESD PROT
参数
3.3V内核电源电压
3.3V输出电源电压
储存温度
工作环境温度
外壳温度
输入ESD保护
人体模型
民
GND - 0.5
-65
0
最大
V
DD
+ 0.5V
V
DD
+ 0.5V
150
70
115
单位
V
V
°
C
°C
°C
V
2000
电气特性 - 输入/电源/通用输出参数
T
A
= 0 - 70 ℃;电源电压V
DD
= 3.3 V +/-5%
参数
输入高电压
输入低电压
输入高电流
符号
V
IH
V
IL
I
IH
I
IL1
输入低电平电流
I
IL2
工作电源电流
输入频率
3
引脚电感
1
输入电容
1
CLK稳定
1,2
调制频率
扩频调制
频率
PLL带宽
SM总线电压
低电平输出电压
目前沉没在V
OL
= 0.4 V
SCLK / SDATA
时钟/数据上升时间
SCLK / SDATA
时钟/数据下降时间
1
条件
3.3 V +/-5%
民
2
典型值
最大
V
DD
+ 0.3
0.8
5
单位备注
V
V
uA
uA
uA
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
I
DD3.3OP
F
i
L
针
C
IN
C
OUT
T
刺
3.3 V +/-5%
V
SS
- 0.3
V
IN
= V
DD
-5
V
IN
= 0 V ;输入没有上拉
-5
电阻
V
IN
= 0 V ;输入上拉
-200
电阻器
全部活动，C
L
=满负荷;
所有差分对三态
V
DD
= 3.3 V
99
逻辑输入
输出引脚电容
从V
DD
电截至1日
时钟
三角波调制
利盟调制
PLL带宽时，
PLL_BW=0
PLL带宽时，
PLL_BW=1
2.7
4
75
27
100
100
50
101
7
5
4.5
1.8
mA
mA
兆赫
nH
pF
pF
ms
千赫
千赫
千赫
兆赫
30
25
400
1.2
33
45
f
MOD
BW
V
DD
V
OLSMBUS
@ I
上拉
I
上拉
SMBus的SDATA引脚
T
RI2C
T
FI2C
（最大VIL - 0.15 ）至（最小VIH + 0.15 ）
（最小VIH + 0.15 ）至（最大VIL - 0.15 ）
5.5
0.4
V
V
mA
ns
ns
1000
300
通过设计和特性保证，而不是100 ％生产测试。
0852C—09/12/05
4
集成
电路
系统公司
ICS9DB102
电气特性 - PCIEX 0.7V电流模式差分对
T
A
= 0 - 70℃ ; V
DD
= 3.3V +/- 5 ％ ;
L
=为2pF ，R
S
=33.2, R
P
=49.9,
Ι
REF
= 475
参数
电流源输出
阻抗
电压高
电压低
最大电压
分压
符号
Zo
VHIGH
VLOW
Vovs
Vuds
条件
V
O
= V
x
单统计测量
使用示波器端信号
在测量单端
使用绝对值信号。
民
3000
660
-150
-300
250
过路的变化对所有
边缘
看到TPERIOD最小 - 最大价值
100.00MHz名义
100.00MHz蔓延
100.00MHz名义/扩散
V
OL
= 0.175V, V
OH
= 0.525V
V
OH
= 0.525V V
OL
= 0.175V
350
12
9.9970
9.9970
9.8720
175
175
30
30
PLL模式。
旁路模式
从差分测量
李沙
V
T
= 50%
PLL模式。从测量
差分李沙
在旁路模式Additve抖动
135
3.2
45
550
140
0
10.0030
10.0533
700
700
125
125
185
3.7
55
25
35
30
850
150
1150
典型值
最大
单位备注
mV
mV
mV
mV
PPM
ns
ns
ns
ps
ps
ps
ps
ps
ns
%
ps
ps
ps
1
1,3
1,3
1,3
1,3
1,3
1,3
1,2
2
2
1,2
1
1
1
1
1
1
1
1
1
1
过零电压（ABS ） Vcross （ ABS）
过零电压（ VAR ）
长精度
平均周期
绝对分钟内
上升时间
下降时间
上升时间变化
秋季时间变化
输入到输出的延迟
占空比
输出至输出扭曲
抖动，周期循环
1
D- Vcross
PPM
TPERIOD
Tabsmin
t
r
t
f
D-吨
r
D-吨
f
t
pd
t
pdBYP
d
t3
t
sk3
t
jcyc - 环
t
jcyc - cycbyp
.
通过设计保证，而不是100 ％生产测试。
2
所有的长期精度和时钟周期的规格都有保证的假设
输入时钟符合CK409 / CK410精度要求
3
I
REF
= V
DD
/(3xR
R
） 。对于R
R
= 475 (1%), I
REF
= 2.32毫安。我
OH
= 6 ×1
REF
和V
OH
= 0.7V @ Z
O
=50.
0852C—09/12/05
5
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