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数据表
1.5V低功耗大范围频率时钟驱动器
ICS98UAE877A
描述
PLL时钟缓冲器, ICS98UAE877A ,被设计为一个
V
DDQ
1.5V的,一个AV
DD
1.5V和差分数据输入
和输出电平。
ICS98UAE877A是分配一个零延迟缓冲器
差分时钟输入对( CLK_INT , CLK_INC )十
差分对时钟输出( CLKT [0: 9] , CLKC [0: 9])和
一个差分对反馈时钟输出( FB_OUTT ,
FBOUTC ) 。时钟输出由输入控制
钟表( CLK_INT , CLK_INC ) ,反馈时钟( FB_INT ,
FB_INC ) ,所述的LVCMOS程序引脚( OE , OS)和
模拟电源输入端( AVDD ) 。当OE为低电平时,输出
(除FB_OUTT / FB_OUTC )被禁用,而
内部PLL继续维持其锁定的频率。
OS (输出选择)是一个程序引脚必须连接到
GND或V
DDQ
。当OS为高电平时, OE将作为
如上所述。当OS低, OE有没有影响
CLKT7 / CLKC7 (它们是自由运行的,除了
FB_OUTT / FB_OUTC ) 。当AV
DD
被接地时,PLL是
被关闭并旁路用于测试目的。
当两个时钟信号( CLK_INT , CLK_INC )的逻辑
低电平时,器件将进入低功耗模式。输入逻辑
在差分输入检测电路中,独立于
输入缓存器,将检测到逻辑低电平,并执行
低功率状态下,所有的输出,反馈和
PLL被关闭。当从两个幸福的输入转换
逻辑低到为差分信号时,PLL将被关
背面上,所述的输入和输出将被启用和PLL
将得到的反馈时钟对之间的相位锁定
( FB_INT , FB_INC )与输入时钟对( CLK_INT ,
CLK_INC )指定的稳定时间TSTAB内。
在ICS98UAE877A时钟驱动的PLL使用的输入
钟表( CLK_INT , CLK_INC )和反馈时钟
( FB_INT , FB_INC ),以提供高性能,低偏移,
低抖动输出差分时钟( CLKT [0 : 9 ] , CLKC [ 0 : 9 ] ) 。
ICS98UAE877A也能够跟踪扩频
时钟( SSC ) ,从而降低EMI 。
ICS98UAE877A在商用温度可
范围( 0 ° C至70 ° C)和工业级温度范围
( -40 ° C至+ 85°C ) 。详情请参阅订购信息
特点
低偏移,低抖动PLL时钟驱动器
1至10差分时钟分配
反馈引脚输入到输出的同步
宽容扩频输入
汽车的PD当输入信号是在一定的逻辑状态
可在52球VFBGA和40引脚MLF
应用
DDR2内存模块/零延迟板扇出
提供了完整的DDR DIMM解决方案
IDT74SSTUAE32xxx家庭
开关特性
周期抖动:
半周期抖动:
输出输出扭曲
周期间抖动
40ps的( DDR2-400 / 533 )
30PS ( DDR2-667 )
60PS ( DDR2-400 / 533 )
50ps的( DDR2-667 )
40ps的( DDR2-400 / 533 )
30PS ( DDR2-667 )
40ps
1.5V低功耗大范围频率时钟驱动器
1
ICS98UAE877A
7181/2
ICS98UAE877A
1.5V低功耗大范围频率时钟驱动器
商用温度等级
框图
LD或OE
OE
OS
AV
DD
(1)
动力
LD ,操作系统,或OE
TEST
模式
PLL旁路
逻辑
LD
CLKT0
CLKC0
CLKT1
CLKC1
CLKT2
CLKC2
CLKT3
CLKC3
CLKT4
CLKC4
CLK_INT
CLK_INC
10KΩ - 100KΩ
FBIN_INT
FBIN_INC
PLL
CLKT5
CLKC5
CLKT6
CLKC6
CLKT7
CLKC7
CLKT8
CLKC8
CLKT9
CLKC9
注意:
1.逻辑检测( LD )对设备断电。
当逻辑LOW同时适用于CLK_INT和
CLK_INC 。
FBOUTT
FBOUTC
1.5V低功耗大范围频率时钟驱动器
2
ICS98UAE877A
7181/2
ICS98UAE877A
1.5V低功耗大范围频率时钟驱动器
商用温度等级
销刀豆网络gurations
CLKC1
CLKC0
CLKC5
CLKT6
CLKC6
32
CLKT1
CLKT0
CLKT5
V
DDQ
V
DDQ
31
1
A
2
3
4
5
6
40
39
38
37
36
35
34
B
C
D
E
F
G
H
J
33
V
DDQ
CLKC2
CLKT2
CLK_INT
CLK_INC
V
DDQ
AGND
AV
DD
V
DDQ
GND
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
30
29
28
27
26
25
24
23
22
21
CLKC7
CLKT7
V
DDQ
FB_INT
FB_INC
FBOUTC
FBOUTT
V
DDQ
OE
OS
CLKT3
CLKT4
CLKT8
V
DDQ
CLKC4
CLKC3
CLKC9
K
A
B
C
D
E
F
G
H
J
K
1
CLKT1
CLKC1
CLKC2
CLKT2
CLK_INT
CLK_INC
AGND
AVDD
CLKT3
CLKC3
2
CLKT0
GND
GND
VDDQ
VDDQ
VDDQ
VDDQ
GND
GND
CLKC4
3
CLKC0
GND
NB
VDDQ
NB
NB
VDDQ
NB
GND
CLKT4
4
CLKC5
GND
NB
VDDQ
NB
NB
VDDQ
NB
GND
CLKT9
5
CLKT5
GND
GND
OS
VDDQ
OE
VDDQ
GND
GND
CLKC9
6
CLKT6
CLKC6
CLKC7
CLKT7
FB_INT
FB_INC
FB_OUTC
FB_OUTT
CLKT8
CLKC8
40引脚MLF
顶视图
176球BGA
顶视图
1.5V低功耗大范围频率时钟驱动器
3
ICS98UAE877A
CLKC8
CLKT9
V
DDQ
7181/2
ICS98UAE877A
1.5V低功耗大范围频率时钟驱动器
商用温度等级
引脚说明
终端名称
AGND
AV
DD
CLK_INT
CLK_INC
FB_INT
FB_INC
FB_OUTT
FB_OUTC
OE
OS
GND
V
DDQ
CLKT [0: 9]
CLKC [0: 9]
NB
模拟地
模拟电源
时钟输入使用10K- 100K
Ω
下拉电阻
互补时钟输入,一个10K- 100K
Ω
下拉
电阻器
反馈时钟输入
互补反馈时钟输入
反馈时钟输出
互补反馈时钟输出
输出使能(异步)
输出选择(连接到GND或V
DDQ
)
逻辑和输出功率
时钟输出
互补的时钟输出
无装球
描述
电动
特征
1.5V标称
差分输入
差分输入
差分输入
差分输入
迪FF erential输出
迪FF erential输出
LVCMOS输入
LVCMOS输入
1.5V标称
差分输出
差分输出
1.5V低功耗大范围频率时钟驱动器
4
ICS98UAE877A
7181/2
ICS98UAE877A
1.5V低功耗大范围频率时钟驱动器
商用温度等级
功能表
输入
AV
DD
GND
GND
GND
GND
1.5V (标称值)
1.5V (标称值)
1.5V (标称值)
1.5V (标称值)
1.5V (标称值)
1.5V (标称值)
1
输出
CLK_
INT
L
H
L
H
L
H
L
H
L
H
OE
H
H
L
L
L
L
H
H
X
X
OS
X
X
H
L
H
L
X
X
X
X
CLK_
INC。
H
L
H
L
H
L
H
L
L
H
CLKT
L
H
L( Z)的
1
L( Z)
CLKT7
活跃
1
L( Z)的
1
L( Z)
CLKT7
活跃
1
L
H
L( Z)的
1
CLKC
H
L
L( Z)的
1
L( Z)
CLKC7
活跃
1
L( Z)的
1
L( Z)
CLKC7
活跃
1
H
L
L( Z)的
1
FB_
OUTT
L
H
FB_
OUTC
H
L
PLL
旁路/关
旁路/关
旁路/关
H
L
H
L
H
L( Z)的
1
版权所有
L
H
L
H
L
L( Z)的
1
旁路/关
On
On
On
On
关闭
禁用输出为低电平状态会议上我
ODL
极限。
绝对最大额定值
应力超过绝对最大额定值可能会造成永久性损伤
装置。这是一个额定值,器件运行在超过或任何其他条件
与本规范的业务部门所标明是不是暗示。暴露在绝对最大额定值
长时间条件下可能会影响其可靠性。
供电电压, (AV
DD
和V
DDQ
)
逻辑输入
工作环境温度
储存温度
-0.5V至2.5V
等级
GND - 0.5V至V
DDQ
+ 0.5V
-40 ° C至+ 85°C
-65到+ 150°C
1.5V低功耗大范围频率时钟驱动器
5
ICS98UAE877A
7181/2
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    联系人:杨小姐
    地址:深圳市福田区振兴路156号上步工业区405栋3层

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