集成
电路
系统公司
ICS852911I
L
OW
S
KEW
, 1-
TO
-9
D
。微分
-
TO
-HSTL F
ANOUT
B
UFFER
F
EATURES
9 HSTL输出
可选的差分CLK ， NCLK或LVPECL时钟输入
HSTL_CLK ， nHSTL_CLK对可以接受以下
差分输入级： LVPECL ， LVDS ， HSTL ， SSTL ， HCSL
PECL_CLK ， nPECL_CLK支持以下输入类型：
LVPECL ， CML ， SSTL
最大输出频率： 500MHz的
输出偏斜： 100ps的（最大）
部分到部分歪斜： 300PS （最大值）
传播延迟： 1.7ns （最大值）
V
OH
= 1.4V （最大）
3.3V内核， 1.6V至3.6V的输出电压范围
-40 ° C至85°C的工作环境温度
G
ENERAL
D
ESCRIPTION
该ICS852911I是一种低歪斜， 1至9 Differen-
TiAl基到HSTL扇出缓冲器和的一员
HiPerClockS
HiPerClocks 系列高性能时钟
从IC解决方案。该ICS852911I有两个SE-
lectable时钟输入，可以接受最昼夜温差
髓鞘的输入电平。
ICS
保证输出歪斜，部件到部件歪斜和交叉
电压特性使ICS852911I非常适合今天的
最先进的应用程序，如IA64和静态RAM 。
B
LOCK
D
IAGRAM
HSTL_CLK
nHSTL_CLK
PECL_CLK
nPECL_CLK
CLK_SEL
0
1
Q1
nQ1
Q2
nQ2
Q0
nQ0
P
IN
A
SSIGNMENT
V
DDO
nQ0
nQ1
nQ2
Q0
Q1
Q2
25
GND
CLK_SEL
HSTL_CLK
V
DD
26
27
28
1
2
3
4
5
nQ8
24
23 22
21
20
19
18
17
16
Q3
nQ3
Q4
V
DDO
nQ4
Q5
nQ5
ICS852911I
15
14
13
Q3
nQ3
Q4
nQ4
Q5
nQ5
Q6
nQ6
Q7
nQ7
Q8
nQ8
nHSTL_CLK
PECL_CLK
nPECL_CLK
6
Q8
7
nQ7
8
V
DDO
9
Q7
10
nQ6
12
11
Q6
28引脚PLCC
11.6毫米X 11.4毫米X 4.1毫米包体
V封装
顶视图
852911AVI
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1
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电路
系统公司
ICS852911I
L
OW
S
KEW
, 1-
TO
-9
D
。微分
-
TO
-HSTL F
ANOUT
B
UFFER
TYPE
描述
核心供电引脚。
上拉/
INVER婷差分时钟输入。 V
CC
/ 2时默认悬空。
下拉
下拉非INVER婷差动LVPECL时钟输入。
上拉/
INVER婷差分时钟输入。 V
CC
/ 2时默认悬空。
下拉
差分输出对。 HSTL接口电平。
差分输出对。 HSTL接口电平。
输出电源引脚。
差分输出对。 HSTL接口电平。
差分输出对。 HSTL接口电平。
差分输出对。 HSTL接口电平。
差分输出对。 HSTL接口电平。
差分输出对。 HSTL接口电平。
差分输出对。 HSTL接口电平。
差分输出对。 HSTL接口电平。
电源接地。
时钟选择输入。当HIGH ，选择PECL_CLK ， nPECL_CLK投入。
下拉低电平时，选择HSTL_CLK ， nHSTL_CLK 。
LVTTL / LVCMOS接口电平。
下拉非INVER婷差分时钟输入。
T
ABLE
1. P
IN
D
ESCRIPTIONS
数
1
2
3
4
5, 6
7, 9
8, 15, 22
10, 11
12, 13
14, 16
17, 18
19, 20
21, 23
24, 25
26
27
28
南ê
V
DD
nHSTL_CLK
PECL_CLK
nPECL_CLK
nQ8 ， Q8
nQ7 ， Q7
V
DDO
nQ6 ， Q6
nQ5 ， Q5
nQ4 ， Q4
nQ3 Q3
NQ2 ， Q2
NQ1 ， Q1
nQ0 ， Q0
GND
CLK_SE L
HSTL_CLK
动力
输入
输入
输入
产量
产量
动力
产量
产量
产量
产量
产量
产量
产量
动力
输入
输入
注意：
上拉
和
下拉
是指内部输入电阻。见表2 ，引脚特性，为典型值。
T
ABLE
2. P
IN
C
极特
符号
C
IN
R
上拉
R
下拉
参数
输入电容
输入上拉电阻
输入下拉电阻
测试条件
最小典型
4
51
51
最大
单位
pF
kΩ
kΩ
T
ABLE
3. C
ONTROL
I
NPUT
F
油膏
T
ABLE
输入
CLK_SEL
0
1
选定采购
HSTL_CLK ， nHSTL_CLK
PECL_CLK ， nPECL_CLK
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ICS852911I
L
OW
S
KEW
, 1-
TO
-9
D
。微分
-
TO
-HSTL F
ANOUT
B
UFFER
4.6V
-0.5V到V
DD
+ 0.5V
50mA
100mA
37.8 ℃/ W（ 0 LFPM ）
-65 ℃150 ℃的
注：如果运行条件超出绝对下上市
最大额定值可能会造成永久性损坏
装置。这些评价只强调规范。实用
产物在这些条件下或在任何条件操作BE-
彼处那些在上市
DC特性
or
AC Character-
istics
是不是暗示。暴露在绝对最大额定值
长时间条件可能会影响产品的可靠性。
A
BSOLUTE
M
AXIMUM
R
ATINGS
电源电压，V
CC
输入，V
I
输出，我
O
连续电流
浪涌电流
封装的热阻抗，
θ
JA
贮藏温度，T
英镑
T
ABLE
4A 。 P
OWER
S
UPPLY
DC
极特
,
V
DD
= 3.3V±0.3V, V
DDO
= 1.6V
TO
3.6V ，T
A
= -40°C
TO
85°C
符号
V
DD
V
DDO
I
DD
参数
核心供电电压
输出电源电压
电源电流
测试条件
最低
3.0
1.6
典型
3.3
3.3
最大
3.6
3.6
95
单位
V
V
mA
T
ABLE
4B 。 LVCMOS / LVTTL DC
极特
,
V
DD
= 3.3V±0.3V, V
DDO
= 1.6V
TO
3.6V ，T
A
= -40°C
TO
85°C
符号
V
IH
V
IL
I
IH
I
IL
参数
CLK_SEL
CLK_SEL
输入高电流
输入低电平电流
CLK_SEL
CLK_SEL
V
IN
= V
DD
= 3.6V
V
IN
= 0V, V
DD
= 3.6V
-5
测试条件
最低
2
-0.3
典型
最大
V
DD
+ 0.3
0.8
150
单位
V
V
A
A
T
ABLE
4C 。 LVPECL DC
极特
,
V
DD
= 3.3V±0.3V, V
DDO
= 1.6V
TO
3.6V ，T
A
= -40°C
TO
85°C
符号
I
IH
I
IL
V
PP
参数
输入高电流
输入低电平电流
PECL_CLK
nPECL_CLK
PECL_CLK
nPECL_CLK
测试条件
V
DD
= V
IN
= 3.6V
V
DD
= V
IN
= 3.6V
V
DD
= 3.6V, V
IN
= 0V
V
DD
= 3.6V, V
IN
= 0V
-5
-150
0.3
1
最低
典型
最大
150
150
单位
A
A
A
A
V
V
峰 - 峰值输入电压
V
CMR
共模输入电压;注： 1 ， 2
1.5
V
DD
注1 ：共模电压定义为V
IH
.
注2 ：对于单端应用，最大输入电压为PECL_CLK和nPECL_CLK为V
DD
+ 0.3V.
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ICS852911I
L
OW
S
KEW
, 1-
TO
-9
D
。微分
-
TO
-HSTL F
ANOUT
B
UFFER
测试条件
HSTL_CLK
nHSTL_CLK
HSTL_CLK
nHSTL_CLK
V
IN
= V
DD
= 3.6V
V
IN
= V
DD
= 3.6V
V
IN
= 0V, V
DD
= 3.6V
V
IN
= 0V, V
DD
= 3.6V
-5
-150
0.15
0.5
1.0
0
40
1. 3
V
DD
- 0.85
1.4
0.4
60
最低
典型
最大
150
150
单位
A
A
A
A
V
V
V
V
%
V
T
ABLE
4D 。 HSTL DC
极特
,
V
DD
= 3.3V±0.3V, V
DDO
= 1.6V
TO
3.6V ，T
A
= -40°C
TO
85°C
符号
I
IH
I
IL
V
PP
V
CMR
V
OH
V
OL
V
OX
参数
输入高电流
输入低电平电流
峰 - 峰值输入电压
共模输入电压;
注1,2
输出高电压;注3
输出低电压;注3
输出电压交叉;注4
峰至峰输出电压摆幅
0.6
1.1
V
摇摆
注1 ：对于单端应用，最大输入电压为HSTL_CLK和nHSTL_CLK为V
DD
+ 0.3V.
注2 ：共模电压定义为V
IH
.
注3 ：输出端接50
Ω
到地面。
注4 ：定义的相对于输出电压摆幅在给定的条件。
T
ABLE
5. AC - C
极特
,
V
DD
= 3.3V±0.3V, V
DDO
= 1.6V
TO
3.6V ，T
A
= -40°C
TO
85°C
符号
f
最大
t
PD
参数
输出频率
传播延迟;注1
输出偏斜;注2： 4
帕吨至帕吨倾斜;注3，注4
输出上升/下降时间
20 ％至80％
20 0
1.3
1.5
测试条件
最低
典型
最大
500
1. 7
100
300
600
53
单位
兆赫
ns
ps
ps
ps
%
t
SK （ O）
t
SK （PP）的
t
R
/ t
F
ODC
输出占空比
47
在f测量所有参数
最大
除非另有说明。
注1 ：从差动输入交叉点到差动输出交叉点测定。
从V测
DD
/ 2到输出差分交点为单端输入电平。
注2 ：定义为输出之间的偏移，在相同的电源电压，并以相等的负载条件。
测得的输出差分交叉点。
注3 ：定义为扭曲在不同的设备输出，在相同的电源电压下工作的
并且以相同的负载条件。使用同一类型的每个设备上的输入，输出被测量
在差分交叉点。
注4 ：该参数定义符合JEDEC标准65 。
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L
OW
S
KEW
, 1-
TO
-9
D
。微分
-
TO
-HSTL F
ANOUT
B
UFFER
P
ARAMETER
M
EASUREMENT
I
载文信息
3.3V±0.3V
1.6V至3.6V
V
DD
V
DD
V
DDO
Qx
范围
nHSTL_CLK ，
nPECL_CLK
HSTL
GND
nQx
V
HSTL_CLK ，
PECL_CLK
PP
交叉点
V
CMR
GND
0V
3.3V
矿
/1.6V
TO
3.6V
安输出
L
OAD
AC牛逼
美东时间
C
IRCUIT
D
。微分
I
NPUT
L
伊维尔基尼
nQx
Qx
NQY
Qy
第1部分
nQx
Qx
第2部分
NQY
Qy
TSK （ O）
TSK （ PP）
O
安输出
S
KEW
P
艺术
-
TO
-P
艺术
S
KEW
nHSTL_CLK ，
nPECL_CLK
80%
HSTL_CLK ，
PECL_CLK
nQ0 ： nQ8
Q0:Q8
t
PD
80%
V
OD
时钟
输出
20%
t
R
t
F
20%
P
ROPAGATION
D
ELAY
nQ0 ： nQ8
Q0:Q8
O
安输出
R
ISE
/F
所有
T
IME
t
PW
t
期
ODC =
t
PW
t
期
x 100%
O
安输出
D
UTY
C
YCLE
/P
ULSE
W
ID
/P
ERIOD
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电路
系统公司
ICS852911I
L
OW
S
KEW
, 1-
TO
-9
D
。微分
-
TO
-HSTL F
ANOUT
B
UFFER
F
EATURES
9 HSTL输出
可选的差分CLK ， NCLK或LVPECL时钟输入
HSTL_CLK ， nHSTL_CLK对可以接受以下
差分输入级： LVPECL ， LVDS ， HSTL ， SSTL ， HCSL
PECL_CLK ， nPECL_CLK支持以下输入类型：
LVPECL ， CML ， SSTL
最大输出频率： 500MHz的
输出偏斜： 100ps的（最大）
部分到部分歪斜： 300PS （最大值）
传播延迟： 1.7ns （最大值）
V
OH
= 1.4V （最大）
3.3V内核， 1.6V至3.6V的输出电压范围
-40 ° C至85°C的工作环境温度
G
ENERAL
D
ESCRIPTION
该ICS852911I是一种低歪斜， 1至9 Differen-
TiAl基到HSTL扇出缓冲器和的一员
HiPerClockS
HiPerClocks 系列高性能时钟
从IC解决方案。该ICS852911I有两个SE-
lectable时钟输入，可以接受最昼夜温差
髓鞘的输入电平。
ICS
保证输出歪斜，部件到部件歪斜和交叉
电压特性使ICS852911I非常适合今天的
最先进的应用程序，如IA64和静态RAM 。
B
LOCK
D
IAGRAM
HSTL_CLK
nHSTL_CLK
PECL_CLK
nPECL_CLK
CLK_SEL
0
1
Q1
nQ1
Q2
nQ2
Q0
nQ0
P
IN
A
SSIGNMENT
V
DDO
nQ0
nQ1
nQ2
Q0
Q1
Q2
25
GND
CLK_SEL
HSTL_CLK
V
DD
26
27
28
1
2
3
4
5
nQ8
24
23 22
21
20
19
18
17
16
Q3
nQ3
Q4
V
DDO
nQ4
Q5
nQ5
ICS852911I
15
14
13
Q3
nQ3
Q4
nQ4
Q5
nQ5
Q6
nQ6
Q7
nQ7
Q8
nQ8
nHSTL_CLK
PECL_CLK
nPECL_CLK
6
Q8
7
nQ7
8
V
DDO
9
Q7
10
nQ6
12
11
Q6
28引脚PLCC
11.6毫米X 11.4毫米X 4.1毫米包体
V封装
顶视图
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1
REV 。一个2005年5月23日
集成
电路
系统公司
ICS852911I
L
OW
S
KEW
, 1-
TO
-9
D
。微分
-
TO
-HSTL F
ANOUT
B
UFFER
TYPE
描述
核心供电引脚。
上拉/
INVER婷差分时钟输入。 V
CC
/ 2时默认悬空。
下拉
下拉非INVER婷差动LVPECL时钟输入。
上拉/
INVER婷差分时钟输入。 V
CC
/ 2时默认悬空。
下拉
差分输出对。 HSTL接口电平。
差分输出对。 HSTL接口电平。
输出电源引脚。
差分输出对。 HSTL接口电平。
差分输出对。 HSTL接口电平。
差分输出对。 HSTL接口电平。
差分输出对。 HSTL接口电平。
差分输出对。 HSTL接口电平。
差分输出对。 HSTL接口电平。
差分输出对。 HSTL接口电平。
电源接地。
时钟选择输入。当HIGH ，选择PECL_CLK ， nPECL_CLK投入。
下拉低电平时，选择HSTL_CLK ， nHSTL_CLK 。
LVTTL / LVCMOS接口电平。
下拉非INVER婷差分时钟输入。
T
ABLE
1. P
IN
D
ESCRIPTIONS
数
1
2
3
4
5, 6
7, 9
8, 15, 22
10, 11
12, 13
14, 16
17, 18
19, 20
21, 23
24, 25
26
27
28
南ê
V
DD
nHSTL_CLK
PECL_CLK
nPECL_CLK
nQ8 ， Q8
nQ7 ， Q7
V
DDO
nQ6 ， Q6
nQ5 ， Q5
nQ4 ， Q4
nQ3 Q3
NQ2 ， Q2
NQ1 ， Q1
nQ0 ， Q0
GND
CLK_SE L
HSTL_CLK
动力
输入
输入
输入
产量
产量
动力
产量
产量
产量
产量
产量
产量
产量
动力
输入
输入
注意：
上拉
和
下拉
是指内部输入电阻。见表2 ，引脚特性，为典型值。
T
ABLE
2. P
IN
C
极特
符号
C
IN
R
上拉
R
下拉
参数
输入电容
输入上拉电阻
输入下拉电阻
测试条件
最小典型
4
51
51
最大
单位
pF
kΩ
kΩ
T
ABLE
3. C
ONTROL
I
NPUT
F
油膏
T
ABLE
输入
CLK_SEL
0
1
选定采购
HSTL_CLK ， nHSTL_CLK
PECL_CLK ， nPECL_CLK
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2
REV 。一个2005年5月23日
集成
电路
系统公司
ICS852911I
L
OW
S
KEW
, 1-
TO
-9
D
。微分
-
TO
-HSTL F
ANOUT
B
UFFER
4.6V
-0.5V到V
DD
+ 0.5V
50mA
100mA
37.8 ℃/ W（ 0 LFPM ）
-65 ℃150 ℃的
注：如果运行条件超出绝对下上市
最大额定值可能会造成永久性损坏
装置。这些评价只强调规范。实用
产物在这些条件下或在任何条件操作BE-
彼处那些在上市
DC特性
or
AC Character-
istics
是不是暗示。暴露在绝对最大额定值
长时间条件可能会影响产品的可靠性。
A
BSOLUTE
M
AXIMUM
R
ATINGS
电源电压，V
CC
输入，V
I
输出，我
O
连续电流
浪涌电流
封装的热阻抗，
θ
JA
贮藏温度，T
英镑
T
ABLE
4A 。 P
OWER
S
UPPLY
DC
极特
,
V
DD
= 3.3V±0.3V, V
DDO
= 1.6V
TO
3.6V ，T
A
= -40°C
TO
85°C
符号
V
DD
V
DDO
I
DD
参数
核心供电电压
输出电源电压
电源电流
测试条件
最低
3.0
1.6
典型
3.3
3.3
最大
3.6
3.6
95
单位
V
V
mA
T
ABLE
4B 。 LVCMOS / LVTTL DC
极特
,
V
DD
= 3.3V±0.3V, V
DDO
= 1.6V
TO
3.6V ，T
A
= -40°C
TO
85°C
符号
V
IH
V
IL
I
IH
I
IL
参数
CLK_SEL
CLK_SEL
输入高电流
输入低电平电流
CLK_SEL
CLK_SEL
V
IN
= V
DD
= 3.6V
V
IN
= 0V, V
DD
= 3.6V
-5
测试条件
最低
2
-0.3
典型
最大
V
DD
+ 0.3
0.8
150
单位
V
V
A
A
T
ABLE
4C 。 LVPECL DC
极特
,
V
DD
= 3.3V±0.3V, V
DDO
= 1.6V
TO
3.6V ，T
A
= -40°C
TO
85°C
符号
I
IH
I
IL
V
PP
参数
输入高电流
输入低电平电流
PECL_CLK
nPECL_CLK
PECL_CLK
nPECL_CLK
测试条件
V
DD
= V
IN
= 3.6V
V
DD
= V
IN
= 3.6V
V
DD
= 3.6V, V
IN
= 0V
V
DD
= 3.6V, V
IN
= 0V
-5
-150
0.3
1
最低
典型
最大
150
150
单位
A
A
A
A
V
V
峰 - 峰值输入电压
V
CMR
共模输入电压;注： 1 ， 2
1.5
V
DD
注1 ：共模电压定义为V
IH
.
注2 ：对于单端应用，最大输入电压为PECL_CLK和nPECL_CLK为V
DD
+ 0.3V.
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3
REV 。一个2005年5月23日
集成
电路
系统公司
ICS852911I
L
OW
S
KEW
, 1-
TO
-9
D
。微分
-
TO
-HSTL F
ANOUT
B
UFFER
测试条件
HSTL_CLK
nHSTL_CLK
HSTL_CLK
nHSTL_CLK
V
IN
= V
DD
= 3.6V
V
IN
= V
DD
= 3.6V
V
IN
= 0V, V
DD
= 3.6V
V
IN
= 0V, V
DD
= 3.6V
-5
-150
0.15
0.5
1.0
0
40
1. 3
V
DD
- 0.85
1.4
0.4
60
最低
典型
最大
150
150
单位
A
A
A
A
V
V
V
V
%
V
T
ABLE
4D 。 HSTL DC
极特
,
V
DD
= 3.3V±0.3V, V
DDO
= 1.6V
TO
3.6V ，T
A
= -40°C
TO
85°C
符号
I
IH
I
IL
V
PP
V
CMR
V
OH
V
OL
V
OX
参数
输入高电流
输入低电平电流
峰 - 峰值输入电压
共模输入电压;
注1,2
输出高电压;注3
输出低电压;注3
输出电压交叉;注4
峰至峰输出电压摆幅
0.6
1.1
V
摇摆
注1 ：对于单端应用，最大输入电压为HSTL_CLK和nHSTL_CLK为V
DD
+ 0.3V.
注2 ：共模电压定义为V
IH
.
注3 ：输出端接50
Ω
到地面。
注4 ：定义的相对于输出电压摆幅在给定的条件。
T
ABLE
5. AC - C
极特
,
V
DD
= 3.3V±0.3V, V
DDO
= 1.6V
TO
3.6V ，T
A
= -40°C
TO
85°C
符号
f
最大
t
PD
参数
输出频率
传播延迟;注1
输出偏斜;注2： 4
帕吨至帕吨倾斜;注3，注4
输出上升/下降时间
20 ％至80％
20 0
1.3
1.5
测试条件
最低
典型
最大
500
1. 7
100
300
600
53
单位
兆赫
ns
ps
ps
ps
%
t
SK （ O）
t
SK （PP）的
t
R
/ t
F
ODC
输出占空比
47
在f测量所有参数
最大
除非另有说明。
注1 ：从差动输入交叉点到差动输出交叉点测定。
从V测
DD
/ 2到输出差分交点为单端输入电平。
注2 ：定义为输出之间的偏移，在相同的电源电压，并以相等的负载条件。
测得的输出差分交叉点。
注3 ：定义为扭曲在不同的设备输出，在相同的电源电压下工作的
并且以相同的负载条件。使用同一类型的每个设备上的输入，输出被测量
在差分交叉点。
注4 ：该参数定义符合JEDEC标准65 。
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集成
电路
系统公司
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L
OW
S
KEW
, 1-
TO
-9
D
。微分
-
TO
-HSTL F
ANOUT
B
UFFER
P
ARAMETER
M
EASUREMENT
I
载文信息
3.3V±0.3V
1.6V至3.6V
V
DD
V
DD
V
DDO
Qx
范围
nHSTL_CLK ，
nPECL_CLK
HSTL
GND
nQx
V
HSTL_CLK ，
PECL_CLK
PP
交叉点
V
CMR
GND
0V
3.3V
矿
/1.6V
TO
3.6V
安输出
L
OAD
AC牛逼
美东时间
C
IRCUIT
D
。微分
I
NPUT
L
伊维尔基尼
nQx
Qx
NQY
Qy
第1部分
nQx
Qx
第2部分
NQY
Qy
TSK （ O）
TSK （ PP）
O
安输出
S
KEW
P
艺术
-
TO
-P
艺术
S
KEW
nHSTL_CLK ，
nPECL_CLK
80%
HSTL_CLK ，
PECL_CLK
nQ0 ： nQ8
Q0:Q8
t
PD
80%
V
OD
时钟
输出
20%
t
R
t
F
20%
P
ROPAGATION
D
ELAY
nQ0 ： nQ8
Q0:Q8
O
安输出
R
ISE
/F
所有
T
IME
t
PW
t
期
ODC =
t
PW
t
期
x 100%
O
安输出
D
UTY
C
YCLE
/P
ULSE
W
ID
/P
ERIOD
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