初步
集成
电路
系统公司
ICS8520
L
OW
S
KEW
, 1-
TO
-16
D
。微分
-
TO
-3.3V LVHSTL F
ANOUT
B
UFFER
F
EATURES
16个差分3.3V LVHSTL与能力输出各
驱动50Ω至地
1差分CLK ， NCLK输入对
CLK ， NCLK对可以接受以下差分输入
级别： LVDS ， LVPECL ， LVHSTL ， SSTL ， HCSL
最大输出频率高达500MHz
平移单端输入电平LVHSTL与水平
电阻偏置NCLK输入
输出偏斜： 50ps的（最大）
部件到部件歪斜： 250PS （最大值）
传播延迟： 1.6ns （最大值）
VOH ： 1.2V （最大）
VOH 40 ％
≤
Vcrossover
≤
的Voh 60％
3.3V核心， 1.8V输出工作电源电压
0 ° C至70 ° C的环境工作温度
G
ENERAL
D
ESCRIPTION
该ICS8520是一种低歪斜，高性能
1至16差分至3.3V LVHSTL扇出缓冲器
HiPerClockS
和HiPerClockS成员系列
从ICS高性能时钟解决方案。该
ICS8520有1个时钟输入对。在CLK ， NCLK
对可以接受最标准的差分输入级。
,&6
保证输出歪斜，部件到部件歪斜和交叉
电压特性使ICS8520理想的接口安排
荷兰国际集团以当今最先进的微处理器和静
的RAM 。
B
LOCK
D
IAGRAM
CLK
NCLK
P
IN
A
SSIGNMENT
NCLK
VCCO
Q15
nQ15
Q14
nQ14
GND
Q13
nQ13
Q12
nQ12
VCCO
Q0
nQ0
Q1
nQ1
Q2
nQ2
Q3
nQ3
Q4
nQ4
Q5
nQ5
Q6
nQ6
Q7
nQ7
Q15
nQ15
Q14
nQ14
Q13
nQ13
Q12
nQ12
Q11
nQ11
Q10
nQ10
Q9
nQ9
Q8
nQ8
VCCO
Q11
nQ11
Q10
nQ10
GND
Q9
nQ9
Q8
nQ8
VCCO
VCC
48 47 46 45 44 43 42 41 40 39 38 37
1
36
2
35
3
34
4
33
5
32
6
31
7
30
8
29
9
28
10
27
11
26
12
25
13 14 15 16 17 18 19 20 21 22 23 24
ICS8520
CLK
VCCO
nQ0
Q0
nQ1
Q1
GND
nQ2
Q2
nQ3
Q3
VCCO
48引脚LQFP
采用7mm x 7mm X 1.4毫米体封装
Y封装
顶视图
本文提供的初步信息代表了原型或试生产的产物。所提到的特征是基于初始
产品特性。集成电路系统公司（ ICS）保留更改任何电路或规格，恕不另行通知。
ICS8520DY
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1
VCCO
nQ4
Q4
nQ5
Q5
GND
nQ6
Q6
nQ7
Q7
VCCO
VCC
初步
集成
电路
系统公司
ICS8520
L
OW
S
KEW
, 1-
TO
-16
D
。微分
-
TO
-3.3V LVHSTL F
ANOUT
B
UFFER
TYPE
描述
输出电源引脚。连接到1.8V 。
差分输出对。 LVHSTL接口电平。
差分输出对。 LVHSTL接口电平。
负电源引脚。连接到地面。
差分输出对。 LVHSTL接口电平。
差分输出对。 LVHSTL接口电平。
正电源引脚。连接到3.3V 。
差分输出对。 LVHSTL接口电平。
差分输出对。 LVHSTL接口电平。
差分输出对。 LVHSTL接口电平。
差分输出对。 LVHSTL接口电平。
差分输出对。 LVHSTL接口电平。
差分输出对。 LVHSTL接口电平。
下拉非INVER婷差分时钟输入。
上拉
INVER婷差分时钟输入。
差分输出对。 LVHSTL接口电平。
差分输出对。 LVHSTL接口电平。
差分输出对。 LVHSTL接口电平。
差分输出对。 LVHSTL接口电平。
T
ABLE
1. P
IN
D
ESCRIPTIONS
数
1, 11,
14, 24,
25, 35,
38, 48
2, 3
4, 5
6, 19,
30, 43
7, 8
9, 10
12, 13
15, 16
1 7, 18
20, 21
22, 23
26, 27
28, 29
36
37
39, 40
41, 42
44, 45
46, 47
名字
VCCO
Q11 ， nQ11
Q10 ， nQ10
VEE
Q9 ， nQ9
Q8 ， nQ8
VCC
Q7 ， nQ7
Q6 ， nQ6
Q5 ， nQ5
Q4 ， nQ4
Q3 ， nQ3
Q2 ， NQ2
CLK
NCLK
Q15 ， nQ15
Q14 ， nQ14
Q13 ， nQ13
Q12 ， nQ12
动力
产量
产量
动力
产量
产量
动力
产量
产量
产量
产量
产量
产量
输入
输入
产量
产量
产量
产量
注意：
上拉
和
下拉
指的是内部的输入电阻。见表2 ，引脚特性，为典型值。
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2
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L
OW
S
KEW
, 1-
TO
-16
D
。微分
-
TO
-3.3V LVHSTL F
ANOUT
B
UFFER
测试条件
CLK ， NCLK
51
51
最低
典型
最大
4
单位
pF
K
K
T
ABLE
2. P
IN
C
极特
符号
CIN
RPULLUP
RPULLDOWN
参数
输入电容
输入上拉电阻
输入下拉电阻
T
ABLE
3. F
油膏
T
ABLE
输入
CLK
0
1
0
1
偏见;注1
NCLK
1
0
偏见;注1
偏见;注1
0
低
高
低
高
高
输出
Q0通Q15
nQ0通nQ15
高
低
高
低
低
输入到输出模式
差分至差分
差分至差分
单端至差分
单端至差分
单端至差分
极性
非铟（Inver）婷
非铟（Inver）婷
非铟（Inver）婷
非铟（Inver）婷
INVER婷
偏见;注1
1
低
高
单端至差分
INVER婷
注1 ：单端使用要求的差分输入之一偏颇。在偏置输入端的电压设置
切换点为单端输入。对于LVCMOS和LVTTL电平推荐的输入偏置网络是一个电阻
至VCC ，同等价值的接地电阻和一个0.1
F的电容从输入到地面。由此产生的开关点
约VCC / 2 ± 300mV的。
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3
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S
KEW
, 1-
TO
-16
D
。微分
-
TO
-3.3V LVHSTL F
ANOUT
B
UFFER
4.6V
-0.5V到VCC + 0.5 V
-0.5V到VCC + 0.5V
46℃ / W （无气流）
-65 ℃150 ℃的
A
BSOLUTE
M
AXIMUM
R
ATINGS
电源电压， VCCx
输入，V
I
产出，V
O
封装的热阻抗，
θ
JA
贮藏温度，T
英镑
超出上述绝对最大额定值强调可能会造成永久性损坏设备。这些评级
只强调规范。产物在这些条件下或超出任何条件中所列出的功能操作
DC
特征
or
AC特性
是不是暗示。暴露在绝对最大额定值条件下工作会
影响产品的可靠性。
T
ABLE
4A 。 P
OWER
S
UPPLY
DC
极特
,
VCC = 3.3V ± 5 ％ ， VCCO = 1.8V ± 0.2V ，T
A
= 0°C
TO
70°C
符号
VCC
VCCO
IEE
参数
正电源电压
输出电源电压
电源电流
测试条件
最低
3.135
1.6
典型
3.3
1.8
最大
3.465
2.0
120
单位
V
V
mA
T
ABLE
4B 。
。微分
DC
极特
,
VCC = 3.3V ± 5 ％ ， VCCO = 1.8V ± 0.2V ，T
A
= 0°C
TO
70°C
符号
IIH
IIL
VPP
参数
输入高电流
输入低电平电流
CLK
NCLK
CLK
NCLK
测试条件
VIN = VCC = 3.465V
VIN = VCC = 3.465V
VIN = 0V ， VCC = 3.465V
VIN = 0V ， VCC = 3.465V
-1
-150
1.3
VCC - 0.85
最低
典型
最大
150
1
单位
A
A
A
A
V
V
峰 - 峰值输入电压
0.15
共模电压范围;
VCMR
VEE + 0.5
注1,2
注1 ：共模电压定义为VIH 。
注2：对于单端应用中，最大输入电压为CLK， NCLK为VCC + 0.3V 。
T
ABLE
4C 。 LVHSTL DC
极特
,
VCC = 3.3V ± 5 ％ ， VCCO = 1.8V ± 0.2V ，T
A
= 0°C
TO
70°C
符号参数
测试条件
产量
VOH
高电压;
注1
产量
VOL
低电压;
注1
产量
VOX
交叉电压
注1 ：输出端接50
到地面。
最低
1.0
典型
最大
1.2
单位
V
0
40 ％ ×（ VOH - VOL ）， VOL +
0.4
60 ％ ×（ VOH - VOL ）， VOL +
V
V
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集成
电路
系统公司
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L
OW
S
KEW
, 1-
TO
-16
D
。微分
-
TO
-3.3V LVHSTL F
ANOUT
B
UFFER
测试条件
0 < F
≤
250MHz
最低
1
典型
最大
500
1.6
50
单位
兆赫
ns
ps
T
ABLE
5. AC - C
极特
,
VCC = 3.3V ± 5 ％ ， VCCO = 1.8V ± 0.2V ，T
A
= 0°C
TO
70°C
符号
FMAX
tPD的
TSK （ O）
参数
最大输入频率
传输延迟低到高;注1
输出偏斜;注2： 4
TSK （ PP）
帕吨至帕吨倾斜;注3，注4
250
ps
tR
输出上升时间
20 ％至80％ @ 50MHz的
300
700
ps
tF
输出下降时间
20 ％至80％ @ 50MHz的
300
700
ps
ODC
输出占空比
47
53
%
所有测量参数在250MHz时，除非另有说明
注1：从差分输入交叉点的差分输出中交叉点。
注2 ：定义为输出之间的偏移，在相同的电源电压，并以相等的负载条件。
测得的输出差分交叉点。
注3 ：定义为扭曲在不同的设备输出，在相同的电源电压下工作的
并且以相同的负载条件。使用同一类型的每个设备上的输入，输出在差分测量
交叉点。
注4 ：该参数定义符合JEDEC标准65 。
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