集成
电路
系统公司
ICS813001I
D
UAL
VCXO
W
/3.3V ， 2.5V LVPECL
F
EMTO
C
LOCK
PLL
F
EATURES
一个3.3V或2.5V的LVPECL输出对
为VCXO两个可选晶体振荡器接口，
一个差分时钟或一路LVCMOS / LVTTL时钟输入
CLK1 / nCLK1支持以下输入类型：
LVPECL ， LVDS ， LVHSTL ， SSTL ， HCSL
晶体工作频率范围： 14MHz - 24MHz的
VCO范围： 490MHz - 640MHz
输出频率范围： 40.83MHz - 640MHz
VCXO牵引范围： ± 100ppm的（典型值）
支持下列应用程序（其中包括） ：
SONET ，以太网，光纤信道， HDTV ， MPEG
RMS相位抖动@ 622.08MHz的（ 12kHz的 - 20MHz的） ：
0.84 （典型值）
电源电压模式：
V
CC
/V
CCO
3.3V/3.3V
3.3V/2.5V
2.5V/2.5V
-40 ° C至85°C的工作环境温度
有两种，标准及RoHS /无铅
兼容封装
G
ENERAL
D
ESCRIPTION
该ICS813001I是双VCXO + FemtoClock
乘法器离散PLL设计用于
HiPerClockS
循环。两个可选择的外置VCXO晶体
允许器件在多速率可以使用应用程序
的阳离子，其中一个给定的线卡可以
切换，例如，千兆以太网之间（ 125MHz的
系统参考时钟）和1Gb的光纤通道
（ 106.25MHz系统参考时钟）模式。当然，
大量的其他应用也是可能的，例如
为74.25MHz和74.175824MHz之间切换
对于HDTV ， SONET ， FEC和非FEC之间切换
率等。
IC
S
该ICS813001I是一个两阶段的设备 - 一个VCXO随后
由FemtoClock PLL 。该FemtoClock PLL可以繁殖
的VCXO的晶体频率，以提供一个输出
40.83MHz的频率范围640MHz ，具有随机
均方根相位小于1ps的抖动（ 12kHz的 - 为20MHz ） 。这
相位抖动性能达到千兆的要求/
10Gb以太网，1GB ， 2GB，4GB和10Gb光纤通道，
和SONET高达OC48 。该FemtoClock锁相环还可以是
如果不需要倍频旁路。为
测试/调试的目的，解除断言输出使能
销将会把Q和NQ处于高阻抗状态。
B
LOCK
D
IAGRAM
VCO_SEL上拉
CLK_SEL0下拉
CLK_SEL1上拉
CLK0下拉
下拉
CLK1
nCLK1上拉
00
01
PD
10
（默认）
0
输出分频器
N2:N0
000 ÷1
001 ÷2
010 ÷3
011 ÷4
（默认）
100 ÷5
101 ÷6
110 ÷8
111 ÷12
XTAL_IN0
VCO
490-640MHz
1
Q
nQ
XTAL_OUT0
XTAL_IN1
VCXO
11
XTAL_OUT1
VC
M2
上拉
M1下拉
M0下拉
N2下拉
N1上拉
N0拉
ê拉
反馈分频器M
M2:M0
000 ÷16
001 ÷20
010 ÷22
011 ÷24
100 ÷25
（默认）
101 ÷32
110 ÷40
111 MR
P
IN
A
SSIGNMENT
VCO_SEL
N0
N1
N2
V
CCO
Q
nQ
V
EE
V
CCA
V
CC
XTAL_OUT1
XTAL_IN1
1
2
3
4
5
6
7
8
9
10
11
12
24
23
22
21
20
19
18
17
16
15
14
13
CLK_SEL1
CLK_SEL0
OE
M2
M1
M0
CLK1
nCLK1
CLK0
VC
XTAL_IN0
XTAL_OUT0
ICS813001I
24引脚TSSOP
4.40毫米X 7.8毫米X 0.92毫米
包体
G封装
顶视图
www.icst.com/products/hiperclocks.html
1
REV 。一个2005年9月2日
813001AGI
集成
电路
系统公司
ICS813001I
D
UAL
VCXO
W
/3.3V ， 2.5V LVPECL
F
EMTO
C
LOCK
PLL
Τψπ ε
Δ ε σχριπ τιο ½
VCO选择引脚。 LVCMOS / LVTTL接口电平。
T
ABLE
1. P
IN
D
ESCRIPTIONS
Νυ μ β ε ρ
1
2, 3
4
5
6, 7
8
9
10
11
12
13
14
15
16
17
18
19, 20
21
22
23
24
Ναμ ε
VCO_SEL
N0, N1
N2
V
CCO
Q， NQ
V
EE
V
CCA
V
CC
XTAL_OUT1,
XTAL_IN1
XTAL_OUT0,
XTAL_IN0
VC
CLK0
nCLK1
CLK1
M0, M1
M2
OE
CLK_SEL0
CLK_SEL1
输入
输入
输入
动力
OUPUT
动力
动力
动力
输入
输入
输入
输入
输入
输入
输入
输入
输入
输入
输入
上拉
上拉
上拉
输出分频器选择引脚。默认值= ÷ 4 。
LVCMOS / LVTTL接口电平。
下拉
输出电源引脚。
差分输出对。 LVPECL接口电平。
负电源引脚。
模拟电源引脚。
核心供电引脚。
并联谐振CR石英晶体界面。 XTAL_OUT1是输出，
XTAL_IN1是输入。
并联谐振CR石英晶体界面。 XTAL_OUT0是输出，
XTAL_IN0是输入。
VCXO控制电压输入。
下拉LVCMOS / LVTTL时钟输入。
INVER婷差分时钟输入。
下拉非INVER婷差分时钟输入。
下拉反馈分频器选择引脚。默认值= ÷ 25 。
LVCMOS / LVTTL接口电平。
上拉
输出使能。当高电平时，输出处于激活状态。低电平时，输出
上拉
处于高阻抗状态。 LVCMOS / LVTTL接口电平。
下拉
时钟选择引脚。 LVCMOS / LVTTL接口电平。参考表3 。
上拉
注意：
下拉和上拉
是指内部输入电阻。见表2 ，引脚特性，为典型值。
T
ABLE
2. P
IN
C
极特
符号
C
IN
R
下拉
R
上拉
参数
输入电容
输入下拉电阻
输入上拉电阻
测试条件
最低
典型
4
51
51
最大
单位
pF
kΩ
kΩ
T
ABLE
3. C
ONTROL
I
NPUT
F
油膏
T
ABLE
CLK_SEL1
0
0
1
1
输入
CLK_SEL0
0
1
0
1
选定的输入
CLK0
CLK1 ， nCLK1
XTAL0
XTAL1
813001AGI
www.icst.com/products/hiperclocks.html
2
REV 。一个2005年9月2日
集成
电路
系统公司
ICS813001I
D
UAL
VCXO
W
/3.3V ， 2.5V LVPECL
F
EMTO
C
LOCK
PLL
4.6V
-0.5V到V
CC
+ 0.5V
50mA
100mA
70 ℃/ W（ 0 LFPM ）
-65 ℃150 ℃的
注：如果运行条件超出绝对下上市
最大额定值可能会造成永久性损坏
装置。这些评价只强调规范。实用
产物在这些条件下或在任何条件操作BE-
彼处那些在上市
DC特性
or
AC Character-
istics
是不是暗示。暴露在绝对最大额定值
长时间条件可能会影响产品的可靠性。
A
BSOLUTE
M
AXIMUM
R
ATINGS
电源电压，V
CC
输入，V
I
输出，我
O
（ LVPECL ）
连续电流
浪涌电流
封装的热阻抗，
θ
JA
贮藏温度，T
英镑
T
ABLE
4A 。 P
OWER
S
UPPLY
DC
极特
,
V
CC
= V
CCA
= V
CCO
= 3.3V ± 5 ％ ， TA = -40°C
TO
85°C
符号参数
V
CC
V
CCA
V
CCO
I
EE
I
CCA
核心供电电压
模拟电源电压
输出电源电压
电源电流
模拟电源电流
测试条件
最低
3.135
3.135
3.135
典型
3.3
3.3
3.3
最大
3.465
3.465
3.465
130
10
单位
V
V
V
mA
mA
T
ABLE
4B 。 P
OWER
S
UPPLY
DC
极特
,
V
CC
= V
CCA
= 3.3V±5%, V
CCO
= 2.5V ± 5 ％ ， TA = -40°C
TO
85°C
符号参数
V
CC
V
CCA
V
CCO
I
EE
I
CCA
核心供电电压
模拟电源电压
输出电源电压
电源电流
模拟电源电流
测试条件
最低
3.135
3.135
2.375
典型
3.3
3.3
2.5
最大
3.465
3.465
2.625
130
10
单位
V
V
V
mA
mA
T
ABLE
4C 。 P
OWER
S
UPPLY
DC
极特
,
V
CC
= V
CCA
= V
CCO
= 2.5V ± 5 ％ ， TA = -40°C
TO
85°C
符号参数
V
CC
V
CCA
V
CCO
I
EE
I
CCA
核心供电电压
模拟电源电压
输出电源电压
电源电流
模拟电源电流
测试条件
最低
2.375
2.375
2.375
典型
2.5
2.5
2.5
最大
2.625
2.625
2.625
125
10
单位
V
V
V
mA
mA
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3
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集成
电路
系统公司
ICS813001I
D
UAL
VCXO
W
/3.3V ， 2.5V LVPECL
F
EMTO
C
LOCK
PLL
测试条件
V
CC
= 3.3V
V
CC
= 2.5V
V
CC
= 3.3V
V
CC
= 2.5V
V
CC
= V
IN
= 3.465V
或2.625V
V
CC
= V
IN
= 3.465V
或2.625V
V
CC
= 3.465V或2.625V ，
V
IN
= 0V
V
CC
= 3.465V或2.625V ，
V
IN
= 0V
V
CC
= 3.465V或2.625V
最小典型
2.0
1.7
-0.3
-0.3
0
最大
V
CC
+ 0.3
V
CC
+ 0.3
0.8
0.7
V
CC
150
5
-5
-150
-100
100
单位
V
V
V
V
V
A
A
A
A
A
T
ABLE
4C 。 LVCMOS / LVTTL DC
极特
,
TA = -40°C
TO
85°C
符号
V
IH
V
IL
VC
参数
输入高电压
输入低电压
VCXO控制电压
输入
HIGH CURRENT
N 2， M0，M1
CLK0 ， CLK_SEL0
N0，N1 ，M2
VCO_SEL ， CLK_SEL1
N 2， M0，M1
CLK0 ， CLK_SEL0
N0，N1 ，M2
VCO_SEL ， CLK_SEL1
I
IH
I
IL
输入
低电流
I
VC
输入电流c V
c
针
T
ABLE
4D. D
。微分
DC
极特
,
TA = -40°C
TO
85°C
符号
I
IH
参数
CLK1
输入高电流
nCLK1
CLK1
I
IL
V
PP
输入低电平电流
nCLK1
峰 - 峰值输入电压
测试条件
V
IN
= V
CC
= 3.465V
或2.625V
V
IN
= V
CC
= 3.465V
或2.625V
V
IN
= 0V, V
CC
= 3.465V
或2.625V
V
IN
= 0V, V
CC
= 3.465V
或2.625V
最低
典型
最大
150
5
-5
-150
0.15
1.3
V
CC
- 0.85
单位
A
A
A
A
V
V
共模输入电压;注： 1 ， 2
V
EE
+ 0.5
V
CMR
注1 ：共模电压定义为V
IH
.
注2 ：对于单端应用进展，最大输入电压为CLK1 ， nCLK1为V
CC
+ 0.3V.
T
ABLE
4E 。 LVPECL DC
极特
,
TA = -40°C
TO
85°C
符号
V
OH
V
OL
V
摇摆
参数
输出高电压;注1
输出低电压;注1
峰至峰输出电压摆幅
测试条件
最低
V
CCO
- 1.4
V
CCO
- 2.0
0.6
典型
最大
V
CCO
- 0.9
V
CCO
- 1.7
1.0
单位
V
V
V
注1 ：输出端接50
Ω
到V
CCO
- 2V.
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4
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集成
电路
系统公司
ICS813001I
D
UAL
VCXO
W
/3.3V ， 2.5V LVPECL
F
EMTO
C
LOCK
PLL
测试条件
VCO_SEL = 1
622.08MHz的（ 12kHz的 - 为20MHz ）
490
20 ％至80％
N÷1
N
≠
÷1
250
43
48
最低
40.83
0.84
640
500
57
52
典型
最大
64 0
单位
兆赫
ps
兆赫
ps
%
%
T
ABLE
5A 。 AC - C
极特
,
V
CC
= V
CCA
= V
CCO
= 3.3V ± 5 ％ ， TA = -40°C
TO
85°C
符号
f
OUT
t
JIT （ φ ）
f
VCO
t
R
/ t
F
ODC
参数
输出频率
RMS相位抖动（随机） ;
注1
PLL VCO锁定范围
输出上升/下降时间
输出占空比
注1 ：使用CR石英晶体界面相抖动。
T
ABLE
5B 。 AC - C
极特
,
V
CC
= V
CCA
= 3.3V±5%, V
CCO
= 2.5V ± 5 ％ ， TA = -40°C
TO
85°C
符号
f
OUT
t
JIT （ φ ）
f
VCO
t
R
/ t
F
ODC
参数
输出频率
RMS相位抖动（随机） ;
注1
PLL VCO锁定范围
输出上升/下降时间
输出占空比
测试条件
VCO_SEL = 1
622.08MHz的（ 12kHz的 - 为20MHz ）
490
20 ％至80％
N÷1
N
≠
÷1
250
43
48
最低
40.83
0.87
640
500
57
52
典型
最大
64 0
单位
兆赫
ps
兆赫
ps
%
%
注1 ：使用CR石英晶体界面相抖动。
T
ABLE
5C 。 AC - C
极特
,
V
CC
= V
CCA
= V
CCO
= 2.5V ± 5 ％ ， TA = -40°C
TO
85°C
符号
f
OUT
t
JIT （ φ ）
f
VCO
t
R
/ t
F
ODC
参数
输出频率
RMS相位抖动（随机） ;
注1
PLL VCO锁定范围
输出上升/下降时间
输出占空比
测试条件
VCO_SEL = 1
622.08MHz的（ 12kHz的 - 为20MHz ）
490
20 ％至80％
N÷1
N
≠
÷1
250
43
48
最低
40.83
1.2
640
500
57
52
典型
最大
64 0
单位
兆赫
ps
兆赫
ps
%
%
注1 ：使用晶体界面相位抖动。
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5
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集成
电路
系统公司
ICS813001I
D
UAL
VCXO
W
/3.3V ， 2.5V LVPECL
F
EMTO
C
LOCK
PLL
F
EATURES
一个3.3V或2.5V的LVPECL输出对
为VCXO两个可选晶体振荡器接口，
一个差分时钟或一路LVCMOS / LVTTL时钟输入
CLK1 / nCLK1支持以下输入类型：
LVPECL ， LVDS ， LVHSTL ， SSTL ， HCSL
晶体工作频率范围： 14MHz - 24MHz的
VCO范围： 490MHz - 640MHz
输出频率范围： 40.83MHz - 640MHz
VCXO牵引范围： ± 100ppm的（典型值）
支持下列应用程序（其中包括） ：
SONET ，以太网，光纤信道， HDTV ， MPEG
RMS相位抖动@ 622.08MHz的（ 12kHz的 - 20MHz的） ：
0.84 （典型值）
电源电压模式：
V
CC
/V
CCO
3.3V/3.3V
3.3V/2.5V
2.5V/2.5V
-40 ° C至85°C的工作环境温度
有两种，标准及RoHS /无铅
兼容封装
G
ENERAL
D
ESCRIPTION
该ICS813001I是双VCXO + FemtoClock
乘法器离散PLL设计用于
HiPerClockS
循环。两个可选择的外置VCXO晶体
允许器件在多速率可以使用应用程序
的阳离子，其中一个给定的线卡可以
切换，例如，千兆以太网之间（ 125MHz的
系统参考时钟）和1Gb的光纤通道
（ 106.25MHz系统参考时钟）模式。当然，
大量的其他应用也是可能的，例如
为74.25MHz和74.175824MHz之间切换
对于HDTV ， SONET ， FEC和非FEC之间切换
率等。
IC
S
该ICS813001I是一个两阶段的设备 - 一个VCXO随后
由FemtoClock PLL 。该FemtoClock PLL可以繁殖
的VCXO的晶体频率，以提供一个输出
40.83MHz的频率范围640MHz ，具有随机
均方根相位小于1ps的抖动（ 12kHz的 - 为20MHz ） 。这
相位抖动性能达到千兆的要求/
10Gb以太网，1GB ， 2GB，4GB和10Gb光纤通道，
和SONET高达OC48 。该FemtoClock锁相环还可以是
如果不需要倍频旁路。为
测试/调试的目的，解除断言输出使能
销将会把Q和NQ处于高阻抗状态。
B
LOCK
D
IAGRAM
VCO_SEL上拉
CLK_SEL0下拉
CLK_SEL1上拉
CLK0下拉
下拉
CLK1
nCLK1上拉
00
01
PD
10
（默认）
0
输出分频器
N2:N0
000 ÷1
001 ÷2
010 ÷3
011 ÷4
（默认）
100 ÷5
101 ÷6
110 ÷8
111 ÷12
XTAL_IN0
VCO
490-640MHz
1
Q
nQ
XTAL_OUT0
XTAL_IN1
VCXO
11
XTAL_OUT1
VC
M2
上拉
M1下拉
M0下拉
N2下拉
N1上拉
N0拉
ê拉
反馈分频器M
M2:M0
000 ÷16
001 ÷20
010 ÷22
011 ÷24
100 ÷25
（默认）
101 ÷32
110 ÷40
111 MR
P
IN
A
SSIGNMENT
VCO_SEL
N0
N1
N2
V
CCO
Q
nQ
V
EE
V
CCA
V
CC
XTAL_OUT1
XTAL_IN1
1
2
3
4
5
6
7
8
9
10
11
12
24
23
22
21
20
19
18
17
16
15
14
13
CLK_SEL1
CLK_SEL0
OE
M2
M1
M0
CLK1
nCLK1
CLK0
VC
XTAL_IN0
XTAL_OUT0
ICS813001I
24引脚TSSOP
4.40毫米X 7.8毫米X 0.92毫米
包体
G封装
顶视图
www.icst.com/products/hiperclocks.html
1
REV 。一个2005年9月2日
813001AGI
集成
电路
系统公司
ICS813001I
D
UAL
VCXO
W
/3.3V ， 2.5V LVPECL
F
EMTO
C
LOCK
PLL
Τψπ ε
Δ ε σχριπ τιο ½
VCO选择引脚。 LVCMOS / LVTTL接口电平。
T
ABLE
1. P
IN
D
ESCRIPTIONS
Νυ μ β ε ρ
1
2, 3
4
5
6, 7
8
9
10
11
12
13
14
15
16
17
18
19, 20
21
22
23
24
Ναμ ε
VCO_SEL
N0, N1
N2
V
CCO
Q， NQ
V
EE
V
CCA
V
CC
XTAL_OUT1,
XTAL_IN1
XTAL_OUT0,
XTAL_IN0
VC
CLK0
nCLK1
CLK1
M0, M1
M2
OE
CLK_SEL0
CLK_SEL1
输入
输入
输入
动力
OUPUT
动力
动力
动力
输入
输入
输入
输入
输入
输入
输入
输入
输入
输入
输入
上拉
上拉
上拉
输出分频器选择引脚。默认值= ÷ 4 。
LVCMOS / LVTTL接口电平。
下拉
输出电源引脚。
差分输出对。 LVPECL接口电平。
负电源引脚。
模拟电源引脚。
核心供电引脚。
并联谐振CR石英晶体界面。 XTAL_OUT1是输出，
XTAL_IN1是输入。
并联谐振CR石英晶体界面。 XTAL_OUT0是输出，
XTAL_IN0是输入。
VCXO控制电压输入。
下拉LVCMOS / LVTTL时钟输入。
INVER婷差分时钟输入。
下拉非INVER婷差分时钟输入。
下拉反馈分频器选择引脚。默认值= ÷ 25 。
LVCMOS / LVTTL接口电平。
上拉
输出使能。当高电平时，输出处于激活状态。低电平时，输出
上拉
处于高阻抗状态。 LVCMOS / LVTTL接口电平。
下拉
时钟选择引脚。 LVCMOS / LVTTL接口电平。参考表3 。
上拉
注意：
下拉和上拉
是指内部输入电阻。见表2 ，引脚特性，为典型值。
T
ABLE
2. P
IN
C
极特
符号
C
IN
R
下拉
R
上拉
参数
输入电容
输入下拉电阻
输入上拉电阻
测试条件
最低
典型
4
51
51
最大
单位
pF
kΩ
kΩ
T
ABLE
3. C
ONTROL
I
NPUT
F
油膏
T
ABLE
CLK_SEL1
0
0
1
1
输入
CLK_SEL0
0
1
0
1
选定的输入
CLK0
CLK1 ， nCLK1
XTAL0
XTAL1
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2
REV 。一个2005年9月2日
集成
电路
系统公司
ICS813001I
D
UAL
VCXO
W
/3.3V ， 2.5V LVPECL
F
EMTO
C
LOCK
PLL
4.6V
-0.5V到V
CC
+ 0.5V
50mA
100mA
70 ℃/ W（ 0 LFPM ）
-65 ℃150 ℃的
注：如果运行条件超出绝对下上市
最大额定值可能会造成永久性损坏
装置。这些评价只强调规范。实用
产物在这些条件下或在任何条件操作BE-
彼处那些在上市
DC特性
or
AC Character-
istics
是不是暗示。暴露在绝对最大额定值
长时间条件可能会影响产品的可靠性。
A
BSOLUTE
M
AXIMUM
R
ATINGS
电源电压，V
CC
输入，V
I
输出，我
O
（ LVPECL ）
连续电流
浪涌电流
封装的热阻抗，
θ
JA
贮藏温度，T
英镑
T
ABLE
4A 。 P
OWER
S
UPPLY
DC
极特
,
V
CC
= V
CCA
= V
CCO
= 3.3V ± 5 ％ ， TA = -40°C
TO
85°C
符号参数
V
CC
V
CCA
V
CCO
I
EE
I
CCA
核心供电电压
模拟电源电压
输出电源电压
电源电流
模拟电源电流
测试条件
最低
3.135
3.135
3.135
典型
3.3
3.3
3.3
最大
3.465
3.465
3.465
130
10
单位
V
V
V
mA
mA
T
ABLE
4B 。 P
OWER
S
UPPLY
DC
极特
,
V
CC
= V
CCA
= 3.3V±5%, V
CCO
= 2.5V ± 5 ％ ， TA = -40°C
TO
85°C
符号参数
V
CC
V
CCA
V
CCO
I
EE
I
CCA
核心供电电压
模拟电源电压
输出电源电压
电源电流
模拟电源电流
测试条件
最低
3.135
3.135
2.375
典型
3.3
3.3
2.5
最大
3.465
3.465
2.625
130
10
单位
V
V
V
mA
mA
T
ABLE
4C 。 P
OWER
S
UPPLY
DC
极特
,
V
CC
= V
CCA
= V
CCO
= 2.5V ± 5 ％ ， TA = -40°C
TO
85°C
符号参数
V
CC
V
CCA
V
CCO
I
EE
I
CCA
核心供电电压
模拟电源电压
输出电源电压
电源电流
模拟电源电流
测试条件
最低
2.375
2.375
2.375
典型
2.5
2.5
2.5
最大
2.625
2.625
2.625
125
10
单位
V
V
V
mA
mA
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电路
系统公司
ICS813001I
D
UAL
VCXO
W
/3.3V ， 2.5V LVPECL
F
EMTO
C
LOCK
PLL
测试条件
V
CC
= 3.3V
V
CC
= 2.5V
V
CC
= 3.3V
V
CC
= 2.5V
V
CC
= V
IN
= 3.465V
或2.625V
V
CC
= V
IN
= 3.465V
或2.625V
V
CC
= 3.465V或2.625V ，
V
IN
= 0V
V
CC
= 3.465V或2.625V ，
V
IN
= 0V
V
CC
= 3.465V或2.625V
最小典型
2.0
1.7
-0.3
-0.3
0
最大
V
CC
+ 0.3
V
CC
+ 0.3
0.8
0.7
V
CC
150
5
-5
-150
-100
100
单位
V
V
V
V
V
A
A
A
A
A
T
ABLE
4C 。 LVCMOS / LVTTL DC
极特
,
TA = -40°C
TO
85°C
符号
V
IH
V
IL
VC
参数
输入高电压
输入低电压
VCXO控制电压
输入
HIGH CURRENT
N 2， M0，M1
CLK0 ， CLK_SEL0
N0，N1 ，M2
VCO_SEL ， CLK_SEL1
N 2， M0，M1
CLK0 ， CLK_SEL0
N0，N1 ，M2
VCO_SEL ， CLK_SEL1
I
IH
I
IL
输入
低电流
I
VC
输入电流c V
c
针
T
ABLE
4D. D
。微分
DC
极特
,
TA = -40°C
TO
85°C
符号
I
IH
参数
CLK1
输入高电流
nCLK1
CLK1
I
IL
V
PP
输入低电平电流
nCLK1
峰 - 峰值输入电压
测试条件
V
IN
= V
CC
= 3.465V
或2.625V
V
IN
= V
CC
= 3.465V
或2.625V
V
IN
= 0V, V
CC
= 3.465V
或2.625V
V
IN
= 0V, V
CC
= 3.465V
或2.625V
最低
典型
最大
150
5
-5
-150
0.15
1.3
V
CC
- 0.85
单位
A
A
A
A
V
V
共模输入电压;注： 1 ， 2
V
EE
+ 0.5
V
CMR
注1 ：共模电压定义为V
IH
.
注2 ：对于单端应用进展，最大输入电压为CLK1 ， nCLK1为V
CC
+ 0.3V.
T
ABLE
4E 。 LVPECL DC
极特
,
TA = -40°C
TO
85°C
符号
V
OH
V
OL
V
摇摆
参数
输出高电压;注1
输出低电压;注1
峰至峰输出电压摆幅
测试条件
最低
V
CCO
- 1.4
V
CCO
- 2.0
0.6
典型
最大
V
CCO
- 0.9
V
CCO
- 1.7
1.0
单位
V
V
V
注1 ：输出端接50
Ω
到V
CCO
- 2V.
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集成
电路
系统公司
ICS813001I
D
UAL
VCXO
W
/3.3V ， 2.5V LVPECL
F
EMTO
C
LOCK
PLL
测试条件
VCO_SEL = 1
622.08MHz的（ 12kHz的 - 为20MHz ）
490
20 ％至80％
N÷1
N
≠
÷1
250
43
48
最低
40.83
0.84
640
500
57
52
典型
最大
64 0
单位
兆赫
ps
兆赫
ps
%
%
T
ABLE
5A 。 AC - C
极特
,
V
CC
= V
CCA
= V
CCO
= 3.3V ± 5 ％ ， TA = -40°C
TO
85°C
符号
f
OUT
t
JIT （ φ ）
f
VCO
t
R
/ t
F
ODC
参数
输出频率
RMS相位抖动（随机） ;
注1
PLL VCO锁定范围
输出上升/下降时间
输出占空比
注1 ：使用CR石英晶体界面相抖动。
T
ABLE
5B 。 AC - C
极特
,
V
CC
= V
CCA
= 3.3V±5%, V
CCO
= 2.5V ± 5 ％ ， TA = -40°C
TO
85°C
符号
f
OUT
t
JIT （ φ ）
f
VCO
t
R
/ t
F
ODC
参数
输出频率
RMS相位抖动（随机） ;
注1
PLL VCO锁定范围
输出上升/下降时间
输出占空比
测试条件
VCO_SEL = 1
622.08MHz的（ 12kHz的 - 为20MHz ）
490
20 ％至80％
N÷1
N
≠
÷1
250
43
48
最低
40.83
0.87
640
500
57
52
典型
最大
64 0
单位
兆赫
ps
兆赫
ps
%
%
注1 ：使用CR石英晶体界面相抖动。
T
ABLE
5C 。 AC - C
极特
,
V
CC
= V
CCA
= V
CCO
= 2.5V ± 5 ％ ， TA = -40°C
TO
85°C
符号
f
OUT
t
JIT （ φ ）
f
VCO
t
R
/ t
F
ODC
参数
输出频率
RMS相位抖动（随机） ;
注1
PLL VCO锁定范围
输出上升/下降时间
输出占空比
测试条件
VCO_SEL = 1
622.08MHz的（ 12kHz的 - 为20MHz ）
490
20 ％至80％
N÷1
N
≠
÷1
250
43
48
最低
40.83
1.2
640
500
57
52
典型
最大
64 0
单位
兆赫
ps
兆赫
ps
%
%
注1 ：使用晶体界面相位抖动。
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