数据表
Precision音频时钟源
描述
该ICS661提供同步时钟产生的
从MPEG流衍生的音频采样的时钟频率，
或者可以作为一个独立的时钟源的27兆赫
水晶。该设备采用了最新的PLL技术
提供出色的相位噪声和长期抖动
性能优越的同步和S / N比。
请联系IDT ，如果你有一个要求输入
输出频率不包括在这里 - 我们可以迅速
修改本产品，以满足特殊的要求。
ICS661
特点
封装采用16引脚TSSOP
可在Pb（铅） FERE包
时钟或晶振输入
低相位噪声
低抖动
精确（ 0 PPM ）的比率倍增
参考时钟输出提供
支持256 ， 384 ， 512 ，和768倍的采样率
框图
VDD （P2）的
VDD （P3）
VDDO
VDDR
X2
水晶
振荡器
REF
X1/REFIN
SELIN
S3:0
PLL时钟
合成
4
CLK
GND （P13）
GND （ P6 ）
GND （ P5 ）
IDT / ICS
Precision音频时钟源
1
ICS661
修订版D 111804
ICS661
Precision音频时钟源
时钟合成器
引脚分配
X1/REFIN
VDD
VDD
S0
GND
GND
S3
S2
1
2
3
4
5
6
7
8
16
15
14
13
12
11
10
9
X2
REF
VDDR
GND
SELIN
VDDO
S1
CLK
输出时钟选型表
S3
0
0
0
0
0
0
0
0
1
1
1
1
1
1
1
1
S2
0
0
0
0
1
1
1
1
0
0
0
0
1
1
1
1
S1
0
0
1
1
0
0
1
1
0
0
1
1
0
0
1
1
S0
0
1
0
1
0
1
0
1
0
1
0
1
0
1
0
1
输入
频率
（兆赫）
27
27
27
27
27
27
27
27
27
27
27
27
27
27
27
27
产量
频率
（兆赫）
8.192
11.2896
12.288
24.576
12.288
16.9344
18.432
36.864
16.384
22.5792
24.576
49.152
24.576
33.8688
36.864
73.728
16针4.40万车身，0.50 mm间距TSSOP
引脚说明
针
数
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
针
名字
X1/REFIN
VDD
VDD
S0
GND
GND
S3
S2
CLK
S1
VDDO
SELIN
GND
VDDR
REF
X2
针
TYPE
输入
动力
动力
输入
动力
动力
输入
输入
产量
输入
动力
输入
动力
动力
产量
输入
电源的晶体振荡器。
电源的PLL 。
引脚说明
该引脚连接到晶振或时钟输入
输出频率选择。确定每个表上面的输出频率。在片内上拉。
连接到地面。
地面为输出级。
输出频率选择。确定每个表上面的输出频率。在片内上拉。
输出频率选择。确定每个表上面的输出频率。在片内上拉。
时钟输出。
输出频率选择。确定每个表上面的输出频率。在片内上拉。
电源，用于输出级。
低时钟输入，为高结晶。在片内上拉。
连接到地面。
电源为参考电压输出。地关闭REF 。
参考时钟输出。
该引脚连接到晶体。如果使用的是时钟输入平仓离场。
IDT / ICS
Precision音频时钟源
2
ICS661
修订版D 111804
ICS661
Precision音频时钟源
时钟合成器
应用信息
系列终端电阻
时钟输出走线应使用串联终端。以系列
终止50Ω跟踪（一种常用的走线阻抗）
放置一个33Ω的电阻串联在时钟线，尽量靠近
时钟输出引脚越好。标称阻抗
时钟输出为20Ω
.
电路板的电容相匹配的名义上所需
晶体负载电容。为了减少可能的噪声拾取，
用很短的PCB走线（无孔）被晶体
和设备。
的负载电容的值可以大致确定
由式C = 2 （℃
L
- 6）其中C是负载电容
连接到X1和X2 ，和C
L
是的规定值
负载电容的晶体。一个典型的晶体C
L
为18 pF的，
所以C = 2 （ 18 - 6 ） = 24 pF的。由于这些电容调整
PCB的杂散电容，检查输出
使用最终布局频率，以查看是否C的值
应改变。
去耦电容
对于任何高性能的混合信号IC，该ICS661
必须从系统的电源噪声隔离，以执行
最佳状态。
0.01μF的去耦电容必须连接
每个VDD与PCB地平面之间。为了进一步
警惕干扰系统电源噪声的ICS661
应该使用的PCB电源一个共同的连接
平面中的下一个页面上的图中，如图所示。铁氧体
珠和大电容有助于降低低频噪音
在供应，可导致输出时钟的相位调制。
PCB布局建议
为确保最佳的设备性能和最低的输出相位
噪音，遵循以下原则应得到遵守。
1 ）每一个0.01μF去耦电容应安装在
电路板的元件侧尽可能靠近VDD引脚
可能。无孔应脱钩之间使用
电容和VDD引脚。 PCB走线连接到VDD引脚应
越短越好，因为要在PCB走线到
通过地面。铁氧体磁珠和去耦大容量的距离
从设备是不太关键的。
2 ）外部晶体的设备旁安装
短的痕迹。 X1和X2的痕迹不应该
路由彼此相邻以最小的空间，而不是
它们应该被分开并远离其他痕迹。
3 ）为了减少EMI ，并获得最佳的信号完整性，
33Ω串联端接电阻应放置在靠近
时钟输出。
4）优化布局之一，在所有组件
电路板的同一侧，通过其他信号通路减少
层（铁氧体磁珠和去耦大容量电容可
安装在后） 。其他信号走线应
离ICS661 。这包括信号线刚
该装置的下面，或在邻近的接地层
设备所使用的平面层。
推荐电源连接的
优化设备性能
在V D D P
onnection至3.3V
P流ER P通道
铁素体
珠子
在V D D P
B天狗 ecoupling apacitor
（如1 ？F的钽）
在V D D P
0.01
F ecoupling apacitors
所有电源引脚都必须连接到相同的
电压，除VDDR和VDDO可以被连接到一个
为了改变输出电平低的电压。如果
参考输出没有被使用，地面VDDR 。
晶体负载电容
如果使用的是晶体，该晶体的设备连接应
包括焊盘从X1的电容接地，从X2
到地面。这些电容器用于调节的杂散
IDT / ICS
Precision音频时钟源
3
ICS661
修订版D 111804
ICS661
Precision音频时钟源
时钟合成器
绝对最大额定值
上面讲下面列出的收视率可能会导致对ICS661永久性损坏。这些评价，这是
对于IDT商业额定零件标准值，只是应力额定值。该器件在功能操作
以上这些在规范的业务部门所标明的任何其他条件不暗示。
暴露在绝对最大额定值条件下长时间会影响产品的可靠性。电动
参数都保证只在推荐的工作温度范围。
项
电源电压（VDD）
所有输入和输出
工作环境温度
储存温度
结温
焊接温度
5.5 V
等级
-0.5 V至VDD + 0.5 V
-40至+ 85°C
-65到+ 150°C
125° C
260° C
推荐工作条件
参数
工作环境温度
电源电压（相对于GND测量）
分钟。
-40
+3.0
典型值。
马克斯。
+85
+3.6
单位
°
C
V
DC电气特性
除非另有说明，否则
VDD = 3.3V ± 10 ％ ，
环境温度-40 + 85°C
参数
工作电压
符号
VDD
VDDO
VDDR
条件
分钟。
3.0
1.8
1.8
2
典型值。
马克斯。
3.6
VDD
VDD
0.8
单位
V
V
V
V
V
V
V
输入高电压
输入低电压
输出高电压
输出高电压
输出低电压
电源电流
短路电流
额定输出阻抗
输入电容
内部上拉电阻
V
IH
V
IL
V
OH
V
OH
V
OL
国际直拨电话
I
OS
Z
OUT
输入引脚
I
OH
= -4毫安
I
OH
= -20毫安
I
OL
= 20毫安
空载
每路输出
VDD-0.4
2.4
0.4
25
±65
20
7
120
V
mA
mA
pF
k
IDT / ICS
Precision音频时钟源
4
ICS661
修订版D 111804
ICS661
Precision音频时钟源
描述
该ICS661提供同步时钟产生的
从MPEG衍生的音频采样的时钟速率
流，或者可以作为一个独立的时钟源
一个27 MHz的晶振。该设备采用最新的PLL
技术，以提供优异的相位噪声和长
优越的任期同步抖动性能
和S / N比。
如果你有一个要求，请联系ICS
输入和输出频率不包括在这里 - 我们可以
快速修改本产品，以满足特殊的
要求。
特点
封装采用16引脚TSSOP
可在Pb（铅） FERE包
时钟或晶振输入
低相位噪声
低抖动
精确（ 0 PPM ）的比率倍增
参考时钟输出提供
支持256 ， 384 ， 512 ，和768次采样
率
框图
VDD （P2）的
VDD （P3）
VDDO
VDDR
X2
水晶
振荡器
REF
X1/REFIN
SELIN
S3:0
PLL时钟
合成
4
CLK
GND （P13）
GND （ P6 ）
GND （ P5 ）
MDS 661
集成电路系统公司
●
1
525马街，圣何塞，加利福尼亚95126
●
修订版111804
电话：（ 408 ） 297-1201
●
www.icst.com
ICS661
Precision音频时钟源
引脚分配
X1/REFIN
VDD
VDD
S0
GND
GND
S3
S2
1
2
3
4
5
6
7
8
16
15
14
13
12
11
10
9
X2
REF
VDDR
GND
SELIN
VDDO
S1
CLK
输出时钟选型表
S3
0
0
0
0
0
0
0
0
1
1
1
1
1
1
1
1
S2
0
0
0
0
1
1
1
1
0
0
0
0
1
1
1
1
S1
0
0
1
1
0
0
1
1
0
0
1
1
0
0
1
1
S0
0
1
0
1
0
1
0
1
0
1
0
1
0
1
0
1
输入
频率
（兆赫）
27
27
27
27
27
27
27
27
27
27
27
27
27
27
27
27
产量
频率
（兆赫）
8.192
11.2896
12.288
24.576
12.288
16.9344
18.432
36.864
16.384
22.5792
24.576
49.152
24.576
33.8688
36.864
73.728
16针4.40万车身，0.50 mm间距TSSOP
引脚说明
针
数
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
针
名字
X1/REFIN
VDD
VDD
S0
GND
GND
S3
S2
CLK
S1
VDDO
SELIN
GND
VDDR
REF
X2
针
TYPE
输入
动力
动力
输入
动力
动力
输入
输入
产量
输入
动力
输入
动力
动力
产量
输入
电源的晶体振荡器。
电源的PLL 。
引脚说明
该引脚连接到晶振或时钟输入
输出频率选择。确定每个表上面的输出频率。在片内上拉。
连接到地面。
地面为输出级。
输出频率选择。确定每个表上面的输出频率。在片内上拉。
输出频率选择。确定每个表上面的输出频率。在片内上拉。
时钟输出。
输出频率选择。确定每个表上面的输出频率。在片内上拉。
电源，用于输出级。
低时钟输入，为高结晶。在片内上拉。
连接到地面。
电源为参考电压输出。地关闭REF 。
参考时钟输出。
该引脚连接到晶体。如果使用的是时钟输入平仓离场。
MDS 661
集成电路系统公司
●
2
525马街，圣何塞，加利福尼亚95126
●
修订版111804
电话：（ 408 ） 297-1201
●
www.icst.com
ICS661
Precision音频时钟源
应用信息
系列终端电阻
时钟输出走线应使用串联终端。对
系列终止50Ω跟踪（一种常用的跟踪
阻抗） ，放置一个33Ω的电阻串联在
时钟线，尽量靠近时钟输出引脚成为可能。
时钟输出的额定阻抗是20Ω 。
调节板的杂散电容匹配
名义上所需晶体负载电容。为了减少
可能的噪声拾取，使用非常短的PCB走线（和
无孔）被晶体和器件。
的负载电容值可以是大致
由式C = 2（下测定
L
- 6）其中C是
负载电容连接到X1和X2 ，和C
L
为
负载电容的晶体的指定值。
一个典型的晶体C
L
18 pF的，所以C = 2 （ 18 - 6 ） = 24 pF的。
由于这些电容调整杂散电容
PCB的，用你的最后检查输出频率
布局，以查看是否应当改变C的值。
去耦电容
对于任何高性能的混合信号IC，该
ICS661必须从系统的电源分离
噪音进行优化。
0.01μF的去耦电容必须连接
每个VDD与PCB地平面之间。对
对干扰系统电源噪声进一步后卫，
该ICS661应该使用一个共同的连接
如该图所示的下一个印刷电路板的电源层
页。铁氧体磁珠和大容量电容有助于降低
在供给低频率的噪声，可导致
输出时钟的相位调制。
PCB布局建议
为确保最佳的设备性能和最低的输出
相位噪声，遵循以下原则应该是
观察到。
1 ）每一个0.01μF去耦电容应
安装在电路板的元件侧靠近
VDD引脚越好。没有通孔，应使用
之间的去耦电容和VDD引脚。在PCB
跟踪到VDD引脚应保持尽可能的短，
如要通过PCB走线到地面。的距离
铁氧体磁珠和散装解耦从设备是
不太重要。
2 ）外部晶体的旁边安装
设备与短的走线。 X1和X2的痕迹应
不被下一个路由到彼此以最小的空间，
相反，他们应该从分开客场
痕迹。
3 ）为了减少EMI ，并获得最佳的信号完整性，
在33Ω串联端接电阻应放置
关闭到时钟输出。
4）优化布局之一，在所有组件
电路板的同一侧，通过其他最大限度地减少通孔
信号层（铁氧体磁珠和去耦大容量
电容器可以安装在背面） 。其他信号
走线应远离ICS661 。这
包括信号迹线正下方的设备，或上
相邻使用的地线平面层的层
装置。
推荐电源连接的
优化设备性能
在V D D P
onnection至3.3V
P流ER P通道
铁素体
珠子
在V D D P
B天狗 ecoupling apacitor
（如1 ？F的钽）
在V D D P
0.01
F ecoupling apacitors
所有电源引脚都必须连接到相同的
电压，除VDDR和VDDO可以被连接到
为了较低的电压来改变输出电平。如果
基准输出没有被使用，地面VDDR 。
晶体负载电容
如果使用的是晶体，该晶体的设备连接
应包括垫从X1电容到地
和从X2到地。这些电容是用来
MDS 661
集成电路系统公司
●
3
525马街，圣何塞，加利福尼亚95126
●
修订版111804
电话：（ 408 ） 297-1201
●
www.icst.com
ICS661
Precision音频时钟源
绝对最大额定值
上面讲下面列出的收视率可能会导致对ICS661永久性损坏。这些评价，其中
对于ICS商业额定零件标准值，只是应力额定值。的功能操作
器件在这些或以上的任何其他条件的业务部门所标明
规格是不是暗示。暴露在绝对最大额定值条件下长时间可以
影响产品的可靠性。电气参数只能在推荐工作保障
温度范围。
项
电源电压（VDD）
所有输入和输出
工作环境温度
储存温度
结温
焊接温度
5.5 V
等级
-0.5 V至VDD + 0.5 V
-40至+ 85°C
-65到+ 150°C
125°C
260°C
推荐工作条件
参数
工作环境温度
电源电压（相对于GND测量）
分钟。
-40
+3.0
典型值。
马克斯。
+85
+3.6
单位
°C
V
DC电气特性
除非另有说明，否则
VDD = 3.3V ± 10 ％ ，
环境温度-40 + 85°C
参数
工作电压
符号
VDD
VDDO
VDDR
条件
分钟。
3.0
1.8
1.8
2
典型值。
马克斯。
3.6
VDD
VDD
0.8
单位
V
V
V
V
V
V
V
输入高电压
输入低电压
输出高电压
输出高电压
输出低电压
电源电流
短路电流
额定输出阻抗
输入电容
内部上拉电阻
V
IH
V
IL
V
OH
V
OH
V
OL
国际直拨电话
I
OS
Z
OUT
输入引脚
I
OH
= -4毫安
I
OH
= -20毫安
I
OL
= 20毫安
空载
每路输出
VDD-0.4
2.4
0.4
25
±65
20
7
120
V
mA
mA
pF
k
MDS 661
集成电路系统公司
●
4
525马街，圣何塞，加利福尼亚95126
●
修订版111804
电话：（ 408 ） 297-1201
●
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ICS661
Precision音频时钟源
描述
该ICS661提供同步时钟产生的
从MPEG衍生的音频采样的时钟速率
流，或者可以作为一个独立的时钟源
一个27 MHz的晶振。该设备采用最新的PLL
技术，以提供优异的相位噪声和长
优越的任期同步抖动性能
和S / N比。
如果你有一个要求，请联系ICS
输入和输出频率不包括在这里 - 我们可以
快速修改本产品，以满足特殊的
要求。
特点
封装采用16引脚TSSOP
可在Pb（铅） FERE包
时钟或晶振输入
低相位噪声
低抖动
精确（ 0 PPM ）的比率倍增
参考时钟输出提供
支持256 ， 384 ， 512 ，和768次采样
率
框图
VDD （P2）的
VDD （P3）
VDDO
VDDR
X2
水晶
振荡器
REF
X1/REFIN
SELIN
S3:0
PLL时钟
合成
4
CLK
GND （P13）
GND （ P6 ）
GND （ P5 ）
MDS 661
集成电路系统公司
●
1
525马街，圣何塞，加利福尼亚95126
●
修订版111804
电话：（ 408 ） 297-1201
●
www.icst.com
ICS661
Precision音频时钟源
引脚分配
X1/REFIN
VDD
VDD
S0
GND
GND
S3
S2
1
2
3
4
5
6
7
8
16
15
14
13
12
11
10
9
X2
REF
VDDR
GND
SELIN
VDDO
S1
CLK
输出时钟选型表
S3
0
0
0
0
0
0
0
0
1
1
1
1
1
1
1
1
S2
0
0
0
0
1
1
1
1
0
0
0
0
1
1
1
1
S1
0
0
1
1
0
0
1
1
0
0
1
1
0
0
1
1
S0
0
1
0
1
0
1
0
1
0
1
0
1
0
1
0
1
输入
频率
（兆赫）
27
27
27
27
27
27
27
27
27
27
27
27
27
27
27
27
产量
频率
（兆赫）
8.192
11.2896
12.288
24.576
12.288
16.9344
18.432
36.864
16.384
22.5792
24.576
49.152
24.576
33.8688
36.864
73.728
16针4.40万车身，0.50 mm间距TSSOP
引脚说明
针
数
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
针
名字
X1/REFIN
VDD
VDD
S0
GND
GND
S3
S2
CLK
S1
VDDO
SELIN
GND
VDDR
REF
X2
针
TYPE
输入
动力
动力
输入
动力
动力
输入
输入
产量
输入
动力
输入
动力
动力
产量
输入
电源的晶体振荡器。
电源的PLL 。
引脚说明
该引脚连接到晶振或时钟输入
输出频率选择。确定每个表上面的输出频率。在片内上拉。
连接到地面。
地面为输出级。
输出频率选择。确定每个表上面的输出频率。在片内上拉。
输出频率选择。确定每个表上面的输出频率。在片内上拉。
时钟输出。
输出频率选择。确定每个表上面的输出频率。在片内上拉。
电源，用于输出级。
低时钟输入，为高结晶。在片内上拉。
连接到地面。
电源为参考电压输出。地关闭REF 。
参考时钟输出。
该引脚连接到晶体。如果使用的是时钟输入平仓离场。
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ICS661
Precision音频时钟源
应用信息
系列终端电阻
时钟输出走线应使用串联终端。对
系列终止50Ω跟踪（一种常用的跟踪
阻抗） ，放置一个33Ω的电阻串联在
时钟线，尽量靠近时钟输出引脚成为可能。
时钟输出的额定阻抗是20Ω 。
调节板的杂散电容匹配
名义上所需晶体负载电容。为了减少
可能的噪声拾取，使用非常短的PCB走线（和
无孔）被晶体和器件。
的负载电容值可以是大致
由式C = 2（下测定
L
- 6）其中C是
负载电容连接到X1和X2 ，和C
L
为
负载电容的晶体的指定值。
一个典型的晶体C
L
18 pF的，所以C = 2 （ 18 - 6 ） = 24 pF的。
由于这些电容调整杂散电容
PCB的，用你的最后检查输出频率
布局，以查看是否应当改变C的值。
去耦电容
对于任何高性能的混合信号IC，该
ICS661必须从系统的电源分离
噪音进行优化。
0.01μF的去耦电容必须连接
每个VDD与PCB地平面之间。对
对干扰系统电源噪声进一步后卫，
该ICS661应该使用一个共同的连接
如该图所示的下一个印刷电路板的电源层
页。铁氧体磁珠和大容量电容有助于降低
在供给低频率的噪声，可导致
输出时钟的相位调制。
PCB布局建议
为确保最佳的设备性能和最低的输出
相位噪声，遵循以下原则应该是
观察到。
1 ）每一个0.01μF去耦电容应
安装在电路板的元件侧靠近
VDD引脚越好。没有通孔，应使用
之间的去耦电容和VDD引脚。在PCB
跟踪到VDD引脚应保持尽可能的短，
如要通过PCB走线到地面。的距离
铁氧体磁珠和散装解耦从设备是
不太重要。
2 ）外部晶体的旁边安装
设备与短的走线。 X1和X2的痕迹应
不被下一个路由到彼此以最小的空间，
相反，他们应该从分开客场
痕迹。
3 ）为了减少EMI ，并获得最佳的信号完整性，
在33Ω串联端接电阻应放置
关闭到时钟输出。
4）优化布局之一，在所有组件
电路板的同一侧，通过其他最大限度地减少通孔
信号层（铁氧体磁珠和去耦大容量
电容器可以安装在背面） 。其他信号
走线应远离ICS661 。这
包括信号迹线正下方的设备，或上
相邻使用的地线平面层的层
装置。
推荐电源连接的
优化设备性能
在V D D P
onnection至3.3V
P流ER P通道
铁素体
珠子
在V D D P
B天狗 ecoupling apacitor
（如1 ？F的钽）
在V D D P
0.01
F ecoupling apacitors
所有电源引脚都必须连接到相同的
电压，除VDDR和VDDO可以被连接到
为了较低的电压来改变输出电平。如果
基准输出没有被使用，地面VDDR 。
晶体负载电容
如果使用的是晶体，该晶体的设备连接
应包括垫从X1电容到地
和从X2到地。这些电容是用来
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Precision音频时钟源
绝对最大额定值
上面讲下面列出的收视率可能会导致对ICS661永久性损坏。这些评价，其中
对于ICS商业额定零件标准值，只是应力额定值。的功能操作
器件在这些或以上的任何其他条件的业务部门所标明
规格是不是暗示。暴露在绝对最大额定值条件下长时间可以
影响产品的可靠性。电气参数只能在推荐工作保障
温度范围。
项
电源电压（VDD）
所有输入和输出
工作环境温度
储存温度
结温
焊接温度
5.5 V
等级
-0.5 V至VDD + 0.5 V
-40至+ 85°C
-65到+ 150°C
125°C
260°C
推荐工作条件
参数
工作环境温度
电源电压（相对于GND测量）
分钟。
-40
+3.0
典型值。
马克斯。
+85
+3.6
单位
°C
V
DC电气特性
除非另有说明，否则
VDD = 3.3V ± 10 ％ ，
环境温度-40 + 85°C
参数
工作电压
符号
VDD
VDDO
VDDR
条件
分钟。
3.0
1.8
1.8
2
典型值。
马克斯。
3.6
VDD
VDD
0.8
单位
V
V
V
V
V
V
V
输入高电压
输入低电压
输出高电压
输出高电压
输出低电压
电源电流
短路电流
额定输出阻抗
输入电容
内部上拉电阻
V
IH
V
IL
V
OH
V
OH
V
OL
国际直拨电话
I
OS
Z
OUT
输入引脚
I
OH
= -4毫安
I
OH
= -20毫安
I
OL
= 20毫安
空载
每路输出
VDD-0.4
2.4
0.4
25
±65
20
7
120
V
mA
mA
pF
k
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