超前信息
ICS548-03
低偏移的时钟逆变器和分频器
特点
封装在16引脚窄（ 150万）的SOIC
输入时钟高达160兆赫，在非PLL模式
提供的CLK ，CLK和CLK / 2的时钟输出
低歪斜（ 500 PS ）的CLK ， CLK和CLK / 2
所有输出可三态
整个芯片可以通过改变一个断电
两个选择引脚
3.3V或5.0V工作电压
描述
该ICS548-03是一种低成本，低偏移，高
高性能通用时钟设计
产生一组一个输出时钟，一倒
输出时钟，一个时钟分频的2 。运用
我们的专利模拟锁相环（ PLL ）
技术中，该装置由一个频率操作
在PLL模式，范围从10 MHz到120 MHz的，
和高达160兆赫，在非PLL模式。
在应用程序需要保持低相位
在时钟树中，非PLL的噪声（当
S3 = S2 = 1）模式应该被使用。
该芯片是不是零延迟缓冲器。许多
应用程序可以是能够使用ICS527零
延迟分频器。
框图
S3:S0
4
时钟
合成
和
分频器
电路
产量
卜FF器
产量
卜FF器
产量
卜FF器
CLK
CLK
时钟输入
输入
卜FF器
CLK/2
OE （所有输出）
MDS 548-03
1
修订版042700
集成电路系统公司 525赛街圣何塞 CA 95126 （ 408 ） 295-9800tel www.icst.com
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ICS548-03
低偏移的时钟逆变器和分频器
CLK ， CLK和CLK / 2选择表（以MHz为单位）
S3
0
0
0
0
0
0
0
0
1
1
1
1
1
1
1
1
S2
0
0
0
0
1
1
1
1
0
0
0
0
1
1
1
1
S1
0
0
1
1
0
0
1
1
0
0
1
1
0
0
1
1
S0
0
1
0
1
0
1
0
1
0
1
0
1
0
1
0
1
CLK ， CLK
低
Input/4
输入
Input/2
低
输入×2
Input/5
Input/3
低
Input/4
输入
Input/2
低
Input/6
Input/8
Input/2
CLK/2
低
Input/8
Input/2
Input/4
低
输入
Input/10
Input/6
低
Input/8
Input/2
Input/4
低
Input/12
Input/16
Input/4
PLL
关闭
On
On
On
关闭
On
On
On
关闭
On
On
On
关闭
关闭
关闭
关闭
输入范围
掉电
20 -120
20 -120
20 -120
掉电
20 - 60
20 -120
20 - 120
掉电
10 - 60
10 - 60
10 - 60
掉电
0 - 160
0 - 160
0 - 160
引脚分配
ICLK
VDD
VDD
S3
GND
GND
S2
S0
1
2
3
4
5
6
7
8
16
15
14
13
12
11
10
9
DC
DC
DC
CLK
CLK
CLK/2
OE
S1
引脚说明
数
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
名字
ICLK
VDD
VDD
S3
GND
GND
S2
S0
S1
OE
CLK/2
CLK
CLK
DC
DC
DC
TYPE
CI
P
P
I
P
P
I
I
I
I
O
O
O
-
-
-
描述
输入时钟。连接到CMOS电平的输入时钟。
连接到+ 3.3V或+ 5.0V 。
连接到+ 3.3V或+ 5.0V 。
时钟选择引脚3见上表。
连接到地面。
连接到地面。
时钟选择引脚2见上表。
时钟选择引脚0见上表。
时钟选择引脚1见上表。
输出使能。三态低的所有时钟输出时。
时钟输出除以2，见上表。
时钟输出。请参见上表。
反转时钟输出。请参见上表。
不连接。不要以任何方式连接到该引脚。
不连接。不要以任何方式连接到该引脚。
不连接。不要以任何方式连接到该引脚。
键： I =输入; O =输出; P =电源连接; CI =时钟输入
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电气规格
参数
条件
最低
典型
绝对最大额定值（超出这些压力会永久损坏设备）
电源电压（VDD）
参考GND
输入
参考GND
-0.5
时钟输出
参考GND
-0.5
工作环境温度
0
焊接温度
10秒以内
储存温度
-65
直流特性（ VDD = 3.3V ，除非另有说明）
工作电压（VDD）
3
输入高电压， VIH ， ICLK只
ICLK （引脚1）
(VDD/2)+1
VDD/2
输入低电压， VIL ， ICLK只
ICLK （引脚1）
VDD/2
输入高电压， VIH
所有其它输入
2
输入低电压， VIL
所有其它输入
输出高电压， VOH ， CMOS电平
IOH=-8mA
VDD-0.4
输出高电压， VOH
IOH=-12mA
2.4
输出低电压， VOL
IOL=12mA
IDD工作电源电流， 100 MHz时钟S3 = S2 = S0 = 0 ， S1 = 1
待定
短路电流
每路输出
±50
输入电容， S3 ， S2 ， S1 ， S0和OE
所有的输入
5
交流特性（ VDD = 3.3V ，除非另有说明）
输入频率，时钟输入， PLL上
10
输入频率，时钟输入， PLL关闭
0
输出频率（见表2页）
模式依赖
0
输出时钟上升时间
0.8 2.0V
1
输出时钟下降时间
2.0 0.8V
1
输出时钟占空比
在VDD / 2
45
49至51
输出使能时间， OE高输出的
输出禁止时间， OE低到三态
绝对时钟周期抖动， PLL模式
从平均偏差
待定
一个西格玛时钟周期抖动， PLL模式
待定
输出时钟歪斜的CLK ， CLK ，或CLK / 2
在VDD / 2
最大
7
VDD+0.5
VDD+0.5
70
260
150
5.5
(VDD/2)-1
0.8
单位
V
V
V
°C
°C
°C
V
V
V
V
V
V
V
V
mA
mA
pF
兆赫
兆赫
兆赫
ns
ns
%
ns
ns
ps
ps
ps
0.4
120
160
120
55
50
50
500
注1：输入和输出时钟之间的相位关系，可以在加电时发生变化。使用ICS570或ICS527零延迟
缓冲器有保证的相位关系。
外部组件/应用信息
该设备需要插针3和5之间，一个0.01μF的去耦电容尽量靠近引脚放置。
管脚2直接到脚3和脚6直接销33 5系列终端电阻
可以使用
所有使用的时钟输出，还靠近器件。留下任何未使用的时钟输出浮动。没有
上拉电阻输入引脚上，所以它们应直接连接到VDD或地。
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包装外形和包装尺寸
（对于目前的尺寸规格，请参阅JEDEC发布第95号）
16引脚SOIC窄
符号
A
A1
B
C
D
E
e
H
L
英寸
民
最大
0.059 0.069
0.004 0.0098
0.013 0.020
0.007 0.0098
0.386 0.394
0.150 0.157
.050 BSC
0.228 0.244
0.016
0.05
MILLIMETERS
民
最大
1.50
1.75
0.10
0.25
0.33
0.51
0.19
0.25
9.80
10.00
3.80
4.00
1.27 BSC
5.80
6.20
0.41
1.27
E
指数
区域
H
1
2
D
A1
e
C
A
L
B
订购信息
零件/订单号
ICS548M-03
ICS548M-03T
记号
ICS548M-03
ICS548M-03
包
16引脚SOIC
磁带和卷轴16引脚SOIC
温度
0至70℃
0至70℃
虽然这里介绍的信息已被检查准确性和可靠性，集成电路系统公司（ ICS）不承担任何责任或者其
使用或任何第三方专利或其他权利，这将导致其使用的侵权行为。没有任何其他电路，专利或许可。本产品是
适用于正常的商业用途。任何其他应用程序，如那些需要扩展级温度范围，高可靠性，或其他特殊
不被推荐使用ICS的环境要求，无需额外处理。 ICS保留更改任何电路或规格，恕不另行通知。 ICS做
没有授权或保证任何ICS的产品用于生命支持设备或关键医疗器械的使用。
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