ICS507-01/02
PECL时钟合成器
描述
该ICS507-01和ICS507-02价格便宜
方法来产生一个低抖动155.52兆赫（或其它
高速）从一个差分PECL时钟输出
低频晶振输入。采用相位Locked-
环（PLL ）技术，这些器件使用标准
基本模式晶体来产生输出
时钟高达200兆赫。
存储在每个芯片中的ROM是能够
生成的选择的不同倍数
输入参考频率，包括一个精确
155.52 MHz时钟的共同结晶。为
在155.52 MHz的低抖动和相位噪声
时钟，一个19.44 MHz的晶振和X8的选择
都可以使用。
特点
打包为16引脚窄体SOIC或死亡
27兆赫 - 输入晶体5的频率
52兆赫 - 输入时钟5的频率
使用低成本的晶体
差分PECL的输出时钟频率高达
到200兆赫
职务的49/51周期
3.3 V或5.0 V±10 ％工作电源
适用于SONET应用和振荡器
制造商
先进的低功耗CMOS工艺
工业温度版本
框图
GND
VDD
1.1k
水库
270
S0:1
2
时钟合成
与控制
电路
时钟
缓冲器/
水晶
振荡器
产量
卜FF器
62
PECL
VDD
62
水晶
or
时钟
X1
产量
卜FF器
PECL
270
X2
显示输出的电阻值是未终止线。
请参阅MAN09以获取更多信息。
OUTPUT ENABLE
（两路输出）
1
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印00年11月13日
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ICS507-01/02
PECL时钟合成器
引脚分配
ICS507-01/02
X1/ICLK
VDD
VDD
S1
GND
GND
NC
PECL
1
2
3
4
5
6
7
8
16
15
14
13
12
11
10
9
X2
NC
S0
OE
NC
NC
水库
PECL
时钟乘法器选择表
S1
0
0
0
M
M
M
1
1
1
S0
0
M
1
0
M
1
0
M
1
倍增器
9.72X*
10X
12X
6.25X
8X
5X
2X
3X
4X
*使用此选项获得
从16兆赫155.52兆赫
输入。
对于最低相位噪声
新一代的155.52兆赫，
使用19.44 MHz的晶振和
在8X的选择。
16引脚窄（ 150万）的SOIC
引脚说明
数
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
名字
X1/ICLK
VDD
VDD
S1
GND
GND
NC
PECL
PECL
水库
NC
NC
OE
S0
NC
X2
TYPE
XI
P
P
TI
P
P
-
O
O
I
-
-
I
TI
-
XO
0 =直接连接引脚接地
1 =直接连接引脚连接到VDD
M =悬空（浮动）
描述
晶振或时钟连接。连接到一个基本的并行模式晶振或时钟。
VDD 。连接到+ 3.3V或+ 5V ，并VDD引脚3 。
VDD 。连接到VDD引脚2与去耦引脚5 。
乘数选择引脚1确定输出频率每桌上面。
连接到地面。
连接到地面。
无连接。没有在内部连接到该引脚。
PECL输出。连接到负载电阻，如图1页。
互补PECL输出。连接到负载电阻，如图1页。
偏置电阻输入。连接该引脚和VDD之间的电阻。
无连接。没有在内部连接到该引脚。
无连接。没有在内部连接到该引脚。
输出使能。三态输出的两个低时。内部上拉。
乘数选择引脚0确定输出频率每桌上面。
无连接。没有在内部连接到该引脚。
铬实达连接。连接到CR实达，或悬空的时钟输入。
键： I =输入， O =输出， TI =三电平输入，P =电源连接;十一， XO =水晶连接
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电气规格
参数
条件
最低
典型
绝对最大额定值（应力进行OND这些都可以permanentl损坏设备）
T
e
m
a
电源电压（VDD）
参考GND
输入
参考GND
-0.5
时钟输出
参考GND
-0.5
工作环境温度
r
ICS507M-0x
0
ICS507M-0xI
-40
焊接温度
20秒以内
储存温度
-65
直流特性（ VDD = 5.0 V除非另有说明）
D
l
工作电压（VDD）
3.0
输入高电压， VIH
只有ICLK
在VDD / 2 + 1个
VDD/2
输入低电压， VIL
只有ICLK
VDD/2
输入高电压， VIH
S0, S1
VDD-0.5
输入低电压， VIL
S0, S1
输出高电压， VOH
注2
VDD-1.2
输出低电压， VOL
注2
IDD工作增刊电流，注意3
无负载， 155.52MHz
67
内部的Cr飞虱电容， X1和X2
引脚1,8
26
输入电容
S0, S1
4
交流特性（ VDD = 5.0 V除非另有说明）
D
l
输入晶体频率
5
输入时钟频率
5
输出频率， ICS507-01
0 70 ℃， VDD = 5.0 V
10
0 70 ℃， VDD = 3.3 V
10
输出频率， ICS507-01I -40 85 ℃， VDD = 3.3 V或5.0 V
10
输出频率， ICS507-02I
0 70 ℃， VDD = 5.0 V
125
0 70 ℃， VDD = 3.3 V
125
-40到85°C VDD = 3.3 V或5.0 V
125
输出时钟占空比
49
PLL带宽
10
绝对时钟周期抖动
从平均偏差
±75
一个西格玛时钟周期抖动
20
注意事项：
最大
7
VDD+0.5
VDD+0.5
70
85
260
150
5.5
VDD/2-1
VDD+0.5
VDD-2.0
单位
V
V
V
°C
°C
°C
°C
V
V
V
V
V
V
V
mA
pF
pF
兆赫
兆赫
兆赫
兆赫
兆赫
兆赫
兆赫
兆赫
%
千赫
ps
ps
27
52
200
156
125
200
200
160
51
1 ）所有典型值是在5.0 V至25 ° C除非另有说明。
2） VOH和VOL可以通过在PECL输出的外部电阻值进行设定。
3） IDD包括电流通过外部电阻器，其可以被修改。
4）的输入和输出之间的相位关系可以在加电时发生变化。对于一个固定的相位关系，看的所述一个
ICS零延迟缓冲器。
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应用
高频差分PECL振荡器：
该ICS507加上一个低频率，基波模
水晶可以建立一个高频差分输出振荡器。例如，一个10 MHz的晶振相连
与12X输出选择的ICS507 （S1 = 0， S0 = 1 ）产生一个120兆赫的PECL输出时钟。
高频TCXO ：
扩展以前的应用程序，一个廉价的，低频率的TCXO可以
建并输出频率可以通过使用ICS507相乘。由于芯片的输出是相位
锁定到输入时， ICS507具有不随温度变化，并且在该温度系数
联合系统是一样的，低频率的TCXO 。
高频VCXO ：
PLL的带宽保证是大于10千赫。这意味着
该锁相环将跟踪在输入小于10kHz的频率的任何调制。通过使用该
性，低的频率的VCXO可以内置，输出然后可以用ICS507乘以
得到的高频输出，由此产生高频的VCXO 。
去耦和外部元件
该ICS507需要一个0.01μF去耦电容被连接VDD和GND之间的引脚2
和5.它必须连接靠近ICS507 。其他的VDD和GND的连接应该是
连接到这些引脚，或电路板上的VDD和GND平面。电阻必须连接
之间的RES （引脚10）和VDD 。需要另外四个电阻为PECL输出上所示
在这些电阻推荐第1值的框图中示出的框图，但它们
可以改变，以改变它的差分对输出摆幅，且DC电平;参考MAN09 。
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包装外形和包装尺寸
(
对于目前的尺寸规格，请参阅JEDEC发布第95号）
16引脚SOIC窄
符号
A
A1
E
指数
区域
H
B
C
1
2
D
A1
e
C
高x 45
D
E
e
H
h
L
英寸
h
民
最大
0.0532
0.0688
0.0040 0.0098
0.0130
0.0200
0.0075 0.0098
0.3859
0.3937
0.1497
0.1574
.050 BSC
S
0.2284
0.2440
0.0099
0.0195
0.0160 0.0500
MILLIMETERS
m
民
最大
1.35
1.75
0.10
0.24
0.33
0.51
0.19
0.24
9.80
10.00
3.80
4.00
1.27 BSC
S
5.80
6.20
0.25
0.50
0.41
1.27
A
L
B
订购信息
零件/订单号
ICS507M-01
ICS507M-01T
ICS507M-01I
ICS507M-01IT
ICS507-01-DSW
ICS507-01-DPK
ICS507-01-DWF
ICS507M-02I
ICS507M-02IT
记号
包
温度
0至70℃
0至70℃
-40到85°C
-40到85°C
0至70℃
0至70℃
0至70℃
-40到85°C
-40到85°C
最低
QUANTITIES
-
ICS507M-01
16引脚窄体SOIC
磁带和卷轴ICS507M -01 16引脚SOIC
ICS507M-01I
16引脚窄体SOIC
ICS507M - 01I 16引脚SOIC卷带
-
探讨晶圆，切割，上胶带
-
在华夫包装测试裸片
-
死在完整无缺，晶圆探测
ICS507M-02I
16引脚窄体SOIC
ICS507M - 02I 16引脚SOIC卷带
2500件
-
2500件
1晶片
1000件
1晶片
-
2500件
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MDS 507
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