IA8044/IA8344
SDLC通信控制器
初步数据表
作为量产版00
特点
外形，装配和功能兼容英特尔
8X44
封装选择： 40引脚塑料双列直插封装（ PDIP ） ， 44
引脚塑料有引线芯片载体（ PLCC ）
8位控制器
与16位的乘法和除法的8位算术逻辑单元
12 MHz时钟
4个8位输入/输出端口
2个16位定时器/计数器
与SDLC / HDLC兼容串行接口单元
最高2.4 Mbps的串行数据速率
两个优先级中断系统
5个中断源
内部时钟分频器，相位发生器
192字节的读/写数据的存储空间
64kB的外部程序存储器
64kB的外部数据存储器空间
4kB的内部ROM （ IA8044只）
IA8044 / IA8344变
IA8044
IA8344
4kB的内部ROM与R0117 2.1版本固件， 192字节的内部RAM
（可扩展到256字节） ， 64kB的外部程序和数据空间。
192字节的内部RAM ， 64kB的外部程序和数据空间。
的IA8044 / IA8344是一个"plug和 - play"简易替换为原来的集成电路。 INNOVASIC
生产使用数英里更换芯片
TM
或管理IC寿命延长系统，克隆
技术。该技术生产的集成电路更换远比"emulation"而更复杂
确保它们与原来的IC相兼容。 MILES
TM
捕捉所以它的克隆的设计
可以制备甚至硅技术的进步。 MILES
TM
也验证对克隆
原装IC以至于连"undocumented features"是重复的。此数据表文件
关于IA8044 / IA8344包括所有必要的工程资料的功能和I / O
描述，电特性，并适用定时。
版权
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作为量产版00
封装引脚
P1.0
P1.1
P1.2
P1.3
P1.4
P1.5
（ RTS ） P1.6
（ CTS ） P1.7
RST
（RXD） P3.0
（TXD） P3.1
（ INT0 ） P3.2
（ INT1 ） P3.3
（ T0 ） P3.4
（ SCLK / T1） P3.5
P1.4
P1.3
P0.1
P0.2
(41)
VCC
P1.0
(2)
(3)
(4)
(5)
(6)
(7)
(8)
(9)
(10)
(11)
(12)
(13)
(14)
(15)
(16)
(17)
(18)
(19)
(20)
40引脚DIP
(39)
(38)
(37)
(36)
(35)
(34)
(33)
(32)
(31)
(30)
(29)
(28)
(27)
(26)
(25)
(24)
(23)
(22)
(21)
P0.0 （ AD0 ）
P0.1 （ AD1 ）
(44)
(43)
(42)
P0.3 （ AD3 ）
P0.4 （ AD4 ）
P0.5 （ AD5 ）
P0.6 （ AD6 ）
P0.7 （ AD7 ）
EA
ALE
PSEN
P2.7 （ A15 ）
P2.6 （ A14 ）
P2.5 （ A13 ）
P2.4 （ A12 ）
P2.3 （A11）
P2.2 （A10）
P1.5
P1.6
P1.7
RST / VPD
P3.0
北卡罗来纳州
P3.1
P3.2
P3.3
P3.4
P3.5
(7)
(8)
(9)
(10)
(11)
(12)
(13)
(14)
(15)
(16)
(17)
(18)
(19)
(20)
(21)
(22)
(23)
(24)
(25)
(26)
(27)
(28)
(40)
(6)
(5)
(4)
(3)
(2)
(1)
P0.2 （ AD2 ）
P0.0
北卡罗来纳州
P0.3
P1.2
P1.1
(1)
IA8X44
(40)
VCC
(39)
(38)
P0.4
P0.5
P0.6
P0.7
EA
北卡罗来纳州
ALE
PSEN
P2.7
P2.6
P2.5
IA8X44
44引脚LCC
(37)
(36)
(35)
(34)
(33)
(32)
(31)
(30)
(29)
（ WR ）， P3.6
（ RD ）， P3.7
XTAL2
XTAL1
VSS
VSS
P2.0
P2.3
XTAL2
XTAL1
P3.6
P3.7
P2.1
P2.1 （A9）
P2.0 （A8）
描述
该IA8044 / IA8344是一种形式，配合和功能兼容部分英特尔8X44 SDLC
通信控制器。该IA8044 / IA8344是一个快速的单芯片8位微控制器
综合SDLC / HDLC串行接口控制器。该IA8044 / IA8344是一个全功能的8位
位，其执行所有ASM51指令，并具有相同的指令集，如嵌入式控制器
英特尔80C51 。该IA8044 / IA8344可以从两种方案的访问指令
存储器，提供软件和硬件中断，提供了用于串行通信的接口
和一个定时器系统。该IA8044 / IA8344与英特尔8X44系列完全兼容。该
功能框图如下所示。
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P2.2
P2.4
北卡罗来纳州
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功能框图
初步数据表
作为量产版00
I / O的内存， SIU ， DMA ，中断，定时器
端口0
地址/数据/ IO
端口2
地址/数据/ IO
端口1
SPCL FUNC / IO
端口3
SPCL FUNC / IO
内存
控制
XTAL
RESET
钟将军
&时机
192x8Dual港
内存
C8051
中央处理器
控制
地址/数据
中断
SIU
计时器
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作为量产版00
I / O特性
下表描述了在IC上的每个信号的I / O特性。信号名称
对应所提供的引脚图的信号名称。下表提供了
I / O的IA8044和IA8344的描述。
名字
RST
ALE
PSEN
EA
P0.7 – P0.0
P1.7 – P1.0
P2.7 – P2.0
P3.7 – P3.0
TYPE
I
O
O
I
I / O
I / O
I / O
I / O
描述
复位。该引脚在两个机器周期，同时保持高
正在运行的振荡器将引起芯片复位。
地址锁存使能。用于锁存在下降沿地址
边对外部存储器的访问。
程序存储启用。当低充当输出使能
外部程序存储器。
外部访问。在保持低EA将导致
IA8044 / IA8344来从外部存储器的指令。
P0口的8位I / O口和低位地址/数据复
字节的外部访问。
端口1 8位I / O口。二位都有复用功能， P1.6
（RTS）和P1.7 （CTS） 。
端口2 8位I / O口。它也可以用作高次
在外部访问地址字节。
端口3 8位I / O口。端口3位也有备用
下面描述的功能。
P3.0 - RXD 。接收数据输入SIU或方向控制
为P3.1依赖于数据链路配置。
P3.1 - TXD 。发送数据输出SIU或数据
输入/输出依赖于数据链路配置。还
使诊断模式时清零。
P3.2 - INT0 。中断0输入或门控输入
计数器0 。
P3.3 - INT1 。中断1输入或门控输入
计数器1 。
P3.4 - T0 。输入到计数器0 。
P3.5 - SCLK / T1 。 SCLK输入到SIU或输入到计数器1 。
P3.6 - WR 。外部存储器写信号。
P3.7 - RD 。外部存储器读信号。
晶振输入1.连接到VSS时，使用外部时钟
在XTAL2 。可以连接到一晶体（与XTAL2 ） ，或
可以直接驱动一个时钟源（ XTAL2不
连接） 。
晶振输入2.可连接到晶体（与XTAL1 ）
或者可以被直接驱动，与反相时钟源
（ XTAL1接地） 。
地面上。
+ 5V电源。
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XTAL1
I
XTAL2
VSS
VCC
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O
P
P
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存储器组织
程序存储器
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作为量产版00
程序存储器包括中断和复位向量。中断向量的间隔为8
字节间隔，从0003H开始为外部中断0 。
复位向量
位置
0003H
000BH
0013H
001BH
0023H
服务
外部中断0
定时器0溢流
外部中断1
定时器1溢出
SIU中断
这些位置可被用于程序代码，如果相应的中断是不
用（被禁用） 。程序存储空间为64K ，从0000H到FFFFH 。最低4K
程序代码（ 0000H至0FFFH ），可以从外部或内部程序存储器取出。这
选择是通过捆扎销“ EA ” （外部地址）到GND或VCC进行。如果复位时， “ EA ”
保持低电平时，所有的程序代码从外部存储器读取。如果在复位过程中， “ EA ”举行
高，程序代码（ 0000H至0FFFH ）的最低4K是从内部存储器（ ROM ）中获取。
数据存储器
外部数据存储器
该IA8044 / IA8344微控制器核心采用了哈佛结构，具有独立
代码和数据空间。从外部存储器中的代码是由-psen‖频闪进账，而数据
从RAM读取位P3 （读选通） 7 ，并通过P3 （写选通）第6位写入RAM 。
外部数据存储器空间的活跃，只有通过使用16位数据寻址
指针寄存器（ DPTR ） 。外部数据存储器的一个较小的子集（ 8位寻址）可能
通过使用MOVX指令，寄存器变址寻址访问。
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数据表
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特点
外形，装配和功能兼容英特尔
8044/8344
封装选择： 40引脚塑料双列直插封装（ PDIP ）
44引脚塑料有引线芯片载体（ PLCC ）
8位控制器
与16位的乘法和除法的8位算术逻辑单元
12 MHz时钟
4个8位输入/输出端口
2个16位定时器/计数器
与SDLC / HDLC兼容串行接口单元
最高2.4 Mbps的串行数据速率
两个优先级中断系统
5个中断源
内部时钟分频器，相位发生器
192字节的读/写数据的存储空间
64kB的外部程序存储器
64kB的外部数据存储器空间
4kB的内部ROM （ IA8044只）
IA8044 / IA8344变
IA8044
IA8344
4kB的内部ROM与R0117 2.3版本固件， 192字节的内部RAM ，
64kB的外部程序和数据空间。
192字节的内部RAM ， 64kB的外部程序和数据空间。
的IA8044 / IA8344是一个"plug和 - play"简易替换为原来的集成电路。 INNOVASIC
生产使用数英里更换芯片
TM
或管理IC寿命延长系统，克隆
技术。该技术生产的集成电路更换远比"emulation"而更复杂
确保它们与原来的IC相兼容。 MILES
TM
捕获克隆的设计，以便它可以
制作甚至硅技术的进步。 MILES
TM
也验证对克隆
原装IC以至于连"undocumented features"是重复的。该数据表的所有文件
关于IA8044 / IA8344包括必要的工程信息的功能和I / O
描述，电特性，并适用定时。
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数据表
封装引脚
P1.0
P1.1
P1.2
P1.3
P1.4
P1.5
（ RTS ） P1.6
（ CTS ） P1.7
RST
（RXD） P3.0
（TXD） P3.1
（ INT0 ） P3.2
（ INT1 ） P3.3
（ T0 ） P3.4
（ SCLK / T1） P3.5
VCC
P1.2
P1.1
P1.0
P0.0
P1.4
P1.3
P0.1
P0.2
(41)
(2)
(3)
(4)
(5)
(6)
(7)
(8)
(9)
(10)
(11)
(12)
(13)
(14)
(15)
(16)
(17)
(18)
(19)
(20)
40引脚DIP
(39)
(38)
(37)
(36)
(35)
(34)
(33)
(32)
(31)
(30)
(29)
(28)
(27)
(26)
(25)
(24)
(23)
(22)
(21)
P0.0 （ AD0 ）
P0.1 （ AD1 ）
(44)
(43)
(42)
P0.3 （ AD3 ）
P0.4 （ AD4 ）
P0.5 （ AD5 ）
P0.6 （ AD6 ）
P0.7 （ AD7 ）
EA
ALE
PSEN
P2.7 （ A15 ）
P2.6 （ A14 ）
P2.5 （ A13 ）
P2.4 （ A12 ）
P2.3 （A11）
P2.2 （A10）
(40)
(6)
(5)
(4)
(3)
(2)
(1)
P0.2 （ AD2 ）
P1.5
P1.6
P1.7
RST / VPD
P3.0
北卡罗来纳州
P3.1
P3.2
P3.3
P3.4
P3.5
北卡罗来纳州
P0.3
(1)
IA8X44
(40)
VCC
(7)
(8)
(9)
(10)
(11)
(12)
(13)
(14)
(15)
(16)
(17)
(18)
(19)
(20)
(21)
(22)
(23)
(24)
(25)
(26)
(27)
(28)
(39)
(38)
P0.4
P0.5
P0.6
P0.7
EA
北卡罗来纳州
ALE
PSEN
P2.7
P2.6
P2.5
IA8X44
44引脚LCC
(37)
(36)
(35)
(34)
(33)
(32)
(31)
(30)
(29)
（ WR ）， P3.6
（ RD ）， P3.7
XTAL2
XTAL1
VSS
VSS
北卡罗来纳州
P2.0
P2.3
XTAL2
XTAL1
P3.6
P3.7
P2.1
P2.1 （A9）
P2.0 （A8）
描述
该IA8044 / IA8344是一种形式，配合和功能兼容部分英特尔8X44 SDLC
通信控制器。该IA8044 / IA8344是一个快速的单芯片8位微控制器与
综合SDLC / HDLC串行接口控制器。该IA8044 / IA8344是一个全功能的8位
其执行所有ASM51指令，并具有相同的指令集的嵌入式控制器
英特尔80C51 。该IA8044 / IA8344可以从两种类型的程序存储器访问指令，
供应的软件和硬件中断，提供了一个接口，用于串行通信和定时器
系统。该IA8044 / IA8344与英特尔8X44系列完全兼容。功能块
图如下所示。
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数据表
功能框图
I / O的内存， SIU ， DMA ，中断，定时器
端口0
地址/数据/ IO
端口2
地址/数据/ IO
端口1
SPCL FUNC / IO
端口3
SPCL FUNC / IO
内存
控制
XTAL
RESET
钟将军
&时机
192x8Dual港
内存
C8051
中央处理器
控制
地址/数据
中断
SIU
计时器
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数据表
I / O特性
下表描述了在IC上的每个信号的I / O特性。信号名称
对应所提供的引脚图的信号名称。下表提供了I / O
的IA8044和IA8344的描述。
名字
RST
ALE
PSEN
EA
P0.7 – P0.0
P1.7 – P1.0
P2.7 – P2.0
P3.7 – P3.0
TYPE
I
O
O
I
I / O
I / O
I / O
I / O
描述
复位。该引脚在两个机器周期，同时保持高
正在运行的振荡器将引起芯片复位。
地址锁存使能。用于锁存在下降沿地址
边对外部存储器的访问。
程序存储启用。当低充当输出使能
外部程序存储器。
外部访问。在保持低EA将导致
IA8044 / IA8344来从外部存储器的指令。
P0口的8位I / O口和低位地址/数据复
字节的外部访问。
端口1个8位I / O口。二位都有复用功能， P1.6
（RTS）和P1.7 （CTS） 。
端口2的8位I / O口。它也可以用作高次
在外部访问地址字节。
端口3 8位I / O口。端口3位也都有复用功能
如下所述。
P3.0 - RXD 。接收数据输入SIU或方向控制
为P3.1依赖于数据链路配置。
P3.1 - TXD 。发送数据输出SIU或数据
输入/输出依赖于数据链路配置。还
使诊断模式时清零。
P3.2 - INT0 。中断0输入或门控制输入计数器
0.
P3.3 - INT1 。中断1输入或门控制输入计数器
1.
P3.4 - T0 。输入到计数器0 。
P3.5 - SCLK / T1 。 SCLK输入到SIU或输入到计数器1 。
P3.6 - WR 。外部存储器写信号。
P3.7 - RD 。外部存储器读信号。
晶振输入1.连接到VSS时，使用外部时钟上
XTAL2 。可以连接到一晶体（与XTAL2 ） ，或者可以
直接驱动的时钟源（ XTAL2未连接） 。
晶振输入2.可连接到晶体（与XTAL1 ）
或者可以被直接驱动，与反相时钟源（XTAL1
接地） 。
地面上。
+ 5V电源。
XTAL1
XTAL2
VSS
VCC
I
O
P
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数据表
存储器组织
程序存储器
程序存储器包括中断和复位向量。中断向量的间隔为8
字节间隔，从0003H开始为外部中断0 。
复位向量
位置
0003H
000BH
0013H
001BH
0023H
服务
外部中断0
定时器0溢流
外部中断1
定时器1溢出
SIU中断
这些位置可被用于程序代码，如果不使用对应的中断
（禁用） 。程序存储空间为64K ，从0000H到FFFFH 。程序的最低4K
代码（ 0000H至0FFFH ），可以从外部或内部程序存储器取出。此选择
通过捆扎销“ EA ” （外部地址）到GND或VCC进行。如果复位时， “ EA ”保持低电平，
所有的程序代码从外部存储器读取。如果在复位过程中， “ EA ”被高举，最低
程序代码4K （ 0000H至0FFFH ）是从内部存储器（ ROM ）中获取。节目
以上4K （ 0FFFH ）的内存地址会导致程序代码从外部获取
内存不管“ EA ”的设置。
数据存储器
外部数据存储器
该IA8044 / IA8344微控制器核心采用了哈佛结构，具有独立
代码和数据空间。从外部存储器中的代码是由-psen‖频闪进账，而数据
从RAM读取位P3 （读选通） 7 ，并通过P3 （写选通）第6位写入RAM 。该
外部数据存储器空间的活跃，只有通过使用MOVX指令和寻址
16位数据指针寄存器（ DPTR ） 。外部数据存储器的一个较小的子集（ 8位
寻址）可通过MOVX指令使用的寄存器变址寻址访问。
内部数据存储器
内部数据存储器地址始终为1字节宽。的存储空间是192字节
大（ 00H至BFH ） ，并且可以通过直接或间接寻址方式访问。特别
功能寄存器占用高128字节。这SFR区仅可通过直接
寻址。内存重叠的SFR地址空间只能通过间接访问
寻址。
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SDLC通信控制器
数据表
INNOVASIC
特点
外形，装配和功能兼容英特尔
8044/8344
封装选择： 40引脚塑料双列直插封装（ PDIP ）
44引脚塑料有引线芯片载体（ PLCC ）
8位控制器
与16位的乘法和除法的8位算术逻辑单元
12 MHz时钟
4个8位输入/输出端口
2个16位定时器/计数器
与SDLC / HDLC兼容串行接口单元
最高2.4 Mbps的串行数据速率
两个优先级中断系统
5个中断源
内部时钟分频器，相位发生器
192字节的读/写数据的存储空间
64kB的外部程序存储器
64kB的外部数据存储器空间
4kB的内部ROM （ IA8044只）
IA8044 / IA8344变
IA8044
IA8344
4kB的内部ROM与R0117 2.3版本固件， 192字节的内部RAM ，
64kB的外部程序和数据空间。
192字节的内部RAM ， 64kB的外部程序和数据空间。
的IA8044 / IA8344是一个"plug和 - play"简易替换为原来的集成电路。 INNOVASIC
生产使用数英里更换芯片
TM
或管理IC寿命延长系统，克隆
技术。该技术生产的集成电路更换远比"emulation"而更复杂
确保它们与原来的IC相兼容。 MILES
TM
捕获克隆的设计，以便它可以
制作甚至硅技术的进步。 MILES
TM
也验证对克隆
原装IC以至于连"undocumented features"是重复的。该数据表的所有文件
关于IA8044 / IA8344包括必要的工程信息的功能和I / O
描述，电特性，并适用定时。
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数据表
封装引脚
P1.0
P1.1
P1.2
P1.3
P1.4
P1.5
（ RTS ） P1.6
（ CTS ） P1.7
RST
（RXD） P3.0
（TXD） P3.1
（ INT0 ） P3.2
（ INT1 ） P3.3
（ T0 ） P3.4
（ SCLK / T1） P3.5
VCC
P1.2
P1.1
P1.0
P0.0
P1.4
P1.3
P0.1
P0.2
(41)
(2)
(3)
(4)
(5)
(6)
(7)
(8)
(9)
(10)
(11)
(12)
(13)
(14)
(15)
(16)
(17)
(18)
(19)
(20)
40引脚DIP
(39)
(38)
(37)
(36)
(35)
(34)
(33)
(32)
(31)
(30)
(29)
(28)
(27)
(26)
(25)
(24)
(23)
(22)
(21)
P0.0 （ AD0 ）
P0.1 （ AD1 ）
(44)
(43)
(42)
P0.3 （ AD3 ）
P0.4 （ AD4 ）
P0.5 （ AD5 ）
P0.6 （ AD6 ）
P0.7 （ AD7 ）
EA
ALE
PSEN
P2.7 （ A15 ）
P2.6 （ A14 ）
P2.5 （ A13 ）
P2.4 （ A12 ）
P2.3 （A11）
P2.2 （A10）
(40)
(6)
(5)
(4)
(3)
(2)
(1)
P0.2 （ AD2 ）
P1.5
P1.6
P1.7
RST / VPD
P3.0
北卡罗来纳州
P3.1
P3.2
P3.3
P3.4
P3.5
北卡罗来纳州
P0.3
(1)
IA8X44
(40)
VCC
(7)
(8)
(9)
(10)
(11)
(12)
(13)
(14)
(15)
(16)
(17)
(18)
(19)
(20)
(21)
(22)
(23)
(24)
(25)
(26)
(27)
(28)
(39)
(38)
P0.4
P0.5
P0.6
P0.7
EA
北卡罗来纳州
ALE
PSEN
P2.7
P2.6
P2.5
IA8X44
44引脚LCC
(37)
(36)
(35)
(34)
(33)
(32)
(31)
(30)
(29)
（ WR ）， P3.6
（ RD ）， P3.7
XTAL2
XTAL1
VSS
VSS
北卡罗来纳州
P2.0
P2.3
XTAL2
XTAL1
P3.6
P3.7
P2.1
P2.1 （A9）
P2.0 （A8）
描述
该IA8044 / IA8344是一种形式，配合和功能兼容部分英特尔8X44 SDLC
通信控制器。该IA8044 / IA8344是一个快速的单芯片8位微控制器与
综合SDLC / HDLC串行接口控制器。该IA8044 / IA8344是一个全功能的8位
其执行所有ASM51指令，并具有相同的指令集的嵌入式控制器
英特尔80C51 。该IA8044 / IA8344可以从两种类型的程序存储器访问指令，
供应的软件和硬件中断，提供了一个接口，用于串行通信和定时器
系统。该IA8044 / IA8344与英特尔8X44系列完全兼容。功能块
图如下所示。
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P2.2
P2.4
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数据表
功能框图
I / O的内存， SIU ， DMA ，中断，定时器
端口0
地址/数据/ IO
端口2
地址/数据/ IO
端口1
SPCL FUNC / IO
端口3
SPCL FUNC / IO
内存
控制
XTAL
RESET
钟将军
&时机
192x8Dual港
内存
C8051
中央处理器
控制
地址/数据
中断
SIU
计时器
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数据表
I / O特性
下表描述了在IC上的每个信号的I / O特性。信号名称
对应所提供的引脚图的信号名称。下表提供了I / O
的IA8044和IA8344的描述。
名字
RST
ALE
PSEN
EA
P0.7 – P0.0
P1.7 – P1.0
P2.7 – P2.0
P3.7 – P3.0
TYPE
I
O
O
I
I / O
I / O
I / O
I / O
描述
复位。该引脚在两个机器周期，同时保持高
正在运行的振荡器将引起芯片复位。
地址锁存使能。用于锁存在下降沿地址
边对外部存储器的访问。
程序存储启用。当低充当输出使能
外部程序存储器。
外部访问。在保持低EA将导致
IA8044 / IA8344来从外部存储器的指令。
P0口的8位I / O口和低位地址/数据复
字节的外部访问。
端口1个8位I / O口。二位都有复用功能， P1.6
（RTS）和P1.7 （CTS） 。
端口2的8位I / O口。它也可以用作高次
在外部访问地址字节。
端口3 8位I / O口。端口3位也都有复用功能
如下所述。
P3.0 - RXD 。接收数据输入SIU或方向控制
为P3.1依赖于数据链路配置。
P3.1 - TXD 。发送数据输出SIU或数据
输入/输出依赖于数据链路配置。还
使诊断模式时清零。
P3.2 - INT0 。中断0输入或门控制输入计数器
0.
P3.3 - INT1 。中断1输入或门控制输入计数器
1.
P3.4 - T0 。输入到计数器0 。
P3.5 - SCLK / T1 。 SCLK输入到SIU或输入到计数器1 。
P3.6 - WR 。外部存储器写信号。
P3.7 - RD 。外部存储器读信号。
晶振输入1.连接到VSS时，使用外部时钟上
XTAL2 。可以连接到一晶体（与XTAL2 ） ，或者可以
直接驱动的时钟源（ XTAL2未连接） 。
晶振输入2.可连接到晶体（与XTAL1 ）
或者可以被直接驱动，与反相时钟源（XTAL1
接地） 。
地面上。
+ 5V电源。
XTAL1
XTAL2
VSS
VCC
I
O
P
P
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数据表
存储器组织
程序存储器
程序存储器包括中断和复位向量。中断向量的间隔为8
字节间隔，从0003H开始为外部中断0 。
复位向量
位置
0003H
000BH
0013H
001BH
0023H
服务
外部中断0
定时器0溢流
外部中断1
定时器1溢出
SIU中断
这些位置可被用于程序代码，如果不使用对应的中断
（禁用） 。程序存储空间为64K ，从0000H到FFFFH 。程序的最低4K
代码（ 0000H至0FFFH ），可以从外部或内部程序存储器取出。此选择
通过捆扎销“ EA ” （外部地址）到GND或VCC进行。如果复位时， “ EA ”保持低电平，
所有的程序代码从外部存储器读取。如果在复位过程中， “ EA ”被高举，最低
程序代码4K （ 0000H至0FFFH ）是从内部存储器（ ROM ）中获取。节目
以上4K （ 0FFFH ）的内存地址会导致程序代码从外部获取
内存不管“ EA ”的设置。
数据存储器
外部数据存储器
该IA8044 / IA8344微控制器核心采用了哈佛结构，具有独立
代码和数据空间。从外部存储器中的代码是由-psen‖频闪进账，而数据
从RAM读取位P3 （读选通） 7 ，并通过P3 （写选通）第6位写入RAM 。该
外部数据存储器空间的活跃，只有通过使用MOVX指令和寻址
16位数据指针寄存器（ DPTR ） 。外部数据存储器的一个较小的子集（ 8位
寻址）可通过MOVX指令使用的寄存器变址寻址访问。
内部数据存储器
内部数据存储器地址始终为1字节宽。的存储空间是192字节
大（ 00H至BFH ） ，并且可以通过直接或间接寻址方式访问。特别
功能寄存器占用高128字节。这SFR区仅可通过直接
寻址。内存重叠的SFR地址空间只能通过间接访问
寻址。
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