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HD151TS404SS
主板时钟发生器
为SiS746 AMD速龙/毒龙芯片组
ADE - 205-711A ( Z)
Rev.1
2002年11月
描述
该HD151TS404是一款高性能,低偏移,低抖动, PC主板时钟发生器。这是
专为SiS746芯片组设计。
特点
1差分对漏极开路输出的CPU时钟。
1漏极开路输出的CPU时钟芯片组。
6个PCI时钟和2 PCI_F时钟@ 3.3 V , 33.3 MHz的典型。
2份AGP时钟@ 3.3V , 66.6 MHz的典型。
2 Zclock @ 3.3V,高达133.3兆赫。
48兆赫USB 1副本@ 3.3 V
24兆赫/ 48 MHz的时钟可选@ 3.3 V
2份14.318 MHz的参考时钟@ 3.3 V
省电和时钟停止功能。
可编程时钟输出偏移控制功能。
I
2
C
TM
串口编程。
扩频调制( -0.5 %或± 0.25 % ) 。
48PIN的SSOP (300密耳)。
支持3
×
DDR DIMM应用与时钟缓冲器HD74CDCV851 ( SSOP48pin )
支持2
×
DDR DIMM微型ATX应用与时钟缓冲器HD74CDCV852 ( SSOP28pin )
订购信息
套餐类型
SSOP -48引脚
封装代码
缩写
SS
TAPING
缩写(数量)
EL ( 1000个/卷)
部件名称
HD151TS404SSEL
注:请咨询售楼处为上述方案的可用性。
注意:
I
2
C是飞利浦公司的商标。
Pentium是Intel Corporation的注册商标。
HD151TS404SS
关键的特定连接的阳离子
电源电压: VDD = 3.3V ± 5 %
时钟周期循环抖动= | 125 | ps的典型
CPU时钟歪斜组= 150 PS最大
AGP时钟歪斜组= 175 PS最大
PCI时钟歪斜组= 500 PS最大
CPU (早期)到PCI , AGP & ZCLK偏移= 1 4纳秒(典型值2ns的)
Rev.1号文件, 2002年11月,第27页2
HD151TS404SS
管脚配置
VDDREF 1
* FS0 / REF0 2
* FS1 / REF1 3
NC 4
GNDREF 5
X1 6
X2 7
GNDZ 8
ZCLK0 9
ZCLK1 10
VDDZ 11
PCI_STP # 12
VDDPCI 13
FS2 * / PCI_F0 14
FS3 * / PCI_F1 15
PCI0 16
PCI1 17
GNDPCI 18
VDDPCI 19
PCI2 20
PCI3 21
PCI4 22
PCI5 23
GNDPCI 24
48 VDDAPIC
47 IOAPIC1
46 IOAPIC0
45 GNDAPIC
44 CPU_STP #
43 CPU1T (OD)的
42 VDDCPU
41 GNDCPU
40 CPU0T (OD)的
39 CPU0C (OD)的
38 VDDCPU
37 GNDA
36 VDDA
35 SCLK
34 SDATA
33 PD #
32 GNDAGP
31 AGPCLK0
30 AGPCLK1
29 VDDAGP
28 VDD48
27 48MHz的
26 24_48MHz
25 GND48
( TOP VIEW )
*锁存输入/多功能引脚。
注意:
FS0 , 1 , 2 , 3 = 120 kΩ的内部下拉。
PCI_STP # , PD # , CPU_STP # = 120 kΩ的上拉。
Rev.1号文件, 2002年11月, 27第3页
HD151TS404SS
框图
2.5V
2.5V
5 × 3.3V VDD 7 GND × 2 × VDDCPU VDDAPIC
2 × 3.3 REF ( 14.318兆赫)
1/m1
OSC
合成
( CPU PLL )
1/n1
SSC调制器
CPU_STP #
PD #
* FS0 , 1 ,2,3
SDATA
SCLK
PCI_STP #
1/m2
时钟
分频器
2 × 2.5 IOAPIC ( 14.318兆赫)
CPUOT / C( OD )
CPU1T (OD)的
2 × AGP 3.3
2 × 3.3 ZCLK
模式控制
逻辑
6 × 3.3 PCICLK
2 × 3.3 PCICLK_F
3.3V VDD48 GND48
3.3V VDDA
GNDA
XTAL
14.318兆赫
合成
( 48兆赫PLL )
1/n2
48 MHz的3.3
24/48 MHz的3.3
注:锁定输入/多功能引脚。
Rev.1号文件, 2002年11月,第27页4
HD151TS404SS
表1时钟频率的功能表&我
2
C
字节4 (位2 , 4,5, 6 & 7)
Bit2
Bit7
FS3
0
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
25
26
27
28
29
30
31
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
0
0
0
0
0
0
0
0
1
1
1
1
1
1
1
1
0
0
0
0
0
0
0
0
1
1
1
1
1
1
1
1
Bit6
FS2
0
0
0
0
1
1
1
1
0
0
0
0
1
1
1
1
0
0
0
0
1
1
1
1
0
0
0
0
1
1
1
1
Bit5
FS1
0
0
1
1
0
0
1
1
0
0
1
1
0
0
1
1
0
0
1
1
0
0
1
1
0
0
1
1
0
0
1
1
Bit4
FS0
0
1
0
1
0
1
0
1
0
1
0
1
0
1
0
1
0
1
0
1
0
1
0
1
0
1
0
1
0
1
0
1
中央处理器
133.33
133.33
133.33
133.33
133.33
133.33
133.33
133.33
100
100
100
100
100
100
111.1
111.1
115.5
120
133.33
133.33
133.33
144.4
150
166.67
111.1
138.4
144.4
150
155.1
166.67
179.8
200
ZCLK
66.67
66.67
100
100
133.33
133.33
166.67
166.67
66.67
66.67
100
100
133.33
133.33
166.67
166.67
115.5
100
83.33
111.1
133.33
115.5
100
111.1
133.33
138.4
144.4
150
124.1
133.33
134.8
133.33
AGP
66.67
50
66.67
50
66.67
50
66.67
55.58
66.67
50
66.67
50
66.67
50
66.67
55.56
64.17
66.67
66.67
74.1
83.33
64.17
66.67
66.67
66.67
69.2
64.17
64.28
68.9
66.67
67.4
66.67
PCICLK
33.33
33.33
33.33
33.33
33.33
33.33
33.33
33.33
33.33
33.33
33.33
33.33
33.33
33.33
33.33
33.33
32.08
33.33
33.33
33.33
33.33
32.08
33.33
33.33
33.33
34.6
32.08
32.14
34.5
33.33
33.7
33.33
Rev.1号文件, 2002年11月,第27页5
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