GS8321Z18/32/36E-250/225/200/166/150/133
165焊球FP -BGA
商用温度
工业级温度
特点
用户可配置的管道和流通过模式
NBT （无总线转左右）功能，允许零等待
读 - 写 - 读总线利用率
完全引脚兼容，既流水线和流过
NtRAM ， NOBL 和ZBT SRAM的
IEEE 1149.1 JTAG兼容的边界扫描
2.5 V或3.3 V +10 ％ / - 10 ％，核心供电
LBO引脚的直线或交错突发模式
带2MB， 4MB， 8MB， 18MB和设备的引脚兼容
字节写操作（ 9位字节）
3芯片使能轻松深度扩展信号
ZZ引脚自动断电
JEDEC标准的165焊球FP- BGA封装
无铅165焊球BGA封装
36MB流水线和流量通过
同步NBT SRAM
250兆赫， 133兆赫
2.5 V或3.3 V V
DD
2.5 V或3.3 V的I / O
因为它是一种同步装置，地址，数据输入，并
读/写控制输入端上捕获的上升沿
输入时钟。突发顺序控制（ LBO）必须连接到电源
铁路正常运行。异步输入包括
休眠模式使能， ZZ和输出使能。输出使能
用于改写输出的同步控制
司机把RAM的输出驱动器关闭，在任何时候。
写周期是内部自定时的由上升开始
在时钟输入的边缘。这个特性消除了复杂的场外
通过异步SRAM芯片所需的写入脉冲的产生
并简化了输入信号的定时。
该GS8321Z18 / 32 / 36E可以由用户进行配置
工作在管道或流通方式。操作为
流水线同步装置中，除了在起立边沿
触发寄存器捕获输入信号，该装置
包括一个上升沿触发的输出寄存器。对于读
周期，流水线SRAM的输出数据由暂时存储
的边缘接入周期中触发输出寄存器和
然后释放到输出驱动器的下一次上升边缘
时钟。
该GS8321Z18 / 32 / 36E与GSI的实现高
性能CMOS技术和可在JEDEC-
标准的165焊球FP- BGA封装。
功能说明
该GS8321Z18 / 32 / 36E是一个36Mbit的同步静态
SRAM 。 GSI的NBT SRAM的，像ZBT ， NtRAM ， NOBL或
其他流水线读/双晚写或流经读/
单后期写的SRAM ，允许使用所有可用总线
带宽不再需要插入取消选择周期
当设备从切换的读写周期。
参数简介
t
KQ
TCYCLE
CURR
(x18)
CURR
(x32/x36)
t
KQ
TCYCLE
CURR
(x18)
CURR
(x32/x36)
-250 -225 -200 -166 -150 -133单位
2.5 2.7 3.0 3.5 3.8 4.0纳秒
4.0 4.4 5.0 6.0 6.6 7.5纳秒
285
350
6.5
6.5
205
235
265
320
7.0
7.0
195
225
245
295
7.5
7.5
185
210
220 210 185毫安
260 240 215毫安
8.0 8.5 8.5纳秒
8.0 8.5 8.5纳秒
175 165 155毫安
200 190 175毫安
管道
3-1-1-1
溢流
通过
2-1-1-1
冯： 1.06b 2/2006
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2003 ， GSI技术
规格援引如有更改，恕不另行通知。对于最新的文档，请参见http://www.gsitechnology.com 。
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165焊球BGA - X18黎民I / O -顶视图（ E组）
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DQB
DQB
DQB
DQB
DQB
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DQB
DQB
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NC
NC
NC
NC
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V
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DQA
DQA
DQA
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DQA
DQA
DQA
DQA
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11 ×15焊球BGA - 15毫米×17 mm主体， 1.0毫米凸块间距
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165焊球BGA - X32通用I / O -顶视图（ E组）
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DQC
DQC
DQC
DQC
FT
DQD
DQD
DQD
DQD
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LBO
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DQC
DQC
DQC
DQC
MCH
DQD
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DQD
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DDQ
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4
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V
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V
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A
A
10
A
A
NC
DQB
DQB
DQB
DQB
NC
DQA
DQA
DQA
DQA
NC
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NC
NC
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DQB
DQB
DQB
DQB
ZZ
DQA
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11 ×15焊球BGA - 15毫米×17 mm主体， 1.0毫米凸块间距
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165焊球BGA - X36通用I / O -顶视图（ E组）
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A
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DQC
DQC
DQC
DQC
DQC
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DQD
DQD
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DQC
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DQC
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MCH
DQD
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DQD
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E2
V
DDQ
V
DDQ
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DDQ
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BC
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DQB
DQB
DQB
DQB
NC
DQA
DQA
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NC
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DQB
DQB
DQB
DQB
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DQA
DQA
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11 ×15焊球BGA - 15毫米×17 mm主体， 1.0毫米凸块间距
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GS8321Z18 / 32 / 36E 165焊球BGA引脚说明
符号
A
0
, A
1
An
DQ
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C
DQ
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, B
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, B
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I
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I
—
I
I
I
I
I
I
I
I
I
I
I
I
I
O
I
—
I
I
I
描述
地址域的LSB和地址计数器的预置输入
地址输入
数据输入和输出引脚
字节写使能为DQ
A
， DQ
B
， DQ
C
， DQ
D
的I / O ;低电平有效
无连接
时钟输入信号;高电平有效
时钟使能;低电平有效
写使能;低电平有效
芯片使能;低电平有效
芯片使能;低电平有效
芯片使能;高电平有效
流经/管道模式控制
输出使能;低电平有效
突发地址计数器提前实现;高电平有效
睡眠模式控制;高电平有效
线性突发顺序模式;低电平有效
扫描测试模式选择
扫描测试数据
扫描测试数据输出
扫描测试时钟
必须连接高
核心供电
I / O和核心地
输出驱动器电源
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