T
R
I
Q
U
I
N
T
性S E M I C 0 N D ü （C T） R， I N以下。
FBIN
11
S1
10
REFCLK
9
S0
8
F1
7
F0
6
GND
5
GA1088
4
VDD
3
TEST
12
VDD
13
相
探测器
VCO
Q10
Q9
Q0
14
2
11-Output
CON连接可配置
时钟缓冲器
特点
宽的频率范围：
18 MHz至105 MHz的
输出配置：
在三个输出
1
/
2
f
REF
在f三个输出
REF
在f四路输出
REF
带可调相或
在f两个输出
REF
以2倍F四路输出
REF
以2倍F四路输出
REF
可调相位
系统定时
制品
GND
15
Q1
Q2
16
17
MUX
逻辑鸿沟
÷ 4 ÷ 6 ，或÷8
输出缓冲器
B组
相
SELECT
1
GND
28
Q8
Q7
组
A
组
C
27
VDD
18
26
VDD
19
20
21
22
23
24
25
GND
Q3
Q4
VDD
Q5
Q6
GND
TriQuint的GA1088是一个可配置的时钟缓冲器产生11
输出，工作在一个宽的频率范围 - 从18兆赫至
105兆赫。输出可在任1倍和2倍或1倍和
1
/
2
x
基准时钟频率f
REF
。当在A组的输出之一（ Q0-
Q2 ）作为反馈到PLL ，所有A组的输出将是在f
REF
和
所有B组（ Q3 - Q6 ）和C组（ Q7 - Q10 ）输出将在2个F
REF
.
时的B组输出之一被用作反馈到PLL时，所有组
A输出将在
1
/
2
架F
REF
和所有B组和C组的输出将
是在f
REF
.
一个非常稳定的内部锁相环（PLL），提供低抖动
操作。这个完全独立的PLL无需外部
电容或电阻。 PLL的压控振荡器（VCO），具有
频率范围从280兆赫到420兆赫。通过反馈的所述一个
输出时钟FBIN ，锁相环一直保持频率和
参考时钟（ REFCLK ），并且每个对之间的相位同步
的输出。移位选择引脚选择的相移（ -2T ， -t ，0，或+ t）的
C组输出（ Q7 - Q10 ）相对于REFCLK 。的相移
增量（t）是等于VCO的周期（1 /女
VCO
).
TriQuint公司专利的输出缓冲器的设计提供了非常低的输出，用于─
150 PS（最大）的输出歪斜。该GA1088的对称TTL输出
采购能力和吸收30毫安。
可选的相移：
-2T ， -t ， 0， +吨（吨= 1 /女
VCO
)
低输出至输出偏斜：
150 ps的（最大）范围内的一组
??近零传播延迟
PS -350 + 500 PS （最大值）或
-350 PS 700 PS （最大值）
TTL兼容30毫安
输出驱动器
28引脚J形引脚表面贴装
包
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1
GA1088
功能说明
该GA1088的核心是一个锁相环（ PLL ）
这持续对参考时钟
（ REFCLK ），以反馈时钟（ FBIN ） ，保持了
两者之间的零频率的差异。由于一
（ Q0 Q6 ）始终连接到FBIN的输出，
锁相环保持之间的传播延迟
输出和内部-350 PS 500 PS的参考时钟
为GA1088 - MC500 ，并在-350 ps的700 ps的
为GA1088 - MC700 。
内部压控振荡器（VCO ）具有
的280兆赫到420兆赫的工作范围。该
压控振荡器和除法逻辑组合使
该GA1088 18 MHz和105 MHz之间的工作。
该器件具有6鸿沟模式：
÷4, ÷6, ÷8, ÷8,
÷12,
和
÷16.
频率选择引脚， F0和F1 ，
并用作反馈到FBIN输出设置分频
模式如表1所示。
挡位选择引脚， S0和S1 ，控制阶段
移的C组输出（ Q7 -Q10 ） ，相对于所述
其他输出。用户可以从四个选择
增量相移，如表2所示（相
选择） 。相移增量（ t）计算
使用下面的公式（其中n为
除法模式） ：
t=
1
(f
REF
) (n)
在测试模式下，PLL被旁路， REFCLK是
通过直接连接到除法逻辑块
MUX ，如图1所示。该模式用于有用
调试和测试用。各种测试模式
在表3中概述在测试模式下，频率
基准时钟是由4,6或8分频。
在输出引脚上的最大上升和下降时间
1.4纳秒。该GA1088的所有输出为TTL兼容
与30毫安对称的驱动器和一个最小V
OH
2.4 V.
电源/复位同步
系统上电或复位后， PLL需要之前的时间
实现了同步锁。的最大时间
需要同步（ TSYNC ）为500毫秒。
表1.频率模式选择
反馈：任何A组输出（ Q0 - Q2 ）
TEST
0
0
0
0
选择引脚
F0
0
1
0
1
F1
0
0
1
1
模式
未使用
÷
8
÷
12
÷
16
参考时钟
频带
不适用
35兆赫 - 50 MHz的
24兆赫 - 35 MHz的
18兆赫 - 26 MHz的
输出频率范围
A组： Q0 ， Q2
B组， C： Q3 - Q10
不适用
35兆赫 - 50 MHz的
24兆赫 - 35 MHz的
18兆赫 - 26 MHz的
不适用
70兆赫 - 105兆赫
48兆赫 - 70 MHz的
35兆赫 - 52 MHz的
反馈：任何B组输出（ Q3 - Q6 ）
TEST
0
0
0
0
选择引脚
F0
0
1
0
1
F1
0
0
1
1
模式
未使用
÷
4
÷
6
÷
8
参考时钟
频带
不适用
70兆赫 - 105兆赫
48兆赫 - 70 MHz的
35兆赫 - 52 MHz的
输出频率范围
A组： Q0 ， Q2
B组， C： Q3 - Q10
不适用
35兆赫 - 50 MHz的
24兆赫 - 35 MHz的
18兆赫 - 26 MHz的
不适用
70兆赫 - 105兆赫
48兆赫 - 70 MHz的
35兆赫 - 52 MHz的
2
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GA1088
表2.选相
S0
0
1
0
1
S1
0
0
1
1
相位差（ Q9 ， Q10 ）
+t
0
–t
–2t
表3.测试模式选择
TEST
1
1
1
1
F0
0
1
0
1
F1
0
0
1
1
模式
未使用
÷
4
÷
6
÷
8
参考文献。时钟
—
f
REF
f
REF
f
REF
A组：
输出Q0 ， Q2
—
f
REF
÷
8
f
REF
÷
12
f
REF
÷
16
B组，C
输出Q3- Q10
—
f
REF
÷
4
f
REF
÷
6
f
REF
÷
8
布局指南
多个接地和电源引脚上的GA1088减少
接地反弹。良好的布局技术，然而，
要保证正常运行，并满足
在整个工作范围内的规格。
每个V的TriQuint公司建议绕过
DD
供应
引脚到最近的接地引脚，尽可能靠近芯片
可能。
图2示出了所建议的功率布局
GA1088 。旁路电容应位于
该板为GA1088的同一侧。在V
DD
迹线连接到内- V层
DD
平面。所有的
接地引脚（GND ）连接到一个小的地面
平面上的芯片下方的表面上。多重吞吐量
孔这个小面的平面连接到内层
接地平面。所述电容器（ C1-C5）为0.1 μF的。
TriQuint的测试板采用X7R温度稳定
电容器在1206 SMD情况。
电源引脚图2.顶层布局（约3.3倍）
V
DD
C4
销1
C3
地
飞机
V
DD
C2
引脚15
C5
V
DD
V
DD
C1
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3
系统定时
制品
V
DD
GA1088
绝对最大额定值
1
储存温度
环境温度与功耗的应用
2
电源电压对地电位
直流输入电压
DC输入电流
封装热阻（ MQuad ）
管芯结温
–65
°C
+150
°C
–55
°C
+100
°C
-0.5 V至7.0 V
-0.5V至（Ⅴ
DD
+ 0.5) V
-30 mA至5毫安
θ
JA
= 45
° C / W
T
J
= 150
°C
DC特性
(V
DD
= + 5V + 5 ％ ，T
A
= 0
°
C至+70
°
C)
3
符号
V
OHT
V
OHC
V
OL
V
IH 5
V
IL5
I
IL
I
IH
I
I
I
DDS 6
V
I
描述
输出高电压
输出高电压
输出低电压
输入高电平
输入低电平
输入低电平电流
输入高电流
输入高电流
电源电流
输入钳位电压
测试条件
V
DD
=分钟
I
OH
= -30毫安
V
IN
= V
IH
或V
IL
V
DD
=分钟
I
OH
= -1毫安
V
IN
= V
IH
或V
IL
V
DD
=分钟
I
OL
= 30毫安
V
IN
= V
IH
或V
IL
保证输入逻辑高电平
电压输入所有
保证输入逻辑低电平
电压输入所有
V
DD
=最大
V
IN
= 0.40 V
V
DD
=最大
V
IN
= 2.7 V
V
DD
=最大
V
IN
= 5.5 V
V
DD
=最大
V
DD
=分钟
I
IN
= -18毫安
民
2.4
3.2
范围
4
典型值
3.4
4.1
0.27
最大
单位
V
V
0.5
V
V
2.0
0.8
–156
0
2
119
–0.70
–400
25
1000
160
–1.2
V
A
A
A
mA
V
电容
符号
C
在3,7
注意事项：
描述
输入电容
测试条件
V
IN
= 2.0V，在f = 1 MHz的
民
典型值
6
最大
pF
1.超过这些参数可能会损坏设备。
2.最高环境温度与设备不切换和卸载。
3，分别适用于GA1088 - MC500和GA1088 - MC700 。
4.典型的限制是在V
DD
= 5.0 V和T
A
= 25
°
C.
5.这是相对于地面设备包括绝对值和所有因系统或测试噪音过冲。
6.此参数测量装置不切换和卸载。
7.这些参数不是100 ％测试，但周期性采样。
4
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GA1088
AC特性
(V
DD
= + 5V + 5 ％ ，T
A
= 0
°
C至+70
°
C)
符号
t
CPWH
t
CPWL
t
IR
输入时钟（ REFCLK ）
CLK脉冲宽高
CLK脉冲宽度低
输入上升时间（ 0.8 V - 2.0 V）
试验条件（图3）
1
图4
图4
民
3
3
—
典型值
---
---
—
最大
—
—
2.0
单位
ns
ns
ns
符号
t
或者，
t
OF
t
PD1
t
PD2
2
2
输入时钟（ Q0 - Q10 ）
上升/下降时间（ 0.8 V - 2.0 V）
CLK我对FBIN I（ GA1088 - MC500 ）
CLK我对FBIN I（ GA1088 - MC700 ）
上升，上升，下降，秋天
（组内）
上升，上升，下降，秋天
（组与组的，对齐的）
试验条件（图3）
1
图4
图4
图4
图5
图6
7
图8
（ skew2考虑skew1 ）
（ skew3考虑skews1 ，2）
（ skew4考虑skew3 ）
民
350
–850
–1050
—
—
—
—
–1000
—
—
—
典型值
—
–350
–350
60
75
—
—
0
80
190
10
最大
1400
+150
+350
150
350
650
1200
+1000
200
400
500
单位
ps
ps
ps
ps
ps
ps
ps
ps
ps
ps
s
t
SKEW1 3
t
SKEW2
t
SKEW4
t
CYC
t
JR
4
3
t
SKEW3 3
上升，上升，下降，秋天
3
（组到组中，未对齐）
科幻gure
上升下降，秋天高层
占空比变化
期至周期抖动
随机抖动
同步时间
图4
图4
图4
t
JP 5
5
t
SYNC 6
图3. AC测试电路
+5 V
R1
R2
Z
FBIN
Q0
Q1
Q2
Q10
Y
50
X
+5 V
R1
R2
+5 V
R1
R2
+5 V
R1
R2
注意事项：
R1 = 160
R2 = 71
Y + Z = X
+5 V
R1
R2
Z
CLK
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5
系统定时
制品
注：1.所有测量都用具有0.5纳秒（0.8至2.0V ）的上升时间的REFCLK进行测试。
2.该PLL保持CLK和FBIN的取向在任何时候。本规范适用于上升沿只是因为输入的职责
周期可以变化，而输出的占空比通常50/50。延迟吨
PD
的测量是在CLK和FBIN的1.5 V电平。
3.斜交指定了输出切换窗口的宽度，并测量在1.5V。
4.本说明书中表示从50/50的输出端上的偏差。
5.抖动指标指峰 - 峰值。吨
JR
是在相对于所述参考时钟输出的抖动。吨
JP
是抖动的
输出相对于输出的前一上升沿。
6. t
SYNC
是同步所需的PLL的时间;这假定一个CLK信号的存在，并从所述一个连接
输出FBIN 。
QQ：2881677436 复制
