T
R
I
Q
U
I
N
T
性S E M I C 0 N D ü （C T） R， I N以下。
图1.框图
FBIN
11
GA1085
S1
10
REFCLK
9
S0
8
F1
7
F0
6
GND
5
TEST
12
VDD
13
相
探测器
VCO
相
SELECT
4
VDD
3
2
Q10
Q9
11-Output
CON连接可配置
时钟缓冲器
Q0
14
GND
15
Q1
Q2
16
17
MUX
逻辑鸿沟
÷ 4 ÷5或6 ÷
输出缓冲器
A组
组
C
1
GND
28
27
Q8
Q7
特点
宽的频率范围：
24 MHz至105 MHz的
输出配置：
在f四路输出
REF
在f四路输出
REF
/2
在f两个输出
REF
/2
可调相位
or
以2倍F五个输出
REF
在f三个输出
REF
在f两个输出
REF
可调相位
可选的相移： -2T ， -t ，
+ t和+ 2吨性（t = 1 /女
VCO
)
低输出至输出偏斜： 150
ps的（最大）范围内的一组
近零传播延迟：
-350 ps的千ps的（最大）
TTL兼容30毫安
输出驱动器
28引脚J形引脚表面贴装
包
VDD
18
组
B
26
VDD
19
20
21
22
23
24
25
GND
Q3
Q4
VDD
Q5
Q6
GND
TriQuint的GA1085是一个可配置的时钟缓冲器产生11输出
而工作在较宽的频率范围，从24 MHz到105 MHz的的。
输出可在任1倍和2倍或1倍和
1
/
2
×基准
时钟频率f
REF
。当A组输出（ Q4 - Q8 ）之一被用作
反馈给PLL ，所有A组的输出将是在f
REF
和所有B组
（ Q0 - Q3）和C组（ Q9 ， Q10 ）的输出将在
1
/
2
架F
REF
。当一
在B组的输出作为反馈到PLL ，所有的A组输出
将在2倍
REF
和所有B组和C组的输出将是在f
REF
。该
按住Shift键选择引脚选择的相移（ -2T ， -t ， + T或+ 2T）为C组
输出（ Q 9 ， Q 10 ）相对于REFCLK 。相移增量（t）的
相当于VCO的周期（1 /女
VCO
).
一个非常稳定的内部锁相环（PLL），提供低抖动的操作。
这个完全独立的PLL无需外部电容或电阻。
PLL的压控振荡器（VCO）的频率范围从
280兆赫至420兆赫。通过反馈的输出时钟FBIN之一
在PLL继续维持频率和相位SYNCHRON -化
间的参考时钟（ REFCLK ），并且每个输出端。
TriQuint公司专利的输出缓冲器的设计提供了非常低的输出至输出
偏斜的150的ps （最大值）。该GA1085的对称TTL输出可
对采购和下沉30毫安。
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1
系统定时
制品
系统时间
GA1085
功能说明
该GA1085的核心是一个锁相环（ PLL ）
这持续对参考时钟（ REFCLK ）
到反馈时钟（ FBIN ） ，保持了零
两者之间的频率差。自的所述一个
输出（ Q0 Q8 ）始终连接到FBIN ，锁相环
保持输出和之间的传播延迟
在-350 +1000 PS PS的参考时钟。
内部压控振荡器（VCO ）具有
的280兆赫到420兆赫的工作范围。该
压控振荡器和除法逻辑组合使
该GA1085 24 MHz和105 MHz之间的工作。
该器件具有6鸿沟模式：
÷4, ÷5, ÷6, ÷8,
÷10,
和
÷12.
频率选择引脚， F0和F1 ，
并用作反馈到FBIN输出设置分频
模式如表1所示。
挡位选择引脚， S0和S1 ，控制阶段
Q9和Q10的相移来的其它输出。该
用户可以从四个增量相移的选择
如表2所示。
相移增量（t）被使用计算出的
下面的等式：
t=
1
(f
REF
) (n)
哪里
n
是的鸿沟模式。
在测试模式下，PLL被旁路， REFCLK是
通过直接连接到除法逻辑块
MUX ，如图1所示。该模式用于有用
调试和测试用。各种测试模式
在表3中概述在测试模式下，频率
基准时钟是由4,5 ，或6分。
在输出引脚上的最大上升和下降时间
1.4纳秒。该GA1085的所有输出为TTL兼容
与30毫安对称的驱动器和一个最小V
OH
2.4 V.
电源/复位同步
上电后或复位后， PLL需要之前的时间
实现了同步锁。的最大时间
需要同步（ TSYNC ）为500毫秒。
表1.频率模式选择
反馈：任何A组输出（ Q4 - Q8 ）
TEST
0
0
0
0
选择引脚
F0
1
0
0
1
F1
0
0
1
1
模式
÷
4
÷
5
÷
6
未使用
参考时钟
频带
70兆赫 - 105兆赫
56兆赫 - 84 MHz的
48兆赫 - 70 MHz的
不适用
输出频率范围
A组： Q4- Q8
B： Q0 - Q3 ， C： Q9 - Q10
70兆赫 - 105兆赫
35兆赫 - 52 MHz的
56兆赫 - 84 MHz的
1
28兆赫 - 42 MHz的
48兆赫 - 70 MHz的
24兆赫 - 35 MHz的
不适用
不适用
反馈：任何B组输出（ Q0 - Q3 ）
TEST
0
0
0
0
注意：
选择引脚
F0
1
0
0
1
F1
0
0
1
1
模式
÷
8
÷
10
÷
12
未使用
参考时钟
频带
35兆赫 - 52 MHz的
28兆赫 - 42 MHz的
24兆赫 - 35 MHz的
不适用
输出频率范围
A组： Q4- Q8
B： Q0 - Q3 ， C： Q9 - Q10
70兆赫 - 105兆赫
35兆赫 - 52 MHz的
56兆赫 - 84 MHz的
1
28兆赫 - 42 MHz的
48兆赫 - 70 MHz的
24兆赫 - 35 MHz的
不适用
不适用
1.该模式产生的输出用40/60的占空比Q4 - 只有Q8 。
2
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GA1085
绝对最大额定值
1
储存温度
环境温度与功耗的应用
2
电源电压对地电位
直流输入电压
DC输入电流
封装热阻（ MQuad ）
管芯结温
–65
°C
+150
°C
–55
°C
+100
°C
-0.5 V至7.0 V
-0.5V至（Ⅴ
DD
+ 0.5) V
-30 mA至5毫安
θ
JA
= 45
° C / W
T
J
= 150
°C
DC特性
(V
DD
= + 5V + 5 ％ ，T
A
= 0
°
C至+70
°
C)
符号
V
OHT
V
OHC
V
OL
V
IH 4
V
IL4
I
IL
I
IH
I
I
I
DDS5
V
I
描述
输出高电压
输出高电压
输出低电压
输入高电平
输入低电平
输入低电平电流
输入高电流
输入高电流
电源电流
输入钳位电压
测试条件
V
DD
=我敏
OH
= -30毫安
V
IN
= V
IH
或V
IL
V
DD
=我敏
OH
= -1毫安
V
IN
= V
IH
或V
IL
V
DD
=我敏
OL
= 30毫安
V
IN
= V
IH
或V
IL
保证输入逻辑
高压对所有输入
保证输入逻辑
低电压所有输入
V
DD
= MAX V
IN
= 0.40 V
V
DD
= MAX V
IN
= 2.7 V
V
DD
= MAX V
IN
= 5.5 V
V
DD
=最大
V
DD
=我敏
IN
= -18毫安
民
3
2.4
3.2
典型值
3.4
4.1
0.27
最大
3
单位
V
V
0.5
V
V
2.0
0.8
–156
0
2
119
–0.70
–400
25
1000
160
–1.2
V
A
A
A
mA
V
电容
符号
C
在6
描述
输入电容
测试条件
V
IN
= 2.0V，在f = 1 MHz的
民
典型值
6
最大
单位
pF
注意事项：
1.超过这些参数可能会损坏设备。
2.最高环境温度与设备不切换和卸载。
3.典型的限制是在V
DD
= 5.0 V和T
A
= 25
°
C.
4.这是相对于地面设备包括绝对值和所有因系统或测试噪音过冲。
5.此参数测量装置不切换和卸载。
6.这些参数不是100 ％测试，但周期性采样。
4
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GA1085
AC特性
符号
t
CPWH
t
CPWL
t
IR
(V
DD
= + 5V + 5 ％ ，T
A
= 0
°
C至+70
°
C)
试验条件（图3）
1
图4
图4
输入时钟（ REFCLK ）
CLK脉冲宽高
CLK脉冲宽度低
输入上升时间（ 0.8 V - 2.0 V）
最小值典型值
3
3
—
---
---
—
最大
—
—
2.0
单位
ns
ns
ns
输出时钟（ Q0 - Q10 ）
t
或者，
t
OF
t
PD2
t
SKEW13
t
SKEW2
3
上升/下降时间（ 0.8 V- 2.0 V）
CLK我对FBIN I（ GA1085 - MC1000 ）
上升，上升，下降，秋季（组内）
上升，上升，下降，秋天
（组与组的，对齐的）
上升，上升，下降，秋天
（组到组中，未对齐）
上升下降，秋天高层
占空比变化
期至周期抖动
随机抖动
同步时间
图4
图4
图5
图6
（ skew2考虑skew1 ）
图7
（ skew3考虑skew1 ， skew2 ）
图8
（ skew4考虑skew3 ）
图4
图4
图4
350 — 1400
–1350–350 +650
—
—
—
—
60
75
—
—
150
350
650
1200
+1000
200
400
500
ps
ps
ps
ps
ps
ps
ps
ps
ps
s
系统定时
系统定时
制品
t
SKEW33
t
SKEW43
t
CYC4
t
JP5
t
JR5
t
SYNC6
注意事项：
–1000 0
— 80
— 190
— 10
1.所有测量都用具有0.5纳秒（0.8至2.0V ）的上升时间的REFCLK进行测试。
2.该PLL保持CLK和FBIN的取向在任何时候。本规范适用于上升沿只是因为输入的职责
周期可以变化，而输出的占空比通常50/50。延迟吨
PD
的测量是在CLK和FBIN的1.5 V电平。
3.斜交指定了输出切换窗口的宽度，并测量在1.5V。
4.本说明书中表示从50/50的输出端上的偏差。
5.抖动指标指峰 - 峰值。吨
JR
是在相对于所述参考时钟输出的抖动。
t
JP
是在相对于该输出的前一上升沿的输出的抖动。
6. t
SYNC
是同步所需的PLL的时间;这假定一个CLK信号的存在和
从输出到FBIN之一的连接。
图3. AC测试电路
+5 V
R1
R2
Z
FBIN
Q0
Q1
Q2
Q10
Y
50
X
+5 V
R1
R2
+5 V
R1
R2
+5 V
R1
R2
注意事项：
R1 = 160
R2 = 71
Y + Z = X
+5 V
R1
R2
Z
CLK
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5
QQ：2880707522 复制
