【第一节MAX II器件系列数据手册本节为设计人员提供的数据表规格最大II器件。本章节包含了内部的功能】,IC型号EPM570T100C5N,EPM570T100C5N PDF资料,EPM570T100C5N经销商,ic,电子元器件-51电子网

第一节MAX II器件

系列数据手册

本节为设计人员提供的数据表规格

最大

II器件。本章节包含了内部的功能定义

体系结构，联合测试行动组（JTAG）和在系统

可编程性（ ISP ）的信息， DC操作条件下， AC时间

参数和MAX II器件订购信息。

本部分包括以下各章：

■

第1章简介

第2章MAX II架构

第3章JTAG &在系统可编程

第4章热插拔&上电复位MAX II器件

第5章DC &开关特性

第6章参考&订购信息

修订历史

请参阅各章自己特定的修订历史。信息

就当每个章节进行了更新，请参阅第一章修订日期

部分，它会出现在完整的手册。

Altera公司。

第I- 1

初步

第1章简介

MII51001-1.6

介绍

最大

II系列瞬时接通，非易失性的CPLD是基于一个

0.18微米， 6层金属闪光过程中，随着密度从240到2210

逻辑单元（LE ）（ 128 2210等效宏单元）和非易失性

存储8千位。 MAX II器件提供高I / O数，速度快

性能和可靠嵌合相对于其他的CPLD架构。

拥有多电压内核，用户闪存（ UFM ）块，并

增强在系统可编程（ ISP ）， MAX II器件的设计

以降低成本和功耗，同时提供用于可编程解决方案

应用，如总线桥接， I / O扩展，上电复位（ POR ）

和顺序控制和设备配置的控制。

下面列出了MAX II CPLD系列数据的主要部分

表：

部分

页面

特色：。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。 1-2

功能描述。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。 2-1

逻辑阵列模块。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。 2-5

逻辑元件。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。 2-8

MultiTrack互联。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。 2-15

全球信号。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。 2-20

用户闪存模块。。。。。。。。。。。。。。。。。。。。。。。。。。。。。 2-23

多电压内核。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。 2-27

I / O结构。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。 2-28

IEEE标准。 1149.1 （ JTAG ）边界扫描支持。。。。。。。。。。 3-1

在系统可编程。。。。。。。。。。。。。。。。。。。。。。。。。。。。 3-4

热插拔。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。 4-1

上电复位电路。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。 4-6

工作条件。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。 5-1

功耗。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。 5-9

时序模型&规格。。。。。。。。。。。。。。。。。。。。。。。。 5-10

器件引脚输出。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。 6-1

订购信息。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。 6-1

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2006年12月

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1–1

初步

特点

■

低成本，低功耗CPLD

瞬时上电，非易失性建筑

待机电流低至2毫安

提供快速的传输延迟和时钟到输出时间

提供了四个全局时钟有两个时钟提供每逻辑阵列

模块（LAB ）

UFM方框高达8 Kbits的非易失性存储

多电压内核使外部电源电压的装置

无论是3.3 V / 2.5 V或1.8 V

多电压I / O接口，支持3.3 V ， 2.5 V， 1.8 V和1.5 V逻辑

水平

总线型架构，包括可编程转换速率，驱动器

强度，总线保持和可编程的上拉电阻

施密特触发器能够容忍的噪声输入（可编程元

针）

完全符合外围部件互连特别

兴趣小组（ PCI SIG ）

PCI本地总线规范2.2修订版

为

在66 MHz的3.3 V操作

支持热插拔

内置的联合测试行动组（JTAG）的边界扫描测试（BST）

电路符合IEEE标准。 1149.1-1990

ISP电路，符合IEEE标准。 1532

表1-1

显示MAX II器件的功能。

表1-1 。 MAX II器件特性

特征

LES

典型的等效

宏单元

等效宏单元

范围

UFM大小（位）

最大用户I / O引脚

PD1

（纳秒）

(1)

CNT

（兆赫）

(2)

（纳秒）

注释

表1-1：

(1)

(2)

PD1

代表了整个器件的引脚到引脚延时为最坏的情况下， I / O布局一个完整的对角线路径和

在单个的LUT和LAB即相邻输出引脚来实现组合逻辑。

最大频率是由在时钟输入引脚的I / O标准的限制。在16位计数器临界延迟

会跑的比这个数字要快。

EPM240

240

192

128 240

8,192

4.7

304

1.7

4.3

EPM570

570

440

240 570

8,192

160

5.4

304

1.2

4.5

EPM1270

1,270

980

570 1270

8,192

212

6.2

304

1.2

4.6

EPM2210

2,210

1,700

1270至2210

8,192

272

7.0

304

1.2

4.6

1–2

MAX II器件手册，卷1

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Altera公司。

2006年12月

介绍

有关等效宏单元的详细信息，请参阅

MAX II逻辑单元到宏单元的转换方法

白

纸张。

MAX II器件有三种速度等级： -3，-4 ， -5与-3的存在

最快的。这些速度等级代表整体相对表现，

没有任何特定的时序参数。对于传播延迟时序数

每个速度等级和密度范围内，请参阅第一章

DC &开关

的特点。

表1-2

显示MAX II器件速度等级的产品。

表1-2。 MAX II速度等级

速度等级

设备

-3

EPM240

EPM570

EPM1270

EPM2210

-4

-5

MAX II器件采用节省空间的FINELINE BGA

，微

FINELINE BGA和薄型四方扁平封装（ TQFP ）封装（见

表1-3

和

1–4).

MAX II器件在相同的支持纵向移植

包（例如，你可以在EPM570 ， EPM1270之间迁移，并

在EPM2210器件

256引脚FINELINE BGA封装）。垂直迁移意味着你可以

迁移到设备的专用引脚和JTAG引脚是相同的，并

电源引脚的子集或超集跨设备的给定包

密度。在任何包中的最大密度最高的数

电源引脚;你必须布局的规划最大的密度封装

提供必要的电源引脚的迁移。对于I / O引脚的迁移

跨越密度，交叉引用使用设备的可用I / O引脚

引脚输出一个给定的封装类型的所有计划中密度来确定

该I / O引脚可以迁移。在Quartus

II可以软件

自动交叉引用和地点时，给予了所有引脚为你

设备迁移列表。

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2006年12月

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1–3

MAX II器件手册，卷1

特点

表1-3 。 MAX II封装&用户I / O引脚

100-Pin

微

FINELINE

BGA

(1)

设备

100-Pin

FINELINE

BGA

(1)

100-Pin

TQFP

144-Pin

TQFP

256-Pin

微

FINELINE

BGA

(1)

160

212

256-Pin

FINELINE

BGA

324-Pin

FINELINE

BGA

EPM240

EPM570

EPM1270

EPM2210

注意

表1-3 ：

(1)

116

160

212

204

272

可仅无铅版本3.3 V / 2.5 V器件封装。

表1-4 。 MAX II TQFP ， BGA FINELINE ， &微FINELINE BGA封装尺寸

100-Pin

微

FINELINE

BGA

0.5

6X6

包

100-Pin

FINELINE

BGA

121

11 X 11

100-Pin

TQFP

0.5

256

16 × 16

144-Pin

TQFP

0.5

484

22 × 22

256-Pin

微

FINELINE

BGA

0.5

121

11 X 11

256-Pin

FINELINE

BGA

289

17 × 17

324-Pin

FINELINE

BGA

361

19 × 19

间距（mm ）

面积（mm2）

长×宽

（毫米×毫米）

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