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EP7212
EP7212
特点
n
ARM720T处理器
- ARM7TDMI CPU
- 8 K字节的4路组相联高速缓存
- MMU具有64项TLB (转换后备缓冲器)
- 写缓冲器
视窗
CE启用
- 可支持Thumb码
n
动态可编程时钟速度
高性能,低功耗
系统级芯片与LCD
控制器和数字音频
接口(DAI )
概观
该EP7212是专为超低功耗应用
系统蒸发散如组织者/掌上电脑,双向寻呼机,
智能手机或任何垂直PDA设备
功能的数字音频退役的附加功能
PRESSION 。该装置的核心逻辑功能是
建立在一个ARM720T处理器, 8 K字节
4路组相联的统一高速缓存和写
缓冲区。纳入ARM720T是
增强的存储器管理单元(MMU ),其
可以支持复杂的操作系统
像微软的Windows CE 。
(续)
18 , 36 , 49 ,和74 MHz的2.5 V
n
性能匹配的100 MHz的英特尔
基于Pentium的PC
n
超低功耗
- 专为那些需要长电池寿命的应用
而使用标准的AA / AAA电池或可充电
细胞
- 典型的幂数
q
90毫瓦74兆赫的工作状态
q
30毫瓦频率为18MHz的工作状态
q
10毫瓦,在空闲状态( CPU时钟停止,
一切运行)
q
<1 mW的待机状态( “开”实时时钟,
一切停止)
(续)
功能框图
13 MHz输入
3.6864兆赫
PLL
内部数据总线
D[0-31]
ARM720T
32.768千赫
NPOR , RUN ,
RESET , WAKEUP
吉巴督, EXTPWR
PWRFL , BATCHG
EINT [1-3] , FIQ ,
MEDCHG
闪烁的LED驱动器
端口A,B , D( 8位)
端口E ( 3位)
KEYBD驱动( 0-7 )
驱动蜂鸣器
DC到DC
ADCCLK , ADCIN ,
ADCOUT , SMPCLK ,
ADCCS
SSIClk的, SSITXFR ,
SSITXDA , SSIRXDA ,
SSIRSFR
32.768-KHZ
振荡器
国家控制
动力
管理
打断
调节器
RTC
GPIO
PWM
SSI1 (ADC)的
SSI2
编解码器
定时器
COUNTERS(2)
片上
引导ROM
8-KBYTE
缓存
MMU
卜FF器
内存控制器
ARM7TDMI
CPU核心
CL- PS6700 INTF
扩展CNTRL
PB [ 0-1] , NCS [ 4-5 ]
EXPCLK ,WORD NCS [0-3 ] ,
EXPRDY ,写
教育部, MWE ,
RAS [ 0-1] , CAS [ 0-3 ]
DRAM CNTRL
内部地址总线
A[0-27],
DRA[0-12]
试验
发展
LCD驱动
LCD DMA
ICE- JTAG
液晶显示
调节器
片上SRAM
38,400 BYTES
UART1
UART2
红外
LED和
光电二极管
ASYNC
接口1
ASYNC
接口2
EPB桥
EPB BUS
Cirrus Logic公司,公司
P.O.箱17847 ,奥斯汀,德克萨斯州78760
( 512 ) 445 7222传真: ( 512 ) 445 7851
http://www.cirrus.com
版权所有 Cirrus Logic公司,公司2000
(版权所有)
DS474PP1
FEB 00
1
EP7212
低功耗系统级芯片与LCD控制器和数字音频接口
特点
(续)
n
先进的音频解码器/解压缩
能力
- 允许对支持多种音频解压
算法
- 支持MPEG 1 , 2 , & 2.5层3音频解码,
包括ISO标准的MPEG 1 & 2层3的支持
所有标准采样率和比特率
- 支持自适应比特率的比特流
- DAI (数字音频接口)提供无缝接口
低功耗的DAC ,ADC和编解码器
n
LCD控制器
- 可直接与单一扫描单色面板
液晶显示
- 面板宽度尺寸从32到1024个像素可编程
在16个像素的增量
视频帧缓冲大小可编程至高达
128千字节
- 每1个,2个,或者4个比特的像素位
n
DRAM控制器
- 同时支持16位和32位宽的DRAM
- 13 MHz的EDO支持(快速页面模式的支持,并
18 MHz工作频率只)
n
内存控制器
- 解码最多可达6个单独的内存段
每256兆字节
- 每个段可以CON组fi gured为8位,16位或32位
宽和支持页模式访问
- 传统的可编程ROM的访问时间/
SRAM / FLASH存储器
- 支持可移动闪存卡接口
- 允许连接到可移动闪存卡
除了扩展闪存模块
n
快速的片上SRAM 38,400字节( 0x9600 )
n
同步串行接口
- ADC ( SSI )接口:仅用于主控模式; SPI
Microwire1
兼容( 128 kbps的操作)
n
片上ROM ;制造支持
n
27位的通用I / O
- 3个8位和一个3位GPIO端口
- 支持扫描键盘矩阵
n
两个UART ( 16550型)
- 支持比特率最高可达115.2 kbps的
- 包含两个16字节的FIFO的TX和RX
- UART1支持调制解调器控制信号
n
的SIR (高达115.2 kbps)表示的红外编码器/解码器
- IrDA(红外数据协会) SIR协议编码器/
解码器
n
的DC- DC转换器接口(PWM)的
- 提供具有可编程2 96 - kHz的时钟输出
占空比的值(1 -在-16 15在-16) ,可用于对
驱动器的DC -DC转换器
n
两个定时器计数器
n
208引脚LQFP或新的256引脚PBGA封装
n
可提供评估板以BOM ,原理图,
n
n
n
n
示例代码和设计数据库
支持最多两个超低功耗CL- PS6700
PC卡控制器
从RTC专用LED闪光引脚
完整的JTAG边界扫描和嵌入式ICE
支持
商业工作温度范围
程序的执行和/或作为帧缓冲器
概观
(续)
该EP7212还包括一个32位的Y2K兼容
实时时钟和比较。
待机 -
这种状态相当于在计算机
感关闭(不显示) ,主
振荡器关闭。作为密钥的事件,例如
按可唤醒处理器。
电源管理
该EP7212是专为超低功耗操作
化。它的核心运行功率仅为2.5伏,它的I / O有
为2.5V - 3.3V。的动作范围的装置,具有
三种基本电源状态:
工作 -
这种状态是充分表现
状态。所有的时钟和外设逻辑是
启用。
IDLE =
这种状态是一样的操作
状态,除了CPU时钟停止状态等待时
荷兰国际集团的事件诸如键按下。
存储器接口
有两种主要的外部存储接口。
第一个是ROM / SRAM /闪存式间
脸上有可编程的等待状态和时序
包括突发模式功能,有八个芯片选择
解码寻址六256 MB的部分
空间。为了获得最大的灵活性,每个银行可以
规定为8 ,16或32位宽。这允许
使用的8比特宽的引导ROM选项以最小化过
2
DS474PP1
EP7212
低功耗系统级芯片与LCD控制器和数字音频接口
概观
(续)
所有的系统成本。片上引导ROM可以用来
在产品制造到串行下载系统
代码到系统的FLASH存储器。为了进一步微型
程度降低系统存储器的要求和成本,在
ARM的Thumb
支持的指令集,从而提供
在16位使用高速32位操作
操作码和高产业界领先的代码密度。
第二个是可编程的16位或32位宽的
DRAM的接口,允许最多的直接连接
DRAM的两个存储体,每个存储体包含256个
兆字节。为了保证尽可能低的功率变
消耗时, EP7212支持自刷新DRAM中,
其中由该装置被放置在一个低功耗状态
当它进入低功耗待机状态。 EDO
和快速页DRAM的支持。
一个DMA地址发生器还提供了
取视频显示数据,从LCD控制器
主要DRAM内存。显示帧缓冲启动
地址是可编程的。另外,内置的
LCD控制器可以利用外部或内部SRAM
对于存储器,这样就省去了对DRAM的。
串行接口
在EP7212包括两个16550型UART的RS-
232串行通信,这两者都具有两个
16字节的FIFO ,用于接收和发送数据。
UART的支持比特率最高可达115.2 kbps的。一
IrDA的SIR协议编码器/解码器可选项 -
同盟切换到RX / TX信号到/从一个
UART的,使这些信号来驱动的红外
直接通信接口。
数字音频接口( DAI )
在EP7212集成了一个接口,以实现直接
连接到许多低成本,低功耗,高品质
音频转换器。具体地,代可直接
与水晶界面
CS43L41 / 43分之42低
功率音频DAC和水晶
CS53L32低
电源ADC。这些设备的一些功能数字
低音和高音增强,数字音量控制和
压缩限幅器功能。
包装
在EP7212可在一个208引脚LQFP封装
和一个256引脚PBGA封装。
数字音频功能
在EP7212采用了强大的32位RISC流程 -
荷兰国际集团的发动机来实现音频解压缩algo-
rithms软件。板上的RISC的性质
处理器和高效的C编译器的可用性
与其他软件开发工具,确保了
广泛的音频压缩算法可以
很容易被移植到和运行上的EP7212 。
系统设计
所示系统框图,简单地增加
所需内存和外设的高度
集成EP7212完成一个小功率系统
的解决方案。所有必要的接口逻辑集成
片上。
DS474PP1
3
EP7212
低功耗系统级芯片与LCD控制器和数字音频接口
水晶
水晶
MOSCIN
RTCIN
CS[4]
PB0
EXPCLK
DD[3:0]
CL1
CL2
FM
M
COL [7 :0]的
液晶显示模块
D[31:0]
键盘
的PA [7:0 ]
PB [ 7:0]
PD [ 7:0]
PE [2:0 ]
PC卡
插座
CL-PS6700
PC卡
调节器
A[27:0]
教育部
EP7212
RAS[1]
RAS[0]
×
16
DRAM
×
16
DRAM
×
16
DRAM
×
16
DRAM
CAS[0]
CAS[1]
CAS[2]
CAS[3]
NCS[0]
NCS[1]
POR
PWRFL
吉巴督
EXTPWR
BATCHG
RUN
唤醒
驱动器[ 1 : 0 ]
FB [1 :0]的
SSIClk的
SSITXFR
SSITXDA
SSIRXDA
动力
供电单元
比较
DC
输入
电池
直流 - 直流
转换器
CODEC/SSI2/
×
16
FL灰
×
16
FL灰
×
16
FL灰
×
16
FL灰
CS [N ]
LEDDRV
PHDIN
RxD1/2
TxD1/2
DSR
CTS
DCD
ADCCLK
ADCCS
ADCOUT
ADCIN
SMPCLK
红外LED和
光电二极管
外部MEMORY-
MAPPED扩张
缓冲器
2
×
RS-232
收发器
CS[2]
CS[3]
额外的I / O
缓冲器
锁存器
ADC
DIGITIZER
一个EP7212为基础的系统
4
DS474PP1
EP7212
EP7212
目录
1.约定...................................................................................................................... 11
1.1缩略语.............................................. .............................................. 11
1.2计量单位...................................................................................................... 12
1.3一般约定........................................................................................................ 12
1.4引脚说明约定.............................................. ............................................... 12
2.密码信息................................................................................................................ 13
2.1 208引脚LQFP封装引脚图........................................... .................................................. 13
2.2引脚说明................................................................................................................ 14
2.2.1外部信号功能
................................................................................... 14
2.2.2 SSI /编解码器/ DAI引脚复用........................................ ..................................... 18
2.2.3输出双向引脚.......................................... .......................................... 18
3.功能说明.............................................. ................................................. 19
3.1 CPU核心.......................................................................................................................... 20
3.2状态控制..................................................................................................................... 21
3.2.1待机状态.......................................................................................................... 21
3.2.1.1 UART在待机状态........................................... .................................... 22
3.2.2空闲状态................................................................................................................. 23
3.2.3键盘中断............................................. .................................................. .... 23
3.3上电排序......................................................................................................... 23
3.4复位............................................................................................................................... 24
3.5时钟............................................................................................................................... 25
3.5.1片上PLL ............................................................................................................ 25
锁相环接口3.5.1.1特性.......................................... .................. 25
3.5.2外部时钟输入( 13 MHz)的........................................ ........................................ 26
3.5.3动态时钟的PLL时钟模式.................................... 26时切换
3.6中断控制器............................................................................................................ 27
3.6.1中断延迟在不同国家.......................................... ........................... 27
3.6.1.1运行状态............................................. .............................................. 27
3.6.1.2空闲状态..................................................................................................... 29
3.6.1.3待机状态............................................. ................................................. 29
3.7 EP7212引导ROM .......................................................................................................... 29
3.8内存和I / O扩展接口.......................................... ..................................... 30
3.9 DRAM控制器与EDO支持............................................ ..................................... 31
3.10 CL- PS6700 PC卡控制器接口.......................................... ............................. 33
3.11字节序..................................................................................................................... 36
3.12内部UART接口(两个)和SIR编码器......................................... ................................ 36
3.13串行接口.............................................................................................................. 38
联系Cirrus Logic公司支持
对于直接销售,分销和销售代表接触的完整列表,请访问Cirrus Logic公司网站:
http://www.cirrus.com/corporate/contacts/
初步产品信息描述了正在生产中的产品,但其全面的特征数据尚未公布。先期产品信息
描述了正在开发中,受发展变化的产品。 Cirrus Logic公司,公司已经取得了最大的努力,以确保信息包含
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复印,复制,储存于检索系统或传播,以任何形式或通过任何手段(电子,机械,照相,或以其他方式)未经PRIO
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EP7212
EP7212
特点
n
ARM720T处理器
- ARM7TDMI CPU
- 8 K字节的4路组相联高速缓存
- MMU具有64项TLB (转换后备缓冲器)
- 写缓冲器
视窗
CE启用
- 可支持Thumb码
n
动态可编程时钟速度
高性能,低功耗
系统级芯片与LCD
控制器和数字音频
接口(DAI )
概观
该EP7212是专为超低功耗应用
系统蒸发散如组织者/掌上电脑,双向寻呼机,
智能手机或任何垂直PDA设备
功能的数字音频退役的附加功能
PRESSION 。该装置的核心逻辑功能是
建立在一个ARM720T处理器, 8 K字节
4路组相联的统一高速缓存和写
缓冲区。纳入ARM720T是
增强的存储器管理单元(MMU ),其
可以支持复杂的操作系统
像微软的Windows CE 。
(续)
18 , 36 , 49 ,和74 MHz的2.5 V
n
性能匹配的100 MHz的英特尔
基于Pentium的PC
n
超低功耗
- 专为那些需要长电池寿命的应用
而使用标准的AA / AAA电池或可充电
细胞
- 典型的幂数
q
90毫瓦74兆赫的工作状态
q
30毫瓦频率为18MHz的工作状态
q
10毫瓦,在空闲状态( CPU时钟停止,
一切运行)
q
<1 mW的待机状态( “开”实时时钟,
一切停止)
(续)
功能框图
13 MHz输入
3.6864兆赫
PLL
内部数据总线
D[0-31]
ARM720T
32.768千赫
NPOR , RUN ,
RESET , WAKEUP
吉巴督, EXTPWR
PWRFL , BATCHG
EINT [1-3] , FIQ ,
MEDCHG
闪烁的LED驱动器
端口A,B , D( 8位)
端口E ( 3位)
KEYBD驱动( 0-7 )
驱动蜂鸣器
DC到DC
ADCCLK , ADCIN ,
ADCOUT , SMPCLK ,
ADCCS
SSIClk的, SSITXFR ,
SSITXDA , SSIRXDA ,
SSIRSFR
32.768-KHZ
振荡器
国家控制
动力
管理
打断
调节器
RTC
GPIO
PWM
SSI1 (ADC)的
SSI2
编解码器
定时器
COUNTERS(2)
片上
引导ROM
8-KBYTE
缓存
MMU
卜FF器
内存控制器
ARM7TDMI
CPU核心
CL- PS6700 INTF
扩展CNTRL
PB [ 0-1] , NCS [ 4-5 ]
EXPCLK ,WORD NCS [0-3 ] ,
EXPRDY ,写
教育部, MWE ,
RAS [ 0-1] , CAS [ 0-3 ]
DRAM CNTRL
内部地址总线
A[0-27],
DRA[0-12]
试验
发展
LCD驱动
LCD DMA
ICE- JTAG
液晶显示
调节器
片上SRAM
38,400 BYTES
UART1
UART2
红外
LED和
光电二极管
ASYNC
接口1
ASYNC
接口2
EPB桥
EPB BUS
Cirrus Logic公司,公司
P.O.箱17847 ,奥斯汀,德克萨斯州78760
( 512 ) 445 7222传真: ( 512 ) 445 7851
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(版权所有)
DS474PP1
FEB 00
1
EP7212
低功耗系统级芯片与LCD控制器和数字音频接口
特点
(续)
n
先进的音频解码器/解压缩
能力
- 允许对支持多种音频解压
算法
- 支持MPEG 1 , 2 , & 2.5层3音频解码,
包括ISO标准的MPEG 1 & 2层3的支持
所有标准采样率和比特率
- 支持自适应比特率的比特流
- DAI (数字音频接口)提供无缝接口
低功耗的DAC ,ADC和编解码器
n
LCD控制器
- 可直接与单一扫描单色面板
液晶显示
- 面板宽度尺寸从32到1024个像素可编程
在16个像素的增量
视频帧缓冲大小可编程至高达
128千字节
- 每1个,2个,或者4个比特的像素位
n
DRAM控制器
- 同时支持16位和32位宽的DRAM
- 13 MHz的EDO支持(快速页面模式的支持,并
18 MHz工作频率只)
n
内存控制器
- 解码最多可达6个单独的内存段
每256兆字节
- 每个段可以CON组fi gured为8位,16位或32位
宽和支持页模式访问
- 传统的可编程ROM的访问时间/
SRAM / FLASH存储器
- 支持可移动闪存卡接口
- 允许连接到可移动闪存卡
除了扩展闪存模块
n
快速的片上SRAM 38,400字节( 0x9600 )
n
同步串行接口
- ADC ( SSI )接口:仅用于主控模式; SPI
Microwire1
兼容( 128 kbps的操作)
n
片上ROM ;制造支持
n
27位的通用I / O
- 3个8位和一个3位GPIO端口
- 支持扫描键盘矩阵
n
两个UART ( 16550型)
- 支持比特率最高可达115.2 kbps的
- 包含两个16字节的FIFO的TX和RX
- UART1支持调制解调器控制信号
n
的SIR (高达115.2 kbps)表示的红外编码器/解码器
- IrDA(红外数据协会) SIR协议编码器/
解码器
n
的DC- DC转换器接口(PWM)的
- 提供具有可编程2 96 - kHz的时钟输出
占空比的值(1 -在-16 15在-16) ,可用于对
驱动器的DC -DC转换器
n
两个定时器计数器
n
208引脚LQFP或新的256引脚PBGA封装
n
可提供评估板以BOM ,原理图,
n
n
n
n
示例代码和设计数据库
支持最多两个超低功耗CL- PS6700
PC卡控制器
从RTC专用LED闪光引脚
完整的JTAG边界扫描和嵌入式ICE
支持
商业工作温度范围
程序的执行和/或作为帧缓冲器
概观
(续)
该EP7212还包括一个32位的Y2K兼容
实时时钟和比较。
待机 -
这种状态相当于在计算机
感关闭(不显示) ,主
振荡器关闭。作为密钥的事件,例如
按可唤醒处理器。
电源管理
该EP7212是专为超低功耗操作
化。它的核心运行功率仅为2.5伏,它的I / O有
为2.5V - 3.3V。的动作范围的装置,具有
三种基本电源状态:
工作 -
这种状态是充分表现
状态。所有的时钟和外设逻辑是
启用。
IDLE =
这种状态是一样的操作
状态,除了CPU时钟停止状态等待时
荷兰国际集团的事件诸如键按下。
存储器接口
有两种主要的外部存储接口。
第一个是ROM / SRAM /闪存式间
脸上有可编程的等待状态和时序
包括突发模式功能,有八个芯片选择
解码寻址六256 MB的部分
空间。为了获得最大的灵活性,每个银行可以
规定为8 ,16或32位宽。这允许
使用的8比特宽的引导ROM选项以最小化过
2
DS474PP1
EP7212
低功耗系统级芯片与LCD控制器和数字音频接口
概观
(续)
所有的系统成本。片上引导ROM可以用来
在产品制造到串行下载系统
代码到系统的FLASH存储器。为了进一步微型
程度降低系统存储器的要求和成本,在
ARM的Thumb
支持的指令集,从而提供
在16位使用高速32位操作
操作码和高产业界领先的代码密度。
第二个是可编程的16位或32位宽的
DRAM的接口,允许最多的直接连接
DRAM的两个存储体,每个存储体包含256个
兆字节。为了保证尽可能低的功率变
消耗时, EP7212支持自刷新DRAM中,
其中由该装置被放置在一个低功耗状态
当它进入低功耗待机状态。 EDO
和快速页DRAM的支持。
一个DMA地址发生器还提供了
取视频显示数据,从LCD控制器
主要DRAM内存。显示帧缓冲启动
地址是可编程的。另外,内置的
LCD控制器可以利用外部或内部SRAM
对于存储器,这样就省去了对DRAM的。
串行接口
在EP7212包括两个16550型UART的RS-
232串行通信,这两者都具有两个
16字节的FIFO ,用于接收和发送数据。
UART的支持比特率最高可达115.2 kbps的。一
IrDA的SIR协议编码器/解码器可选项 -
同盟切换到RX / TX信号到/从一个
UART的,使这些信号来驱动的红外
直接通信接口。
数字音频接口( DAI )
在EP7212集成了一个接口,以实现直接
连接到许多低成本,低功耗,高品质
音频转换器。具体地,代可直接
与水晶界面
CS43L41 / 43分之42低
功率音频DAC和水晶
CS53L32低
电源ADC。这些设备的一些功能数字
低音和高音增强,数字音量控制和
压缩限幅器功能。
包装
在EP7212可在一个208引脚LQFP封装
和一个256引脚PBGA封装。
数字音频功能
在EP7212采用了强大的32位RISC流程 -
荷兰国际集团的发动机来实现音频解压缩algo-
rithms软件。板上的RISC的性质
处理器和高效的C编译器的可用性
与其他软件开发工具,确保了
广泛的音频压缩算法可以
很容易被移植到和运行上的EP7212 。
系统设计
所示系统框图,简单地增加
所需内存和外设的高度
集成EP7212完成一个小功率系统
的解决方案。所有必要的接口逻辑集成
片上。
DS474PP1
3
EP7212
低功耗系统级芯片与LCD控制器和数字音频接口
水晶
水晶
MOSCIN
RTCIN
CS[4]
PB0
EXPCLK
DD[3:0]
CL1
CL2
FM
M
COL [7 :0]的
液晶显示模块
D[31:0]
键盘
的PA [7:0 ]
PB [ 7:0]
PD [ 7:0]
PE [2:0 ]
PC卡
插座
CL-PS6700
PC卡
调节器
A[27:0]
教育部
EP7212
RAS[1]
RAS[0]
×
16
DRAM
×
16
DRAM
×
16
DRAM
×
16
DRAM
CAS[0]
CAS[1]
CAS[2]
CAS[3]
NCS[0]
NCS[1]
POR
PWRFL
吉巴督
EXTPWR
BATCHG
RUN
唤醒
驱动器[ 1 : 0 ]
FB [1 :0]的
SSIClk的
SSITXFR
SSITXDA
SSIRXDA
动力
供电单元
比较
DC
输入
电池
直流 - 直流
转换器
CODEC/SSI2/
×
16
FL灰
×
16
FL灰
×
16
FL灰
×
16
FL灰
CS [N ]
LEDDRV
PHDIN
RxD1/2
TxD1/2
DSR
CTS
DCD
ADCCLK
ADCCS
ADCOUT
ADCIN
SMPCLK
红外LED和
光电二极管
外部MEMORY-
MAPPED扩张
缓冲器
2
×
RS-232
收发器
CS[2]
CS[3]
额外的I / O
缓冲器
锁存器
ADC
DIGITIZER
一个EP7212为基础的系统
4
DS474PP1
EP7212
EP7212
目录
1.约定...................................................................................................................... 11
1.1缩略语.............................................. .............................................. 11
1.2计量单位...................................................................................................... 12
1.3一般约定........................................................................................................ 12
1.4引脚说明约定.............................................. ............................................... 12
2.密码信息................................................................................................................ 13
2.1 208引脚LQFP封装引脚图........................................... .................................................. 13
2.2引脚说明................................................................................................................ 14
2.2.1外部信号功能
................................................................................... 14
2.2.2 SSI /编解码器/ DAI引脚复用........................................ ..................................... 18
2.2.3输出双向引脚.......................................... .......................................... 18
3.功能说明.............................................. ................................................. 19
3.1 CPU核心.......................................................................................................................... 20
3.2状态控制..................................................................................................................... 21
3.2.1待机状态.......................................................................................................... 21
3.2.1.1 UART在待机状态........................................... .................................... 22
3.2.2空闲状态................................................................................................................. 23
3.2.3键盘中断............................................. .................................................. .... 23
3.3上电排序......................................................................................................... 23
3.4复位............................................................................................................................... 24
3.5时钟............................................................................................................................... 25
3.5.1片上PLL ............................................................................................................ 25
锁相环接口3.5.1.1特性.......................................... .................. 25
3.5.2外部时钟输入( 13 MHz)的........................................ ........................................ 26
3.5.3动态时钟的PLL时钟模式.................................... 26时切换
3.6中断控制器............................................................................................................ 27
3.6.1中断延迟在不同国家.......................................... ........................... 27
3.6.1.1运行状态............................................. .............................................. 27
3.6.1.2空闲状态..................................................................................................... 29
3.6.1.3待机状态............................................. ................................................. 29
3.7 EP7212引导ROM .......................................................................................................... 29
3.8内存和I / O扩展接口.......................................... ..................................... 30
3.9 DRAM控制器与EDO支持............................................ ..................................... 31
3.10 CL- PS6700 PC卡控制器接口.......................................... ............................. 33
3.11字节序..................................................................................................................... 36
3.12内部UART接口(两个)和SIR编码器......................................... ................................ 36
3.13串行接口.............................................................................................................. 38
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